TWI750161B - 電光感測器晶片總成及其形成方法 - Google Patents

電光感測器晶片總成及其形成方法 Download PDF

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Abstract

本發明提供一種電光感測器晶片總成(SCA)，其包含：一讀出積體電路(ROIC)；一偵測器，包含一基板、一緩衝層、一畫素層、及一包含複數個畫素之陣列，該陣列設置於該畫素層中；以及一互連層，夾置於該讀出積體電路與該畫素層之間且包含複數個冷焊式互連柱(cold welded interconnect post)，該等冷焊式互連柱可分別自該等畫素延伸至該讀出積體電路。自形成於該基板及該緩衝層中之一直視窗傳播之可見波長光係可穿透該偵測器而到達該等畫素其中之一或多者。

Description

電光感應器晶片總成及其形成方法
本發明係關於一種電光偵測器元件及一種出於對準目的而直接讀取畫素之方法。
在過去幾年內，已開發出併入有解析度日益變高之偵測器之電光感測器，相應地，便需要在對準及畫素共對齊方面具有愈來愈高精度之系統。確實，感測器光學系統現在要求使濾光片對準及畫素共對齊達到小於約2微米之解析度，以滿足效能要求。
當前對準技術在多個組裝階段相對於現在所需之較嚴格容差皆具有顯著對準誤差。此等階段包含偵測器混雜(hybridization)階段、感測器晶片組裝(sensor chip assembly；SCA)階段、接合濾光片對準階段、及光學系統對準階段、以及偵測器間對準階段。舉例而言，固有且顯著之容差疊加(tolerance stack-up)問題包含在感測器晶片組裝接合期間一讀出積體電路(read-out integrated circuit；ROIC)相對於一偵測器之放置準確度問題。達成此種準確放置既需要進行精確定位又需要所知量測值，而此可能皆難以獲得。若以電光感測器級來執行對準操作，則該等對準操作變為關鍵路徑活動且常常需要多次反覆以完成。在某些情形中，該等反覆包含對焦平面進行冷卻操作，以評估對準準確度，此會造成高成本且對利用反覆對準方法進行之感測器級整合操作在時間安排上造成顯著影響。
在最好情況下，甚至具有與對準操作相關聯之延遲及成本，當前對準技術仍具有混雜誤差(例如，約4微米至8微米)、感測器晶片組裝對準誤差、或濾光片對準誤差(約20微米)、及總對準誤差(約25微米)。
根據一個實施例，提供一種電光偵測器元件，其包含：一積體電路(integrated circuit；IC)；一偵測器，包含一基板、一緩衝層、一畫素層、及一包含複數個畫素之陣列，該陣列設置於該畫素層中；以及一互連層，夾置於該積體電路與該畫素層之間且包含複數個冷焊式互連柱(cold welded interconnect post)，該等冷焊式互連柱可分別自該等畫素延伸至該積體電路。自形成於該基板及該緩衝層中之一直視窗(direct view window)傳播之可見波長光係可穿透該偵測器而到達該等畫素其中之一或多者。
根據另一實施例，提供一種形成一電光偵測器元件之方法。該方法包含：組裝一偵測器，該偵測器包含一基板、一緩衝層、一畫素層、及一包含複數個畫素之陣列，該陣列設置於該畫素層中；在一積體電路(IC)與該畫素層之間夾置一互連層；將該積體電路與該偵測器混雜(hybridizing)，藉此冷焊出分別可自該等畫素延伸至該積體電路之複數個互連柱；在該基板及該緩衝層中於該等畫素其中之一或多者之一位置處形成一直視窗；以及使可見波長光自該直視窗傳播至該等畫素其中之該一或多者。
根據另一實施例，提供一種組裝一電光偵測器之方法。該方法包含：表徵一光學元件相對於一基座之一位置；對一電光偵測器元件進行直接讀取畫素對準；將該電光偵測器元件設置於該基座上；以及基於該所表徵位置及該直接讀取畫素對準而將該電光偵測器元件相對於該光學元 件對準。
藉由本發明之技術會達成其他特徵及優點。本發明之其他實施例及態樣將在本文中予以詳細闡述且被視為所主張發明之一部分。
100:影像偵測器
120:偵測裝置
140:讀出積體電路
160:單位單元
200:半導體基板
202:吸收體層
204:分離層
206:接觸層
300:單位單元
302a:第一觸點
302b:第二觸點
304:鈍化物
306a:直接接合互連件
306b:直接接合互連件
308:抗反射塗層
401:第一互連柱
402:第二互連柱
403:偵測器晶圓
404:讀出積體電路晶圓
601:電光感測器晶片總成
602:讀出積體電路
603:偵測器
604:互連層
605:直視窗
606:側面搬運V型凹槽
610:第一互連柱
611:第二互連柱
612:p型帽層
613:接觸金屬層
614:鈍化材料層
801:示波器
802:可見波長光
1101:金剛石尖頭車削頭
1102:金剛石尖頭車削機器
1201:遮罩
1202:蝕刻劑
1301:電光模組總成
1302:基座
1303:感測器晶片總成
1304:電光偵測器元件
1305:讀出積體電路
1306:支撐墊片
1307:光學元件總成
1308:邊框
1309:界定影像開孔
1310:光學元件
1311:剛性撓曲總成
1312:撓曲纜線
6021:墊片
6032:基板
6033:畫素
6034:緩衝層
6036:畫素層
6041:互連柱
L:光
為更完整地理解本發明，現在結合附圖及詳細說明作為參照，進行之以下簡要描述，其中相同參考編號表示相同部件：第1圖係為例示根據實施例之一影像偵測器之示意圖；第2圖係為根據實施例，在進行後處理以形成一單位單元之前，一半導體基板之剖視圖；第3圖係為根據實施例，以第2圖所示半導體基板製成之一單位單元之剖視圖；第4圖係為例示一電光感測器晶片總成組裝之一初始階段之示意性側視圖；第5圖係為例示一電光感測器晶片總成組裝之一末期階段之示意性側視圖；第6A圖係為根據實施例，一電光感測器晶片總成在一初始組裝階段之剖視圖；第6B圖係為根據實施例，一電光感測器晶片總成在一中間組裝階段之剖視圖；第6C圖係為根據實施例，一電光感測器晶片總成在一末期組裝階段之剖視圖； 第6D圖係為第6A圖所示電光感測器晶片總成之一畫素層之複數個畫素之平面圖；第7圖係為根據實施例之一電光感測器晶片總成之立體圖；第8圖係為根據實施例之一電光感測器晶片總成之一直視窗及一對應畫素之側視圖；第9圖係為根據實施例之一電光感測器晶片總成之一直視窗及一對應偏移畫素群組之側視圖；第10圖係為根據實施例之一電光感測器晶片總成之一直視窗及一對應畫素群組之側視圖；第11圖係為例示根據實施例，用於在一電光感測器晶片總成中形成一直視窗之一金剛石尖頭車削(diamond point turning；DPT)機械加工方法之示意性側視圖；第12圖係為例示根據實施例，用於在一電光感測器晶片總成中形成一直視窗之一化學蝕刻方法或一乾式蝕刻方法之示意性側視圖；以及第13圖係為根據實施例之一電光偵測器之剖視圖。
如下文將論述，對一偵測器與一積體電路(IC)元件(例如一讀出積體電路(ROIC))之混雜相關聯之誤差得以消除或實質上減小。此係藉由以金剛石尖頭車削(DPT)機械加工方法及/或蝕刻方法移除紅外線偵測器基板以暴露出偵測器之畫素結構並容許利用一對準示波器進行可見 光檢驗來達成，該對準示波器之準確度固有地係原本藉由紅外線(infrared；IR)偵測示波器所能達成之準確度之10倍以上，此歸因於可見光之較短波長。
第1圖係為例示根據實施例之一影像偵測器100之示意圖。影像偵測器100可係為一焦平面陣列(focal plane array；FPA)、主動畫素感測器(active pixel sensor；APS)、或任何其他適合之能量波長感測裝置。影像偵測器100可用作一攝影及/或影像擷取裝置(例如，一數位照相機、一視訊攝影機或、或其他類似裝置)之一組件。影像偵測器100可包含一偵測裝置120及一讀出積體電路140。
偵測裝置120包含由排列成一X×Y矩陣之複數個光敏/能量波長敏感偵測器單位單元160形成之一陣列。各該偵測器單位單元160可回應於入射於偵測器單位單元160上之光L而累積電荷或產生一電流及/或電壓且可對應於一所擷取電子影像中之一畫素。偵測器單位單元160其中之一或多者可包含一光伏打偵測器(例如，一光伏打單吸收體偵測器或一光伏打多吸收體(多接面)偵測器)、一障壁裝置偵測器(barrier device detector)、一位置敏感偵測器(position sensitive detector；PSD)、或其他適合之偵測器。偵測器單位單元160可包含任何適合之材料、摻雜劑濃度、層數目、層厚度、及/或基於光電偵測器之類型而選擇之其他特性。
讀出積體電路140可用於處理入射光(例如，用以形成表示入射光之一影像)。舉例而言，積體電路140與偵測裝置120介接，以接收一訊號，例如回應入射於偵測器單位單元160上之光而產生之所累加電荷或電流及/或電壓。積體電路140可包含一影像處理單元，且可包含硬體、軟體或韌體之一組合，該組合可運作以將所接收訊號轉換成一電子影像。
積體電路140可包含一包含被排列成一X×Y矩陣之複數個讀出積體電路單位單元之陣列，該X×Y矩陣對應於偵測器單位單元160之X×Y矩陣之手性(chiral)定向。因此，各該讀出積體電路單位單元可藉由一或多個直接接合互連件(例如直接金屬間互連件或銦互連件)與一對應偵測器單位單元160互連。該等互連件可係以晶圓級或以晶粒級製成。在前一種情形中，可藉由以下操作來製成互連件：將包含複數個讀出積體電路單位單元之陣列提供為一讀出積體電路晶圓且將包含複數個偵測器單位單元160之陣列提供為一偵測器晶圓，並藉由對讀出積體電路晶圓及偵測器晶圓進行加壓(pressurization)或擠壓(squeezing)以將此二者融合於一起而進行混雜。儘管使用晶圓能夠有效地製造影像偵測器100，但對讀出積體電路晶圓與偵測器晶圓之混雜可使得互連件實際上被冷焊且使得對互連件施加剪切應力(shear stress)，如下文將論述。
參照第2圖，其提供根據實施例，在進行後處理以形成偵測器單位單元160之前，一半導體基板200之剖視圖。半導體基板200可包含一障壁層或裝置，例如一少數載子同型裝置(minority carrier isotype device)或一異質接面裝置(heterojunction device)。該障壁層可係由以下形成：鎘鋅碲、鍺、碳化矽、銻化砷化鋁、銻化鎵、砷化鎵、氮化鎵、磷化鎵、銻化銦、砷化銦、銻化砷化銦、砷化銦鎵、氮化銦、磷化銦、汞鎘碲、矽鍺、或其他適合之半導體材料。
半導體基板200可更包含一吸收體層202、一分離層204、及一接觸層206。半導體基板200之各種層可生長於一基底基板上。該基底基板可包含任何實質上本質半導體基板(例如，純本質或經極輕摻雜)，包含但不限於矽、鎘鋅碲、鍺、碳化矽、銻化砷化鋁、銻化鎵、砷化鎵、氮化 鎵、磷化鎵、銻化銦、砷化銦、銻化砷化銦、砷化銦鎵、氮化銦、磷化銦、汞鎘碲、矽鍺、或其他適合之半導體材料。用於基底基板之材料可係基於欲自半導體基板200製成之一單位單元之所需特性而選擇。
吸收體層202可運作以吸收入射光子，俾使所吸收光子在吸收體層202中激發出正電荷及負電荷。吸收體層202可包含任何實質上經摻雜半導體基板(例如，介於約2×1014cm-3與約5×1017cm-3間之摻雜劑濃度)，包含但不限於上文關於基底基板所述之半導體。吸收體層202可係為一n型半導體、一p型半導體、或一本質半導體。用於吸收體層202之材料可係基於單位單元之所需特性而選擇(例如，可選擇能隙適於進行光子吸收且因此適於對一特定波長或波長範圍進行光偵測之一材料)。吸收體層202可被生長至介於約1.0微米(μm)與約25.0微米間之一厚度(例如，以確保使吸收體層202厚至足以擷取一特定強度之光，但又薄至足以收集光生電荷載子)。
分離層204可包含一障壁層、一接面層、或其他可運作以自吸收體層202接收帶電載子並將供在一第一觸點處收集之第一帶電載子從供在一第二觸點處收集之第二帶電載子分離之適合層。第一帶電載子可係為具有一第一極性或正極性之電荷，且第二帶電載子可係為具有一第二極性或負極性(例如，與第一帶電載子之極性相反之一極性)之電荷。分離層204可包含任何經摻雜或未摻雜半導體，包含但不限於上文關於基底基板所述之半導體。摻雜劑濃度可介於約2×1014cm-3與約5×1017cm-3之間。分離層204可包含與吸收體層202相同之摻雜類型(例如，二者皆為n型或二者皆為p型)。舉例而言，某些障壁裝置可在吸收體層202及分離層204中使用相同之摻雜類型。另一選擇為，分離層204可包含與吸收體層202不同之一摻 雜類型(例如，吸收體層202可包含n型摻雜且分離層204可包含p型摻雜，或反之亦然)。舉例而言，接面裝置及某些障壁裝置可在吸收體層202及分離層204中使用相反之摻雜。分離層204可被生長至介於約0.05微米與約2.0微米間之一厚度。用於分離層204之材料、分離層204之摻雜劑濃度、分離層204之厚度、及/或分離層204之其他物理特性可係基於單位單元之所需特性而選擇。
接觸層206可耦合至一或多個直接接合互連件，且各該直接接合互連件可運作以將帶電載子傳導至讀出積體電路140。接觸層206可包含任何經高度摻雜半導體基板(例如，介於約1×1016cm-3與約5×1018cm-3間之摻雜劑濃度)，包含但不限於上文關於基底基板所述之半導體。接觸層206可包含與吸收體層202相同之摻雜類型(例如，二者皆為n型或二者皆為p型)。另一選擇為，接觸層206可包含與吸收體層202不同之一摻雜類型(例如，吸收體層202可包含n型摻雜且接觸層206可包含p型摻雜，或反之亦然)。接觸層206可被生長至介於約0.1微米與約3.0微米間之一厚度。用於接觸層206之材料、接觸層206之摻雜劑濃度、接觸層206之厚度、及/或接觸層206之其他物理特性可係基於單位單元之所需特性而選擇。舉例而言，某些物理特性可係基於接觸層206之一所需電阻率而選擇。
如上所述，每一層之材料可係基於單位單元之所需特性而選擇。在某些實施例中，該等層可包含III-V族材料。該等III-V族材料可至少包含位於週期表之III族中之一第一元素及位於週期表之V族中之一第二元素。III族元素可在其最外電子殼層中具有三個電子；實例包含硼、鋁、鎵、銦、及鉈。V族元素可在其最外電子殼層中具有五個電子；實例包含氮、磷、砷、銻、及鉍。III-V族材料可極適於耐受與以一直接接合互連件將單位單 元與積體電路140互連相關聯之高溫度。在某些實施例中，III-V族材料可包含基底基板中之銻化鎵、吸收體層202及接觸層206中之銻化砷化銦、以及分離層204中之銻化砷化鋁。在某些實施例中，包含銻化物或汞鎘碲之材料可極適於被設計成偵測紅外線光之一單位單元。在某些實施例中，包含砷化銦鎵或矽鍺之材料可極適於被設計成偵測可見光之一單位單元。
在已形成上述各種層其中之一或多者之後，可使用半導體基板200來製作一或多個一或多個單位單元，如下文更詳細所述。
參照第3圖，其提供單位單元300之剖視圖。如第3圖中所示，單位單元300包含吸收體層202、分離層204及接觸層206之相應部分。由接觸層206之相應部分形成一或多個第一觸點302a及一或多個第二觸點302b。第一觸點302a促進將第一帶電載子(例如，訊號載子)自分離層204之相應部分傳導至讀出積體電路140。第二觸點302b促進將帶電載子(例如，接地載子)自吸收體層202之相應部分傳導至讀出積體電路140。第一觸點302a可藉由鈍化物304與第二觸點302b電性隔離。直接接合互連件306a(例如，訊號互連件)可將第一觸點302a與讀出積體電路140互連，且直接接合互連件306b(例如，接地互連件)可將第二觸點302b與讀出積體電路140互連。單位單元300可視需要包含沿著吸收體層202之至少一部分定位之一抗反射塗層308，以防止電磁能被反射離開單位單元300。
自半導體基板200製作單位單元300可涉及利用任何適合之蝕刻技術(例如，濕式化學蝕刻或乾式電漿蝕刻)自半導體基板200蝕刻出吸收體層202、分離層204及接觸層206之相應部分。可蝕刻各種層，以為單位單元300界定一畫素區域(例如，當一單位單元300用作由複數個單位單元300形成之一陣列中之一單位單元時)。舉例而言，可蝕刻接觸層206之相 應部分，以界定半導體基板200的欲電性耦合至單位單元300外部之其他電性及/或電子電路(例如讀出積體電路140)之一或多個區域。
在吸收體層202、分離層204及/或接觸層206之相應部分已被蝕刻之後，可在單位單元300之暴露部分之頂部上沉積鈍化物304。鈍化物304可包含二氧化矽、氮化矽、氧化鋁、氧化鉿、碲化鎘、或任何其他適合之材料。可藉由熱蒸鍍(thermal evaporation)、分子束磊晶(molecular beam epitaxy)、電漿增強化學氣相沉積(plasma enhanced chemical vapor deposition)、原子層沉積(atomic layer deposition)、或任何其他適合之技術在半導體基板200上沉積鈍化物304。在沉積鈍化物304之後，可移除鈍化物304之複數個部分(例如，藉由濕式化學蝕刻或乾式電漿蝕刻)，以暴露出接觸層206之剩餘部分。鈍化物304可用於將半導體基板200之各部分電性隔離。
第一觸點302a可包含形成於接觸層206的未被鈍化物304覆蓋之相應部分上之金屬，且可包含一通常導電材料(例如，銦、鋁、銀、銅、金、或其他適合之金屬)，以經由對應直接接合互連件306a將接觸層206電性耦合至讀出積體電路140。可藉由植入、沉積、磊晶、或任何其他適合之製作技術在半導體基板200上形成第一觸點302a。
可以晶圓級或晶粒級進行直接接合互連件306a之接合製程。亦即，參照第4圖及第5圖，直接接合互連件306a可分別由複數個第一互連柱401及複數個第二互連柱402形成，第一互連柱401可由銦或其他類似材料形成且自單位單元160朝向讀出積體電路140延伸，第二互連柱402在第一互連柱401之遠端與讀出積體電路140之間延伸。在接合製程期間，藉由對偵測器晶圓403及讀出積體電路晶圓404進行加壓或擠壓來使第一互連柱 401與第二互連柱402混雜。儘管此種對晶圓及晶圓級處理之使用會達成有效製造，但對偵測器晶圓403及讀出積體電路晶圓404進行加壓及擠壓可能會使得第一互連柱401及第二互連柱402被冷焊且對第一互連柱401及第二互連柱402施加剪切應力。此等剪切應力會引起某一分量移位，此係為位置誤差之一起因。此種移動需要另外對畫素移位進行量測，進而引入位置誤差並會浪費所知位置。
為此，參照第6A圖、第6B圖、第6C圖、第6D圖、及第7圖，一電光感測器晶片總成601具備一積體電路(例如，讀出積體電路)及複數個偵測器組件，該積體電路及該等偵測器組件類似於上文所述者。亦即，電光感測器晶片總成601包含：一讀出積體電路602，類似於上文所述之讀出積體電路140、或另一類似積體電路總成；一墊片(shim)6021，鄰近讀出積體電路602而設置；一偵測器603，類似於上文所述之偵測裝置120；以及一互連層604。至少在一初始階段，偵測器603包含一基板6032及一包含複數個畫素6033之陣列。基板6032包含一緩衝層6034及一畫素層6036。包含複數個畫素6033之陣列設置於畫素層6036中。互連層604夾置於讀出積體電路602與畫素層6036之間且包含複數個互連柱6041。互連柱6041可係藉由上文參照第4圖及第5圖所述製程而形成且因此可包含第一互連柱610(例如，銦互連件)及第二互連柱611。無論如何，互連柱6041皆可因剪切應力及相對於其對應畫素6033之位置移位(由將讀出積體電路602加壓及擠壓至偵測器603之製程引起)而展現出變形。無論如何，互連柱6041分別可自畫素6033延伸至讀出積體電路602。
根據實施例，緩衝層6034可包含紅外線可透過之半導體材料，例如碲化鎘(cadmium telluride；CdTe)、硒化鎘(cadmium selenide； CdSe)、硒化鋅(zinc selenide；ZnSe)、或碲化鋅(zinc telluride；ZnTe)，且畫素層6036可例如包含一n型汞鎘碲(mercury cadmium tellurium；HgCdTe)吸收體材料。同時，各該畫素6033可包含：一p型帽層612；一接觸金屬層613，夾置於p型帽層612與對應互連柱6041之間；一鈍化材料層614，環繞接觸金屬層613；以及一上覆玻璃(overglass)層(圖中未顯示)，設置於鈍化材料層614及接觸金屬層613上。
根據實施例，基板6032及緩衝層6034之相應部分被形成為界定至少一或多個直視窗605。如第6C圖及第6D圖中所示，各該直視窗605延伸穿過基板6032及緩衝層6034且通常係界定於畫素6033其中之對應一或多者之一平面位置處或極靠近該平面位置處。此處，該平面位置係沿著X軸線及Y軸界定，其中Z軸線係沿著基板6032及緩衝層6034之一深度尺寸界定(即，在第6A圖、第6B圖及第6C圖中係自上至下)。根據其他實施例，在形成直視窗605之後緩衝層6034之剩餘部分被形成為薄至足以使自直視窗605傳播之可見波長光能夠穿透至畫素6033其中之一或多者。因此，畫素6033至少其中之一可透過直視窗605而看到(被放大)，在此期間實際上即進行了直接讀取畫素對準程序(direct read pixel alignment procedure)。
亦即，直接讀取畫素對準程序可利用可見波長光來輔助對畫素位置進行直接讀取，而無需進行多次傳送或使用紅外線量測設備。此反而可用於促進對電光感測器晶片總成601進行畫素對準。此外，由於可見波長光之波長係為可被透射穿過基板材料之其他形式之電磁波譜(例如紅外線波長光)之波長之1/10以下，因而與利用紅外線光進行之紅外線畫素偵測之潛在準確度相較，藉由直視窗605來促進之直接讀取畫素對準程序之一準確度得以顯著改良。
根據實施例，且如第7圖中所示，電光感測器晶片總成601可包含或可被形成為界定複數個側面搬運V型凹槽606。側面搬運V型凹槽606沿著基板6032之外邊緣延伸且輔助對電光感測器晶片總成601進行搬運及移動，俾使電光感測器晶片總成601可被放置於一偵測模組總成(例如，下文欲闡述之第13圖所示電光模組總成1301)中，而不會具有使讀出積體電路602或偵測器603受到損壞之風險。
參照第8圖至第10圖，現在將闡述直視窗605之實施例。
如第8圖中所示，每一個別直視窗605可係與一個別畫素6033以一1：1對應關係而提供。在此等情形中，直視窗605可在大小上大體類似於或略大於對應畫素6033(或者畫素之面積被處理成略大)且可被定位於與畫素6033實質上類似之一平面位置處。此處，直視窗605之略大大小可用以考量到直視窗605與畫素6033之輕微位置不對準、以及對應互連柱6041之剪切或移位、以及容置正使用之若干個光學量測裝置。可提供一示波器(scope)801(例如一高精度z型示波器)，以輔助利用可見波長光802透過直視窗605來對畫素6033進行觀看及直接讀取對準。根據實施例，配置並執行對畫素6033之直接讀取對準，以基於與畫素邊緣之對比度來找出並定位畫素中心。
如第9圖中所示，每一個別直視窗605可係與多個畫素6033以一1：2-1：4偏移對應關係而提供。在此等情形中，直視窗605可在大小上大於多個畫素6033其中之每一者且可被定位於一偏移平面位置處(例如，定心於邊緣或隅角上)。如上所述，可提供一示波器801(例如高精度z型示波器)，以輔助利用可見波長光802透過直視窗605對多個畫素6033進行觀看及直接讀取對準。根據實施例，配置並執行對多個畫素6033之直接讀取對準，以基於與畫素邊緣之對比度而找出並定位畫素中心。
如第10圖中所示，每一個別直視窗605可係與多個畫素6033以一1：4+對應關係而提供。在此等情形中，直視窗605可在大小上實質上大於多個畫素6033其中之每一者。較寬窗構形容許使用一較高放大率觀看示波器且提供較多畫素邊緣，以改良量測值之統計顯著性，藉此改良所知量測值。如上所述，可提供一示波器801(例如高精度z型示波器)，以輔助利用可見波長光802透過直視窗605對多個畫素6033進行觀看及直接讀取對準。根據實施例，配置並執行對多個畫素6033之直接讀取對準，以基於與畫素邊緣之對比度來找出並定位畫素中心。
雖然參照一單個畫素6033或通常被分組於一起之多個畫素6033闡述了第8圖至第10圖所示實施例，但應理解，此並非係必需的且存在其他實施例。舉例而言，在第8圖所示情形中，可提供多個直視窗605，以促進在多個位置處或例如在電光感測器晶片總成601之2/3維陣列處執行多次直接讀取畫素對準。
根據實施例，並參照第11圖及第12圖，可藉由以下至少其中之一在基板6032及緩衝層6034中形成直視窗605：金剛石尖頭車削(diamond point turning；DPT)機械加工製程(參見第11圖)或其他類似機械加工製程、及/或化學蝕刻或乾式蝕刻(參見第12圖)或其他類似蝕刻製程。對於其中採用金剛石尖頭車削機械加工製程之彼等情形且如第11圖中所示，藉由一金剛石尖頭車削機器1102之複數個伺服元件來相對於基板6032及緩衝層6034對一金剛石尖頭車削頭1101進行定位及控制。金剛石尖頭車削頭1101反覆地自基板6032及然後自緩衝層6034移除材料。
在採用化學蝕刻製程來形成直視窗605之情形下且如第12圖中所示，藉由遮罩1201遮蔽基板6032的位於欲形成直視窗605之區域以外之 部分，且將基板6032之所得暴露部分及然後將緩衝層6034之所得暴露部分暴露於一適當蝕刻劑1202或類似蝕刻製程。乾式蝕刻製程將微粒(離子)或氣體衝擊(gas impingement)併入至基板6032及緩衝層6034之複數個部分中以進行材料移除，進而形成一直視窗605。
雖然上文將金剛石尖頭車削機械加工製程及蝕刻製程闡述為被分別採用，但應理解，其亦可被組合地採用。舉例而言，如第6A圖、第6B圖及第6C圖之序列中所示，可藉由金剛石尖頭車削機械加工製程移除基板6032之外層，以達成第6B圖所示經薄化基板6032狀態。隨後，可藉由一種蝕刻方法更仔細地移除基板6032之內層及緩衝層6034，以確保在形成第6C圖所示直視窗605時不會將畫素6033之任何部分不合乎需要地移除。
參照第13圖，一電光模組總成1301可包含一基座1302及一感測器晶片總成1303。此感測器晶片總成1303包含一如上所述之電光偵測器元件1304、一如上所述之讀出積體電路1305及一支撐墊片1306。基座1302可更包含一光學元件總成1307，光學元件總成1307被形成為界定一光學元件(例如，一濾光片)1310，光學元件1310以一界定影像開孔1309被緊固至一邊框1308中。另外，基座1302可支撐一剛性撓曲總成1311，剛性撓曲總成1311具有數目變化之撓曲纜線1312或一母板總成，以用於電性互連。可藉由以下來組裝電光模組總成1301：表徵光學元件1310相對於基座1302之一位置、對電光偵測器元件1304進行直接讀取畫素對準操作、將電光偵測器元件1304設置於基座1302上、以及基於所表徵位置及直接讀取畫素對準操作之結果而將電光偵測器元件1304相對於光學元件(例如，濾光片)1310對準(例如，三維對準)。該組裝步驟可更包含：基於直接讀取畫素對準操作之結果，利用對準特徵及偵測器畫素將另一偵測器陣列1303設置於 基座1302上或將另一電光模組總成1301對準。
根據實施例，在電光偵測器元件1304已經受直接讀取畫素對準操作之情形下，可以實質上提高之準確度來完成對電光偵測器1301之組裝。
以下申請專利範圍中所有構件或步驟加功能元件之對應結構、材料、動作及等效內容皆旨在包含結合所具體主張之其他所主張元件來執行功能之任何結構、材料或動作。對本發明之說明係為進行例示及闡述而呈現，而非旨在係為詳盡的或將本發明限於所揭露之形式。此項技術中具有通常知識者將明瞭諸多潤飾及變化形式，此並不背離本發明之範圍及精神。選擇及闡述該等實施例係為了最佳地解釋本發明之原理及實際應用，並使此項技術中其他具有通常知識者能夠針對各種實施例來理解本發明，該等實施例具有適合於所構想的特定用途之各種潤飾。
儘管已闡述了本發明之較佳實施例，但將理解，熟習此項技術者在現在及將來皆可作出屬於以下申請專利範圍之範疇內之各種改良及增強形式。此申請專利範圍應被理解為維持對首先闡述之發明之恰當保護。
601:電光感測器晶片總成
602:讀出積體電路
603:偵測器
604:互連層
610:第一互連柱
611:第二互連柱
612:p型帽層
613:接觸金屬層
614:鈍化材料層
6021:墊片
6032:基板
6033:畫素
6034:緩衝層
6036:畫素層
6041:互連柱

Claims (13)

  1. 一種電光(electro-optical)感測器晶片總成(sensor chip assembly；SCA)，包含：一積體電路(integrated circuit；IC)；一偵測器，包含一基板、一緩衝層、一畫素層、及一包含複數個畫素之陣列，該陣列設置於該畫素層中；以及一互連層，夾置於該積體電路與該畫素層之間且包含複數個冷焊式互連柱(cold welded interconnect post)，該等冷焊式互連柱可分別自該等畫素延伸至該積體電路，其中，自形成於該基板及該緩衝層中之一直視窗(direct view window)傳播之可見波長光係可穿透該偵測器而到達該等畫素其中之一或多者。
  2. 如請求項1所述之電光感測器晶片總成，更包含複數個側面搬運凹槽(sidelong handling groove)。
  3. 如請求項1所述之電光感測器晶片總成，其中該緩衝層包含半導體材料。
  4. 如請求項1所述之電光感測器晶片總成，其中該畫素層包含半導體材料。
  5. 如請求項1所述之電光感測器晶片總成，其中各該畫素包含：一n型吸收體；一p型帽；一接觸金屬，夾置於該p型帽與一對應互連柱之間；以及一鈍化材料，環繞該接觸金屬。
  6. 一種形成一電光感測器晶片總成之方法，包含： 組裝一偵測器，該偵測器具有一基板、一緩衝層、一畫素層、及一包含複數個畫素之陣列，該陣列設置於該畫素層中；在一積體電路(IC)與該畫素層之間夾置一互連層；將該積體電路與該偵測器混雜(hybridizing)，藉此冷焊出分別可自該等畫素延伸至該積體電路之複數個互連柱；在該基板及該緩衝層中於該等畫素其中之一或多者之一位置處形成一直視窗；以及使可見波長光自該直視窗穿過該偵測器傳播至該等畫素其中之該一或多者。
  7. 如請求項6所述之方法，更包含在複數個側面搬運凹槽處搬運該偵測器。
  8. 如請求項6所述之方法，其中該緩衝層包含半導體材料。
  9. 如請求項6所述之方法，其中該畫素層包含半導體材料。
  10. 如請求項6所述之方法，其中各該畫素包含：一n型吸收體；一p型帽；一接觸金屬，夾置於該p型帽與一對應互連柱之間；以及一鈍化材料，環繞該接觸金屬。
  11. 如請求項6所述之方法，其中該形成該直視窗之步驟包含進行金剛石尖頭車削(diamond point turning；DPT)。
  12. 如請求項6所述之方法，其中該形成該直視窗之步驟包含進行化學蝕刻製程或乾式蝕刻製程。
  13. 如請求項6所述之方法，其中該形成該直視窗之步驟包含： 進行金剛石尖頭車削(DPT)穿透該基板之複數個外部層；以及進行化學蝕刻穿透該基板之複數個內部層以及該緩衝層。
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