TWI714317B - 畫素電路與相關的顯示裝置 - Google Patents

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Abstract

一種畫素電路包含補償電路、寫入電路、發光單元、以及電力供應電路。補償電路用於依據第一節點的電壓和系統高電壓提供驅動電流。寫入電路用於依據第一控制訊號提供資料電壓，以使補償電路設置第一節點的電壓。發光單元用於依據驅動電流發光。電力供應電路用於依據第一發光訊號導通補償電路和發光單元，用於依據第二發光訊號提供系統高電壓至補償電路，且用於依據第二控制訊號提供系統低電壓以重置第一節點的電壓。第一控制訊號反相於第一發光訊號，且第二控制訊號反相於第二發光訊號。

Description

畫素電路與相關的顯示裝置
本揭示文件有關一種顯示裝置，尤指顯示裝置中一種能免疫漏電影響的畫素電路。
相較於液晶顯示器，有機發光二極體(Organic Light-Emitting Diode，簡稱OLED)顯示器具有低功率消耗、高色彩飽和度和高反應速度等優點，使其被視為下一代主流顯示器產品的熱門技術之一。有機發光二極體顯示器利用工作於飽和區的電晶體作為電流源，以驅動有機發光二極體。然而，相關的畫素電路通常需要搭配具有複雜波形的控制訊號，且還面臨薄膜電晶體的漏電問題。
本揭示文件提供一種畫素電路，其包含補償電路、寫入電路、發光單元、以及電力供應電路。補償電路包含第一節點，用於依據第一節點的電壓和系統高電壓提供驅動電流。寫入電路用於依據第一控制訊號將資料電壓提供至補償電路，以使補償電路設置第一節點的電壓。發 光單元用於依據驅動電流發光。電力供應電路用於依據第一發光訊號導通補償電路和發光單元，用於依據第二發光訊號提供系統高電壓至補償電路，且用於依據第二控制訊號提供系統低電壓至補償電路以重置第一節點的電壓。第一控制訊號反相於第一發光訊號，且第二控制訊號反相於第二發光訊號。
本揭示文件提供一種顯示裝置，其包含閘極驅動器、畫素矩陣、以及源極驅動器。閘極驅動器用於提供多個控制訊號和多個發光訊號。源極驅動器耦接於畫素矩陣，用於提供資料電壓。畫素電路包含補償電路、寫入電路、發光單元、以及電力供應電路。補償電路包含一第一節點，用於依據第一節點的電壓和系統高電壓提供驅動電流。寫入電路用於依據多個控制訊號中的第一控制訊號將資料電壓提供至補償電路，以使補償電路設置第一節點的電壓。發光單元用於依據驅動電流發光。電力供應電路用於依據多個發光訊號中的第一發光訊號導通補償電路和發光單元，用於依據多個發光訊號中的第二發光訊號提供系統高電壓至補償電路，且用於依據多個控制訊號中的第二控制訊號提供系統低電壓至補償電路以重置第一節點的電壓。多個控制訊號分別反相於多個發光訊號。
上述的畫素電路和顯示裝置能避免因節點漏電而產生的畫面閃爍。
PX、PXa‧‧‧畫素電路
100‧‧‧顯示裝置
110‧‧‧畫素矩陣
120‧‧‧源極驅動器
130‧‧‧閘極驅動器
310、410‧‧‧補償電路
320、420‧‧‧寫入電路
330、430‧‧‧電力供應電路
Idr‧‧‧驅動電流
T1‧‧‧第一開關
T2‧‧‧第二開關
T3‧‧‧第三開關
T4‧‧‧第四開關
T5‧‧‧第五開關
T6‧‧‧第六開關
T7‧‧‧第七開關
Td‧‧‧驅動電晶體
DI‧‧‧發光單元
Cs‧‧‧儲存電容
IN1‧‧‧第一輸入端
IN2‧‧‧第二輸入端
N1‧‧‧第一節點
S[1]~S[n]‧‧‧控制訊號
EM[1]~EM[n]‧‧‧發光訊號
Vdata[1]~Vdata[n]‧‧‧資料電壓
Vref‧‧‧參考電壓
OVDD‧‧‧系統高電壓
OVSS‧‧‧系統低電壓
P1、P2、P3、P4、P5、P6‧‧‧時間長度
610、620‧‧‧電流路徑
800‧‧‧閘極驅動器
810[1]~810[n]‧‧‧移位暫存器
812[1]~812[n]‧‧‧子移位暫存器
814[1]~814[n]‧‧‧反向器
VSQ、VSG‧‧‧電力輸入
第1圖為依據本揭示文件一實施例的顯示裝置簡化後的功能方塊圖。
第2圖為控制訊號與發光訊號簡化後的波形示意圖。
第3圖為第1圖的畫素電路簡化後的功能方塊圖。
第4圖為依據本揭示文件一實施例的畫素電路的示意圖。
第5圖為提供至第4圖的畫素電路的控制訊號與發光訊號簡化後的波形示意圖。
第6A圖為畫素電路在第一重置階段的等效電路操作示意圖。
第6B圖為畫素電路在第二重置階段的等效電路操作示意圖。
第6C圖為畫素電路在補償階段的等效電路操作示意圖。
第6D圖為畫素電路在發光階段的等效電路操作示意圖。
第7A圖為第4圖的畫素電路的臨界電壓補償模擬結果示意圖。
第7B圖為第4圖的畫素電路的電阻電位降補償模擬結果示意圖。
第8圖為依據本揭示文件一實施例的閘極驅動器簡化後的功能方塊圖。
以下將配合相關圖式來說明本揭示文件的實施例。在圖式中，相同的標號表示相同或類似的元件或方法流程。
第1圖為依據本揭示文件一實施例的顯示裝置100簡化後的功能方塊圖。顯示裝置100包含畫素矩陣110，其中畫素矩陣110包含多個畫素電路PX。顯示裝置100還包含源極驅動器120與閘極驅動器130。源極驅動器120用於透過多條資料線提供資料電壓Vdata[1]~Vdata[n]至畫素矩陣110。閘極驅動器130用於透過多條閘極線提供控制訊號S[1]~S[n]與發光訊號EM[1]~EM[n]至畫素矩陣110。每個畫素電路PX設置於資料線與閘極線的交點，以接收控制訊號S[1]~S[n]中對應的多者、發光訊號EM[1]~EM[n]中對應的多者、以及資料電壓Vdata[1]~Vdata[n]中對應的一者，以進行資料寫入、元件特性補償、及/或發光等等運作。
實作上，顯示裝置100可以是有機發光二極體顯示器或是微發光二極體(Micro LED)顯示器。
第2圖為控制訊號S[1]~S[n]與發光訊號EM[1]~EM[n]簡化後的波形示意圖。如第2圖所示，控制訊號S[1]~S[n]會依序切換至邏輯高準位(例如，低電壓準位)，且分別反相於發光訊號EM[1]~EM[n]。例如，控制訊號S[1]反相於發光訊號EM[1]，控制訊號S[2]反相於發光訊號EM[2]，而控制訊號S[n]反相於發光訊號EM[n]， 依此類推。
在一幀畫面期間，控制訊號S[1]~S[n]具有邏輯高準位的時間長度(例如，時間長度P1)彼此相同，而發光訊號EM[1]~EM[n]具有邏輯低準位的時間長度(例如，時間長度P2)也彼此相同。進一步來說，在一幀畫面期間，控制訊號S[1]~S[n]中任意一者具有邏輯高準位的時間長度，會相同於發光訊號EM[1]~EM[n]中任意一者具有邏輯低準位的時間長度。亦即，時間長度P1相同於時間長度P2。
換言之，由於控制訊號S[1]~S[n]與發光訊號EM[1]~EM[n]具有簡單的波形，閘極驅動器130能具有簡單的電路架構以實現窄邊框的顯示裝置100。例如，閘極驅動器130可以包含兩種不同的移位暫存器以分別產生控制訊號S[1]~S[n]與發光訊號EM[1]~EM[n]，或是僅包含一種具有反向器的移位暫存器以一併產生控制訊號S[1]~S[n]與發光訊號EM[1]~EM[n]。
第3圖為第1圖的畫素電路PX簡化後的功能方塊圖。為便於說明，第3圖的畫素電路PX為第1圖中接收控制訊號S[n-1]、控制訊號S[n]、發光訊號EM[n-1]、以及發光訊號EM[n]的畫素電路PX(亦即，第1圖中以虛線框標示者)。畫素電路PX包含補償電路310、寫入電路320、電力供應電路330、以及發光單元DI。補償電路310用於依據補償電路310內部的第一節點N1(未繪示於第3圖)電壓以及電力供應電路330提供的系統高電壓OVDD，提供驅動電流Idr至發光單元DI，以使發光單元DI產生對應的亮度。
寫入電路320用於依據控制訊號S[n]將資料電壓Vdata[n]提供至補償電路310，且用於依據發光訊號EM[n]將參考電壓Vref提供至補償電路310，其中補償電路310會依據資料電壓Vdata[n]和參考電壓Vref設置第一節點N1的電壓。電力供應電路330用於依據發光訊號EM[n]導通補償電路310和發光單元DI，並用於依據發光訊號EM[n-1]提供系統高電壓OVDD至補償電路310。另外，電力供應電路330還用於依據控制訊號S[n-1]提供系統低電壓OVSS至補償電路310，此時，補償電路310會依據控制訊號S[n]和控制訊號S[n-1]導通第一節點N1和電力供應電路330，以重置第一節點N1的電壓。
值得一提的是，顯示裝置100中的畫素電路PX會與設置於相鄰列的其他畫素電路PX共用訊號，以進一步簡化閘極驅動器130的架構。例如，第1圖中以虛線框標示的畫素電路PX，會與設置於相鄰列的畫素電路PX共用控制訊號S[n-1]和發光訊號EM[n-1]。
第4圖為依據本揭示文件一實施例的畫素電路PXa的示意圖。畫素電路PXa包含補償電路410、寫入電路420、電力供應電路430、以及發光單元DI，其中發光單元DI的第一端耦接於補償電路410，發光單元DI的第二端則用於接收系統低電壓OVSS。
在一實施例中，補償電路410包含第一輸入端IN1、第二輸入端IN2、第一節點N1、以及驅動電晶體Td，其中驅動電晶體Td的第一端、第二端、以及控制端分別耦 接於第一輸入端IN1、第二輸入端IN2、以及第一節點N1。第一輸入端IN1用於自電力供應電路430接收系統高電壓OVDD。第二輸入端IN2用於自電力供應電路430接收系統低電壓OVSS，且透過電力供應電路430耦接於發光單元DI。
當電力供應電路430提供系統高電壓OVDD時，補償電路410會依據控制訊號S[n]和控制訊號S[n-1]將第一節點N1、第一輸入端IN1、以及第二輸入端IN2彼此斷開，且依據第一節點N1的電壓和系統高電壓OVDD提供驅動電流Idr至發光單元DI。此時，第一輸入端IN1的電壓會高於第一節點N1的電壓，且第一節點N1的電壓會高於第二輸入端IN2的電壓。因此，第一輸入端IN1會往第一節點N1漏電，而第一節點N1會往第二輸入端IN2漏電，進而穩定第一節點N1的電壓，相關的內容將於後續進行說明。
在另一實施例中，補償電路410另包含第一開關T1、第二開關T2、以及儲存電容Cs。第一開關T1的第一端耦接於第二輸入端IN2。第一開關T1的第二端耦接於第一節點N1。第一開關T1的控制端用於接收控制訊號S[n]。第二開關T2的第一端耦接於第一輸入端IN1。第二開關T2的第二端耦接於第一節點N1。第二開關T2的控制端用於接收控制訊號S[n-1]。儲存電容Cs的第一端耦接於第一節點N1，儲存電容Cs的第二端則耦接於寫入電路420。
上述多個實施例中的補償電路410可以用於實現第3圖的補償電路310。
寫入電路420耦接於補償電路410，且包含第三開關T3和第四開關T4。第三開關T3的第一端耦接於儲存電容Cs。第三開關T3的第二端用於接收資料電壓Vdata[n]。第三開關T3的控制端用於接收控制訊號S[n]。第四開關T4的第一端耦接於儲存電容Cs。第四開關T4的第二端用於接收參考電壓Vref。第四開關T4的控制端用於接收發光訊號EM[n]。
在一實施例中，寫入電路420可以用於實現第3圖的寫入電路320。
電力供應電路430包含第五開關T5、第六開關T6、以及第七開關T7。第五開關T5的第一端用於接收系統高電壓OVDD。第五開關T5的第二端耦接於補償電路310的第一輸入端IN1。第五開關T5的控制端用於接收發光訊號EM[n-1]。第六開關T6的第一端用於接收系統低電壓OVSS。第六開關T6的第二端耦接於補償電路410的第二輸入端IN2。第六開關T6的控制端用於接收控制訊號S[n-1]。第七開關T7的第一端耦接於第二輸入端IN2。第七開關T7的第二端耦接於發光單元DI的第一端。第七開關T7的控制端用於接收發光訊號EM[n]。
在一實施例中，電力供應電路430可以用於實現第3圖的電力供應電路330。
在一實施例中，第4圖的畫素電路PXa可以用於實現第2圖和第3圖的畫素電路PX。
實作上，上述實施例中的開關與驅動電晶體Td 可以用合適種類的P型電晶體來實現。例如，薄膜電晶體(Thin-Film Transistor)或是金氧半場效電晶體(MOS Field-Effect Transistor)。發光單元DI可以用有機發光二極體或是微發光二極體來實現。
第5圖為輸入至畫素電路PXa的控制訊號S[n]、控制訊號S[n-1]、發光訊號EM[n]、以及發光訊號EM[n-1]簡化後的波形示意圖。第6A圖為畫素電路PXa在第一重置階段的等效電路操作示意圖。第6B圖為畫素電路PXa在第二重置階段的等效電路操作示意圖。第6C圖為畫素電路PXa在補償階段的等效電路操作示意圖。第6D圖為畫素電路PXa在發光階段的等效電路操作示意圖。
如第5圖所示，在一幀畫面期間，控制訊號S[n-1]具有邏輯高準位(例如，低電壓準位)的時間長度P3與控制訊號S[n]具有邏輯高準位的時間長度P4相同，且發光訊號EM[n-1]具有邏輯低準位(例如，高電壓準位)的時間長度P5與發光訊號EM[n]具有邏輯低準位的時間長度P6相同。在另一實施例中，在一幀畫面期間，時間長度P3、時間長度P4、時間長度P5、以及時間長度P6彼此相同。
請參照第5圖和第6A圖，在第一重置階段中，控制訊號S[n-1]和發光訊號EM[n]具有邏輯高準位，而控制訊號S[n]和發光訊號EM[n-1]具有邏輯低準位。因此，第二開關T2、第四開關T4、以及第六開關T6會導通，而畫素電路PXa中其餘的開關會關斷，使得發光單元DI的第一端被設置為系統低電壓OVSS，進而完全關閉發光單元DI 以提高畫面對比度。
請參照第5圖和第6B圖，在第二重置階段中，控制訊號S[n]和控制訊號S[n-1]具有邏輯高準位，而發光訊號EM[n]和發光訊號EM[n-1]具有邏輯低準位。因此，第一開關T1、第二開關T2、第三開關T3、以及第六開關T6會導通，而畫素電路PXa中其餘的開關會關斷，使得第一輸入端IN1、第二輸入端IN2、以及第一節點N1被設置為系統低電壓OVSS。另外，寫入電路420會於第二重置階段中將儲存電容Cs的第二端維持於資料電壓Vdata[n]。
請參照第5圖和第6C圖，在補償階段中，控制訊號S[n]和發光訊號EM[n-1]具有邏輯高準位，而控制訊號S[n-1]和發光訊號EM[n]具有邏輯低準位。因此，第一開關T1、第三開關T3、第五開關T5、以及驅動電晶體Td會導通，而畫素電路PXa中其餘的開關會關斷。補償電路410會偵測驅動電晶體Td的臨界電壓以產生偵測結果，並將偵測結果儲存於第一節點N1。另外，寫入電路420會於補償階段中將儲存電容Cs的第二端維持於資料電壓Vdata[n]。
詳細而言，第一節點N1的電壓於補償階段中可由以下的《公式1》表示：V1=OVDD-|Vth| 《公式1》其中V1代表第一節點N1的電壓，而Vth代表驅動電晶體Td的臨界電壓。
請參照第5圖和第6D圖，在發光階段中，控制訊號S[n]和控制訊號S[n-1]具有邏輯低準位，而發光訊號EM[n]和發光訊號EM[n-1]具有邏輯高準位。因此，第四開關T4、第五開關T5、第七開關T7、以及驅動電晶體Td會導通，而畫素電路PXa中其餘的開關會關斷。電力供應電路430會提供系統高電壓OVDD至第一輸入端IN1，並導通第二輸入端IN2與發光單元DI。寫入電路420會提供參考電壓Vref至儲存電容Cs的第二端，使得第一節點N1的電壓因儲存電容Cs的電容耦合效應而改變。
詳細而言，第一節點N1的電壓於發光階段中可由以下的《公式2》表示：V1=OVDD-|Vth|+(Vref-Vdata) 《公式2》
另外，驅動電晶體Td會工作於飽和區，且會依據第一節點N1的電壓與系統高電壓OVDD提供驅動電流Idr。驅動電流Idr於發光階段中可由以下的《公式3》表示：
Figure 108138296-A0101-12-0011-1
 其中k代表驅動電晶體Td的載子遷移率(carrier mobility)、閘極氧化層的單位電容大小、以及閘極寬長比三者的乘積。
由《公式3》可知，即使驅動電晶體Td的臨界電壓因製程或元件老化等等因素產生變異，或是系統高電壓OVDD因電阻電位降效應(IR drop)而產生變異，驅動電流Idr 的大小與資料電壓Vdata[n]都會保持原本的對應關係。
另一方面，如第6D圖所示，第一輸入端IN1會朝向第一節點N1漏電，以補充因第一節點N1朝向第二輸入端IN2漏電而損失的電荷。例如，第一節點N1會經由電流路徑610獲得電荷，以補充第一節點N1經由電流路徑620所損失的電荷。因此，畫素電路PXa在一幀畫面期間能夠提供穩定的驅動電流Idr。
上述多個實施例中的開關也可以用合適種類的N型電晶體來實現。在此情況下，控制訊號S[n]、控制訊號S[n-1]、發光訊號EM[n]、以及發光訊號EM[n-1]的波形，會反相於第5圖中的對應波形。
第7A圖為第4圖的畫素電路PXa的臨界電壓補償模擬結果示意圖。如第7A圖所示，在對應於低至高灰階(例如，0至255灰階)的資料電壓Vdata[n]範圍中，無論驅動電晶體Td的臨界電壓Vth變異了正0.5V或是負0.5V，驅動電流Idr與理想值的差異皆在5%以內。
第7B圖為第4圖的畫素電路PXa的電阻電位降補償模擬結果示意圖。如第7B圖所示，在對應於低至高灰階(例如，0至255灰階)的資料電壓Vdata[n]範圍中，即使系統高電壓OVDD變異了負0.5V，驅動電流Idr與理想值的差異皆在3.5%以內。前述的理想值是指在臨界電壓Vth和系統高電壓OVDD未變異的情況下，驅動電流Idr所具有的大小。
另外，如表一所示，在對應於低、中、以及高 灰階的情況下，第一節點N1的電壓於發光階段中的變化量皆小於3%。
Figure 108138296-A0101-12-0013-2
第8圖為依據本揭示文件一實施例的閘極驅動器800簡化後的功能方塊圖。閘極驅動器800包含多級移位暫存器810[1]~810[n]。移位暫存器810[1]~810[n]分別用於提供控制訊號S[1]~S[n]，並分別用於提供發光訊號EM[1]~EM[n]。
移位暫存器810[1]~810[n]用於依據時脈訊號Ck1~Ck4和起始訊號ST進行移位暫存運作，以輸出具有邏輯高準位的控制訊號S[1]~S[n]及/或發光訊號EM[1]~EM[n]。移位暫存器810[1]~810[n]還會依據電力輸入VSQ和電力輸入VSG，將控制訊號S[1]~S[n]及/或發光訊號EM[1]~EM[n]穩定於邏輯低準位。
在一實施例中，閘極驅動器800可以用於實現 第1圖的閘極驅動器130。
如第8圖所示，移位暫存器810[1]~810[n]分別包含子移位暫存器812[1]~812[n]，並分別包含反向器814[1]~814[n]。子移位暫存器812[1]~812[n]用於對應地提供控制訊號S[1]~S[n]。反向器814[1]~814[n]分別耦接於子移位暫存器812[1]~812[n]，且用於依據控制訊號S[1]~S[n]對應地提供發光訊號EM[1]~EM[n]。
例如，子移位暫存器812[1]會輸出控制訊號S[1]至反向器814[1]，而反向器814[1]會輸出反相於控制訊號S[1]的發光訊號EM[1]。又例如，子移位暫存器812[2]會輸出控制訊號S[2]至反向器814[2]，而反向器814[2]會輸出反相於控制訊號S[2]的發光訊號EM[2]。
在另一實施例中，子移位暫存器812[1]~812[n]用於對應地提供發光訊號EM[1]~EM[n]。反向器814[1]~814[n]會依據發光訊號EM[1]~EM[n]對應地提供控制訊號S[1]~S[n]。
換言之，閘極驅動器800具有簡單的電路架構，且能提供不同波形的訊號，因而適用於窄邊框的顯示器。
在說明書及申請專利範圍中使用了某些詞彙來指稱特定的元件。然而，所屬技術領域中具有通常知識者應可理解，同樣的元件可能會用不同的名詞來稱呼。說明書及申請專利範圍並不以名稱的差異做為區分元件的方式，而是以元件在功能上的差異來做為區分的基準。在說 明書及申請專利範圍所提及的「包含」為開放式的用語，故應解釋成「包含但不限定於」。另外，「耦接」在此包含任何直接及間接的連接手段。因此，若文中描述第一元件耦接於第二元件，則代表第一元件可通過電性連接或無線傳輸、光學傳輸等信號連接方式而直接地連接於第二元件，或者通過其他元件或連接手段間接地電性或信號連接至該第二元件。
在此所使用的「及/或」的描述方式，包含所列舉的其中之一或多個項目的任意組合。另外，除非說明書中特別指明，否則任何單數格的用語都同時包含複數格的涵義。
以上僅為本揭示文件的較佳實施例，凡依本揭示文件請求項所做的均等變化與修飾，皆應屬本揭示文件的涵蓋範圍。
Pxa‧‧‧畫素電路
410‧‧‧補償電路
420‧‧‧寫入電路
430‧‧‧電力供應電路
T1‧‧‧第一開關
T2‧‧‧第二開關
T3‧‧‧第三開關
T4‧‧‧第四開關
T5‧‧‧第五開關
T6‧‧‧第六開關
T7‧‧‧第七開關
Td‧‧‧驅動電晶體
DI‧‧‧發光單元
Cs‧‧‧儲存電容
IN1‧‧‧第一輸入端
IN2‧‧‧第二輸入端
N1‧‧‧第一節點
S[n-1]、S[n]‧‧‧控制訊號
EM[n-1]、EM[n]‧‧‧發光訊號
Vdata[n]‧‧‧資料電壓
Vref‧‧‧參考電壓
OVDD‧‧‧系統高電壓
OVSS‧‧‧系統低電壓

Claims (10)

  1. 一種畫素電路，包含：
    一補償電路，包含一第一節點，用於依據該第一節點的電壓和一系統高電壓提供一驅動電流；
    一寫入電路，用於依據一第一控制訊號將一資料電壓提供至該補償電路，以使該補償電路設置該第一節點的電壓；
    一發光單元，用於依據該驅動電流發光；以及
    一電力供應電路，用於依據一第一發光訊號導通該補償電路和該發光單元，用於依據一第二發光訊號提供該系統高電壓至該補償電路，且用於依據一第二控制訊號提供一系統低電壓至該補償電路以重置該第一節點的電壓；
    其中該第一控制訊號反相於該第一發光訊號，且該第二控制訊號反相於該第二發光訊號。
  2. 如請求項1所述的畫素電路，其中，於一幀畫面期間，該第一控制訊號具有一邏輯高準位的時間長度與該第二控制訊號具有該邏輯高準位的時間長度相同，且該第一發光訊號具有一邏輯低準位時間長度與該第二發光訊號具有該邏輯低準位的時間長度相同。
  3. 如請求項2所述的畫素電路，其中，於該幀畫面期間，該第一控制訊號具有該邏輯高準位的時間長度、該第二控制訊號具有該邏輯高準位的時間長度、該第 一發光訊號具有該邏輯低準位的時間長度、以及該第二發光訊號具有該邏輯低準位的時間長度彼此相同。
  4. 如請求項1所述的畫素電路，其中，該補償電路另包含：
    一第一輸入端，用於接收該系統高電壓；
    一第二輸入端，用於接收該系統低電壓；以及
    一驅動電晶體，包含一第一端、一第二端、以及一控制端，其中該驅動電晶體的該第一端耦接於該第一輸入端，該驅動電晶體的該第二端耦接於該第二輸入端，該驅動電晶體的該控制端耦接於該第一節點；
    其中若該電力供應電路提供該系統高電壓至該補償電路，該補償電路斷開該第一節點與該第一輸入端，也斷開該第一節點與該第二輸入端，且該第一輸入端往該第一節點漏電，該第一節點往該第二輸入端漏電，以穩定該第一節點的電壓。
  5. 如請求項1所述的畫素電路，其中，該補償電路另包含：
    一第一輸入端，用於接收該系統高電壓；
    一第二輸入端，用於接收該系統低電壓；
    一驅動電晶體，包含一第一端、一第二端、以及一控制端，其中該驅動電晶體的該第一端耦接於該第一輸入端，該驅動電晶體的該第二端耦接於該第二輸入端，該驅 動電晶體的該控制端耦接於該第一節點；
    一第一開關，包含一第一端、一第二端、以及一控制端，其中該第一開關的該第一端耦接於該第二輸入端，該第一開關的該第二端耦接於該第一節點，該第一開關的該控制端用於接收該第一控制訊號；
    一第二開關，包含一第一端、一第二端、以及一控制端，其中該第二開關的該第一端耦接於該第一輸入端，該第二開關的該第二端耦接於該第一節點，該第二開關的該控制端用於接收該第二控制訊號；以及
    一儲存電容，耦接於該第一節點和該寫入電路之間。
  6. 如請求項1所述的畫素電路，其中，該寫入電路包含：
    一第三開關，包含一第一端、一第二端、以及一控制端，其中該第三開關的該第一端耦接於該補償電路，該第三開關的該第二端用於接收該資料電壓，該第三開關的該控制端用於接收該第一控制訊號；以及
    一第四開關，包含一第一端、一第二端、以及一控制端，其中該第四開關的該第一端耦接於該補償電路，該第四開關的該第二端用於接收一參考電壓，該第四開關的該控制端用於接收該第一發光訊號。
  7. 如請求項1所述的畫素電路，其中，該電力供應電路包含：
    一第五開關，包含一第一端、一第二端、以及一控制端，其中該第五開關的該第一端用於接收該系統高電壓，該第五開關的該第二端耦接於該補償電路，該第五開關的該控制端用於接收該第二發光訊號；
    一第六開關，包含一第一端、一第二端、以及一控制端，其中該第六開關的該第一端用於接收該系統低電壓，該第六開關的該第二端耦接於該補償電路，該第六開關的該控制端用於接收該第二控制訊號；以及
    一第七開關，包含一第一端、一第二端、以及一控制端，其中該第七開關的該第一端耦接於該補償電路，該第七開關的該第二端耦接於該發光單元，該第七開關的該控制端用於接收該第一發光訊號。
  8. 一種顯示裝置，包含：
    一閘極驅動器，用於提供多個控制訊號和多個發光訊號，其中該多個控制訊號分別反相於該多個發光訊號；
    一畫素矩陣，耦接於該閘極驅動器，且包含多個畫素電路，其中每個畫素電路包含：
    一補償電路，包含一第一節點，用於依據該第一節點的電壓和一系統高電壓提供一驅動電流；
    一寫入電路，用於依據該多個控制訊號中的一第一控制訊號將一資料電壓提供至該補償電路，以使該補償電路設置該第一節點的電壓；
    一發光單元，用於依據該驅動電流發光；以及
    一電力供應電路，用於依據該多個發光訊號中的一第一發光訊號導通該補償電路和該發光單元，用於依據該多個發光訊號中的一第二發光訊號提供該系統高電壓至該補償電路，且用於依據該多個控制訊號中的一第二控制訊號提供一系統低電壓至該補償電路以重置該第一節點的電壓；以及
    一源極驅動器，耦接於該畫素矩陣，用於提供該資料電壓。
  9. 如請求項8所述的顯示裝置，其中，該閘極驅動器包含多級移位暫存器，且該多級移位暫存器的每一者包含：
    一子移位暫存器，用於提供以下兩者的其中之一：該多個控制訊號中對應的一者與該多個發光訊號中對應的一者；以及
    一反向器，耦接於該子移位暫存器，其中若該子移位暫存器提供該多個控制訊號中該對應的一者，則該反向器依據該多個控制訊號中該對應的一者提供該多個發光訊號中該對應的一者，
    其中若該子移位暫存器提供該多個發光訊號中該對應的一者，則該反向器依據該多個發光訊號中該對應的一者提供該多個控制訊號中該對應的一者。
  10. 如請求項8所述的顯示裝置，其中，於 一幀畫面期間，該第一控制訊號具有一邏輯高準位的時間長度與該第二控制訊號具有該邏輯高準位的時間長度相同，且該第一發光訊號具有一邏輯低準位的時間長度與該第二發光訊號具有該邏輯低準位的時間長度相同。
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