TW201635269A - 源極驅動裝置及其操作方法 - Google Patents

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Abstract

一種源極驅動裝置及其操作方法。源極驅動裝置可以驅動顯示面板的多個源極線，而該顯示面板還包括閘極驅動裝置。源極驅動裝置包括多個驅動通道以及一延遲控制電路。這些驅動通道輸出多個源極驅動信號。延遲控制電路控制這些驅動通道，來改變這些源極驅動信號於相同期間內的延遲時間，使這些源極驅動信號的所述延遲時間分別響應於這些源極線至閘極驅動裝置的距離。

Description

源極驅動裝置及其操作方法
本發明是有關於一種顯示裝置，且特別是有關於一種源極驅動裝置及其操作方法。
圖1是說明薄膜電晶體(Thin Film Transistor，TFT)液晶顯示器(Liquid Crystal Display，LCD)10之電路方塊示意圖。液晶顯示器10包含一個時序控制器(timing controller)11、一個或多個閘極驅動器(gate driver，例如圖1所示12_1與12_2)、一個或多個源極驅動器(source driver，例如圖1所示13_1、13_2與13_3)以及顯示面板14。
閘極驅動器12_1與12_2耦接於時序控制器11與顯示面板14之間。在閘極驅動器12_1與12_2接收到時序控制器11所提供的垂直起始信號STV後，垂直起始信號STV便在閘極驅動器12_1與12_2之內部依照閘極時脈信號CPV的時序開始逐級遞移。因此，閘極驅動器12_1與12_2便可依據垂直起始信號STV 之遞移位置而一個接著一個地輪流驅動顯示面板14的每一條閘極線。例如，閘極線GD1先被驅動，然後依序驅動閘極線GD2、GD3、…等。時序控制器11經由控制匯流排提供輸出致能信號OE(或是輸出禁能信號)給閘極驅動器12_1與12_2，以控制閘極驅動器12_1與12_2所輸出閘極驅動信號之脈寬。
源極驅動器13_1、13_2與13_3耦接於時序控制器11與顯示面板14之間。在源極驅動器13_1、13_2與13_3接收到時序控制器11所提供的水平起始信號STH後，水平起始信號STH便在源極驅動器13_1、13_2與13_3之內部依照源極時脈信號CK的時序開始逐級遞移。時序控制器11將多條線資料(顯示資料)以串列方式依序輸出至資料線匯流排DAT，因此源極驅動器13_1、13_2與13_3可以從資料線匯流排DAT獲得顯示資料。資料線匯流排DAT例如是符合小型低電壓差動信號傳輸介面(Mini Low Voltage Differential Signaling,mini-LVDS)規格的匯流排。依據時序控制器11所輸出源極時脈信號CK與水平起始信號STH的控制，源極驅動器13_1、13_2與13_3可以將資料線匯流排DAT的不同顯示資料閂鎖於對應的驅動通道中。依據線閂鎖信號LD的控制，源極驅動器13_1、13_2與13_3可以將被閂鎖於這些驅動通道的顯示資料同時轉換為源極驅動信號。配合閘極驅動器12_1與12_2的掃描時序，這些源極驅動信號可以被寫入顯示面板14的多個像素(pixel)單元中(例如圖1所示P1、P2、P3、P4、P5、P6、P7、P8與P9)以顯示影像。
顯示面板14係由兩基板(Substrate)構成，而於兩基板間填充有液晶材料(LCD layer)。顯示面板14設置有複數條源極線(source line，或稱資料線，例如圖1所示SD1、SD2與SD3)、複數條閘極線(gate line，或稱掃描線，例如圖1所示GD1、GD2與GD3)以及複數個像素單元(例如圖1所示P1、P2、P3、P4、P5、P6、P7、P8與P9)。源極線SD1、SD2與SD3垂直於閘極線GD1、GD2與GD3。像素單元P1~P9係以矩陣的方式分佈於顯示面板14上。圖1繪示了像素單元P3的範例電路圖，而其他像素單元P1~P2、P4~P9可以參照像素單元P3而類推。
閘極驅動器12_1與12_2輸出閘極驅動信號至閘極線GD1、GD2與GD3。閘極驅動信號會因為閘極線上RC負載導致傳輸延遲。圖1繪示了閘極線GD1、GD2與GD3的等效電路，其中電阻符號表示閘極線的等效電阻(或寄生電阻)，而電容符號表示閘極線的等效電容(或寄生電容)。閘極線上的寄生電阻與寄生電容會形成RC負載，導致信號傳輸發生延遲。隨著顯示面板14的尺寸加大，閘極線的延遲效應會越明顯。在距離閘極驅動器最遠的位置，其延遲效應最為嚴重。
圖2繪示了圖1所示信號的時序示意圖。請參照圖1與圖2，在閘極線GD1的脈衝結束後，閘極線GD2的脈衝才開始上升。閘極線GD1的RC負載導致傳輸延遲，使得像素單元P1、P2與P3所收到的閘極驅動信號GD1a、GD1b與GD1c具有不同的延遲時間。閘極驅動信號GD1a、GD1b與GD1c的所述延遲時間響 應於像素單元P1、P2與P3至閘極驅動裝置12_1的距離。相類似地，閘極線GD2的RC負載導致傳輸延遲，使得像素單元P4、P5與P6所收到的閘極驅動信號GD2a、GD2b與GD2c具有不同的延遲時間。閘極驅動信號GD2a、GD2b與GD2c的所述延遲時間響應於像素單元P4、P5與P6至閘極驅動裝置12_1的距離。
為了確保前一條閘極線(例如GD1)的所有像素單元都關閉(turn off)後，下一條閘極線(例如GD2)的像素單元才可以打開(turn on)，時序控制器11可以利用致能信號OE來縮小閘極驅動信號之脈寬。閘極驅動信號之脈寬被縮小，意味著源極驅動器對像素單元進行充電的時間被縮小。充電時間被縮小將導致像素單元因充電不足致使顯示異常。此現象在越大尺寸的面板更顯嚴重。
從圖2可以知道，對同一條閘極線GD2而言，較靠近閘極驅動裝置12_1的像素單元P4可以獲得較大的有效充電時間Tch1。遠離閘極驅動裝置12_1的像素單元P5的有效充電時間Tch2小於像素單元P4的有效充電時間Tch1，而遠離閘極驅動裝置12_1的像素單元P6的有效充電時間Tch3又小於像素單元P5的有效充電時間Tch2。有效充電時間被縮小，可能導致遠離閘極驅動裝置12_1的像素單元(例如像素單元P6及/或像素單元P5)因充電不足致使顯示異常。
本發明提供一種源極驅動裝置及其操作方法，以便增加像素單元的有效充電時間。
本發明的實施例提供一種源極驅動裝置。源極驅動裝置經配置驅動顯示面板的多個源極線，該顯示面板還包括閘極驅動裝置。源極驅動裝置包括多個驅動通道以及一延遲控制電路。這些驅動通道輸出多個源極驅動信號。延遲控制電路控制這些驅動通道，來改變這些源極驅動信號於期間內的延遲時間，使這些源極驅動信號的所述延遲時間分別響應於這些源極線至閘極驅動裝置的距離。
在本發明的一實施例中，上述的驅動通道之一者包括輸出緩衝器以及輸出開關。輸出開關的第一端耦接至輸出緩衝器的輸出端。輸出開關的第二端耦接至源極線中的對應源極線。延遲控制電路控制輸出開關的導通時序，以改變對應源極線的源極驅動信號的延遲時間。
在本發明的一實施例中，上述的延遲控制電路經配置以耦接外部控制器。依據外部控制器的控制來決定源極驅動信號的延遲時間。
在本發明的一實施例中，上述的延遲控制電路的第一偵測端與第二偵測端分別耦接至顯示面板的假閘極線(dummy gate line)的第一位置與第二位置，以偵測閘極驅動信號在第一位置與第二位置的時序。依據閘極驅動信號在第一位置與第二位置的時序來決定該些源極驅動信號的延遲時間。
在本發明的一實施例中，上述的延遲控制電路包括上升緣偵測電路以及控制器。上升緣偵測電路耦接至延遲控制電路的第一偵測端，以偵測在第一位置該閘極驅動信號的上升緣時序，而獲得第一時點。上升緣偵測電路耦接至延遲控制電路的第二偵測端，以偵測在第二位置該閘極驅動信號的上升緣時序，而獲得第二時點。控制器耦接至上升緣偵測電路與該些驅動通道。控制器經配置以計算第一時點與第二時點的時間差，以及依據時間差來決定該些驅動通道的源極驅動信號的延遲時間。
本發明的實施例提供種源極驅動裝置的操作方法，以驅動顯示面板的多個源極線，該顯示面板還包括閘極驅動裝置。該操作方法包括：輸出多個源極驅動信號以驅動該些源極線；以及配置這些源極驅動信號於期間內的延遲時間，使這些源極驅動信號的所述延遲時間分別響應於這些源極線至閘極驅動裝置的距離。
在本發明的一實施例中，上述的源極驅動信號的延遲時間互不相同。
在本發明的一實施例中，上述的期間為一水平掃描期間。
在本發明的一實施例中，上述的驅動通道被分群為多個通道群組。屬於相同通道群組的驅動通道的源極驅動信號的延遲時間互為相同。屬於不同通道群組的源極驅動信號的延遲時間互不相同。
在本發明的一實施例中，上述的顯示面板還耦接第二源 極驅動裝置。源極驅動裝置所輸出的源極驅動信號的任一者的延遲時間小於第二源極驅動裝置所輸出的多個源極驅動信號的任一者的延遲時間。
在本發明的一實施例中，上述的由該延遲控制電路控制該些驅動通道以改變該些源極驅動信號於該水平掃描期間內的延遲時間之步驟包括：由該延遲控制電路依據外部控制器的控制來決定該些源極驅動信號的所述延遲時間。
在本發明的一實施例中，上述的外部控制器包括時序控制器。
在本發明的一實施例中，上述的由該延遲控制電路控制該些驅動通道以改變該些源極驅動信號於該水平掃描期間內的延遲時間之步驟包括：由該延遲控制電路偵測閘極驅動信號在該顯示面板的假閘極線的第一位置與第二位置的時序，；以及由該延遲控制電路依據該閘極驅動信號在該第一位置與該第二位置的時序來決定該些源極驅動信號的所述延遲時間。
在本發明的一實施例中，上述的由該延遲控制電路控制該些驅動通道以改變該些源極驅動信號於該水平掃描期間內的延遲時間之步驟更包括：由該延遲控制電路偵測在該第一位置該閘極驅動信號的上升緣時序而獲得第一時點；由該延遲控制電路偵測在該第二位置該閘極驅動信號的上升緣時序而獲得第二時點；由該延遲控制電路計算該第一時點與該第二時點的時間差；以及由該延遲控制電路依據該時間差來決定該些驅動通道的該些源極 驅動信號的延遲時間。
基於上述，本發明實施例提供一種源極驅動裝置及其操作方法，使不同驅動通道所輸出的源極驅動信號於一個水平掃描期間內具有不同的延遲時間，以便增加像素單元的有效充電時間。
為讓本發明的上述特徵和優點能更明顯易懂，下文特舉實施例，並配合所附圖式作詳細說明如下。
10‧‧‧液晶顯示器
11、310‧‧‧時序控制器
12_1、12_2‧‧‧閘極驅動器
13_1、13_2、13_3‧‧‧源極驅動器
14、340‧‧‧顯示面板
300‧‧‧顯示裝置
320_1、320_2‧‧‧閘極驅動裝置
330_1、330_2、330_3‧‧‧源極驅動裝置
331‧‧‧延遲控制電路
332_1、332_2、332_3‧‧‧驅動通道
610‧‧‧時序控制器
620‧‧‧輸出緩衝器
630‧‧‧輸出開關
810‧‧‧上升緣偵測電路
820‧‧‧控制器
A、B、C、D、E、F‧‧‧位置
CK‧‧‧源極時脈信號
CPV‧‧‧閘極時脈信號
DAT‧‧‧資料線匯流排
GD1、GD2、GD3、GD31、GD32、GD33‧‧‧閘極線
GD1a、GD1b、GD1c、GD2a、GD2b、GD2c、GD31a、GD31b、GD31c、GD32a、GD32b、GD32c‧‧‧閘極驅動信號
GD30‧‧‧假閘極線
INA、INB‧‧‧偵測端
LD‧‧‧線閂鎖信號
OE‧‧‧輸出致能信號
P1、P2、P3、P4、P5、P6、P7、P8、P9、P11、P12、P13、P14、P15、P21、P22、P23、P24、P25、P31、P32、P33、P34、P35‧‧‧像素單元
SD1、SD2、SD3、SD31、SD32、SD33、SD34、SD35‧‧‧源極線
STH‧‧‧水平起始信號
STV‧‧‧垂直起始信號
T1、T2、T3‧‧‧時間差
Tch1、Tch2、Tch3、Tch31、Tch32、Tch33、Tch51、Tch52、Tch53‧‧‧有效充電時間
Td1、Td2、Td3‧‧‧延遲時間
Th‧‧‧水平掃描期間
圖1是說明薄膜電晶體液晶顯示器之電路方塊示意圖。
圖2繪示了圖1所示信號的時序示意圖。
圖3是依照本發明實施例說明一種顯示裝置的電路方塊示意圖。
圖4是依照本發明一實施例繪示了圖3所示信號的時序示意圖。
圖5是依照本發明另一實施例繪示了圖3所示信號的時序示意圖。
圖6是依照本發明一實施例說明圖3所示顯示裝置的電路方塊示意圖。
圖7是依照本發明另一實施例說明圖3所示顯示裝置的電路方塊示意圖。
圖8是依照本發明一實施例說明圖7所示源極驅動裝置的電 路方塊示意圖。
在本案說明書全文(包括申請專利範圍)中所使用的「耦接」一詞可指任何直接或間接的連接手段。舉例而言，若文中描述第一裝置耦接於第二裝置，則應該被解釋成該第一裝置可以直接連接於該第二裝置，或者該第一裝置可以透過其他裝置或某種連接手段而間接地連接至該第二裝置。另外，凡可能之處，在圖式及實施方式中使用相同標號的元件/構件/步驟代表相同或類似部分。不同實施例中使用相同標號或使用相同用語的元件/構件/步驟可以相互參照相關說明。
圖3是依照本發明實施例說明一種顯示裝置300的電路方塊示意圖。此顯示裝置300可以是薄膜電晶體(Thin Film Transistor，TFT)液晶顯示器(Liquid Crystal Display，LCD)或是其他類型的顯示裝置。顯示裝置300包含一個時序控制器(timing controller)310、一個或多個閘極驅動裝置(例如圖3所示320_1與320_2)、一個或多個源極驅動裝置(例如圖3所示330_1與330_2)以及顯示面板340。閘極驅動裝置320_1與320_2可以是不同的閘極驅動器(gate driver)或是閘極驅動積體電路。源極驅動裝置330_1與330_2可以是不同的源極驅動器(source driver)或是源極驅動積體電路。圖3所示時序控制器310、閘極驅動裝置320_1、閘極驅動裝置320_2與顯示面板340可以參照圖1所示時 序控制器11、閘極驅動器12_1、閘極驅動器12_2與顯示面板14的相關說明而類推。
圖3所示顯示面板340設置有複數條源極線(source line，或稱資料線，例如圖3所示SD31、SD32、SD33、SD34與SD35)、複數條閘極線(gate line，或稱掃描線，例如圖3所示GD31、GD32與GD33)以及複數個像素單元(例如圖3所示P11、P12、P13、P14、P15、P21、P22、P23、P24、P25、P31、P32、P33、P34與P35)。圖3所示閘極線GD31~GD33、源極線SD31~SD35、像素單元P11~P15、像素單元P21~P25與像素單元P31~P35可以參照圖1所示閘極線GD1~GD3、源極線SD1~SD3與像素單元P1~P9的相關說明而類推。
閘極驅動裝置320_1與320_2耦接於時序控制器310與顯示面板340之間。依照閘極時脈信號CPV的觸發時序，閘極驅動裝置320_1與320_2便可將垂直起始信號STV從第一條閘極線一個接著一個地遞移(shift)到最後一條閘極線。例如，閘極線GD31先被驅動，然後依序驅動閘極線GD32、GD33、…等。
以下將以源極驅動裝置330_1作為說明範例。其餘源極驅動裝置(例如源極驅動裝置330_2)可以參照源極驅動裝置330_1的相關說明而類推，故不再贅述。
源極驅動裝置330_1包括一個延遲控制電路331以及多個驅動通道(例如驅動通道332_1、332_2與332_3)。這些驅動通道332_1、332_2與332_3以一對一方式輸出多個源極驅動信號給 顯示面板340的多個源極線(例如源極線SD31、SD32與SD33)。舉例來說，在源極驅動器330_1接收到時序控制器310所提供的水平起始信號後，此水平起始信號便依照源極時脈信號的時序在這些驅動通道332_1、332_2與332_3之間逐級遞移。時序控制器310將顯示資料以串列方式依序輸出至資料線匯流排DAT，因此這些驅動通道332_1、332_2與332_3可以從資料線匯流排DAT獲得顯示資料。依據時序控制器310所輸出源極時脈信號與水平起始信號的控制，這些驅動通道332_1、332_2與332_3可以閂鎖資料線匯流排DAT的對應顯示資料。依據線閂鎖信號LD的控制，這些驅動通道332_1、332_2與332_3可以將被閂鎖的顯示資料轉換為源極驅動信號。配合閘極驅動器320_1與320_2的掃描時序，這些源極驅動信號可以被寫入顯示面板340的像素單元P11~P15、P21~P25與P31~P35中以顯示影像。
延遲控制電路331可以控制這些驅動通道332_1、332_2與332_3來改變所述源極驅動信號於一個水平掃描期間內的延遲時間。其中，這些源極驅動信號的延遲時間分別響應於這些源極線SD31、SD32與SD33至閘極驅動裝置(例如閘極驅動裝置320_1、320_2)的距離。距離越遠，則延遲時間越大。
舉例來說(但不限於此)，圖4是依照本發明實施例繪示了圖3所示信號的時序示意圖。請參照圖3與圖4，閘極驅動裝置320_1與320_2輸出閘極驅動信號至閘極線GD31、GD32與GD33。閘極驅動信號會因為閘極線上RC負載(例如圖3所示閘 極線GD31、GD32與GD33的等效電路)導致傳輸延遲。圖3所示電阻符號表示閘極線的等效電阻(或寄生電阻)，而電容符號表示閘極線的等效電容(或寄生電容)。閘極線上的寄生電阻與寄生電容會形成RC負載，導致信號傳輸發生延遲。例如，閘極線GD31的RC負載導致傳輸延遲，使得像素單元P11、P12與P13所收到的閘極驅動信號GD31a、GD31b與GD31c具有不同的延遲時間。閘極驅動信號GD31a、GD31b與GD31c的所述延遲時間響應於像素單元P11、P12與P13至閘極驅動裝置320_1的距離。相類似地，閘極線GD32的RC負載導致傳輸延遲，使得像素單元P21、P22與P23所收到的閘極驅動信號GD32a、GD32b與GD32c具有不同的延遲時間。隨著顯示面板340的尺寸加大，閘極線的延遲效應會越明顯。在距離閘極驅動器最遠的位置，其延遲效應最為嚴重。
延遲控制電路331可以控制這些驅動通道332_1、332_2與332_3，來改變所述源極驅動信號於一個水平掃描期間Th內的延遲時間。所述水平掃描期間Th也可以稱為水平線期間或一條掃描線期間。這些源極驅動信號的延遲時間分別響應於這些源極線SD31、SD32與SD33至閘極驅動裝置(例如閘極驅動裝置320_1、320_2)的距離。距離越遠，則延遲時間越大。也就是說，這些源極驅動信號的延遲時間互不相同。舉例來說(但不限於此)，驅動通道332_1傳輸至源極線SD31的源極驅動信號的延遲時間可以被設定為Td1，驅動通道332_2傳輸至源極線SD32的源極驅動信號的延遲時間可以被設定為Td2，而驅動通道332_3傳輸至源極線 SD33的源極驅動信號的延遲時間可以被設定為Td3。這些源極驅動信號的延遲時間Td1、Td2與Td3互不相同。
對同一條閘極線(例如閘極線GD2)而言，像素單元P21的有效充電時間為Tch31，像素單元P22的有效充電時間為Tch32，而像素單元P23的有效充電時間為Tch33。從圖4可以知道，由於不同驅動通道332_1、332_2與332_3所輸出的源極驅動信號於水平掃描期間Th內具有不同的延遲時間Td1、Td2與Td3，因此像素單元的有效充電時間可以被增加。舉例來說(但不限於此)，比較圖2與圖4，假設圖4所示源極線SD31的源極驅動信號的有效充電時間Tch31約略等於圖2所示源極線SD1的源極驅動信號的有效充電時間Tch1，則圖4所示源極線SD32的源極驅動信號的有效充電時間Tch32大於圖2所示源極線SD2的源極驅動信號的有效充電時間Tch2，且圖4所示源極線SD33的源極驅動信號的有效充電時間Tch33大於圖2所示源極線SD3的源極驅動信號的有效充電時間Tch3。有效充電時間的增加，可以改善像素單元充電不足的問題。
圖3所示源極驅動裝置330_2可以參照源極驅動裝置330_1的相關說明而類推。在一些實施例中，源極驅動裝置330_1所輸出的源極驅動信號的任一者的延遲時間小於源極驅動裝置330_2所輸出的源極驅動信號的任一者的延遲時間。
圖5是依照本發明另一實施例繪示了圖3所示信號的時序示意圖。圖5所示實施例可以參照圖4所示實施例的相關說明 而類推。相較於圖4所示實施例，於圖5所示閘極線的閘極驅動信號之脈寬可以加大。時序控制器310經由控制匯流排提供輸出致能信號OE給閘極驅動器320_1與320_2，以控制閘極驅動器320_1與320_2所輸出閘極驅動信號之脈寬。
請參照圖3與圖5。延遲控制電路331可以控制這些驅動通道332_1、332_2與332_3，來改變這些源極線SD31、SD32與SD33的源極驅動信號於一個水平掃描期間Th內的延遲時間。這些源極驅動信號的延遲時間分別響應於這些源極線SD31、SD32與SD33至閘極驅動裝置(例如閘極驅動裝置320_1、320_2)的距離。舉例來說(但不限於此)，驅動通道332_1傳輸至源極線SD31的源極驅動信號的延遲時間可以被設定為Td1，驅動通道332_2傳輸至源極線SD32的源極驅動信號的延遲時間可以被設定為Td2，而驅動通道332_3傳輸至源極線SD33的源極驅動信號的延遲時間可以被設定為Td3。
對同一條閘極線(例如閘極線GD2)而言，像素單元P21的有效充電時間為Tch51，像素單元P22的有效充電時間為Tch52，而像素單元P23的有效充電時間為Tch53。比較圖4與圖5，假設圖4所示水平掃描期間Th約略等於圖5所示水平掃描期間Th，則圖5所示源極線SD31的源極驅動信號的有效充電時間Tch51大於圖4所示源極線SD31的源極驅動信號的有效充電時間Tch31，圖5所示源極線SD32的源極驅動信號的有效充電時間Tch52大於圖4所示源極線SD32的源極驅動信號的有效充電時間 Tch32，且圖5所示源極線SD33的源極驅動信號的有效充電時間Tch53大於圖4所示源極線SD33的源極驅動信號的有效充電時間Tch33。有效充電時間的增加，可以改善像素單元充電不足的問題。
於上述諸實施例中，這些驅動通道所輸出不同源極驅動信號具有不同的延遲時間。無論如何，本發明的實施方式並不限於此。在另一些實施例中，圖3所示驅動通道332_1、332_2、332_3與其他驅動通道可以被分群為多個通道群組。其中，屬於相同通道群組的驅動通道所輸出的源極驅動信號的延遲時間互為相同，而屬於不同通道群組的驅動通道所輸出的源極驅動信號的延遲時間互不相同。舉例來說(但不限於此)，假設驅動通道332_1、332_2屬於第一通道群組，而驅動通道332_3屬於第二通道群組，則驅動通道332_1所輸出的源極驅動信號的延遲時間可以相同於驅動通道332_2所輸出的源極驅動信號的延遲時間，而驅動通道332_3所輸出的源極驅動信號的延遲時間不相同於驅動通道332_1與332_2所輸出的源極驅動信號的延遲時間。
圖6是依照本發明一實施例說明圖3所示顯示裝置300的電路方塊示意圖。此顯示裝置300包含外部控制器(例如時序控制器610)、一個或多個源極驅動裝置(例如圖1所示330_1、330_2與330_3)以及顯示面板340。依照產品設計需求，時序控制器610可能包括時序控制器、微控制器或是其他控制電路。
以下將以源極驅動裝置330_1作為說明範例。其餘源極驅動裝置(例如源極驅動裝置330_2與330_3)可以參照源極驅動 裝置330_1的相關說明而類推，故不再贅述。
源極驅動裝置330_1包括一個延遲控制電路331以及多個驅動通道(例如驅動通道332_1)。其餘驅動通道(例如圖3所示驅動通道332_2與332_3)可以參照驅動通道332_1的相關說明而類推，故不再贅述。驅動通道332_1包括輸出緩衝器620以及輸出開關630。輸出開關630的第一端耦接至輸出緩衝器620的輸出端。輸出開關630的第二端耦接至顯示面板340的多個源極線中的一條對應源極線(例如圖3所示源極線SD31)。
延遲控制電路331經配置以耦接時序控制器610。依據時序控制器610的控制，延遲控制電路331可以決定源極驅動裝置330_1內多個驅動通道(例如驅動通道332_1)所輸出源極驅動信號的延遲時間(例如圖4、5所示延遲時間Td1)。以圖6所示電路為例，延遲控制電路331可以控制輸出開關630的導通時序，以改變對應源極線(例如圖3所示源極線SD31)的源極驅動信號的延遲時間(例如圖4、5所示延遲時間Td1)。
圖6所示源極驅動裝置330_2與330_3可以參照源極驅動裝置330_1的相關說明而類推。基於時序控制器610的控制，源極驅動裝置330_1所輸出的源極驅動信號的任一者的延遲時間均小於源極驅動裝置330_2所輸出的源極驅動信號的任一者的延遲時間，而源極驅動裝置330_2所輸出的源極驅動信號的任一者的延遲時間均小於源極驅動裝置330_3所輸出的源極驅動信號的任一者的延遲時間。也就是說，這些源極驅動信號的延遲時間分 別響應於所屬源極線至閘極驅動裝置的距離。距離越遠，則延遲時間越大。
於上述諸實施例中，源極驅動裝置330_1的延遲控制電路331是受控於時序控制器610來決定這些驅動通道(例如圖3所示驅動通道332_1、332_2與332_3)的延遲時間(例如圖4、5所示延遲時間Td1、Td2與Td3)。無論如何，本發明的實施方式並不限於此。舉例來說，在另一些實施例中，延遲控制電路331可以具有自我偵測能力，並依據偵測結果來動態決定這些驅動通道(例如圖3所示驅動通道332_1、332_2與332_3)的延遲時間(例如圖4、5所示延遲時間Td1、Td2與Td3)。
圖7是依照本發明另一實施例說明圖3所示顯示裝置300的電路方塊示意圖。於圖7所示實施例中，顯示面板340還配置了一條假閘極線(dummy gate line)GD30。閘極驅動裝置320_1與320_2輸出閘極驅動信號(掃描信號)至假閘極線GD30、閘極線GD31、閘極線GD32與閘極線GD33。不同於閘極線GD31、GD32與GD33之處在於，假閘極線GD30並未連接任何像素單元。源極驅動裝置330_1、330_2與330_3各自具有偵測端INA與INB。這些源極驅動裝置330_1、330_2與330_3的偵測端INA與INB分別耦接至顯示面板340的假閘極線GD30的不同位置，以偵測閘極驅動裝置320_1所輸出閘極驅動信號在不同位置的時序。舉例來說，源極驅動裝置330_1的偵測端INA與INB分別耦接至假閘極線GD30的位置A與位置B，源極驅動裝置330_2的偵測端 INA與INB分別耦接至假閘極線GD30的位置C與位置D，而源極驅動裝置330_3的偵測端INA與INB分別耦接至假閘極線GD30的位置E與位置F。依據偵測結果，源極驅動裝置330_1、330_2與330_3可以動態決定源極驅動信號的延遲時間(請參照圖4、5所示延遲時間Td1、Td2與Td3的相關說明而類推)。
圖8是依照本發明一實施例說明圖7所示源極驅動裝置的電路方塊示意圖。以下將以源極驅動裝置330_1作為說明範例。其餘源極驅動裝置(例如源極驅動裝置330_2與330_3)可以參照源極驅動裝置330_1的相關說明而類推，故不再贅述。
源極驅動裝置330_1包括一個延遲控制電路331以及多個驅動通道(例如驅動通道332_1)。其餘驅動通道(例如圖3所示驅動通道332_2與332_3)可以參照驅動通道332_1的相關說明而類推，故不再贅述。驅動通道332_1的輸出端耦接至顯示面板340的多個源極線中的一條對應源極線(例如圖3所示源極線SD31)。
延遲控制電路331的第一偵測端經由源極驅動裝置330_1的偵測端INA耦接至顯示面板340的假閘極線GD30的位置A，而延遲控制電路331的第二偵測端經由源極驅動裝置330_1的偵測端INB耦接至假閘極線GD30的位置B。延遲控制電路331可以偵測閘極驅動信號在位置A與位置B的時序。依據閘極驅動信號在位置A與位置B的時序(或時間差T1)，延遲控制電路331可以自我決定源極驅動裝置330_1所輸出源極驅動信號的延遲時 間(例如圖4、5所示延遲時間Td1、Td2與Td3)。
以此類推，源極驅動裝置330_2的延遲控制電路的第一偵測端與第二偵測端分別經由源極驅動裝置330_2的偵測端INA與偵測端INB耦接至假閘極線GD30的位置C與位置D，而源極驅動裝置330_3的延遲控制電路的第一偵測端與第二偵測端分別經由源極驅動裝置330_3的偵測端INA與偵測端INB耦接至假閘極線GD30的位置E與位置F。源極驅動裝置330_2的延遲控制電路可以偵測閘極驅動信號在位置C與位置D的時序(或時間差T2)，以及自我決定源極驅動裝置330_2所輸出源極驅動信號的延遲時間。源極驅動裝置330_3的延遲控制電路可以偵測閘極驅動信號在位置E與位置F的時序(或時間差T3)，以及自我決定源極驅動裝置330_3所輸出源極驅動信號的延遲時間。
於圖8所示實施例中，延遲控制電路331包括上升緣偵測電路810以及控制器820。上升緣偵測電路810耦接至延遲控制電路331的第一偵測端，以偵測在位置A處的閘極驅動信號的上升緣時序而獲得第一時點。上升緣偵測電路810耦接至延遲控制電路331的第二偵測端，以偵測在位置B處的閘極驅動信號的上升緣時序而獲得第二時點。控制器820耦接至上升緣偵測電路810與所述多個驅動通道(例如驅動通道332_1)。控制器820經配置以計算所述第一時點與所述第二時點的時間差T1，以及依據時間差T1來決定所述多個驅動通道的源極驅動信號的延遲時間(請參照圖4、5所示延遲時間Td1、Td2與Td3的相關說明而類推)。
在此說明源極驅動裝置的操作方法。此操作方法包括：由多個驅動通道以一對一方式輸出多個源極驅動信號給顯示面板的多個源極線；以及由延遲控制電路控制該些驅動通道，以改變該些源極驅動信號於一個水平掃描期間內的延遲時間。其中，該些源極驅動信號的所述延遲時間分別響應於該些源極線至顯示面板的閘極驅動裝置的距離。
在一些實施例中，該些源極驅動信號的延遲時間互不相同。在另一些實施例中，該些驅動通道被分群為多個通道群組，其中屬於相同通道群組的驅動通道的該些源極驅動信號的延遲時間互為相同，屬於不同通道群組的源極驅動信號的延遲時間互不相同。
在一些實施例中，源極驅動裝置(第一源極驅動裝置)所輸出的所述多個源極驅動信號的任一者的延遲時間均小於顯示面板的另一源極驅動裝置(第二源極驅動裝置)所輸出的多個源極驅動信號的任一者的延遲時間。其中，此第一源極驅動裝置所連接的源極線至閘極驅動裝置的距離均小於此第二源極驅動裝置所連接的源極線至閘極驅動裝置的距離。
在一些實施例中，源極驅動裝置的該延遲控制電路依據外部控制器(例如時序控制器或是其他控制電路)的控制來決定該些源極驅動信號的延遲時間。
在另一些實施例中，源極驅動裝置的該延遲控制電路可以偵測閘極驅動信號在顯示面板的假閘極線的第一位置與第二位 置的時序。依據閘極驅動信號在該第一位置與該第二位置的時序，該延遲控制電路可以自我決定該些源極驅動信號的延遲時間。舉例來說(但不限於此)，延遲控制電路可以偵測在該第一位置處的閘極驅動信號的上升緣時序而獲得第一時點，以及偵測在該第二位置處的閘極驅動信號的上升緣時序而獲得第二時點。該延遲控制電路可以計算該第一時點與該第二時點的時間差，以及依據該時間差來動態決定該些驅動通道的該些源極驅動信號的延遲時間。
綜上所述，本發明實施例提供一種源極驅動裝置及其操作方法，使不同驅動通道所輸出的源極驅動信號於一個水平掃描期間內具有不同的延遲時間(例如圖4、5所示延遲時間Td1、Td2與Td3)，以便增加像素單元的有效充電時間(例如圖4所示有效充電時間Tch31、Tch32與Tch33，或圖5所示有效充電時間Tch51、Tch52與Tch53)。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何所屬技術領域中具有通常知識者，在不脫離本發明的精神和範圍內，當可作些許的更動與潤飾，故本發明的保護範圍當視後附的申請專利範圍所界定者為準。
GD31、GD32‧‧‧閘極線
GD31a、GD31b、GD31c、GD32a、GD32b、GD32c‧‧‧閘極驅動信號
LD‧‧‧線閂鎖信號
SD31、SD32、SD33‧‧‧源極線
Tch31、Tch32、Tch33‧‧‧有效充電時間
Td1、Td2、Td3‧‧‧延遲時間
Th‧‧‧水平掃描期間

Claims (19)

  1. 一種源極驅動裝置，經配置驅動一顯示面板的多個源極線，該顯示面板還包括一閘極驅動裝置，該源極驅動裝置包括：多個驅動通道，經配置輸出多個源極驅動信號；以及一延遲控制電路，經配置以控制該些驅動通道來改變該些源極驅動信號於一期間內的延遲時間，使該些源極驅動信號的所述延遲時間分別響應於該些源極線至該閘極驅動裝置的距離。
  2. 如申請專利範圍第1項所述的源極驅動裝置，其中該些源極驅動信號的延遲時間互不相同。
  3. 如申請專利範圍第1項所述的源極驅動裝置，其中該期間為一水平掃描期間。
  4. 如申請專利範圍第1項所述的源極驅動裝置，其中該些驅動通道被分群為多個通道群組，屬於相同通道群組的該些驅動通道的該些源極驅動信號的延遲時間互為相同，屬於不同通道群組的該些源極驅動信號的延遲時間互不相同。
  5. 如申請專利範圍第1項所述的源極驅動裝置，其中該顯示面板還耦接一第二源極驅動裝置，而該源極驅動裝置所輸出的該些源極驅動信號的任一者的延遲時間小於該第二源極驅動裝置所輸出的多個源極驅動信號的任一者的延遲時間。
  6. 如申請專利範圍第1項所述的源極驅動裝置，其中該些驅動通道之一者包括：一輸出緩衝器；以及 一輸出開關，其第一端耦接至該輸出緩衝器的輸出端，該輸出開關的第二端耦接至該些源極線中的一對應源極線，其中該延遲控制電路控制該輸出開關的導通時序以改變該對應源極線的該源極驅動信號的延遲時間。
  7. 如申請專利範圍第1項所述的源極驅動裝置，其中該延遲控制電路經配置以耦接一外部控制器，以及依據該外部控制器的控制來決定該些源極驅動信號的所述延遲時間。
  8. 如申請專利範圍第7項所述的源極驅動裝置，其中該外部控制器包括一時序控制器。
  9. 如申請專利範圍第1項所述的源極驅動裝置，其中該延遲控制電路的一第一偵測端與一第二偵測端分別耦接至該顯示面板的一假閘極線的一第一位置與一第二位置，以偵測一閘極驅動信號在該第一位置與該第二位置的時序，以及依據該閘極驅動信號在該第一位置與該第二位置的時序來決定該些源極驅動信號的所述延遲時間。
  10. 如申請專利範圍第9項所述的源極驅動裝置，其中該延遲控制電路包括：一上升緣偵測電路，耦接至該延遲控制電路的該第一偵測端以偵測在該第一位置該閘極驅動信號的上升緣時序而獲得一第一時點，以及耦接至該延遲控制電路的該第二偵測端以偵測在該第二位置該閘極驅動信號的上升緣時序而獲得一第二時點；以及一控制器，耦接至該上升緣偵測電路與該些驅動通道，該控 制器經配置以計算該第一時點與該第二時點的一時間差，以及依據該時間差來決定該些驅動通道的該些源極驅動信號的延遲時間。
  11. 一種源極驅動裝置的操作方法，以驅動一顯示面板的多個源極線，該顯示面板還包括一閘極驅動裝置，該操作方法包括：輸出多個源極驅動信號以驅動該些源極線；以及配置該些源極驅動信號於一期間內的延遲時間，使該些源極驅動信號的所述延遲時間分別響應於該些源極線至該閘極驅動裝置的距離。
  12. 如申請專利範圍第11項所述的源極驅動裝置的操作方法，其中該些源極驅動信號的延遲時間互不相同。
  13. 如申請專利範圍第11項所述的源極驅動裝置的操作方法，其中該期間為一水平掃描期間。
  14. 如申請專利範圍第11項所述的源極驅動裝置的操作方法，其中該些驅動通道被分群為多個通道群組，屬於相同通道群組的該些驅動通道的該些源極驅動信號的延遲時間互為相同，屬於不同通道群組的該些源極驅動信號的延遲時間互不相同。
  15. 如申請專利範圍第11項所述的源極驅動裝置的操作方法，其該源極驅動裝置所輸出的該些源極驅動信號的任一者的延遲時間小於該顯示面板的一第二源極驅動裝置所輸出的多個源極驅動信號的任一者的延遲時間。
  16. 如申請專利範圍第11項所述的源極驅動裝置的操作方 法，其中所述由該延遲控制電路控制該些驅動通道以改變該些源極驅動信號於該水平掃描期間內的延遲時間之步驟包括：由該延遲控制電路依據一外部控制器的控制來決定該些源極驅動信號的所述延遲時間。
  17. 如申請專利範圍第16項所述的源極驅動裝置的操作方法，其中該外部控制器包括一時序控制器。
  18. 如申請專利範圍第11項所述的源極驅動裝置的操作方法，其中所述由該延遲控制電路控制該些驅動通道以改變該些源極驅動信號於該水平掃描期間內的延遲時間之步驟包括：由該延遲控制電路偵測一閘極驅動信號在該顯示面板的一假閘極線的一第一位置與一第二位置的時序；以及由該延遲控制電路依據該閘極驅動信號在該第一位置與該第二位置的時序來決定該些源極驅動信號的所述延遲時間。
  19. 如申請專利範圍第18項所述的源極驅動裝置的操作方法，其中所述由該延遲控制電路控制該些驅動通道以改變該些源極驅動信號於該水平掃描期間內的延遲時間之步驟更包括：由該延遲控制電路偵測在該第一位置該閘極驅動信號的上升緣時序而獲得一第一時點；由該延遲控制電路偵測在該第二位置該閘極驅動信號的上升緣時序而獲得一第二時點；由該延遲控制電路計算該第一時點與該第二時點的一時間差；以及 由該延遲控制電路依據該時間差來決定該些驅動通道的該些源極驅動信號的延遲時間。
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