CN106205511B - 源极驱动装置及其操作方法 - Google Patents

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Abstract

本发明提供一种源极驱动装置及其操作方法。源极驱动装置可以驱动显示面板的多个源极线，而该显示面板还包括栅极驱动装置。源极驱动装置包括多个驱动通道以及一延迟控制电路。这些驱动通道输出多个源极驱动信号。延迟控制电路控制这些驱动通道，来改变这些源极驱动信号在相同期间内的延迟时间，使这些源极驱动信号的所述延迟时间分别响应于这些源极线至栅极驱动装置的距离。本发明提供的源极驱动装置及其操作方法，可以增加像素单元的有效充电时间。

Description

源极驱动装置及其操作方法
技术领域
本发明是有关于一种显示装置，且特别是有关于一种源极驱动装置及其操作方法。
背景技术
图1是说明薄膜晶体管(Thin Film Transistor，简称TFT)液晶显示器(LiquidCrystal Display，简称LCD)的电路方块示意图。液晶显示器10包含一个时序控制器(timing controller)11、一个或多个栅极驱动器(gate driver，例如图1所示12_1与12_2)、一个或多个源极驱动器(source driver，例如图1所示13_1、13_2与13_3)以及显示面板14。
栅极驱动器12_1与12_2耦接于时序控制器11与显示面板14之间。在栅极驱动器12_1与12_2接收到时序控制器11所提供的垂直起始信号STV后，垂直起始信号STV便在栅极驱动器12_1与12_2的内部依照栅极时脉信号CPV的时序开始逐级递移。因此，栅极驱动器12_1与12_2便可依据垂直起始信号STV的递移位置而一个接着一个地轮流驱动显示面板14的每一条栅极线。例如，栅极线GD1先被驱动，然后依次驱动栅极线GD2、GD3、…等。时序控制器11通过控制总线提供输出致能信号OE(或是输出禁能信号)给栅极驱动器12_1与12_2，以控制栅极驱动器12_1与12_2所输出栅极驱动信号的脉宽。
源极驱动器13_1、13_2与13_3耦接于时序控制器11与显示面板14之间。在源极驱动器13_1、13_2与13_3接收到时序控制器11所提供的水平起始信号STH后，水平起始信号STH便在源极驱动器13_1、13_2与13_3的内部依照源极时脉信号CK的时序开始逐级递移。时序控制器11将多条线数据(显示数据)以串行的方式依次输出至数据线总线DAT，因此源极驱动器13_1、13_2与13_3可以从数据线总线DAT获得显示数据。数据线总线DAT例如是符合小型低电压差动信号传输接口(Mini Low Voltage Differential Signaling,简称mini-LVDS)规格的总线。依据时序控制器11所输出源极时脉信号CK与水平起始信号STH的控制，源极驱动器13_1、13_2与13_3可以将数据线总线DAT的不同显示数据闩锁于对应的驱动通道中。依据线闩锁信号LD的控制，源极驱动器13_1、13_2与13_3可以将被闩锁于这些驱动通道的显示数据同时转换为源极驱动信号。配合栅极驱动器12_1与12_2的扫描时序，这些源极驱动信号可以被写入显示面板14的多个像素(pixel)单元中(例如图1所示P1、P2、P3、P4、P5、P6、P7、P8与P9)以显示图像。
显示面板14是由两基板(Substrate)构成，而在两基板间填充有液晶材料(LCDlayer)。显示面板14设置有多条源极线(source line，或称数据线，例如图1所示SD1、SD2与SD3)、多条栅极线(gate line，或称扫描线，例如图1所示GD1、GD2与GD3)以及复数个像素单元(例如图1所示P1、P2、P3、P4、P5、P6、P7、P8与P9)。源极线SD1、SD2与SD3垂直于栅极线GD1、GD2与GD3。像素单元P1～P9是以矩阵的方式分布于显示面板14上。图1示出了像素单元P3的范例电路图，而其他像素单元P1～P2、P4～P9可以参照像素单元P3而类推。
栅极驱动器12_1与12_2输出栅极驱动信号至栅极线GD1、GD2与GD3。栅极驱动信号会因为栅极线上RC负载导致传输延迟。图1示出了栅极线GD1、GD2与GD3的等效电路，其中电阻符号表示栅极线的等效电阻(或寄生电阻)，而电容符号表示栅极线的等效电容(或寄生电容)。栅极线上的寄生电阻与寄生电容会形成RC负载，导致信号传输发生延迟。随着显示面板14的尺寸加大，栅极线的延迟效应会越明显。在距离栅极驱动器最远的位置，其延迟效应最为严重。
图2示出了图1所示信号的时序示意图。请参照图1与图2，在栅极线GD1的脉冲结束后，栅极线GD2的脉冲才开始上升。栅极线GD1的RC负载导致传输延迟，使得像素单元P1、P2与P3所收到的栅极驱动信号GD1a、GD1b与GD1c具有不同的延迟时间。栅极驱动信号GD1a、GD1b与GD1c的所述延迟时间响应于像素单元P1、P2与P3至栅极驱动装置12_1的距离。相类似地，栅极线GD2的RC负载导致传输延迟，使得像素单元P4、P5与P6所收到的栅极驱动信号GD2a、GD2b与GD2c具有不同的延迟时间。栅极驱动信号GD2a、GD2b与GD2c的所述延迟时间响应于像素单元P4、P5与P6至栅极驱动装置12_1的距离。
为了确保前一条栅极线(例如GD1)的所有像素单元都关闭(turn off)后，下一条栅极线(例如GD2)的像素单元才可以打开(turn on)，时序控制器11可以利用致能信号OE来缩小栅极驱动信号的脉宽。栅极驱动信号的脉宽被缩小，意味着源极驱动器对像素单元进行充电的时间被缩小。充电时间被缩小将导致像素单元因充电不足致使显示异常。此现象在越大尺寸的面板更显严重。
从图2可以知道，对同一条栅极线GD2而言，较靠近栅极驱动装置12_1的像素单元P4可以获得较大的有效充电时间Tch1。远离栅极驱动装置12_1的像素单元P5的有效充电时间Tch2小于像素单元P4的有效充电时间Tch1，而远离栅极驱动装置12_1的像素单元P6的有效充电时间Tch3又小于像素单元P5的有效充电时间Tch2。有效充电时间被缩小，可能导致远离栅极驱动装置12_1的像素单元(例如像素单元P6和/或像素单元P5)因充电不足致使显示异常。
发明内容
本发明提供一种源极驱动装置及其操作方法，以便增加像素单元的有效充电时间。
本发明的实施例提供一种源极驱动装置。源极驱动装置经配置驱动显示面板的多个源极线，该显示面板还包括栅极驱动装置。源极驱动装置包括多个驱动通道以及一延迟控制电路。这些驱动通道输出多个源极驱动信号。延迟控制电路控制这些驱动通道，来改变这些源极驱动信号在期间内的延迟时间，使这些源极驱动信号的所述延迟时间分别响应于这些源极线至栅极驱动装置的距离。
在本发明的一实施例中，上述的驱动通道之一者包括输出缓冲器以及输出开关。输出开关的第一端耦接至输出缓冲器的输出端。输出开关的第二端耦接至源极线中的对应源极线。延迟控制电路控制输出开关的导通时序，以改变对应源极线的源极驱动信号的延迟时间。
在本发明的一实施例中，上述的延迟控制电路经配置以耦接外部控制器。依据外部控制器的控制来决定源极驱动信号的延迟时间。
在本发明的一实施例中，上述的延迟控制电路的第一检测端与第二检测端分别耦接至显示面板的假栅极线(dummy gate line)的第一位置与第二位置，以检测栅极驱动信号在第一位置与第二位置的时序。依据栅极驱动信号在第一位置与第二位置的时序来决定该些源极驱动信号的延迟时间。
在本发明的一实施例中，上述的延迟控制电路包括上升缘检测电路以及控制器。上升缘检测电路耦接至延迟控制电路的第一检测端，以检测在第一位置该栅极驱动信号的上升缘时序，而获得第一时点。上升缘检测电路耦接至延迟控制电路的第二检测端，以检测在第二位置该栅极驱动信号的上升缘时序，而获得第二时点。控制器耦接至上升缘检测电路与该些驱动通道。控制器经配置以计算第一时点与第二时点的时间差，以及依据时间差来决定该些驱动通道的源极驱动信号的延迟时间。
本发明的实施例提供一种源极驱动装置的操作方法，以驱动显示面板的多个源极线，该显示面板还包括栅极驱动装置。该操作方法包括：输出多个源极驱动信号以驱动该些源极线；以及配置这些源极驱动信号在期间内的延迟时间，使这些源极驱动信号的所述延迟时间分别响应于这些源极线至栅极驱动装置的距离。
在本发明的一实施例中，上述的源极驱动信号的延迟时间互不相同。
在本发明的一实施例中，上述的期间为一水平扫描期间。
在本发明的一实施例中，上述的驱动通道被分群为多个通道群组。属于相同通道群组的驱动通道的源极驱动信号的延迟时间互为相同。属于不同通道群组的源极驱动信号的延迟时间互不相同。
在本发明的一实施例中，上述的显示面板还耦接第二源极驱动装置。源极驱动装置所输出的源极驱动信号的任一者的延迟时间小于第二源极驱动装置所输出的多个源极驱动信号的任一者的延迟时间。
在本发明的一实施例中，上述的由该延迟控制电路控制该些驱动通道以改变该些源极驱动信号在该水平扫描期间内的延迟时间的步骤包括：由该延迟控制电路依据外部控制器的控制来决定该些源极驱动信号的所述延迟时间。
在本发明的一实施例中，上述的外部控制器包括时序控制器。
在本发明的一实施例中，上述的由该延迟控制电路控制该些驱动通道以改变该些源极驱动信号在该水平扫描期间内的延迟时间的步骤包括：由该延迟控制电路检测栅极驱动信号在该显示面板的假栅极线的第一位置与第二位置的时序，以及由该延迟控制电路依据该栅极驱动信号在该第一位置与该第二位置的时序来决定该些源极驱动信号的所述延迟时间。
在本发明的一实施例中，上述的由该延迟控制电路控制该些驱动通道以改变该些源极驱动信号在该水平扫描期间内的延迟时间的步骤还包括：由该延迟控制电路检测在该第一位置该栅极驱动信号的上升缘时序而获得第一时点；由该延迟控制电路检测在该第二位置该栅极驱动信号的上升缘时序而获得第二时点；由该延迟控制电路计算该第一时点与该第二时点的时间差；以及由该延迟控制电路依据该时间差来决定该些驱动通道的该些源极驱动信号的延迟时间。
基于上述，本发明实施例提供一种源极驱动装置及其操作方法，使不同驱动通道所输出的源极驱动信号在一个水平扫描期间内具有不同的延迟时间，以便增加像素单元的有效充电时间。
为让本发明的上述特征和优点能更明显易懂，下文特举实施例，并配合附图作详细说明如下。
附图说明
图1是说明薄膜晶体管液晶显示器的电路方块示意图；
图2示出了图1所示信号的时序示意图；
图3是本发明实施例说明一种显示装置的电路方块示意图；
图4是本发明一实施例示出了图3所示信号的时序示意图；
图5是本发明另一实施例示出了图3所示信号的时序示意图；
图6是本发明一实施例说明图3所示显示装置的电路方块示意图；
图7是本发明另一实施例说明图3所示显示装置的电路方块示意图；
图8是本发明一实施例说明图7所示源极驱动装置的电路方块示意图。
附图标记说明：
10：液晶显示器；
11、310：时序控制器；
12_1、12_2：栅极驱动器；
13_1、13_2、13_3：源极驱动器；
14、340：显示面板；
300：显示装置；
320_1、320_2：栅极驱动装置；
330_1、330_2、330_3：源极驱动装置；
331：延迟控制电路；
332_1、332_2、332_3：驱动通道；
610：时序控制器；
620：输出缓冲器；
630：输出开关；
810：上升缘检测电路；
820：控制器；
A、B、C、D、E、F：位置；
CK：源极时脉信号；
CPV：栅极时脉信号；
DAT：数据线总线；
GD1、GD2、GD3、GD31、GD32、GD33：栅极线；
GD1a、GD1b、GD1c、GD2a、GD2b、GD2c、GD31a、GD31b、GD31c、GD32a、GD32b、GD32c：栅极驱动信号；
GD30：假栅极线；
INA、INB：检测端；
LD：线闩锁信号；
OE：输出致能信号；
P1、P2、P3、P4、P5、P6、P7、P8、P9、P11、P12、P13、P14、P15、P21、P22、P23、P24、P25、P31、P32、P33、P34、P35：像素单元；
SD1、SD2、SD3、SD31、SD32、SD33、SD34、SD35：源极线；
STH：水平起始信号；
STV：垂直起始信号；
T1、T2、T3：时间差；
Tch1、Tch2、Tch3、Tch31、Tch32、Tch33、Tch51、Tch52、Tch53：有效充电时间；
Td1、Td2、Td3：延迟时间；
Th：水平扫描期间。
具体实施方式
在本案说明书全文(包括申请专利范围)中所使用的“耦接”一词可指任何直接或间接的连接手段。举例而言，若文中描述第一装置耦接于第二装置，则应该被解释成该第一装置可以直接连接于该第二装置，或者该第一装置可以通过其他装置或某种连接手段而间接地连接至该第二装置。另外，凡可能之处，在图式及实施方式中使用相同标号的元件/构件/步骤代表相同或类似部分。不同实施例中使用相同标号或使用相同用语的元件/构件/步骤可以相互参照相关说明。
图3是本发明实施例说明一种显示装置的电路方块示意图。此显示装置300可以是薄膜晶体管(Thin Film Transistor，简称TFT)液晶显示器(LiquidCrystal Display，简称LCD)或是其他类型的显示装置。显示装置300包含一个时序控制器(timing controller)310、一个或多个栅极驱动装置(例如图3所示320_1与320_2)、一个或多个源极驱动装置(例如图3所示330_1与330_2)以及显示面板340。栅极驱动装置320_1与320_2可以是不同的栅极驱动器(gate driver)或是栅极驱动集成电路。源极驱动装置330_1与330_2可以是不同的源极驱动器(source driver)或是源极驱动集成电路。图3所示时序控制器310、栅极驱动装置320_1、栅极驱动装置320_2与显示面板340可以参照图1所示时序控制器11、栅极驱动器12_1、栅极驱动器12_2与显示面板14的相关说明而类推。
图3所示显示面板340设置有多条源极线(source line，或称数据线，例如图3所示SD31、SD32、SD33、SD34与SD35)、多条栅极线(gate line，或称扫描线，例如图3所示GD31、GD32与GD33)以及复数个像素单元(例如图3所示P11、P12、P13、P14、P15、P21、P22、P23、P24、P25、P31、P32、P33、P34与P35)。图3所示栅极线GD31～GD33、源极线SD31～SD35、像素单元P11～P15、像素单元P21～P25与像素单元P31～P35可以参照图1所示栅极线GD1～GD3、源极线SD1～SD3与像素单元P1～P9的相关说明而类推。
栅极驱动装置320_1与320_2耦接于时序控制器310与显示面板340之间。依照栅极时脉信号CPV的触发时序，栅极驱动装置320_1与320_2便可将垂直起始信号STV从第一条栅极线一个接着一个地递移(shift)到最后一条栅极线。例如，栅极线GD31先被驱动，然后依次驱动栅极线GD32、GD33、…等。
以下将以源极驱动装置330_1作为说明范例。其余源极驱动装置(例如源极驱动装置330_2)可以参照源极驱动装置330_1的相关说明而类推，故不再赘述。
源极驱动装置330_1包括一个延迟控制电路331以及多个驱动通道(例如驱动通道332_1、332_2与332_3)。这些驱动通道332_1、332_2与332_3以一对一方式输出多个源极驱动信号给显示面板340的多个源极线(例如源极线SD31、SD32与SD33)。举例来说，在源极驱动装置330_1接收到时序控制器310所提供的水平起始信号后，此水平起始信号便依照源极时脉信号的时序在这些驱动通道332_1、332_2与332_3之间逐级递移。时序控制器310将显示数据以串行的方式依次输出至数据线总线DAT，因此这些驱动通道332_1、332_2与332_3可以从数据线总线DAT获得显示数据。依据时序控制器310所输出源极时脉信号与水平起始信号的控制，这些驱动通道332_1、332_2与332_3可以闩锁数据线总线DAT的对应显示数据。依据线闩锁信号LD的控制，这些驱动通道332_1、332_2与332_3可以将被闩锁的显示数据转换为源极驱动信号。配合栅极驱动器320_1与320_2的扫描时序，这些源极驱动信号可以被写入显示面板340的像素单元P11～P15、P21～P25与P31～P35中以显示图像。
延迟控制电路331可以控制这些驱动通道332_1、332_2与332_3来改变所述源极驱动信号在一个水平扫描期间内的延迟时间。其中，这些源极驱动信号的延迟时间分别响应于这些源极线SD31、SD32与SD33至栅极驱动装置(例如栅极驱动装置320_1、320_2)的距离。距离越远，则延迟时间越大。
举例来说(但不限于此)，图4是本发明一实施例示出了图3所示信号的时序示意图。请参照图3与图4，栅极驱动装置320_1与320_2输出栅极驱动信号至栅极线GD31、GD32与GD33。栅极驱动信号会因为栅极线上RC负载(例如图3所示栅极线GD31、GD32与GD33的等效电路)导致传输延迟。图3所示电阻符号表示栅极线的等效电阻(或寄生电阻)，而电容符号表示栅极线的等效电容(或寄生电容)。栅极线上的寄生电阻与寄生电容会形成RC负载，导致信号传输发生延迟。例如，栅极线GD31的RC负载导致传输延迟，使得像素单元P11、P12与P13所收到的栅极驱动信号GD31a、GD31b与GD31c具有不同的延迟时间。栅极驱动信号GD31a、GD31b与GD31c的所述延迟时间响应于像素单元P11、P12与P13至栅极驱动装置320_1的距离。相类似地，栅极线GD32的RC负载导致传输延迟，使得像素单元P21、P22与P23所收到的栅极驱动信号GD32a、GD32b与GD32c具有不同的延迟时间。随着显示面板340的尺寸加大，栅极线的延迟效应会越明显。在距离栅极驱动器最远的位置，其延迟效应最为严重。
延迟控制电路331可以控制这些驱动通道332_1、332_2与332_3，来改变所述源极驱动信号在一个水平扫描期间Th内的延迟时间。所述水平扫描期间Th也可以称为水平线期间或一条扫描线期间。这些源极驱动信号的延迟时间分别响应于这些源极线SD31、SD32与SD33至栅极驱动装置(例如栅极驱动装置320_1、320_2)的距离。距离越远，则延迟时间越大。也就是说，这些源极驱动信号的延迟时间互不相同。举例来说(但不限于此)，驱动通道332_1传输至源极线SD31的源极驱动信号的延迟时间可以被设定为Td1，驱动通道332_2传输至源极线SD32的源极驱动信号的延迟时间可以被设定为Td2，而驱动通道332_3传输至源极线SD33的源极驱动信号的延迟时间可以被设定为Td3。这些源极驱动信号的延迟时间Td1、Td2与Td3互不相同。
对同一条栅极线(例如栅极线GD2)而言，像素单元P21的有效充电时间为Tch31，像素单元P22的有效充电时间为Tch32，而像素单元P23的有效充电时间为Tch33。从图4可以知道，由于不同驱动通道332_1、332_2与332_3所输出的源极驱动信号在水平扫描期间Th内具有不同的延迟时间Td1、Td2与Td3，因此像素单元的有效充电时间可以被增加。举例来说(但不限于此)，比较图2与图4，假设图4所示源极线SD31的源极驱动信号的有效充电时间Tch31约略等于图2所示源极线SD1的源极驱动信号的有效充电时间Tch1，则图4所示源极线SD32的源极驱动信号的有效充电时间Tch32大于图2所示源极线SD2的源极驱动信号的有效充电时间Tch2，且图4所示源极线SD33的源极驱动信号的有效充电时间Tch33大于图2所示源极线SD3的源极驱动信号的有效充电时间Tch3。有效充电时间的增加，可以改善像素单元充电不足的问题。
图3所示源极驱动装置330_2可以参照源极驱动装置330_1的相关说明而类推。在一些实施例中，源极驱动装置330_1所输出的源极驱动信号的任一者的延迟时间小于源极驱动装置330_2所输出的源极驱动信号的任一者的延迟时间。
图5是本发明另一实施例示出了图3所示信号的时序示意图。图5所示实施例可以参照图4所示实施例的相关说明而类推。相较于图4所示实施例，在图5所示栅极线的栅极驱动信号的脉宽可以加大。时序控制器310通过控制总线提供输出致能信号OE给栅极驱动装置320_1与320_2，以控制栅极驱动装置320_1与320_2所输出栅极驱动信号的脉宽。
请参照图3与图5。延迟控制电路331可以控制这些驱动通道332_1、332_2与332_3，来改变这些源极线SD31、SD32与SD33的源极驱动信号在一个水平扫描期间Th内的延迟时间。这些源极驱动信号的延迟时间分别响应于这些源极线SD31、SD32与SD33至栅极驱动装置(例如栅极驱动装置320_1、320_2)的距离。举例来说(但不限于此)，驱动通道332_1传输至源极线SD31的源极驱动信号的延迟时间可以被设定为Td1，驱动通道332_2传输至源极线SD32的源极驱动信号的延迟时间可以被设定为Td2，而驱动通道332_3传输至源极线SD33的源极驱动信号的延迟时间可以被设定为Td3。
对同一条栅极线(例如栅极线GD2)而言，像素单元P21的有效充电时间为Tch51，像素单元P22的有效充电时间为Tch52，而像素单元P23的有效充电时间为Tch53。比较图4与图5，假设图4所示水平扫描期间Th约略等于图5所示水平扫描期间Th，则图5所示源极线SD31的源极驱动信号的有效充电时间Tch51大于图4所示源极线SD31的源极驱动信号的有效充电时间Tch31，图5所示源极线SD32的源极驱动信号的有效充电时间Tch52大于图4所示源极线SD32的源极驱动信号的有效充电时间Tch32，且图5所示源极线SD33的源极驱动信号的有效充电时间Tch53大于图4所示源极线SD33的源极驱动信号的有效充电时间Tch33。有效充电时间的增加，可以改善像素单元充电不足的问题。
在上述诸实施例中，这些驱动通道所输出不同源极驱动信号具有不同的延迟时间。无论如何，本发明的实施方式并不限于此。在另一些实施例中，图3所示驱动通道332_1、332_2、332_3与其他驱动通道可以被分群为多个通道群组。其中，属于相同通道群组的驱动通道所输出的源极驱动信号的延迟时间互为相同，而属于不同通道群组的驱动通道所输出的源极驱动信号的延迟时间互不相同。举例来说(但不限于此)，假设驱动通道332_1、332_2属于第一通道群组，而驱动通道332_3属于第二通道群组，则驱动通道332_1所输出的源极驱动信号的延迟时间可以相同于驱动通道332_2所输出的源极驱动信号的延迟时间，而驱动通道332_3所输出的源极驱动信号的延迟时间不相同于驱动通道332_1与332_2所输出的源极驱动信号的延迟时间。
图6是本发明一实施例说明图3所示显示装置的电路方块示意图。此显示装置300包含外部控制器(例如时序控制器610)、一个或多个源极驱动装置(例如图1所示330_1、330_2与330_3)以及显示面板340。依照产品设计需求，时序控制器610可能包括时序控制器、微控制器或是其他控制电路。
以下将以源极驱动装置330_1作为说明范例。其余源极驱动装置(例如源极驱动装置330_2与330_3)可以参照源极驱动装置330_1的相关说明而类推，故不再赘述。
源极驱动装置330_1包括一个延迟控制电路331以及多个驱动通道(例如驱动通道332_1)。其余驱动通道(例如图3所示驱动通道332_2与332_3)可以参照驱动通道332_1的相关说明而类推，故不再赘述。驱动通道332_1包括输出缓冲器620以及输出开关630。输出开关630的第一端耦接至输出缓冲器620的输出端。输出开关630的第二端耦接至显示面板340的多个源极线中的一条对应源极线(例如图3所示源极线SD31)。
延迟控制电路331经配置以耦接时序控制器610。依据时序控制器610的控制，延迟控制电路331可以决定源极驱动装置330_1内多个驱动通道(例如驱动通道332_1)所输出源极驱动信号的延迟时间(例如图4、5所示延迟时间Td1)。以图6所示电路为例，延迟控制电路331可以控制输出开关630的导通时序，以改变对应源极线(例如图3所示源极线SD31)的源极驱动信号的延迟时间(例如图4、5所示延迟时间Td1)。
图6所示源极驱动装置330_2与330_3可以参照源极驱动装置330_1的相关说明而类推。基于时序控制器610的控制，源极驱动装置330_1所输出的源极驱动信号的任一者的延迟时间均小于源极驱动装置330_2所输出的源极驱动信号的任一者的延迟时间，而源极驱动装置330_2所输出的源极驱动信号的任一者的延迟时间均小于源极驱动装置330_3所输出的源极驱动信号的任一者的延迟时间。也就是说，这些源极驱动信号的延迟时间分别响应于所属源极线至栅极驱动装置的距离。距离越远，则延迟时间越大。
在上述诸实施例中，源极驱动装置330_1的延迟控制电路331是受控于时序控制器610来决定这些驱动通道(例如图3所示驱动通道332_1、332_2与332_3)的延迟时间(例如图4、5所示延迟时间Td1、Td2与Td3)。无论如何，本发明的实施方式并不限于此。举例来说，在另一些实施例中，延迟控制电路331可以具有自我检测能力，并依据检测结果来动态决定这些驱动通道(例如图3所示驱动通道332_1、332_2与332_3)的延迟时间(例如图4、5所示延迟时间Td1、Td2与Td3)。
图7是本发明另一实施例说明图3所示显示装置的电路方块示意图。在图7所示实施例中，显示面板340还配置了一条假栅极线(dummy gate line)GD30。栅极驱动装置320_1与320_2输出栅极驱动信号(扫描信号)至假栅极线GD30、栅极线GD31、栅极线GD32与栅极线GD33。不同于栅极线GD31、GD32与GD33之处在于，假栅极线GD30并未连接任何像素单元。源极驱动装置330_1、330_2与330_3各自具有检测端INA与INB。这些源极驱动装置330_1、330_2与330_3的检测端INA与INB分别耦接至显示面板340的假栅极线GD30的不同位置，以检测栅极驱动装置320_1所输出栅极驱动信号在不同位置的时序。举例来说，源极驱动装置330_1的检测端INA与INB分别耦接至假栅极线GD30的位置A与位置B，源极驱动装置330_2的检测端INA与INB分别耦接至假栅极线GD30的位置C与位置D，而源极驱动装置330_3的检测端INA与INB分别耦接至假栅极线GD30的位置E与位置F。依据检测结果，源极驱动装置330_1、330_2与330_3可以动态决定源极驱动信号的延迟时间(请参照图4、5所示延迟时间Td1、Td2与Td3的相关说明而类推)。
图8是本发明一实施例说明图7所示源极驱动装置的电路方块示意图。以下将以源极驱动装置330_1作为说明范例。其余源极驱动装置(例如源极驱动装置330_2与330_3)可以参照源极驱动装置330_1的相关说明而类推，故不再赘述。
源极驱动装置330_1包括一个延迟控制电路331以及多个驱动通道(例如驱动通道332_1)。其余驱动通道(例如图3所示驱动通道332_2与332_3)可以参照驱动通道332_1的相关说明而类推，故不再赘述。驱动通道332_1的输出端耦接至显示面板340的多个源极线中的一条对应源极线(例如图3所示源极线SD31)。
延迟控制电路331的第一检测端通过源极驱动装置330_1的检测端INA耦接至显示面板340的假栅极线GD30的位置A，而延迟控制电路331的第二检测端通过源极驱动装置330_1的检测端INB耦接至假栅极线GD30的位置B。延迟控制电路331可以检测栅极驱动信号在位置A与位置B的时序。依据栅极驱动信号在位置A与位置B的时序(或时间差T1)，延迟控制电路331可以自我决定源极驱动装置330_1所输出源极驱动信号的延迟时间(例如图4、5所示延迟时间Td1、Td2与Td3)。
以此类推，源极驱动装置330_2的延迟控制电路的第一检测端与第二检测端分别通过源极驱动装置330_2的检测端INA与检测端INB耦接至假栅极线GD30的位置C与位置D，而源极驱动装置330_3的延迟控制电路的第一检测端与第二检测端分别通过源极驱动装置330_3的检测端INA与检测端INB耦接至假栅极线GD30的位置E与位置F。源极驱动装置330_2的延迟控制电路可以检测栅极驱动信号在位置C与位置D的时序(或时间差T2)，以及自我决定源极驱动装置330_2所输出源极驱动信号的延迟时间。源极驱动装置330_3的延迟控制电路可以检测栅极驱动信号在位置E与位置F的时序(或时间差T3)，以及自我决定源极驱动装置330_3所输出源极驱动信号的延迟时间。
在图8所示实施例中，延迟控制电路331包括上升缘检测电路810以及控制器820。上升缘检测电路810耦接至延迟控制电路331的第一检测端，以检测在位置A处的栅极驱动信号的上升缘时序而获得第一时点。上升缘检测电路810耦接至延迟控制电路331的第二检测端，以检测在位置B处的栅极驱动信号的上升缘时序而获得第二时点。控制器820耦接至上升缘检测电路810与所述多个驱动通道(例如驱动通道332_1)。控制器820经配置以计算所述第一时点与所述第二时点的时间差T1，以及依据时间差T1来决定所述多个驱动通道的源极驱动信号的延迟时间(请参照图4、5所示延迟时间Td1、Td2与Td3的相关说明而类推)。
在此说明源极驱动装置的操作方法。此操作方法包括：由多个驱动通道以一对一方式输出多个源极驱动信号给显示面板的多个源极线；以及由延迟控制电路控制该些驱动通道，以改变该些源极驱动信号在一个水平扫描期间内的延迟时间。其中，该些源极驱动信号的所述延迟时间分别响应于该些源极线至显示面板的栅极驱动装置的距离。
在一些实施例中，该些源极驱动信号的延迟时间互不相同。在另一些实施例中，该些驱动通道被分群为多个通道群组，其中属于相同通道群组的驱动通道的该些源极驱动信号的延迟时间互为相同，属于不同通道群组的源极驱动信号的延迟时间互不相同。
在一些实施例中，源极驱动装置(第一源极驱动装置)所输出的所述多个源极驱动信号的任一者的延迟时间均小于显示面板的另一源极驱动装置(第二源极驱动装置)所输出的多个源极驱动信号的任一者的延迟时间。其中，此第一源极驱动装置所连接的源极线至栅极驱动装置的距离均小于此第二源极驱动装置所连接的源极线至栅极驱动装置的距离。
在一些实施例中，源极驱动装置的该延迟控制电路依据外部控制器(例如时序控制器或是其他控制电路)的控制来决定该些源极驱动信号的延迟时间。
在另一些实施例中，源极驱动装置的该延迟控制电路可以检测栅极驱动信号在显示面板的假栅极线的第一位置与第二位置的时序。依据栅极驱动信号在该第一位置与该第二位置的时序，该延迟控制电路可以自我决定该些源极驱动信号的延迟时间。举例来说(但不限于此)，延迟控制电路可以检测在该第一位置处的栅极驱动信号的上升缘时序而获得第一时点，以及检测在该第二位置处的栅极驱动信号的上升缘时序而获得第二时点。该延迟控制电路可以计算该第一时点与该第二时点的时间差，以及依据该时间差来动态决定该些驱动通道的该些源极驱动信号的延迟时间。
综上所述，本发明实施例提供一种源极驱动装置及其操作方法，使不同驱动通道所输出的源极驱动信号在一个水平扫描期间内具有不同的延迟时间(例如图4、5所示延迟时间Td1、Td2与Td3)，以便增加像素单元的有效充电时间(例如图4所示有效充电时间Tch31、Tch32与Tch33，或图5所示有效充电时间Tch51、Tch52与Tch53)。
最后应说明的是：以上各实施例仅用以说明本发明的技术方案，而非对其限制；尽管参照前述各实施例对本发明进行了详细的说明，本领域的普通技术人员应当理解：其依然可以对前述各实施例所记载的技术方案进行修改，或者对其中部分或者全部技术特征进行等同替换；而这些修改或者替换，并不使相应技术方案的本质脱离本发明各实施例技术方案的范围。

Claims (17)

1.一种源极驱动装置，其特征在于，经配置驱动显示面板的多个源极线，所述显示面板还包括栅极驱动装置，所述源极驱动装置包括：
多个驱动通道，经配置输出多个源极驱动信号；以及
延迟控制电路，经配置以控制该些驱动通道来改变该些源极驱动信号在期间内的延迟时间，使该些源极驱动信号的所述延迟时间分别响应于该些源极线至所述栅极驱动装置的距离，其中所述延迟控制电路的第一检测端与第二检测端分别耦接至所述显示面板的假栅极线的第一位置与第二位置，以检测栅极驱动信号在所述第一位置与所述第二位置的时序，以及依据所述栅极驱动信号在所述第一位置与所述第二位置的时序来决定该些源极驱动信号的所述延迟时间。
2.根据权利要求1所述的源极驱动装置，其特征在于，该些源极驱动信号的延迟时间互不相同。
3.根据权利要求1所述的源极驱动装置，其特征在于，所述期间为水平扫描期间。
4.根据权利要求1所述的源极驱动装置，其特征在于，该些驱动通道被分群为多个通道群组，属于相同通道群组的该些驱动通道的该些源极驱动信号的延迟时间互为相同，属于不同通道群组的该些源极驱动信号的延迟时间互不相同。
5.根据权利要求1所述的源极驱动装置，其特征在于，所述显示面板还耦接第二源极驱动装置，而所述源极驱动装置所输出的该些源极驱动信号的任一者的延迟时间小于所述第二源极驱动装置所输出的多个源极驱动信号的任一者的延迟时间。
6.根据权利要求1所述的源极驱动装置，其特征在于，该些驱动通道之一者包括：
输出缓冲器；以及
输出开关，其第一端耦接至所述输出缓冲器的输出端，所述输出开关的第二端耦接至该些源极线中的对应源极线，其中所述延迟控制电路控制所述输出开关的导通时序以改变所述对应源极线的所述源极驱动信号的延迟时间。
7.根据权利要求1所述的源极驱动装置，其特征在于，所述延迟控制电路经配置以耦接外部控制器，以及依据所述外部控制器的控制来决定该些源极驱动信号的所述延迟时间。
8.根据权利要求7所述的源极驱动装置，其特征在于，所述外部控制器包括时序控制器。
9.根据权利要求1所述的源极驱动装置，其特征在于，所述延迟控制电路包括：
上升缘检测电路，耦接至所述延迟控制电路的所述第一检测端以检测在所述第一位置所述栅极驱动信号的上升缘时序而获得第一时点，以及耦接至所述延迟控制电路的所述第二检测端以检测在所述第二位置所述栅极驱动信号的上升缘时序而获得第二时点；以及
控制器，耦接至所述上升缘检测电路与该些驱动通道，所述控制器经配置以计算所述第一时点与所述第二时点的时间差，以及依据所述时间差来决定该些驱动通道的该些源极驱动信号的延迟时间。
10.一种源极驱动装置的操作方法，其特征在于，所述源极驱动装置的多个驱动通道耦接至显示面板的多个源极线，所述显示面板还包括栅极驱动装置，所述操作方法包括：
输出多个源极驱动信号以驱动该些源极线；以及
配置该些源极驱动信号在期间内的延迟时间，使该些源极驱动信号的所述延迟时间分别响应于该些源极线至所述栅极驱动装置的距离，其中
所述配置该些源极驱动信号在所述期间内的延迟时间的步骤包括：
检测栅极驱动信号在所述显示面板的假栅极线的第一位置与第二位置的时序；以及
依据所述栅极驱动信号在所述第一位置与所述第二位置的时序来决定该些源极驱动信号的所述延迟时间。
11.根据权利要求10所述的源极驱动装置的操作方法，其特征在于，该些源极驱动信号的延迟时间互不相同。
12.根据权利要求10所述的源极驱动装置的操作方法，其特征在于，所述期间为水平扫描期间。
13.根据权利要求10所述的源极驱动装置的操作方法，其特征在于，该些驱动通道被分群为多个通道群组，属于相同通道群组的该些驱动通道的该些源极驱动信号的延迟时间互为相同，属于不同通道群组的该些源极驱动信号的延迟时间互不相同。
14.根据权利要求10所述的源极驱动装置的操作方法，其特征在于，所述源极驱动装置所输出的该些源极驱动信号的任一者的延迟时间小于所述显示面板的第二源极驱动装置所输出的多个源极驱动信号的任一者的延迟时间。
15.根据权利要求10所述的源极驱动装置的操作方法，其特征在于，所述配置该些源极驱动信号在所述期间内的延迟时间的步骤包括：
依据外部控制器的控制来决定该些源极驱动信号的所述延迟时间。
16.根据权利要求15所述的源极驱动装置的操作方法，其特征在于，所述外部控制器包括时序控制器。
17.根据权利要求10所述的源极驱动装置的操作方法，其特征在于，所述配置该些源极驱动信号在所述期间内的延迟时间的步骤还包括：
检测在所述第一位置所述栅极驱动信号的上升缘时序而获得第一时点；
检测在所述第二位置所述栅极驱动信号的上升缘时序而获得第二时点；
计算所述第一时点与所述第二时点的时间差；以及
依据所述时间差来决定该些驱动通道的该些源极驱动信号的延迟时间。
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