KR960706130A - 페이지 주소 모드를 구비한 마이크로컨트롤러(Microcontroller having a page address mode) - Google Patents

페이지 주소 모드를 구비한 마이크로컨트롤러(Microcontroller having a page address mode)

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KR960706130A
KR960706130A KR1019960702538A KR19960702538A KR960706130A KR 960706130 A KR960706130 A KR 960706130A KR 1019960702538 A KR1019960702538 A KR 1019960702538A KR 19960702538 A KR19960702538 A KR 19960702538A KR 960706130 A KR960706130 A KR 960706130A
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KR
South Korea
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address
zero mode
microcontroller
memory
page zero
Prior art date
Application number
KR1019960702538A
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English (en)
Inventor
버른스 네일
미즈라히-샬롬 오리
Original Assignee
요트.게.아. 롤페즈
필립스 일렉트로닉스 엔.브이.
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Filing date
Publication date
Application filed by 요트.게.아. 롤페즈, 필립스 일렉트로닉스 엔.브이. filed Critical 요트.게.아. 롤페즈
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    • G06F9/06—Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/30—Arrangements for executing machine instructions, e.g. instruction decode
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    • G—PHYSICS
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Abstract

메모리 주소 영역이 향상된 수행을 일으키는 다수 페이지의 주소 영역중 한 페이지에 제한되는 페이지 제로모드를 갖는 마이크로컨트롤러. 주소 매핑 논리 및 메모리 분할 선택 논리는 주소를 가능한 24비트의 주소중 최하위 16 비트로 제한한다. 제거된 상위 주소(high order address) 클럭 싸이클을 갖는 상이한 또는 대안의 마이크로코드 프로그램 제어 명령 순서는 페이지 제로 모드에서 사용된다.

Description

페이지 주소 모드를 구비한 마이크로컨트롤러(Microcontroller having a page address mode)
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 마이크로컨트롤러를 나타내는 예시도, 제2도 및 제3도는 메모리 구성도, 제4도는 페이지 제로 주소 회로의 구성도, 제5도는 마이크로코드 프로그램 어드레싱을 나타내는 예시도.

Claims (7)

  1. 제1의 주소 영역을 구비한 메모리; 및 상기 메모리에 연결된 컴퓨터을 구비한 미이크로 컨트롤러에 있어서, 상기 컴퓨터가 상기 메모리의 제1의 주소 영역보다 적은 제2의 주소 영역에 주소를 제한하기 위한 주소 수단; 및 제2의 주소 영역에 제한되는 주소 동작을 수행하기 위한 실행 수단을 포함하는 것을 특징으로 하는 마이크로컨트롤러.
  2. 제1항에 있어서, 상기 주소 수단은 페이지 제로 모드에서 상위 주소 비트(upper ordre address bits)를 제로로 설정하는 것을 특징으로 하는 마이크로컨트롤러.
  3. 제2항에 있어서, 상기 실행 수단은 표준 모드에서는 선정된 수의 클럭 싸이클로 페이지 제로 모드에서는 선정된 수보다 작은 수의 클럭 싸이클로 프로그램 흐름 변화 명령 마이크로코드 프로그램(program flow change instruction microcode program)을 수행하는 것을 특징으로 하는 마이크로컨트롤러.
  4. 제2항에 있어서, 상기 실행 수단이 제1 및 제2의 마이크로코드 프로그램 세트를 포함하고, 상기 제2의 세트는 페이지 제로 모드에서 하위 주소 동작(low order address operations)에 제한되는 것을 특징으로 하는 마이크로컨트롤러.
  5. 제1의 주소 영역을 구비한 메모리; 및 상기 메모리에 연결된 컴퓨터를 포함하는 마이크로컨트롤러에 있어서, 상기 컴퓨터가 페이지 제로 모드의 제로치(zero value)에서 스택 위치를 제2의 주소 영역 상위 주소 비트(address space upper ordre address bits)로 유지하고 제한함으로써 주소를 상기 메모리의 첫번째 주소 영역보다 적은 제2의 주소 영역에 제한하기 위한 주소 수단; 및 제2의 주소 영역에 제한되는 주소 동작을 수행하고, 표준 모드에서는 선정된 수의 클럭 싸이클로, 페이지 제로 모드에서는 선정된 수의 클럭 싸이클보다 작은 수의 클럭 싸이클로 프로그램 흐름 변화 명령 마이크로코드 프로그램을 실행시키고, 그리고 페이지 제로 모드에서 제2의 세트가 하위 주소 동작(low order address operations)에 제한되는, 제1 및 제2의 마이크로코드 명령 프로그램 세트를 포함하기 위한 실행 수단을 포함하는 것을 특징으로 하는 마이크로컨트롤러.
  6. 페이지 제로 모드가 유효한지를 결정하고; 페이지 제로 모드에 있을때 컴퓨터 프로그램 주소를 페이지 제로로 제한하고; 그리고 페이지 제로 모드에 있을때 감소된 클럭 싸이클(reduced clock cycle) 명령의 수행을 포함하는 것을 특징으로 하는 컴퓨터 프로그램을 수행하는 방법.
  7. 제6항에 있어서, 상기 감소된 클럭 싸이클 명령이 흐름 전송 명령 마이크로코드 프로그램 실행동안 상위 주소 동작(upper order address operation)을 제거하는 것을 특징으로 하는 컴퓨터 프로그램을 수행하는 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019960702538A 1994-09-16 1995-08-21 페이지 주소 모드를 구비한 마이크로컨트롤러(Microcontroller having a page address mode) KR960706130A (ko)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
US308,052 1981-10-02
US30805294A 1994-09-16 1994-09-16
PCT/IB1995/000671 WO1996008766A1 (en) 1994-09-16 1995-08-21 Microcontroller having a page address mode

Publications (1)

Publication Number Publication Date
KR960706130A true KR960706130A (ko) 1996-11-08

Family

ID=23192336

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019960702538A KR960706130A (ko) 1994-09-16 1995-08-21 페이지 주소 모드를 구비한 마이크로컨트롤러(Microcontroller having a page address mode)

Country Status (5)

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US (1) US6012128A (ko)
EP (1) EP0729612A1 (ko)
JP (1) JPH09505428A (ko)
KR (1) KR960706130A (ko)
WO (1) WO1996008766A1 (ko)

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Also Published As

Publication number Publication date
JPH09505428A (ja) 1997-05-27
WO1996008766A1 (en) 1996-03-21
US6012128A (en) 2000-01-04
EP0729612A1 (en) 1996-09-04

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