KR960019992A - 전류형 인버터회로, 전류형 논리회로, 전류형 래치회로, 반도체 집적회로, 전류형 링 발진기, 전압제어발진기 및 pll회로 - Google Patents

전류형 인버터회로, 전류형 논리회로, 전류형 래치회로, 반도체 집적회로, 전류형 링 발진기, 전압제어발진기 및 pll회로 Download PDF

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기다오까 다까시
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Abstract

낮은 전력 소모를 가지고 고속으로 동작하는 전류형 인버터 회로 등을 얻는다.
기준전원(1)은 전원(VDD)에 연결된 일 끝단과 기준전류(Iref)를 다른 끝단을 갖는다.
전류미러회로(CMI)의 NMOS트랜지스터(Q1)의 드레인과 게이트는, 입력부로서, 입력신호(Iin)를 입력받는다.
NMOS 트랜지스터(Q2)의 드레인은 기준전원(1)의 다른 끝단의 절점(NI)에 출력부로서 연결된다.
입력부로서, 전류미러회로(CM2)의 NMOS 트랜지스터(Q3)의 드레인과 게이트는 절점(NI)에 연결되는 반면, NMOS 트랜지스터(Q4)의 드레인은 출력전류(Iout)를 출력하는 출력부의 기능을 한다.
트랜지스터는 TS1 ≥ 1, TS2≥ 1, 및 TS1·TS2 > 의 조건을 만족하도록 설정되고, 여기에서 TS1는 NMOS 트랜지스터(Q2)와 NMOS 트랜지스터(Q1)의 크기의 비이고, TS2는 NMOS 트랜지스터(Q4)와 NMOS 트랜지스터(Q3)의 크기의 비이다.

Description

전류형 인버터회로, 전류형 논리회로, 전류형 래치회로, 반도체 집적회로, 전류형 링 발진기, 전압제어발진기 및 PLL회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제1실시예의 제1국면에 따른 전류형 인버터 회로의 구조를 도시하는 회로도,
제10도는 본 발명의 제4실시예에 따른 전류형 NOR게이트 회로의 구조를 도시하는 도면,
제12도는 본 발명의 제5실시예의 제1국면에 따른 전류형 NAND게이트 회로의 구조를 도시하는 도면,
제18도는 본 발명의 제8실시예의 제1국면에 따른 전류형 D-래치 회로의 구조를 도시하는 회로도,
제25도는 본 발명의 제11실시예에 따른 선택회로의 회로도,
제28도는 본 발명의 제12실시예의 제1국면에 따른 전류/전압 변환회로의 구조를 도시하는 회로도,
제32도는 바이어스 발생 회로의 회로도,
제34도는 본 발명의 제15실시예에 따른 전류형 링 발진기의 구조를 도시하는 블럭도,
제26도는 본 발명의 제16실시예에 따른 전압제어 발진기의 구조를 도시하는 블럭도,
제40도는 본 발명의 제17실시예에 따른 PLL 회로의 구조의 블럭도.

Claims (25)

  1. 제1전원 및 제2전원; 상기 제1전원에 연결된 일 끝단과 기준전류를 제공하기 위한 다른 끝단을 갖는 기준 전류 제공수단; 입력전류를 입력받기 위한 제1입력부와 상기 기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 입력전류에 비례하는 크기를 갖는 중간 출력전류를 상기 제1출력부와 제2전원 사이에 제공하는 제1전류미러회로; 상기 기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제2전원 사이에 흐르는 중간 입력전류에 비례하는 크기를 갖는 출력전류를 상기 제2출력부와 상기 제2전원 사이에 제공하는 제2전류미러회로로 구성되며, N1·II ≥ IR; N2≥ 1; 및 N1 ·2 > 1(II는 상기 입력전류의 크기, IR는 상기 기준전류의 크기, N1은 상기 중간 출력전류와 상기 입력전류간의 크기의 비, N2는 상기 출력전류와 상기 중간 입력전류간의 크기의 비)의 조건을 만족하는 것을 특징으로 하는 전류형 인버터 회로.
  2. 제1항에 있어서, 상기 입력전류에 비례하는 크기의 선택 출력전류를 제공하기 위하여 전류미러 접속 내의 상기 제1전류미러회로의 상기 제1입력부에 연결되는 선택전류 제공수단을 부가하는 것을 특징으로 하는 전류형 인버터 회로.
  3. 제1항에 있어서, 상기 기준전류 제공수단은 외부로부터 제어신호를 입력받아 상기 제어신호에 근거하여 상기 기준전류의 크기를 설정하는 것을 특징으로 하는 전류형 인버터 회로.
  4. 제3항에 있어서, 상기 제2전류미러회로는 상기 제3출력부와 상기 제2전원 사이에 상기 중간 입력전류에 비례하는 크기를 갖는 제2출력전류를 제공하기 위하여 상기 제2출력을 운반하는 제3출력을 갖으며, N3≥ 1; 및 N1·N3>1(N3은 상기 제2출력전류와 상기 중간 입력전류간의 크기의 비)의 조건을 만족하는 것을 특징으로 하는 전류형 인버터 회로로.
  5. 제1전원 및 제2전원; 상기 제1전원에 연결된 일 끝단과 기준전류를 제공하기 위한 다른 끝단을 갖는 기준 전류 제공수단; 제1입력전류를 입력받기 위한 제1입력부와 상기 기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 제1출력부와 상기 제2전원 사이에 상기 제1입력전류에 비례하는 크기를 갖는 제1중간 출력전류를 제공하기 위한 제1전류미러회로; 제2입력전류를 받기 위한 제2입력부와 상기 기준전류 제공수단의 다른 끝단에 연결된 제2출력부를 갖으며, 상기 제2출력부와 상기 제2전원 사이에 상기 제2입력전류에 비례하는 크기의 제2중간 출력전류를 제공하는 제2전류미러회로; 상기 기준전류 제공수단의 다른 끝단에 연결된 제3입력부와 출력전류를 운반하는 기능을 하는 제3출력부를 갖으며, 상기 제3입력부와 상기 제2전원 사이에 흐르는 중간 입력전류에 비례하는 상기 출력전류를 상기 제3출력부와 상기 제2전원 사이에 제공하는 제3전류미러회로로 구성되며, N1·II1≥ IR; N2·II2≥IR; N3≥1, N1·N3 > 1, N2·N3 > 1(II1은 상기 제1입력전류의 크기, II2는 상기 제2입력전류의 크기, IR은 상기 기준전류의 크기, N1은 상기 제1중간 출력전류와 상기 제1입력 전류간의 크기의 비, N2는 상기 제2중간 출력전류와 상기 제2입력전류간의 크기의 비, N3은 상기 출력전류와 상기 중간 입력전류간의 크기의 비)의 조건을 만족하는 전류형 논리회로.
  6. 제1전원 및 제2전원; 상기 제1전원에 연결된 일 끝단과 기준전류를 체공하기 위한 다른 끝단을 갖는 기준 전류 제공수단; 제1입력전류를 입력받기 위한 제1입력부와 상기 기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖는 제1전류 미러회로; 제2입력전류를 받기 위한 제2입력부와, 상기 제1입력전류에 비례하는 제1중간 출력전류를 상기 제1출력부와 상기 제2출력부 사이에 제공하는 상기 제1전류 미러회로를 통해 상기 기준전류 제공수단의 다른 끝단에 연결된 제2출력부를 갖으며, 상기 제2입력전류에 비례하는 제2중간 출력전류를 상기 제2출력부와 상기 제2전원 사이에 제공하는 제2전류미러회로; 및 상기 기준전류 제공수단의 다른 끝단에 연결된 제3입력부와 출력전류를 운반하는 기능을 하는 제3출력부를 갖으며, 상기 제3입력부와 상기 제2전원 사이에 흐르는 중간 입력전류에 비례하는 상기 출력전류를 상기 제3출력부와 상기 제2전원 사이에 제공하는 제3전류 미러회로로 구성되며, N1·R1≥IR; N2·II2≥IR; N3≥1, N1·N3 > 1, N2·N3 > I(II1은 상기 제1입력전류의 크기, II2는 상기 제2입력전류의 크기, IR은 상기 기준전류의 크기, N1은 상기 제1중간 출력전류와 상기 제1입력전류간의 크기의 비, N2는 상기 제2중간 출력전류와 상기 제2입력전류간의 크기의 비, N3은 상기 출력전류와 상기 중간 입력전류간의 크기의 비)의 조건을 만족하는 전류형 논리회로.
  7. 제6항에 있어서, 상기 제2전류미러회로의 상기 제2출력부와 동일한 크기의 부하를 상기 제1입력부에 제공하기 위하여 상기 제1전류미러회로의 상기 제1입력부에 연결되는 부하 수단을 부가하는 것을 특징으로 하는 전류형 논리회로.
  8. 제7항에 있어서, 전류미러 접속 내에서 상기 제1전류미러회로의 상기 제1입력부와 상기 제2전류미러회로의 상기 제2입력부의 하나에 연결되고, 이로써 상기 전류미러 접속 내에 있는 상기 제1 및 제2입력부의 일에 제공되는 상기 제1 및 제2입력전류의 일에 비례하는 크기의 선택전류를 제공하는 선택전류 제공수단을 부가하는 것을 특징으로 하는 전류형 논리회로.
  9. 제1전원 및 제2전원; 상기 제1전원에 연결된 일 끝단과 기준전류를 제공하기 위한 다른 끝단을 갖는 기준 전류 제공수단; 입력전류를 입력받기 위한 제1입력부와 상기 기준전류 제공수단의 다른 끝단에 연결되는 제1출력부를 갖으며, 상기 입력전류에 비례하는 중간 출력전류를 상기 제1출력부와 상기 제2전원 사이에 제공하기 위한 제1전류미러회로; 및 상기 기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 상기 제2입력부와 상기 제2전원 사이에 흐르는 중간 입력전류에 비례하는 크기의 출력전류를 상기 제2출력부와 상기 제2전원 사이에 제공하기 위하여 상기 출력전류를 운반하기 위한 제2출력부를 갖는 제2전류미러회로를 포함하는 제1전류형 인버터 회로 및 제2전류형 인버터 회로; 및 제1접속부와 제2접속부를 갖으며, 상기 제1접속부는 상기 제1전류형 인버터 회로의 제2출력부에 연결되고, 상기 제2접속부는 상기 제2전류형 인버터 회로의 제1입력부에 연결되며, 제1전류형 인버터 회로로부터의 상기 출력전류에 비례하는 전류의 상기 제1전원과 상기 제2전류형 인버터 회로 사이에 상기 제2전류형 인버터 회로에 제공되는 상기 입력전류로서 제공되는 접속회로로 구성되는 전류형 논리회로.
  10. 제9항에 있어서, N11·II1≥IR; N12≥1, N21≥1, N22≥1,N3>1, N11· N12·N21·N22·N3 > 1 (II1은 상기 제1전류형 인버터 회로에 의해 입력된 상기 입력전류의 크기, IR은 상기 기준전류의 크기, N11은 상기 제1전류형 인버터 회로 내의 상기 중간 출력전류와 상기 입력전류간의 크기의 비, N12는 상기 제1전류형 인버터 회로 내의 상기 중간 출력전류와 상기 중간 입력전류간의 크기의 비, N21은 상기 제2전류형 인버터 회로 내의 상기 중간 출력전류와 상기 입력전류간의 크기의 비, N22는 상기 제2전류형 인버터 회로 내의 상기 출력전류와 상기 중간 입력전류간의 크기의 비, N3은 상기 결속회로 내의 상기 제2전류형 인버터 회로에의 상기 입력전류와 제1전류형 인버터 회로로부터의 상기 출력전류간의 크기의 비)의 조건을 만족하는 것을 특징으로 하는 전류형 논리회로.
  11. 제9항에 있어서, 제3전류형 인버터 회로 및 제4전류형 인버터 회로가 부가되고, 상기 제3전류형 인버터 회로는 상기 제1전원에 연결되는 일끝단과 제2기준전류를 입력받기 위한 다른 끝단을 갖는 제2기준전류 제공수단; 제2입력전류를 입력받기 위한 제3입력부와 제2기준전류 제공수단에 연결된 제3출력부를 갖으며, 상기 제2입력전류에 비례하는 제2중간 출력전류를 상기 제3출력부와 상기 제2전원 사이에 제공하는 제3전류미러회로; 및 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제4입력부와 제2출력전류를 운반하기 위한 제4출력부를 갖으며, 상기 제4입력부와 상기 제2전원 사이에 흐르는 제2중간 입력전류에 비례하는 제2출력전류를 상기 제4출력부와 상기 제2전원 사이에 제공하는 제4전류미러회로를 포함하고, 상기 제4전류형 인버터 회로는 상기 제2전원에 연결된 일끝단과 제3기준전류를 전달하기 위 한 다른 끝단을 갖는 제3기준전류 제공수단; 제3입력전류를 입력받기 위한 제5입력부와 상기 제3기준전류 제공수단의 다른 끝단에 연결된 제5출력부를 갖으며, 상기 제3입력전류에 비례하는 제3중간 출력전류를 상기 제5출력부와 상기 제1전원 사이에 제공하는 제5전류미러회로; 및 상기 제3기준전류 제공수단이 다른 끝단에 연결된 제6입력부와 제3출력전류를 운반하기 위한 제6출력부를 갖으며, 상기 제6입력부와 상기 제1전원 사이에 흐르는 제3중간 입력전류에 비례하는 상기 제3출력전류를 상기 제6출력부와 상기 제1전원 사이에 제공하는 제6전류미러회로를 포함하며, 상기 제3전류미러회로의 상기 제4출력부와 상기 제4전류미러회로의 상기 제5입력부가 서로간에 연결되어 상기 제2출력전류가 상기 제3입력전류로서 사용되는 것을 특징으로 하는 전류형 논리회로.
  12. 제1전원과 제2전원; 및 제1전류형 인버터 회로 및 제2전류형 인버터 회로로 구성되고, 상기 제1전류형 인버터 회로는 상기 제1전원에 연결되는 일 끝단과 제1기준전류를 제공하기 위한 다른 끝단을 갖는 제1기준전류 제공수단; 제1입력전류를 입력받기 위한 제1입력부와 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 제1입력전류에 비례하는 제1중간 출력전류를 상기 제1출력부와 상기 제2전원 사이에 제공하는 제1전류미러회로; 및 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 제1출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제2전원 사이에 흐르는 제1중간 입력전류에 비례하는 제1출력전류를 상기 제2출력부와 상기 제2전원 사이에 제공하는 제2전류미러회로를 포함하며, 상기 제2전류형 인버터 회로는 상기 제2전원에 연결된 일 끝단과 제2기준전류를 제공하기 위한 다른 끝단을 갖는 제2기준전류 제공수단; 제2입력전류를 입력받기 위한 제3입력부와 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제3출력부를 갖으며, 상기 제2입력전류에 비례하는 제2중간 출력전류를 상기 제3출력부와 상기 제1전원 사이에 제공하는 제3전류미러회로; 및 상기 제2기준전류 제공수단의 다른 끝단에 연결되는 제4입력부와 제2출력전류를 운반하기 위한 제4출력부를 갖으며, 상기 제4입력부와 상기 제1전원 사이에 흐르는 제2중간 입력전류에 비례하는 제2출력전류를 상기 제4출력부와 상기 제1전원 사이에 제공하는 제4전류미러회로를 포함하고, 상기 제1전류미러회로의 상기 제2출력부와 상기 제2전류미러회로의 상기 제3입력부가 서로 연결되어 상기 제1출력전류가 상기 제2입력전류로서 사용되는 것을 특징으로 하는 전류형 논리회로.
  13. 제11항에 있어서, N11·II1≥IR; N12≥1, N21≥1, N22>1, N11·N12 ·N21·N22 > 1(II1은 상기 제1전류형 인버터 회로에 의해 입력된 상기 입력전류의 크기, IR은 상기 기준전류의 크기, N11은 상기 제1중간 출력전류와 상기 입력전류간의 크기의 비, N12는 상기 제1출력전류와 상기 제1중간 출력전류간의 크기의 비, N21은 상기 제2중간 출력전류와 상기 제2입력전류간의 크기의 비, N22는 상기 제2출력전류와 상기 제2중간 입력전류간의 크기의 비)의 조건을 만족하는 것을 특징으로 하는 전류형 논리회로.
  14. 제1전원과 제2전원; 및 제1전류형 인버터 회로 및 제2전류형 인버터 회로로 구성되고, 상기 제1전류형 인버터 회로는 상기 제1전원에 연결되는 일 끝단과 제1기준전류를 제공하기 위한 다른 끝단을 갖는 제1기준전류 제공수단; 제1입력전류를 입력받기 위한 제1입력부와 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 제1입력전류에 비례하는 제1중간 출력전류를 상기 제1출력부와 상기 제2전원 사이에 제공하는 제1전류미러회로; 및 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 제1출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제2전원 사이에 흐르는 제1중간 입력전류에 비례하는 제1출력전류를 상기 제2출력부와 상기 제2전원 사이에 제공하는 제2전류미러회로를 포함하며, 상기 제2전류형 인버터 회로는 상기 제2전원에 연결된 일끝단과 제2기준전류를 제공하기 위한 다른 끝단을 갖는 제2기준전류 제공수단; 제2입력전류를 입력받기 위한 제3입력부와 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제3출력부를 갖으며, 상기 제2입력전류에 비례하는 제2중간 출력전류를 상기 제3출력부와 상기 제1전원 사이에 제공하는 제3전류미러회로; 및 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제4입력부와 제2출력전류를 운반하기 위한 제4출력부를 갖으며, 상기 제4입력부와 상기 제1전원 사이에 흐르는 제2중간 입력전류에 비례하는 상기 제2출력전류를 상기 제4출력부와 상기 제1전원 사이에 제공하는 제4전류미러회로를 포함하고, 상기 제1전류형 인버터 회로의 상기 제2출력부와 상기 제2전류형 인버터 회로의 상기 제3입력부가 서로 연결되어 상기 제1 및 제2전류형 인버터 회로가 상기 제1출력전류를 상기 제2입력전류로서 처리하며, 상기 전류형 논리회로는 외부 입력전류를 입력받기 위한 제5입력부와 제5출력부를 갖으며, 상기 외부 입력전류에 비례하는 크기의 외부 중간 출력전류를 상기 제5출력부와 상기 제2전원 사이에 제공하는 외부 입력전류미러회로; 상기 외부 입력전류미러회로의 상기 제5출력부와 상기 제1출력미러회로의 상기 제1입력부 또는 제2입력부를 전기적으로 연결하고 단락시키는 제1스위칭 동작을 수행하는 클락신호와, 상기 제4전류미러회로의 상기 제4출력와 상기 제1출력미러회로의 상기 제1입력부를 전기적으로 연결하고 단락시키는 제2스위칭 동작을 수행하는 클락신호에 응하여, 상기 클락신호를 입력받기 위한 스위칭 수단; 및 전류미러 접속 내의 상기 제4전류미러회로의 상기 제4입력부에 연결되며, 상기 제2중간 입력전류에 비례하는 크기의 외부 입력전류를 출력하는 전류출력수단을 부가하는 것을 특징으로 하는 전류형 논리회로.
  15. 제14항에 있어, 상기 클락신호는 전류 신호이고, 상기 스위칭 수단은 상기 클락 신호의 전류 크기에 근거하여 상기 제1 및 상기 제2스위칭 동작을 수행하는 것을 특징으로 하는 전류형 논리회로.
  16. 제14항에 있어서, 상기 클락신호는 전압신호이고, 상기 스위칭 수단은 상기 제1 및 상기 제2스위칭 동작을 상기 클락신호의 전압 크기에 근거하여 수행하는 것을 특징으로 하는 전류형 논리회로.
  17. 제1전원 및 제2전원; 상기 제1전원에 연결되고, 제1입력부와 제1출력부를 갖으며, 상기 제1입력부를 통하여 흐르는 상기 제1입력전류에 비례하는 제1중간 출력전류를 상기 제1출력부로부터 제공하는 제1전류미러회로; 상기 제2전원에 연결되고, 제2입력부와 제2출력부를 갖으며, 상기 제2입력부를 통하여 흐르는 제2중간 출력전류를 제공하는 상기 제2출력부로부터 제2전류미러회로; 외부 입력전류를 입력받기 위한 제3입력부와 제3출력부를 갖으며, 상기 외부 입력전류에 비례하는 크기의 외부 출력전류를 상기 제3출력부로부터 제공하는 외부 입력전류미러회로; 상기 제1 및 상기 제2전류미러회로의 상기 제1 및 상기 제2입력부의 일과 상기 외부 입력전류미러회로의 상기 제3출력부를 전기적으로 연결하고 단락시키는 제1스위칭 동작을 수행하는 클락신호와, 상기 제1전류미러회로의 상기 제1입력부와 상기 제2전류 미러회로의 상기 제2출력부를 전기적으로 연결하고 단락시키는 제2스위칭 동작을 수행하는 클락신호와, 상기 제1전류미러회로의 상기 제1출력부와 상기 제2전류미러회로의 상기 제2입력부를 전기적으로 연결하고 단락시키는 제3스위칭 동작을 수행하는 클락신호에 응하여 상기 클락신호를 입력받기 위한 스위칭 수단; 및 전류미러 접속 내의 상기 제1 및 상기 제2전류미러회로의 상기 제1 및 상기 제2입력부의 일에 연결되고, 상기 제1 또는 제2중간 입력전류에 비례하는 크기의 외부 출력전류를 제공하는 전류 출력 수단으로 구성되는 것을 특징으로 하는 전류형 논리회로.
  18. 전류형 인버터 회로를 포함하고, 각각이 소정의 논리 기능을 수행하는 다수의 매크로 블럭에 의해 형성되며, 상기 전류형 인버터 회로는 제1전원 및 제2전원; 상기 제1전원에 연결되는 일 끝단과 기준전류를 제공하기 위한 다른 끌단을 갖으며, 외부로부터 제어신호를 입력받아 상기 제어신호에 근거하여 상기 기준전류의 크기를 설정하는 기준전류 제공수단; 입력전류를 입력받기 위한 제1입력부와 상기 기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 입력전류에 비례하는 중간 출력전류를 상기 제1출력부와 상기 제2전원 사이에 제공하는 제1전류미러회로; 및 상기 기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제2전원 사이에 흐르는 중간 입력전류에 비례하는 상기 출력전류를 상기 제2출력부과 상기 제2전원 사이에 제공하는 제2전류미러회로를 포함하고, 상기 전류형 인버터 회로는 N1·II≥ IR; N2≥ 1; 및 N1·N2 > 1(II는 상기 입력전류의 크기, IR는 상기 기준전류의 크기, N1은 상기 중간 출력전류와 상기 입력전류간의 크기의 비, N2는 상기 출력전류와 상기 중간 입력전류간의 크기의 비)의 조건을 만족하며, 상기 다수의 매크로 블럭의 각각은 최소한 하나의 상기 전류형 인버터 회로를 포함하고 상기 제어신호를 서로 독립적으로 입력받는 것을 특징으로 하는 반도체 집적회로.
  19. 제18항에 있어서, 상기 제어신호를 발생하기 위한 회로가 상기 다수의 매크로 블럭 내에 합체되는 것을 특징으로 하는 반도체 집적회로.
  20. 제19항에 있어서, 상기 다수의 매크로 블럭은 각각이 다수의 기본셀로 형성되고, 상기 다수의 기본셀은 각각이 상기 제어신호를 제공하기 위한 제공 영역을 포함하는 것을 특징으로 하는 반도체 집적회로.
  21. 제1전원과 제2전원; 및 제1 내지 제N(N≥ 3, N은 홀수)전류형 인버터 회로로 구성되며, 상기 제1 내지 제N전류형 인버터 회로의 각각은 상기 제1전원에 연결되는 일끝단과 제1기준전류를 제공하기 위한 다른 끝단을 갖으며, 외부로부터 제1제어신호를 입력받아 상기 제1제어신호에 근거하여 상기 제1기준전류의 크기를 설정하는 제1기준전류 제공수단; 제1입력전류를 입력받기 위한 제1입력부와 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 입력전류에 비례하는 제1중간 출력전류를 상기 제1출력부와 상기 제2전원 사이에 제공하는 제1전류미러회로; 및 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제2전원 사이에 흐르는 제1중간입력전류에 비례하는 상기 출력전류를 상기 제2출력부와 상기 제2전원 사이에 제공하는 제2전류미러회로를 포함하고, 상기 제2 내지 제(N-1) 전류형 인버터 회로의 각각은 상기 제2전원에 연결되는 일 끝단과 제2기준전류를 제공하기 위한 다른 끝단을 갖으며, 외부로부터 제2제어신호를 입력받아 상기 제2제어신호에 근거하여 설정되는 제2기준 전류를 제공하는 제2기준전류 제공수단; 입력전류를 입력받기 위한 제1입력부와 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 입력전류에 비례하는 제2중간 출력전류를 상기 제1출력부와 상기 제1전원 사이에 제공하는 제3전류미러회로; 및 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제1전원 사이에 흐르는 제2중간입력전류에 비례하는 상기 출력전류를 상기 제2출력부와 상기 제1전원 사이에 제공하는 제4전류미러회로를 포함하며, 상기 제1 내지 제N전류형 인버터 회로에서 상기 i(1≤i≤(N-1))전류형 인버터 회로의 제2출력부는 상기 제(i+1)전류형 인버터 회로의 제1입력부에 연결되고, 제1접속부와 제2접속부를 갖으며 상기 제1접속부는 상기 제N전류형 인버터 회로의 상기 제2출력부에 연결되고 상기 제2접속부는 상기 제1전류형 인버터 회로의 상기 제1입력부에 연결되며 상기 제1전원과 상기 제1전류형 인버터 회로의 상기 제1입력부 사이에 상기 제1전류형 인버터 회로에의 상기 입력전류로서 상기 제N전류형 인버터 회로로부터의 상기 출력전류에 비례하는 전류를 제공하는 접속 회로; 및 상기 제1 내지 제N전류형 인버터 회로의 일의 제2출력부로부터의 상기 출력전류 입력받고 전압 출력신호를 출력하기 위하여 상기 출력전류에 전압/전압 변환을 수행하는 전압 출력 수단을 부가하는 것을 특징으로 하는 전류형 링 발진기.
  22. 제1전원과 제2전원 및 제1 내지 제N(N≥ 3, N은 홀수)전류형 인버터 회로를 포함하고, 상기 제1 내지 제N전류형 인버터 회로의 각각은 상기 제1전원에 연결되는 일 끝단과, 외부로부터 제1제어신호를 입력받아 상기 제1제어신호에 근거하여 설정된 제1기준전류를 제공하기 위한 다른 끝단을 갖는 제1기준전류 제공수단; 입력전류를 입력받기 위한 제1입력부와 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 입력전류에 비례하는 제1중간 출력전류를 상기 제1출력부와 상기 제2전원 사이에 제공하는 제1전류미러회로; 및 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제2전원 사이에 흐르는 제1중간 입력전류에 비례하는 출력전류를 상기 제2출력부와 상기 제2전원 사이에 제공하는 제2전류미러회로를 포함하며, 상기 제2 내지 제(N-1)전류형 인버터 회로의 각각은 상기 제2전원에 연결되는 일끝단과 제2기준전류를 제공하기 위한 다른 끝단을 갖으며, 외부로부터 제2제어신호를 입력받아 상기 제2제어신호에 근거하여 설정되는 제2기준전류를 제공하는 제2기준전류 제공수단; 입력전류를 입력받기 위한 제1입력부와 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 입력전류에 비례하는 제2중간 출력전류를 상기 제1출력부와 상기 제1전원 사이에 제공하는 제3전류미러회로; 및 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제1전원 사이에 흐르는 제2중간 입력전류에 비례하는 상기 출력전류를 상기 제2출력부와 상기 제1전원 사이에 제공하는 제4전류미러회로를 포함하고, 상기 제1 내지 제N전류형 인버터 회로에서 상기 i(1 ≤i≤(N-1))전류형 인버터 회로의 제2출력부는 상기 제1(i+1)전류형 인버터 회로의 제1입력부에 연결되고, 제1접속부와 제2접속부를 갖으며 상기 제1접속부는 상기 제N전류형 인버터 회로의 상기 제2출력부에 연결되고 상기 제2접속부는 상기 제1전류형 인버터 회로의 상기 제1입력부에 연결되며 상기 제1전원과 상기 제1전류형 인버터 회로의 상기 제1입력부 사이에 상기 제1전류형 인버터 회로에의 상기 입력전류로서 상기 제N전류형 인버터 회로로부터의 상기 출력전류에 비례하는 전류를 제공하는 접속회로; 및 상기 제1 내지 제N전류형 인버터 회로의 일의 제2출력부로부터의 상기 출력전류를 입력받고 전압 출력신호를 출력하기 위하여 상기 출력전류에 전류/전압 변환을 수행하는 전압 출력 수단을 부가하는 전류형 링 발진기로 구성되고, 상기 전압제어 발진기는 전압 입력신호를 입력받아 상기 전압 입력신호에 근거하여 상기 제1 및 상기 제2기준 전류가 동일한 크기의 전류를 갖도록 상기 제1 및 상기 제2제어신호를 발생하는 제어신호 발생회로를 부가하는 것을 특징으로 하는 전압제어 발진기.
  23. 기준신호와 발진신호를 입력받아 상기 기준신호와 상기 발진신호 사이의 위상차에 따른 전압 레벨의 위상비교신호를 출력하는 위상비교수단; 및 전류형 링 발진로 구성되고, 상기 전류형 링 발진기는 제1전원과 제2전원; 및 제1 내지 제N(N≤ 3, N은 홀수)전류형 인버터 회로를 포함하며, 상기 제1 내지 제N전류형 인버터 회로의 각각은 상기 제1전원에 연결되는 일 끝단과, 외부로부터 제1제어신호를 입력받아 상기 제1제어신호에 근거하여 설정된 제1기준전류를 제공하기 위한 다른 끝단을 갖는 제1기준전류 제공수단; 입력전류를 입력받기 위한 제1입력부와 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 입력전류에 비례하는 제1중간 출력전류를 상기 제1출력부와 상기 제2전원 사이에 제공하는 제1전류미러회로; 및 상기 제1기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제2전원 사이에 흐르는 제1중간 입력전류에 비례하는 출력전류를 상기 제2출력부와 상기 제2전원 사이에 제공하는 제2전류미러회로를 포함하며, 상기 제2 내지 제(N-1)전류형 인버터 회로의 각각은 상기 제2전원에 연결되는 일 끝단과 제2기준전류를 제공하기 위한 다른 끝단을 갖으며, 외부로부터 제2제어신호를 입력받아 상기 제2제어신호에 근거하여 설정되는 제2기준전류를 제공하는 제2기준전류 제공수단; 입력전류를 입력받기 위한 제1입력부와 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제1출력부를 갖으며, 상기 입력전류에 비례하는 제2중간 출력전류를 상기 제1출력부와 상기 제1전원 사이에 제공하는 제3전류미러회로; 및 상기 제2기준전류 제공수단의 다른 끝단에 연결된 제2입력부와 출력전류를 운반하기 위한 제2출력부를 갖으며, 상기 제2입력부와 상기 제1전원 사이에 흐르는 제2중간 입력전류에 비례하는 상기 출력전류를 상기 제2출력부와 상기 제1전원 사이에 제공하는 제4전류미러회로를 포함하고, 상기 제1 내지 제N전류형 인버터 회로에서 상기 i(1≤i≤(N-1))전류형 인버터 회로의 제2출력부는 상기 제(i+l)전류형 인버터 회로의 제1입력부에 연결되고, 제1접속부와 제2접속부를 갖으며 상기 제1접속부는 상기 제N전류형 인버터 회로의 상기 제2출력부에 연결되고 상기 제2접속부는 상기 제1전류형 인버터 회로의 상기 제1입력부에 연결되며 상기 제1전원과 상기 제1전류형 인버터 회로의 상기 제1입력부 사이에 상기 제1전류형 인버터 회로에의 상기 입력전류로서 상기 제N전류형 인버터 회로로부터의 상기 출력전류에 비례하는 전류를 제공하는 접속회로; 및 상기 제1 내지 제N전류형 인버터 회로의 일의 제2출력부로부터의 상기 출력전류를 입력받고 전압 출력신호를 출력하기 위하여 상기 출력전류에 전류/전압 변환을 수행하는 전압 출력 수단을 부가하는 전류형 링 발진기로 구성되고, 상기 전압제어 발진기는 전압 입력신호를 입력받아 상기 전압 입력신호에 근거하여 상기 제1 및 상기 제2기준전류가 동일한 크기의 전류를 갖도록 상기 제1 및 상기 제2제어신호를 발생하는 제어신호 발생회로를 부가하며, 상기 전압제어 발진기는 상기 위상비교신호를 상기 전압 입력신호로 입력받아 상기 전압 출력신호를 상기 발진 신호로 출력하는 것을 특징으로 하는 PLL 회로.
  24. 제23항에 있어서, 상기 기준신호와 상기 발진신호의 각각은 제1논리 레벨 또는 제2논리 레벨을 표시하고, 상기 위상비교수단은 상기 기준신호가 상기 제2논리 레벨에서 상기 제1논리 레벨로 변경된 후 상기 기준신호의 논리 레벨과는 무관하여 상기 기준신호와 상기 발진 신호 사이의 위상차를 검출하여 상기 위상비교신호에 관계되는 위상비교 관계 신호를 출력하는 기능을 하는 위상비교부를 포함하는 것을 특징으로 하는 PLL 회로.
  25. 제24항에 있어서, 상기 위상비교부는 상기 기준신호와 상기 발진신호를 입력받아 상기 기준신호가 상기 제2논리 레벨을 가질 때 상기 제2논리 레벨의 제1 내부 신호를 발생하는 제1 내부 신호 발생수단; 상기 제1내부 신호와 상기 발진신호를 입력받아 상기 제1 내부 신호가 상기 제2논리 레벨을 가지는 때에는 상기 제1논리 레벨의 제2 내부 신호를 발생하고, 상기 제1 내부 신호와 상기 발진신호가 둘다 상기 제1논리 레벨을 가지는 때에는 상기 제2논리 레벨의 제2내부 신호를 발생하는 제2내부 신호 발생수단; 상기 제1 내부 신호와 상기 제2 내부 신호를 입력받아 상기 제2내부 신호가 상기 제2논리 레벨을 가지는 때에는 상기 제1논리 레벨의 제3내부 신호를 발생하고, 상기 제1 내부 신호와 상기 제2 내부 신호가 둘다 상기 제1논리 레벨을 가지는 때에는 상기 제2논리 레벨의 제3 내부 신호를 발생하는 제3 내부 신호 발생수단; 및 상기 제3 내부 신호에 근거하여 상기 위상비교 관계 신호를 출력하는 위상비교 관계 신호 출력 수단으로 구성되고, 상기 제1 내부 신호 발생수단은 상기 기준신호가 상기 제2논리 레벨을 가지고 상기 제3내부 신호가 상기 제1논리 레벨을 가질 때 상기 제3내부 신호를 더 입력받아 상기 제2논리 레벨의 상기 제2 내부 신호를 발생하는 것을 특징으로 하는 PLL회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950042075A 1994-11-17 1995-11-17 전류형 인버터 회로, 전류형 논리회로 및 반도체 직접 회로 KR100209253B1 (ko)

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