KR960006271A - 주/종속 플립-플롭 - Google Patents

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KR960006271A
KR960006271A KR1019940018513A KR19940018513A KR960006271A KR 960006271 A KR960006271 A KR 960006271A KR 1019940018513 A KR1019940018513 A KR 1019940018513A KR 19940018513 A KR19940018513 A KR 19940018513A KR 960006271 A KR960006271 A KR 960006271A
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김용범
Original Assignee
김주용
현대전자산업 주식회사
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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K3/00Circuits for generating electric pulses; Monostable, bistable or multistable circuits
    • H03K3/02Generators characterised by the type of circuit or by the means used for producing pulses
    • H03K3/353Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of field-effect transistors with internal or external positive feedback
    • H03K3/356Bistable circuits
    • H03K3/3562Bistable circuits of the master-slave type
    • H03K3/35625Bistable circuits of the master-slave type using complementary field-effect transistors

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  • Logic Circuits (AREA)
  • Dc Digital Transmission (AREA)

Abstract

본 발명은 클럭펄스(CLK+)가 로우에서 하이로 전이할때 입력신호(IN-)를 래치하며, 상기 클럭펄스(CLK+)가 하이에서 로우로 전이할때 3-상태 버퍼를 유지하는 마스터래치부, 반전클럭펄스(CLK-)가 로우에서 하이로 전이할때 상기 마스터래치부의 출력신호(노드Y및/Y의 신호)을 래치하며, 상기 클럭펄스(CLK+)가 하이에서 로우로 전이할때 3-상태 버퍼를 유지하는 슬레이브 래치부, 상기 반전 클럭펄스(CLK-)가 로우에서 하이로 전이할때 상기 슬레이브 래치부의 출력신호(노드Z및/Z의 신호)를 출력하되 슬레이브래치부의 일부와 포지티브 피드백을 이루어 동작되는 출력버퍼부, 상기 마스터래치부, 슬레이브 래치부, 출력버퍼부의 전압변동범위를 결정하는 기준전압공급부를 포함하며 이루어지는 것을 특징으로 하는 주/종속 플립-플롭에 관한 것으로, 주/종속 플립-플롭을 사용하는 소자의 고속동작을 이루고는 효과가 있다.

Description

주/종속 플립-플롭
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 일실시예에 따른 주/종속 플립-플롭 회로도.

Claims (2)

  1. 클럭펄스가 로우에서 하이로 전이할때 입력신호 및 그 반전신호를 래치하며, 상기 클럭펄스가 하이에서 로우로 전이할 때 3-상태 버퍼를 유지하는 마스터 래치부, 반전 클럭펄스가 로우에서 하이로 전이할 때 상기 마스터 래치부의 출력신호를 래치하며, 상기 클럭펄스가 하이에서 로우로 전이할때 3-상태 버퍼를 유지하는 슬레이브 래치부, 상기 반전 클럭펄스가 로우에서 하이로 전이할 때 상기 슬레이브 래치부의 출력신호를 출력하되 슬레이브 래치부의 일부와 포지티브 피드백을 이루어 동작하는 출력버퍼부, 상기 마스터 래치부, 슬레이브 래치부, 출력버퍼부의 전압변동범위를 결정하는 기준전압공급부를 포함하여 이루어지는 것을 특징으로 하는 주/종속 플립-플롭(master/slave flip-flop)
  2. 제1항에 있어서, 상기 클럭펄스가 하이에서 로우로 전이할때 마스터 래치부가 3-상태 버퍼 상태가 되더라도 데이타를 어느정도 유지할 수 있도록 슬레이브 래치부와의 연결부위 또는 마스터 래치부로 클럭펄스가 입력되는 노드에 캐패시터가 형성되어 있는 것을 특징으로 하는 주/종속 플립-플롭.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940018513A 1994-07-28 1994-07-28 주/종속 플립-플롭 KR0131164B1 (ko)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100476868B1 (ko) * 1997-09-04 2005-07-12 삼성전자주식회사 고속동작이가능한d플립플롭

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