KR950702075A - 시모스 전류 스티어링 회로(cmos current steering circuit) - Google Patents

시모스 전류 스티어링 회로(cmos current steering circuit)

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KR950702075A
KR950702075A KR1019940704432A KR19940704432A KR950702075A KR 950702075 A KR950702075 A KR 950702075A KR 1019940704432 A KR1019940704432 A KR 1019940704432A KR 19940704432 A KR19940704432 A KR 19940704432A KR 950702075 A KR950702075 A KR 950702075A
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리만석
Original Assignee
비. 제이 올슨
사이러스 로직 인코포레이티드
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    • H03—ELECTRONIC CIRCUITRY
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    • H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
    • H03K19/02—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components
    • H03K19/08—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits using specified components using semiconductor devices
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    • H—ELECTRICITY
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    • H03K—PULSE TECHNIQUE
    • H03K17/00—Electronic switching or gating, i.e. not by contact-making and –breaking
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    • H03K17/041—Modifications for accelerating switching without feedback from the output circuit to the control circuit
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Abstract

최소 전력을 이용하는 스팅어링 전류를 위한 CMOS 회로(100)는 병력구조인 제1전력공급 트랜지스터(101)와 제1유휴 트랜지스터(113)을 포함하는 제1스테이지와, 상기 제1스테이지와 직렬로 놓여져 또한 병렬 구조인 제2전력공급 트랜지스터(131)와 제2유휴 트랜지스터(121)를 포함하는 제2스테이를 포함한다.

Description

시모스 전류 스티어링 회로(CMOS CURRENT STEERING CIRCUIT)
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 회로의 실시예에 대한 개략도이며,
제2도는 본 발명의 다른 실시예에 대한 계략도이다.

Claims (15)

  1. 입력, 출력 및 제어입력을 가진 제1전력 공금 디바이스; 입력 및 출력을 가진 제2전력공급 디바이스; 출력을 가진 제1유휴 디바이스; 입력, 출력 및 제어입력을 가진 제2유휴 디바이스; 전기적으로 연결된, 제1유휴 디바이스 출력, 제1전력공급 디바이스 출력, 제2유휴 디바이스 입력 및 제2전력 공급 디바이스 입력; 제1전력 공급 디바이스 입력에 전압을 공급하는 수단; 제1전력 공급 디바이스로 부터 출력된 전류를 제어하도록 제1제어기능 바이어스 전압을 제1전력 공급 디바이스 제어 입력에 공급하는 수단; 제2유휴 디바이스를 통한 전도상태를 제어하도록 제2제어가능 바이어스 전압을 제2유휴 디바이스 제어 입력에 공급하는 수단; 실제로 일정한 전류를 출력하도록 구성된 제1유휴 디바이스를 포함하는 것을 특징으로 하는 전류 스티어링 회로.
  2. 제1항에 있어서, 제1전력 공급 디바이스는 제1유휴 디바이스 보다 큰 전류 전도를 제어 가능하도록 구성되며 제 유휴 디바이스는 제2전력 공급 디바이스 보다 작은 전류 전도를 제어 가능하도록 구성되는 것을 특징으로 하는 전류 스티어링 회로.
  3. 제1항에 있어서, 각각의 전력 공급 디바이스는 병렬 회로 상태로 전기 연결된 다수의 트랜지스터를 포함하는 것을 특징으로 하는 전류 스티어링 회로.
  4. 제3항에 있어서, 트랜지스터는 MOS 트랜지스터인 것을 특징으로 하는 전류 스티어링 회로.
  5. 제1항에 있어서, 제1유휴 디바이스 출력은 실제로 일정한 전압레벨을 유지하는 것을 특징으로 하는 전류 스티어링 회로.
  6. 제1항에 있어서, 회로는 단일 집적 회로에서 수행되는 것을 특징으로 하는 전류 스티어링 회로.
  7. 제1항에 있어서, 제1 및 제2제어가능 바이어스 전압은 상호 연관되어 제2유휴 디바이스를 통하여 실제로 전도상태를 제한할때 제1전력 공급 디바이스를 통해 전도 상태가 가능하도록 하는 것을 특징으로 하는 전류 스티어링 회로.
  8. 제1항에 있어서, 제1 및 제2제어가능 바이어스 전압은 상호연관 되어 제2유휴 디바이스를 통해 전도가 허용될 때 제1전력 공급 디바이스를 통해 전도 상태를 거의 제한하는 것을 특징으로 하는 전류 스티어링 회로.
  9. 입력, 출력 및 제어 입력을 가지 제1전력 공급 디바이스; 입력 출력 및 제어입력을 가진 제2전력공급 디바이스; 출력을 가진 제1유휴 디바이스; 입력, 및 출력을 가진 제2유휴 디바이스; 전기적으로 연결된, 제1유휴 디바이스 출력, 제1전력공급 디바이스 출력, 제2유휴 디바이스 입력 및 제2전력 공급 디바이스 입력; 제1전력 공급 디바이스 입력에 전압을 공급하는 수단; 제1전력 공급 디바이스로 부터 출력된 전류를 제어하도록 제1제어기능 바이어스 전압을 제1전력 공급 디바이스 제어 입력에 공미급하는 수단; 제2유휴 디바이스를 통한 전도상태및 전류를 제어하도록 제2도 바이어스 전압을 제2전력공급 디바이스 제어 입력에 공급하는 수단; 실제로 일정한 전류를 출력하도록 구성된 제1유휴 디바이스를 포함하는 것을 특징으로 하는 전류 스티어링 회로.
  10. 제9항에 있어서,제1및 제2제어가능 바이어스 전압은 상호 연관되어 제2전력공급 디바이스를 통해 전도 상태를 허용할 때 제1전력공급 디바이스를 통해 전도 상태를 허용하는 것을 특징으로 하는 전류 스티어링 회로.
  11. 입력, 출력 및 제어입력을 가진 다수의 제1스테이지 전력 공급 디바이스; 입력 및 출력을 가진 다수의 제2스테이지 전력공급 디바이스; 출력을 가진 제1유휴 디바이스; 입력, 출력 및 제어입력을 가진 제2유휴 디바이스; 전기적으로 연결된, 제1유휴 디바이스 입력 및 제2전력공급 디바이스 입력; 제1전력 공급 디바이스 입력에 전압을 공급하는 수단; 각 제1스테이지 전력 공급 디바이스 부터 출력된 전류를 제어하기 위하여 각각의 제1스테이지 제어가능 바이어스 전압을 각각의 대응 제1스테이지 전력공급 디바이스 제어입력에 공급하도록 구성되어, 적어도 하나의 제1스테이지 전력공급 디바이스에 상응하는, 다수의 제1스테이지 제어가능 바잉어스 전압소스; 제2유휴 디아비스를 통한 전도상태를 제어 하도록 제2스테이지 제어가능 바이어스 전압을 제2스테이지 유휴 디바이스 제어 입력에 공급하는 수단; 실제로 일정한 전류를 출력하도록 구성된 제1유휴 디바이스를 포함하는 것을 특징으로 하는 전류 스티어링 회로.
  12. 각각 입력, 출력 및 제어 입력을 가진, 다수의 제1스테이지 전력공급 트랜지스터, 다수의 제2스테이지 전력 공급 트랜지스터, 제1스테이지 유휴 트랜지스터 및 제2유휴 트랜지스터; 전기적으로 연결된, 제1유휴 트랜지스터 출력, 각각의 제1스테이지 전력공급 트랜지스터 출력, 제2유휴 트랜지스터 입력 및 각각의 제2스테이지 전력공급 트랜지스터 입력; 각각의 제1전력공급 트랜지스터 입력에 전압을 공급하는 수단;제1유휴 트랜지스터 입력에 전압을 공급하는 공급하는 수단; 제1스테이지 제어가능 바이어스 전압을 각각의 대응 제1스테이지 전력공급 트랜지스터 제어입력에 공급하기 위한 다수의 제1스테이지 전력공급 트랜지스터에 대응하는 다수의 수단; 제2스테이지 제어가능 바이어스 전압을 제2유휴 트랜지스터에 공급하는 수단; 바이어스 전압을 각각의 제2스테이지 전력공급 트랜지스터 제어입력에 공급하는 수단을 포함하는 것을 특징으로 하는 전류 스티어링 회로.
  13. 유휴 전류를 발생시키는 단계; 제어가능한 전력공급 전류를 발생시키는 단계; 제1제어가능 전도 전류경로와 제2전류경로를 가진 루우팅 디바이스의 입력에 유휴 및 전력공급 전류를 전기적으로 연결시키는 단계;전력공급 전류를 발생시키는 동안 제1경로를 통하여 전도 가능하게 하고 전력공급 전류가 발생하지 않는 동안 제1경로를 통하여 전도를 억제하기 위하여 전력공급 전류의 발생과 제1전류 경로의 전도상태를 상호연관 시키는 단계를 포함하는 것을 특징으로 하는 전자회로의 전류를 제어하는 방법.
  14. 제13항에 있어서, 유휴 전류는 실제로 일정한 것을 특징으로 하는 전자 회로의 전류를 제어하는 방법.
  15. 제13항에 있어서, 전력공급 전류는 유휴전류보다 더 큰 것을 특징으로 하는 전자 회로의 전류를 제어하는 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940704432A 1992-06-05 1993-06-03 시모스 전류 스티어링 회로 KR100220291B1 (ko)

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US07/894,476 US5179292A (en) 1992-06-05 1992-06-05 CMOS current steering circuit
US7/894476 1992-06-05
US07/894,476 1992-06-05
PCT/US1993/005314 WO1993026092A1 (en) 1992-06-05 1993-06-03 Cmos current steering circuit

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KR100220291B1 KR100220291B1 (ko) 1999-09-15

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JP (1) JPH07508143A (ko)
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EP0643884B1 (en) 1998-08-26
KR100220291B1 (ko) 1999-09-15
EP0643884A1 (en) 1995-03-22
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