KR950035150A - 프로그램 가능한 주파수 분할기 회로와, 분할기 회로를 포함하는 주파수 신씨사이저 및 주파수 신씨사이저를 포함하는 무선 텔레폰 - Google Patents

프로그램 가능한 주파수 분할기 회로와, 분할기 회로를 포함하는 주파수 신씨사이저 및 주파수 신씨사이저를 포함하는 무선 텔레폰 Download PDF

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KR950035150A
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Abstract

본 발명에 따른 주파수 분할기 회로가 입력 주파수 신호용 N개의 2분할 또는 3분할 분할셀의 연속을 포함하며, 이들 셀중 특징셀은 2N개 이하의 분할 인수를 획득하기 위해 무력화될 수 있다.
출원; 특히 무선 송수신 회로용 주파수 신씨사이저; 무선 텔레폰

Description

프로그램 가능한 주파수 분할기 회로와, 분할기 회로를 포함하는 주파수 신씨사이저 및 주파수 신씨사이저를 포함하는 무선 텔레폰
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제4도는 무력활될 수도 있는 본 발명에 따른 셀의 제1실시예도, 제5도는 제4도에 도시된 바와 같은 셀에 통합시키려 하는 D-형 플리플롭의 제1실시예도, 제6도는 분할인수가 2와 31간에 변하는 본 발명에 따른 분할기 회로의 제1실시예도, 제7도는 12분할에 적합한 제6도에 도시된 바와 같은 분할기 회로의 동작을 설명하는 타이밍도, 제8도는 분할인수가 2와 31간에 변하는 본 발명에 따른 분할기 회로의 제2실시예도, 제9도는 본 발명에 따른 프로그램 가능한 주파수 분할기 회로(programmable frequency divider circuit)를 이용하는 주파수 신씨사이저 (frequency synthesizer)도시도, 제10도는 송신기 및 수신기 회로가 제9도에 도시된 바와 같은 주파수 신씨사이저를 이용하는 무선 텔레폰 도시도.

Claims (9)

  1. 임의의 열(i)의 분할을 각각 나타내며, 전체가 2분할 정상 모드(nomal divide-by-two mode)와 3분할 프로그램된 모드(programmed divide-by-thred node)간에 전환가능한 p개의 캐스케이드 접속된 분할 셀(pcascade-connected frequency-dividing cells)을 포함하는 프로그램 가능한 주파수 분할기 회로(programmable frequency divider circuit)로서, 상기 임의의 열(i)의 셀이-입력 주파수 신호용 제1입력과, -고위의 열의 셀의 상기 제1입력에 인가되어질 출력 주파수 신호용 제1출력과, -상기 프로그램된 모드에 적합한 인에이블 신호용 제2입력과, -제2입력을 통해 수신된 인에이블 신호에 응답하여 발생되고 인에이블 신호로서 저위의 열의 셀의 제2입력에 인가된 신호용 제2입력을 포함하는 프로그램 가능한 주파수 분할기 회로에 있어서, 적어도 하나의 셀이 상기 셀을 무력화할 수 있는 부가의 입력(Ai, Ai’)을 구비하는 것을 특징으로 하는 프로그램 가능한 주파수 분할기 회로.
  2. 제1항에 있어서, 상기 주파수 분할기 회로는 -열(p 내지 p-q)로부터의 셀을 무력화하고, -열(p-q-1)의 셀의 출력 주파수 신호(FOp-q-1)와 동일한 주파수를 가진 상기 분할기 회로의 출력 신호를 선택하는 수단을 포함하는 것을 특징으로 하는 프로그램 가능한 주파수 분할기 회로.
  3. 제2항에 있어서, 열(i)의 임의의 셀을 무력화하기 위해, 상기 주파수 분할기 회로는 하위의 열(i-1)의 셀이 제2입력(SI1-1)에 연속한 활성 인에이블 신호의 공급을 허용하는 수단을 포함하는 것을 특징으로 하는 프로그램 가능한 주파수 분할기 회로.
  4. 제3항에 있어서, 열(i)의 각 셀은 -상기 입력 주파수 신호(FIi)에 의해 서로에 대해 역으로 시간이 정해진 제1 및 제2의 D형 플립플롭(B1 및 B2)에 의해 형성된 셀의 입력 주파수 신호(FIi)의 2분할 분할기단(셀의 출력(Oi)을 형성하는 제2플립플롭(B2)의 출력이 제1플립플롭(B1)의 데이타 입력에 역 루프되어진다)과, -스왈로윙(swallowing)을 고려해서, 셀이 프로그래밍 및 인에이블링 신호가 활성일시에, 상기 입력 주파수 신호(FIi)의 3분할에 대해, 제3 및 제4의 D형 플립플롭(B3 B4; 제4플립플롭(B4)의 출력이 제1플립를롭(B1)의 데이타 입력을 억제하게 하는 것을 가능하게 한다)에 의해 형성된 스왈로우 단(swallowstage) 및, -셀이 무력화 될 수 있을시에 트랜지스터(P)의 제어전극에 결합된 부가의 입력(Ai)을 구비하고, 상기 신호가 더이상 활성이 아닌 호출된 활성 신호를 수신할시에 상기 셀의 제2출력(SOi)을 또한 형성하는 제3플립플롭(B3)의 출력을 연속한 활성 레벨이 되게 하는 제3플립플롭(B3)을 포함하는 것을 특징으로 하는 프로그램 가능한 주파수 분할기 회로.
  5. 제4항에 있어서, 상기 인에이블링 신호는 고위의 열(i+1)의 셀의 프로그래밍 및 인에이블링 신호간의 놀리 “AND”연산에 의하여 획득되는 것을 특징으로 하는 프로그램 가능한 주파수 분할기 회로.
  6. 제2항 내지 제5항중 어느 한 항에 있어서, 상기 분할기 회로는 출력 신호로서 제1셀의 제2출력(S01)에 공급된 신호를 탭핑하는 수단을 포함하는 것을 특징으로 하는 프로그램 가능한 주파수 분할기 회로.
  7. 제6항에 있어서, 상기 분할기 회로는 상기 출력 신호의 듀티 싸이클을 증가시키는 수단을 포함하는 것을 특징으로 하는 프로그램 가능한 주파수 분할기 회로.
  8. 주파수 분할기가 제1항 내지 제7항중 어느 한 항에 청구된 바와 같은 프로그램 가능한 주파수 분할기 회로를 포함하는 것을 특징으로 하는 주파수 신씨사이저.
  9. 송신기 회로나 또는 수신기 회로가 제8항에 청구된 바와 같은 주파수 신씨사이저를 포함하는 무선 텔레폰.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019950010702A 1994-05-04 1995-05-02 프로그램 가능한 주파수 분할기 회로와, 분할기 회로를 포함하는 주파수 신씨사이저 및 주파수 신씨사이저를 포함하는 무선 텔레폰 KR950035150A (ko)

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Families Citing this family (12)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FI100285B (fi) * 1995-12-11 1997-10-31 Nokia Mobile Phones Ltd Taajuudenmuodostuspiiri
US5948046A (en) * 1997-12-15 1999-09-07 Telefonaktiebolaget Lm Ericsson Multi-divide frequency division
US6061418A (en) * 1998-06-22 2000-05-09 Xilinx, Inc. Variable clock divider with selectable duty cycle
US6157693A (en) * 1998-09-30 2000-12-05 Conexant Systems, Inc. Low voltage dual-modulus prescaler circuit using merged pseudo-differential logic
DE10251703B4 (de) * 2002-11-06 2005-08-04 Infineon Technologies Ag Schaltungsanordnung zur Frequenzteilung und Phasenregelschleife mit der Schaltungsanordnung
US7564276B2 (en) * 2006-06-28 2009-07-21 Qualcomm Incorporated Low-power modulus divider stage
CN101355361B (zh) * 2008-09-24 2010-06-09 东南大学 一种带占空比调整的高速宽范围多模可编程分频器
CN103229420B (zh) * 2011-01-28 2016-09-28 相干逻辑公司 跨着倍频程边界具有同步范围扩展的分频器
JP6344979B2 (ja) * 2014-05-30 2018-06-20 三菱電機株式会社 可変分周回路
US9438257B1 (en) * 2015-07-02 2016-09-06 Aura Semiconductor Pvt. Ltd Programmable frequency divider providing output with reduced duty-cycle variations over a range of divide ratios
WO2017158761A1 (ja) * 2016-03-16 2017-09-21 三菱電機株式会社 可変分周器
CN107565964B (zh) * 2017-08-26 2020-12-18 复旦大学 一种扩展分频比的可编程分频器

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5467753A (en) * 1977-11-10 1979-05-31 Toshiba Corp Pulse swallow type programmable frequency divider
JPS57170635A (en) * 1981-04-13 1982-10-20 Nippon Telegr & Teleph Corp <Ntt> Radio telephone set
US5027429A (en) * 1988-08-12 1991-06-25 Nec Corporation Frequency modulator utilizing frequency synthesizer
US5065415A (en) * 1989-10-23 1991-11-12 Nihon Musen Kabushiki Kaisha Programmable frequency divider
KR950016032A (ko) * 1993-11-11 1995-06-17 이용규 이중 통신 모드용 주파수 대역 전환회로

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4421952A (en) * 1981-10-16 1983-12-20 Motorola, Inc. Multi-frequency busy signal synthesizing circuitry
US4575867A (en) * 1982-08-09 1986-03-11 Rockwell International Corporation High speed programmable prescaler
US5195111A (en) * 1990-09-07 1993-03-16 Nihon Musen Kabushiki Kaisha Programmable frequency dividing apparatus
FR2677515A1 (fr) * 1991-06-07 1992-12-11 Philips Composants Circuit diviseur de frequence.

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5467753A (en) * 1977-11-10 1979-05-31 Toshiba Corp Pulse swallow type programmable frequency divider
JPS57170635A (en) * 1981-04-13 1982-10-20 Nippon Telegr & Teleph Corp <Ntt> Radio telephone set
US5027429A (en) * 1988-08-12 1991-06-25 Nec Corporation Frequency modulator utilizing frequency synthesizer
US5065415A (en) * 1989-10-23 1991-11-12 Nihon Musen Kabushiki Kaisha Programmable frequency divider
KR950016032A (ko) * 1993-11-11 1995-06-17 이용규 이중 통신 모드용 주파수 대역 전환회로

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EP0682411A1 (fr) 1995-11-15

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