KR950025874A - 반도체소자의 게이트전극 제조방법 - Google Patents
반도체소자의 게이트전극 제조방법 Download PDFInfo
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Abstract
본 발명은 반도체소자의 제조방법에 관한 것으로, 공정마진의 확보를 위하여 베리드 콘택홀등과 같은 단차를 갖는 부분과 일측이 중첩되도록 게이트전극을 형성할 때, 폴리실리콘층상에 고융점금속 실리사이드층을 적층하고, 상기 실리사이드층의 굴곡진 부분에서의 난반사를 방지하기 위하여 산화막을 적층한 후 식각 마스크로 사용되는 감광막패턴을 형성하였으므로, 노광공정시의 난반사에 의한 감광막패턴의 나칭 및 단선을 방지하여 공정수율 및 소자의 신뢰성을 향상시킬 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도(A)-(B)는 본 발명에 따른 게이트 전극 제조 공정도.
Claims (2)
- 반도체기판상에 게이트절연막과 폴리실리콘층 및 고융점금속 실리사이드층을 적층하는 공정과, 상기 실리사이드층 및 폴리실리콘층을 사진 식각하여 베리드 콘택홀의 일측과 접촉되는 게이트전극을 형성하는 공정을 구비하는 반도체소자의 게이트전극 제조방법에 있어서, 상기 실리사이드층상에 소정두께의 산화막을 적충한 후 사진 식각공정을 진행하는 공정을 구비하는 반도체소자의 게이트전극 제조방법.
- 제1항에 있어서, 상기 산화막을 1000-5000Å 정도 두께로 형성하는 것을 특징으로 하는 반도체소자의 게이트전극 제조방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940003449A KR950025874A (ko) | 1994-02-25 | 1994-02-25 | 반도체소자의 게이트전극 제조방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019940003449A KR950025874A (ko) | 1994-02-25 | 1994-02-25 | 반도체소자의 게이트전극 제조방법 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR950025874A true KR950025874A (ko) | 1995-09-18 |
Family
ID=66689922
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019940003449A KR950025874A (ko) | 1994-02-25 | 1994-02-25 | 반도체소자의 게이트전극 제조방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR950025874A (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100642442B1 (ko) * | 2000-03-21 | 2006-11-02 | 주식회사 하이닉스반도체 | 베리드 콘택 제조방법 |
-
1994
- 1994-02-25 KR KR1019940003449A patent/KR950025874A/ko not_active Application Discontinuation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100642442B1 (ko) * | 2000-03-21 | 2006-11-02 | 주식회사 하이닉스반도체 | 베리드 콘택 제조방법 |
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