KR950007272A - 차동 증폭기 - Google Patents

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Abstract

차동 증폭기가 입력된 차동 증폭기 회로 및 출력단 차동 증폭기 회로를 포함한다. 출력단 차동 증폭기 회로의 차동 동상 출력 전압은 공통 연결된 소스를 갖는 트랜지스터에 의해 동상전류로 변환된다. 동상 전류들은 전류 미러 회로의 입력 미러 전류로서 취해진다. 전류 미러 회로의 출력 미러 전류들은 동상 피드백 회로를 형성하기 위해 입력단 차동 증폭기 회로의 정전류 트랜지스터의 출력 전극으로서 드레인측에 공급된다. 동상 피드백 회로가 단지 동상 전압/전류 변환 트랜지스터 및 전류 미러 히로만으로 구성되어지므로, 피드백 경로가 줄어들고 단일 극점을 갖는 전달 함수를 형성하게 되어 차동 증폭기의 동작을 안정하게 한다.

Description

차동 증폭기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 차동 증폭기의 일실시예의 회로도
제2도는 본 발명에 따른 차동 증폭기의 다른 실시예의 회로도

Claims (10)

  1. 차동 입력 신호를 증폭하는 입력단 차동 증폭기 회로와; 상기 입력단 차동 증폭기의 차동 출력을 차동 입력으로서 취하는 출력단 차동 증폭기 회로와; 개별 제어 전극에서 상기 입력단 차동 증폭기의 차동 출력을 입력하고 상기 수신된 차동 출력에 대응하는 동상 전류를 발생시키는 제1 및 제2동상 전류 발생 트랜지스터와; 상기 제1 및 제2동상 전류 발생 트랜지스터에 의해 발생된 동상 전류의 합성 전류를 입력하는 전류 미러 회로 및; 상기 전류 미러 회로의 출력 미러 전류에 대응하는 전류를 상기 입력 및 차동 증폭기 회로의 정전류에 피드백시켜 이전류들을 합성하는 합성 수단을 포함하는 것을 특징으로 하는 차동 증폭기.
  2. 제1항에 있어서, 상기 합성 수단은 일정한 바이어스가 인가된 제어 전극을 갖는 기준 전류 발생 트랜지스터를 포함하고, 기준 전류와 상기 출력 미러 전류의 차동 전류는 합성을 위해 상기 입력단 차동 증폭기 회로의 정전류로 피드백되는 것을 특징으로 하는 차동 증폭기.
  3. 제2항에 있어서, 상기 입력단 차동 증폭기 회로가 제어 전극에 차동 입력 신호가 공급되는 제1차동 트랜지스터쌍과; 상기 제1차동 트랜지스터쌍에 동작 전류를 공급하는 정전류 트랜지스터 및; 상기 제1차동 트랜지스터쌍과 제1전력원 사이에 연결되어 상기 제1차동 트랜지스터쌍에 대해 능동 부하의 기능을 하는 부하 트랜지스터쌍을 포함하고, 상기 출력단 차동 증폭기 회로가 제어 전극에 상기 입력단 차동 증폭기 회로의 차동 출력이 공급되고 상기 제1전력원에 연결된 공통 전극을 갖는 제2차동 트랜지스터쌍 및; 상기 제2차동 트랜지스터쌍과 제2전력원 사이에 연결되어 상기 제2차동 트랜지스터쌍에 대해 능동 부하의 기능을 하는 부하 트랜지스터쌍을 포함하는 것을 특징으로 하는 차동 증폭기.
  4. 제3항에 있어서, 상기 차동 전류가 상기 정전류 트랜지스터의 출력 정전류와 합성되는 것을 특징으로 하는 차동 증폭기.
  5. 제4항에 있어서, 상기 제1및 제2동상 전류 발생 트랜지스터는 상기 출력단 차동 증폭기 회로의 차동 출력이 인가되는 제어전극과, 상기 제2전력원에 연결된 공통 전극 및, 공통 연결된 출력 전극을 가지며, 상기 합성 전류는 공통 연결된 상기 출력 전극의 출력인 것을 특징으로 하는 차동 증폭기.
  6. 차동 입력 신호를 증폭하는 입력단 차동 증폭기 회로와; 상기 입력단 차동 증폭기의 차동 출력을 차동 입력으로서 취하는 출력단 차동 증폭기 회로와; 개별 제어 전극에서 상기 입력단 차동 증폭기의 차동 출력을 입력하고 상기 차동 출력에 대응하는 동상 전류를 발생시키는 제1 및 제2동상 전류 발생 트랜지스터와; 상기 제1 및 제2동상 전류 발생 트랜지스터에 의해 발생된 상기 동상 전류의 합성 전류를 입력하고 출력 미러 전류쌍을 발생시키는 전류 미러 회로 및; 상기 출력 미러 전류쌍에 대응하는 전류를 상기 입력단 차동 증폭기 회로의 차동 출력 단자쌍에 피드백 시키는 합성 수단을 포함하는 것을 특징으로 하는 차동 증폭기.
  7. 제6항에 있어서, 상기 합성 수단이 기준 전류 발생 트랜지스터쌍을 포함하고, 상기 기준 전류쌍과 상기 출력 미러 전류쌍의 차동전류가 상기 입력단 차동 증폭기 회로의 상기 차동 출력 단자쌍에 피드백 되는 것을 특징으로 하는 차동 증폭기.
  8. 제7항에 있어서, 상기 입력단 차동 증폭기 회로가 제어 전극에 차동 입력 신호가 공급되는 제1차동 트랜지스터쌍과; 상기 제1차동 트랜지스터쌍에 동작 전류를 공급하는 정전류 트랜지스터 및; 상기 제1차동 트랜지스터쌍 출력 전극과 제1전력원 사이에 연결되어 상기 차동 트랜지스터쌍에 대해 능동 부하의 기능을 하는 부하 트랜지스터쌍을 포함하고, 상기 출력단 차동 증폭기 회로가 제어 전극에 상기 입력단 차동 증폭기 회로의 차동 출력이 공급되고 상기 제1전력원에 연결된 공통 전극을 갖는 제2차동 트랜지스터쌍 및; 상기 제2차동 트랜지스터쌍과 제2전력원 사이에 연결되어 상기 제2차동 트랜지스터쌍에 대해 능동 부하의 기능을 하는 부하 트랜지스터쌍을 포함하는 것을 특징으로 하는 차동 증폭기.
  9. 제8항에 있어서, 개별의 상기 차동 전류들이 상기 제1차동 트랜지스터쌍의 출력 전극에 공급되는 것을 특징으로 하는 차동 증폭기.
  10. 제9항에 있어서, 상기 제1및 제2동상 전류 발생 트랜지스터는 상기 출력단 차동 증폭기 회로의 차동 출력이 인가되는 제어전극과, 상기 제2전력원에 연결된 공통 전극 및, 공통 연결된 출력 전극을 가지며, 상기 합성 전류는 공통 연결된 상기 출력 전극의 출력인 것을 특징으로 하는 차동 증폭기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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