KR950002207A - 클램핑 회로 - Google Patents

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KR950002207A
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마사미 쯔기따
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세끼모또 다다히로
니뽄 덴끼 가부시끼가이샤
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    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
    • H03K5/01—Shaping pulses
    • H03K5/08—Shaping pulses by limiting; by thresholding; by slicing, i.e. combined limiting and thresholding
    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
    • H04N5/00—Details of television systems
    • H04N5/14—Picture signal circuitry for video frequency region
    • H04N5/16—Circuitry for reinsertion of dc and slowly varying components of signal; Circuitry for preservation of black or white level
    • H04N5/18—Circuitry for reinsertion of dc and slowly varying components of signal; Circuitry for preservation of black or white level by means of "clamp" circuit operated by switching circuit

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Abstract

클램핑 회로는 출력 노드의 전압과 일정한 클램프 전압을 비교하는 한쌍의 트랜지스터를 구비한다. 한쌍 트랜지스터는 제 1 전류원으로부터의 일정 전류가 공급되는 공통 에미터를 구비한다. 차동 증폭기의 출력이 출력 노드를 충전시키는 트랜지스터에 베이스에 공급된다. 출력 노드는 제 2 전류원에 의해 일정하게 방전된다. 제 1 전류원으로부터의 일정 전류가 제 2 전류원으로부터의 일정 전류보다 2 배 더 크다. 제1 및 제 2 전류원이 제어되고 작동되어 전류 제어 신호에 따라 제1 및 제 2전류를 발생시킨다. 클램핑 회로는 각각의 제1 및 제2 일정 전류의 값을 셋팅하는 전류 제어 회로도 구비한다. 전류 제어 회로는 클램프제어 신호에 의해 제어되고 제2 전류원에 의해 상기 회로를 선택적으로 작동시킨다.

Description

클램핑 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 3 도는 본 발명의 일실시예에 따른 클램핑 회로의 회로 구성도, 제 4 도는 제 3 도의 전류 및 전류 제어 회로의 회로 구성도.

Claims (5)

  1. 제 1 의 일정 전압으로 클램프되어질 출력 노드와; 상기 제1의 일정 전압이 공급되는 제 1 단자와; 상기 출력 노드 및 상기 제 1 단자에 동작가능하게 결합되고 상기 출력 노드의 전압과 상기 제 1 단자의 상기 제 1 의 일정 전압간의 전압차를 나타내는 제어 신호를 출력 하는 전압 검출 회로와; 상기 제어 신호에 응답하여 상기 출력 노드와 제 2의 일정 전압이 공급되는 제 2 단자간의 전류를 제어하는 구동 회로 및; 제 1 의 전류 제어 신호에 응답하여 상기 출력 노드와 제 3 의 일정 전압이 공급되는 제 3 단자간에 제 1 의 일정 전류를 발생시키는 제 1 전류원을 포함하는 것을 특징으로 하는 클램핑 회로.
  2. 제 1 항에 있어서, 제 2 의 전류 제어 신호에 응답하여 제 2 의 일정 전류를 상기 전압 검출 회로에 공급하는 제 2 전류원을 포함하는데, 상기 전압 검출 회로는 상기 제 2 의 일정 전류가 공급되는 공통 노드를 구비한 차동 형태로 형태된 한쌍의 트랜지스터를 포함하는 것을 특징으로 하는 클램핑 회로.
  3. 제 2 항에 있어서, 상기 제1 및 제 2 전류원은 제1 및 제 2 전류원 트랜지스터를 각기 포함하는데, 상기 제1 및 제 2 전류원 트랜지스터에 상기 제1 및 제 2 전류 제어 신호가 각기 공급되어지며, 상기 제1 및 제 2 전류원 트랜지스터가 공통 싸이즈로 형성되어지고, 상기 제1 및 제 2 전류원 트랜지스터가 상기 제 1 의 일정 전류 보다 2배 더 큰 상기 제 2 의 일정 전류를 출력하는 것을 특징으로 하는 클램핑 회로.
  4. 제 3 항에 있어서, 클램프 제어 회로에 응답하여 상기 제1 및 제 2 의 전류 제어 신호를 출력하는 전류 제어 회로를 포함하는데, 상기 전류 제어 회로는 제 1 공통 노드를 통해 서로 연결되고 상기 제2 및 제 3 단자간에 직렬로 연결된 제1 및 제 2 트랜지스터를 포함하며, 상기 제 2 트랜지스터가 상기 제 1 트랜지스터보다 2배 더 크고, 상기 제 1 공통 노드가 상기 제 1의 전류 제어 신호를 출력하는 것을 특징으로 하는 클램핑 회로.
  5. 제 4 항에 있어서, 상기 전류 제어 회로는 제 2 의 공통 노드를 통해 서로 연결되고 상기 제2 및 제 3 단자간에 직렬로 연결되는 제3 및 제 4 트랜지스터를 포함하는데, 상기 제 3 트랜지스터가 상기 제 4 트랜지스터보다 2배 더 크고, 상기 제 2 공통 노드가 상기 제 1 전류 제어 신호를 출력하는 것을 특징으로 하는 클램핑 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940015885A 1993-06-30 1994-06-30 클램핑 회로(Clamping circuit) KR0135942B1 (ko)

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JPH0722883A (ja) 1995-01-24

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