KR940008272A - 아날로그/디지탈 컨버터 - Google Patents

아날로그/디지탈 컨버터 Download PDF

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KR940008272A
KR940008272A KR1019930017055A KR930017055A KR940008272A KR 940008272 A KR940008272 A KR 940008272A KR 1019930017055 A KR1019930017055 A KR 1019930017055A KR 930017055 A KR930017055 A KR 930017055A KR 940008272 A KR940008272 A KR 940008272A
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KR
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modulator
data
digital data
outputting
analog signal
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KR1019930017055A
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Inventor
마사키 우에키
Original Assignee
오오가 노리오
소니 가부시끼가이샤
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    • H03ELECTRONIC CIRCUITRY
    • H03MCODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M3/00Conversion of analogue values to or from differential modulation
    • H03M3/30Delta-sigma modulation
    • H03M3/458Analogue/digital converters using delta-sigma modulation as an intermediate step
    • H03M3/466Multiplexed conversion systems
    • H03M3/472Shared, i.e. using a single converter for multiple channels
    • HELECTRICITY
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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
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  • Compression, Expansion, Code Conversion, And Decoders (AREA)

Abstract

본 발명은 부품점수의 삭감, 회로규모의 축소화 및 저원가화를 도모할 수 있는 외에 동상 노이즈성분을 제거하고 출력하는 음성데이터의 S/N비를 향상시킬수 있는 A/D컨버터의 제공을 목적으로 한다.
그 구성을 보면, 아날로그신호 입력단자(1)를 통하여 공급된 아날로그 신호인 음성신호를 제1,제2△

Description

아날로그/디지탈 컨버터
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 관계되는 A/D컨버터의 제1실시예의 블록도이다.
제3도는 상기 제1실시예의 A/D컨버터에 설치되어 있는 △모듈레이터의 구체적인 회로구성을 설명하기 위한 블록도이다.
제4도는 본 발명에 관계되는 A/D컨버터의 제2실시예의 블록도이다.
제5도는 본 발명에 관계되는 A/D컨버터의 제3실시예의 블록도이다.

Claims (5)

  1. 외부에서 공급된 아날로그신호를 각각 병렬적으로 디지탈 데이터로 변환하여 출력하는 복수의 △모듈레이터와, 상기 복수의 △모듈레이터에서 공급되는 복수의 디지탈데이터를 가산처리함으로써, 가산데이터를 형성하여 출력하는 가산수단과, 상기 가산수단으로부터의 가산데이터를 상기 △모듈레이터의 설치된 수로 제산처리함으로써 제산데이터를 형성하여 출력하는 감쇠수단과, 상기 감쇠수단으로부터의 제산데이터를 이 제산데이터의 비트수보다도 큰 소정의 비트수의 디지탈 데이터로 변환하여 출력하는 데시메이션필터를 가지는 것을 특징으로 하는 아날로그/디지탈 컨버터.
  2. 제1항에 있어서, 상기 복수의 △모듈레이터로서, 제1△모듈레이터 및 제2△모듈레이터의 제2개의 △모듈레이터를 가지는 것을 특징으로 하는 아날로그/디지탈 컨버터.
  3. 외부에서 공급된 아날로그신호를 디지탈 데이터로 변환하여 출력하는 제1△모듈레이터와, 외부에서 공급된 아날로그신호의 위상을 반전하여 출력하는 위상반전수단과, 상기 위상반전수단으로 부터의 위상이 반전된 아날로그신호를 디지탈 데이터로 변환하여 출력하는 제2△모듈레이터와, 상기 제2△모듈레이터로부터의 위상이 반전된 아날로그신호에 대응하는 디지탈 데이터의 극성을 반전하여 상기 제1△모듈레이터로 부터의 디지탈 데이터와 가산처리함으로써 역극성 가산데이터를 형성하여 출력하는 역극성 가산수단과, 상기 역극성 가산수단으로 부터의 역극성 가산데이터를 1/2배로 제산처리함으로써, 제산데이터를 형성하여 출력하는 감쇠수단과, 상기 감쇠수단으로 부터의 제산데이터를 이 제산데이터의 비트수보다도 큰 소정의 비트수의 디지탈 데이터로 변환하여 출력하는 데시메이션필터를 가지는 것을 특징으로 하는 아날로그/디지탈 컨버터.
  4. 제3항에 있어서, 상기 역극성가산수단은, 상기 제2△모듈레이터에서 출력된 상기 위상이 아날로그신호에 대응하는 디지탈 데이터의 극성을 반전하여 출력하는 극성반전수단과, 상기 제1△모듈레이터로 부터의 디지탈 데이터와 상기 극성반전수단으로부터의 디지탈 데이터와를 가산처리하여 출력하는 가산 수단으로 구성되는 것을 특징으로 하는 아날로그/ 디지탈 컨버터.
  5. 제3항에 있어서, 상기 역극성 가산수단은, 상기 제1△모듈레이터에서 출력되는 디지탈 데이터에서 상기 제2△모듈레이터에서 상기 제2△모듈레이터에서 출력되는 상기 위상이 반전된 아날로그신호에 대응하는 디지탈 데이터를 감산처리하는 감산수단으로 구성되는 것을 특징으로 하는 아날로그/디지탈 컨버터.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019930017055A 1992-09-07 1993-08-30 아날로그/디지탈컨버터 KR100279078B1 (ko)

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Families Citing this family (22)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH03106102U (ko) * 1990-02-19 1991-11-01
JP3080207B2 (ja) * 1993-01-06 2000-08-21 三菱電機株式会社 電子式電力量計
CH689471A5 (de) * 1994-05-05 1999-04-30 Landis & Gyr Tech Innovat Anordnung zum Summieren von Produkten zweier gleichen oder unterschiedlichen Signale.
US5801652A (en) * 1994-07-08 1998-09-01 Cirrus Logic, Inc. Pattern dependent noise reduction in a digital processing circuit utilizing image circuitry
US5719572A (en) * 1994-07-08 1998-02-17 Cirrus Logic, Inc. Digital signal processor with reduced pattern dependent noise
JP3341566B2 (ja) * 1996-02-15 2002-11-05 ソニー株式会社 信号伝送方法及び装置、並びに信号再生方法及び装置
JP3371681B2 (ja) * 1996-04-23 2003-01-27 ソニー株式会社 信号処理装置
US5923273A (en) * 1996-11-18 1999-07-13 Crystal Semiconductor Corporation Reduced power FIR filter
GB2321143B (en) * 1997-01-10 2001-03-28 Phoenix Vlsi Consultants Delta sigma analog-to-digital converter
US6075820A (en) * 1997-05-28 2000-06-13 Lucent Technologies Inc. Sampling receiver with multi-branch sigma-delta modulators and digital channel mismatch correction
US6292121B1 (en) 1998-01-09 2001-09-18 Lecroy Corporation Delta sigma-analog-to-digital converter
US6154161A (en) * 1998-10-07 2000-11-28 Atmel Corporation Integrated audio mixer
US6456215B1 (en) 2000-11-29 2002-09-24 Raytheon Company Method and system for quantizing an input signal
US6441767B1 (en) 2000-11-29 2002-08-27 Raytheon Company Method and system for adjusting a threshold control in an analog-to-digital converter
US6614373B1 (en) * 2000-11-29 2003-09-02 Raytheon Company Method and system for sampling a signal using analog-to-digital converters
US6429797B1 (en) 2001-07-05 2002-08-06 International Business Machines Corporation Decimation filter for a bandpass delta-sigma ADC
US6683550B2 (en) * 2001-12-14 2004-01-27 Teradyne, Inc. High precision, high-speed signal capture
DE60215463T2 (de) * 2002-05-22 2007-02-08 Freescale Semiconductor, Inc., Austin Analog-Digital-Wandler Anordnung und Methode
US7456766B2 (en) * 2006-07-19 2008-11-25 Qualcomm Incorporated Sigma-delta modulation with offset
JP5018680B2 (ja) * 2008-08-01 2012-09-05 株式会社Jvcケンウッド Ad変換装置
JP5609684B2 (ja) * 2011-02-01 2014-10-22 ソニー株式会社 Ad変換装置および信号処理システム
US9350373B1 (en) * 2014-12-17 2016-05-24 Mediatek Inc. Analog-to-digital converter and long-term-evolution advanced device and method for analog-to-digital conversion

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP3012887B2 (ja) * 1989-03-13 2000-02-28 日本テキサス・インスツルメンツ株式会社 信号変換装置
US5196852A (en) * 1992-02-21 1993-03-23 California Institute Of Technology Analog-to-digital converter using parallel ΔΣ modulators

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Publication number Publication date
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KR100279078B1 (ko) 2001-01-15
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US5363101A (en) 1994-11-08

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