KR930011662B1 - 카트리지를 이용한 lbp 시스팀 - Google Patents

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Abstract

내용 없음.

Description

카트리지를 이용한 LBP 시스팀
제1도는 본 발명에 의한 LBP 시스팀의 구성도.
제2도는 본 발명에 의한 한글, 한자 카트리지의 내부 구성도.
제3도는 제1도의 LBP 시스팀의 개략적인 세부 구성블럭도.
제4도는 제3도의 메모리 억세스 제어로직부의 동작 상태도.
제5도는 제3도의 메모리 억세스 제어로직부의 일실시예 세부 구성 회로도.
제6도는 본 발명에 의한 2메가 바이트 메모리를 갖는 카트리지의 일실시예 세부 구성도.
제7도는 본 발명에 의한 2메가 바이트 메모리를 갖는 카트리지의 다른 실시예 세부 구성도.
제8도는 본 발명에 의한 4메가 바이트 메모리를 갖는 카트리지의 일실시예 세부 구성도.
제9도는 본 발명에 의한 4메가 바이트 메모리를 갖는 카트리지의 다른 실시예 세부 구성도.
* 도면의 주요부분에 대한 부호의 설명
1 : LBP 11 : 에뮬레이션 소프트웨어 카트리지
12 : 영문폰트 카트리지
13, 20 : 한글, 한자 폰트 및 에뮬레이션 기능을 갖는 카트리지
14 : 비디오 콘트롤러 15 : 엔진 및 기구부
21 : 카트리지 메모리 22 : 카트리지 메모리 제어로직부
31 : 메모리 억세스 제어로직부 32 : 주 회로부
34, 35 : 카트리지 콘넥터
본 발명은 한글, 한자 및 영문 프린트 출력이 가능한 LBP(Laser Beam Printer) 시스팀에 관한 것으로, 특히 한글, 한자폰트 및 한글, 한자 출력용 에뮬레이션 프로그램 코드를 고집적 마스크롬과 SOP(Small Outline Package) 타입의 소자를 사용한 카트리지 방식으로 실현하여 외부에서 옵션으로 장착 및 교환이 가능하도록 한 LBP 시스팀에 관한 것이다.
종래의 한글, 한자 및 영문 출력용 LBP 시스팀에서는 LBP 시스팀 내부의 비디오 콘트롤러 보드위에 PCB(Printed Circuit Board) 접속 콘넥터를 사용하여 주로 EPROM(Erasable and Programmable ROM)으로 구성된 한자 폰트 PCB를 별도로 장착하도록 설계되어 다음과 같은 문제점을 가지고 있었다.
첫째, 사용자가 같은 사무실에서 다수의 LBP를 구입하여 사용하는 경우 LBP의 내부에 장착되는 한자보드를 여러 사용자가 공용하는 것이 불편하므로 고가의 한자보드에 대한 중복 투자를 해야만 한다. 둘째, 종래의 한자보드는 고가의 EPROM으로 구성되어 있어 소자 가격이 비싸고 PCB의 크기도 커지며 고가의 PCB 접속 콘넥터를 별도로 사용해야 하므로 전체적인 재료비가 상승된다. 세째, 비디오 콘트롤러 외에 한자 폰트보드가 콘트롤러부의 공간을 점유하므로 한글, 한자를 사용하는 사용자의 요구에 따라 확장 메모리보드나 확장 I/O 보드를 장착가능하도록 설계가 곤란하다.
넷째, 한글 또는 한자 서체가 다양하게 개발되어도 사용자가 교환하기가 매우 불편하며 각기 다른 조합형의 프린터의 에뮬레이션 기능이 추가되어도 사용자가 용이하게 LBP 외부에서 교환이 불가능하고 에뮬레이션 기능을 갖는 모듈의 별도 생산이 불가능하다.
상기 문제점을 해결하기 위해 안출된 본 발명은 SOP 타입의 4메가비트 마스크롬 또는 16메가비트 마스크롬 및 32메가비트 마스크롬을 사용하여 콤팩트(COMPACT)한 카트리지를 설계하여 LBP 외부에서 편리하게 장착가능하도록 하고, 메모리 제어로직을 2분화하여 한글, 한자 및 한글과 한자 카트리지를 영문폰트 및 영문 에뮬레이션 소프트웨어 카트리지와 공용으로 사용하도록 한 LBP 시스팀을 제공함에 그 목적이 있다.
상기 목적을 달성하기 위해 본 발명은 비디오 콘트롤러를 포함하여 구성되는 LBP에 영문 에뮬레이션 소프트웨어 카트리지, 영문 폰트 카트리지와 한글, 한자 폰트, 및 한글 한자 에뮬레이션 카트리지 등 다수의 카트리지를 장착하여 한글, 한자 및 영문을 프린트 출력하는 LBP 시스팀에 있어서, 상기 비디오 콘트롤러는 상기 비디오 콘트롤러의 주기능을 담당하는 주 제어수단, 상기 주 제어수단에 연결되고 상기 주 제어수단으로부터 제어신호 및 어드레스 신호가 입력되어 상기 다수의 카트리지를 공용으로 억세스 가능하도록 하는 메모리 억세스 제어로직수단, 및 상기 메모리 억세스 제어로직수단과 주 제어수단과 카트리지에 연결되어 제어신호, 어드레스 신호, 및 데이터 신호를 상기 카트리지에 전달하는 카트리지 콘넥터로 구성되고, 상기 카트리지는 상기 카트리지 콘넥터에 연결되고 상기 메모리 억세스 제어로직수단의 제어신호와 상기 주제어수단의 어드레스 신호를 입력으로 하여 상기 카트리지 종류에 따라 가변성 있는 기능을 실현하는 카트리지 메모리 제어로직수단, 및 상기 카트리지 콘넥터와 카트리지 메모리 제어로직수단에 연결되고 상기 메모리 억세스 제어로직수단의 제어신호와 상기 주 제어수단의 어드레스신호 및 데이터 신호와 상기 카트리지 메모리 제어로직수단의 제어신호가 입력되는 카트리지 메모리로 구성되는 것을 특징으로 한다.
이하, 첨부한 도면을 참조하여 본 발명의 실시예를 상세히 설명한다.
제1도는 본 발명에 의한 LBP 시스팀의 구성도로, 1은 LBP, 11은 에뮬레이션 소프트웨어 카트리지, 12는 영문폰트 카트리지, 13은 한글, 한자 폰트카트리지, 14는 비디오 콘트롤러, 15는 엔진 및 기구부, 34, 35는 카트리지 콘넥터를 각각 나타낸다.
본 발명에 의한 LBP 시스팀은 영문폰트 카트리지(12) 및 영문 에뮬레이션 소프트웨어 카트리지(11)를 사용하는 것과 동일한 방식으로 비디오 콘트롤러의 카트리지 콘넥터(34, 35)에 한글 폰트 카트리지, 한자 폰트 카트리지, 한글과 한자로 된 폰트 카트리지, 및 한글 한자 에뮬레이션 카트리지(13)를 LBP(1) 외부에서 사용자 선택에 따라 장착가능하도록 하였다.
그리고 한글, 한자, 한글과 한자 카트리지를 영문 폰트 및 영문 에뮬레이션 소프트웨어 카트리지와 공용으로 사용하기 위해 제3도와 같이 메모리 제어로직을 2분화하여 상기 각종 카트리지를 공용으로 억세스 하는 기능은 비디오 콘트롤러(14)의 메모리 억세스 제어로직부(31)로 실현하고, 카트리지 종류에 따라 가변성을 갖는 부분은 각 카트리지 상에 카트리지 메모리 제어 로직부(22)로 구성하여 실현하였다.
제2도는 본 발명에 의한 한글, 한자 폰트 및 한글 한자 에뮬레이션 카트리지의 내부 구성도로, 21은 카트리지 메모리, 22는 카트리지 메모리 제어로직부를 나타낸다.
한글, 한자, 및 한글과 한자의 폰트 및 한글 한자 에뮬레이션 카트리지(13)는 4메가비트 이상의 고집적 마스크롬으로 구성된 카트리지 메모리(21)와 SOP 타입의 소자로 구성된 카트리지 메모리 제어 로직부(22)로 구성된다.
제3도는 본 발명에 의한 LBP 시스팀 주요부의 개략적인 세부구성 블록도로서, 31은 메모리 억세스 제어로직부, 32는 주 회로부, 34, 35는 카트리지 콘넥터를 각각 나타낸다.
LBP 시스팀(1)의 비디오 콘트롤러(14)는 어드레스라인 및 테이타 입출력 라인을 구비하고 있으며 상기 비디오 콘트롤러(14)의 주 제어기능을 담당하는 주 회로부(32)에 메모리 억세스 제어로직부(31)를 연결하여 상위 바이트 신호, 읽기신호(RD), 및 어드레스 신호를 공급받고 상기 메모리 억세스 제어로직부(31) 및 주회로부(32)에 카트리지 콘넥터(34,35)를 연결하여 구성한다.
한편 본 발명에서는 사용 목적에 따라 워드 억세스와 우수 바이트 억세스 및 기수 바이트 억세스가 가능하도록 메모리 억세스 제어로직부를 비디오 콘트롤러에 실현하였으며 뱅크 메모리를 선택하기 위한 카트리지 메모리 제어로직부를 마련하여 다양한 메모리에 관계없이 카트리지 메모리를 운영 가능하도록 하였다.
LBP 시스팀의 한글, 한자 카트리지(20)는 상기 카트리지 콘넥터(34,35)에 연결되어 카트리지 선택신호 및 어드레스를 공급받는 카트리지 메모리 제어로직부(22), 및 상기 카트리지 메모리 제어로직부(22)에 연결되어 뱅크 메모리신호 및 메모리제어신호와 주 회로부(32)로부터 어드레스와 테이타를 공급받도록 구성한다.
메모리 억세스 제어로직부(31)는 각종 카트리지를 공용으로 억세스 가능하도록 하는 기능을 실현하는 것으로 주 회로부(32)로부터 상위 바이트 신호, 읽기 신호(RD), 및 어드레스 신호가 입력되면 상기 신호특성에 따라 워드 억세스(16비트 읽기), 바이트 억세스(8비트 읽기)를 선택하여 상위 바이트 선택신호, 하위 바이트 선택신호, 및 카트리지 선택신호를 카트리지 콘넥터(34,35)로 보낸다. 바이트 억세스는 목적에 따라 우수바이트와 기수바이트로 선택이 가능하다.
제4도는 제3도의 메모리 억세스 제어로직부의 동작상태도이다.
제4도를 참조하여 메모리 억세스 제어로직부(31)의 동작을 살펴보면 다음과 같다.
메모리 억세스 제어로직부(31)는 어드레스(AO)가 로직 1이고 상위 바이트 신호가 로직 1이고 읽기 신호(RD)가 로직 1인 경우 워드 억세스를 선택하며, 이 경우 상위 바이트 선택신호와 하위바이트 선택신호를 모두 로직 1상태로 하여 카트리지 콘넥터(34,35)로 내보낸다. 또한, 메모리 억세스 제어로직부(31)는 어드레스(AO)가 로직 1이고 상위 바이트 신호가 로직 0이고 읽기신호(RD)가 로직 1일 경우 우수바이트 억세스를 선택하며, 이 경우 상위 바이트 선택신호는 로직 0상태로, 하위 바이트 선택신호는 로직 1상태로 하여 카트리지 콘넥터(34,35)로 보낸다. 그리고 메모리 억세스 제어로직부(31)는 어드레스(AO)가 로직 0이고 상위바이트 신호가 로직 1이고 읽기신호(RD)가 로직 1일 경우 기수바이트 억세스를 선택하며, 이 경우에는 상위 바이트 선택신호는 로직 1상태로, 하위 바이트 선택신호는 로직 0상태로 하여 카트리지 콘넥터(34,35)로 내보낸다.
카트리지 메모리 제어로직부(22)는 카트리지 종류에 따라 가변성 있는 부분을 실현하는 것으로 상기 카트리지 콘넥터(34,35)에서 오는 카트리지 선택신호가 로직 1일 때 어드레스 라인의 선택에 따라 목적하는 메모리 뱅크를 억세스 할 수 있다. 뱅크 메모리 신호는 카트리지 메모리(21)의 선택된 뱅크에 해당하는 영역의 메모리 소자그룹이나 메모리 영역을 읽을 수 있도록 카트리지 메모리(21)로 출력된다.
제5도는 메모리 억세스 제어로직부의 일실시예 구성도이다.
메모리 억세스 제어로직부(31)는 카트리지 선택신호 처리부(319)와 상위/하위 바이트 선택신호 처리부(316)로 나뉘어진다.
본 실시예에서는 어드레스(A22) 신호를 반전시키는 인버터(51), 상기 인버터 출력과 어드레스(A23) 신호를 부정 논리곱하여 카트리지 선택신호 #1을 출력하는 NAND 게이트(52), 및 상기 두 어드레스(A22, A23) 신호를 부정 논리곱하여 카트리지 선택신호 #2를 출력하는 NAND 게이트(53)로 카트리지 선택신호 처리부(31a)를 구성하고, 어드레스(AO) 신호와 읽기() 신호를 논리합하여 하위바이트 선택신호를 출력하는 OR게이트(54), 및 상기 읽기 신호와 주회로부(32)로부터의 상위 바이트 신호를 논리합하여 상위 바이트 선택신호를 출력하는 OR 게이트(55)로 상위/하위 바이트 선택신호 처리부 (31b)를 구성한다.
카트리지 선택신호 처리부(31a)는 I/O 디코더 게이트를 사용하여 구성할 수도 있다. 어드레스 A23, A22는 카트리지 #1과 #2를 선택하여 주는 신호로써 A23, A22가 각각 1, 0이면 카트리지 어드레스 영역을 800000번지부터 BFFFFF까지를 선택하여 카트리지 선택신호 #1을 로우(로직 1)로 하며, A23, A22가 1, 1이면 C00000부터 FFFFFF까지를 선택하여 카트리지 선택신호 #2를 로우(로직 1)로 한다. 읽기신호(), 상위 바이트 신호(), 상위바이트 선택신호, 하위바이트 선택신호가 각각 로우인 것을 로직 1로써 제4도의 RD, 상위바이트 선택신호, 하위바이트 선택신호가 각각 로직 1인 것과 대응한다.,, 상위바이트 선택신호, 하위바이트 선택신호가 각각 하이인 것은 로직 0으로써 제4도의 RD, 상위바이트 신호, 상위바이트 선택신호, 하위 바이트 선택신호가 각각 로직 0으로써 제4도의 로직 1, 0과 동일하게 대응한다. 그리고 어드레스 A0가 로우인 것은 로직 1이며, 하이인 것은 로직 0으로써 제4도의 로직 1, 0과 동일하게 대응한다. 그리고 어드레스 A0가 로우인 것은 로직 1이며, 하이인 것은 로직 0으로써 제4도의 로직 1, 0과 동일하게 대응한다.
제6도는 2메가 바이트의 메모리를 갖는 카트리지의 일실시예 세부 구성도로, 메모리로서 4메가 비트의 마스크롬 4개를 사용한 경우이다. 도면에서와 같이 카트리지 메모리 제어 로직부(22)는 특정 어드레스 신호(A20)를 반전시키는 인버터(61)와, 상기 인버터(61) 출력과 카트리지 선택신호를 논리합하여 뱅크 선택신호 1을 결정하는 OR 게이트(62)와, 상기 어드레스 신호(A20)와 카트리지 선택신호를 논리합하여 뱅크 선택신호 0을 결정하는 OR게이트(63)로 구성된다. 상위바이트 선택신호와 하위바이트 선택신호는 직접 4메가 비트 마스크 롬의단자로 입력된다. 어드레스 A20 신호는 뱅크를 선택하는 신호로써 A20이 로우이고 카트리지 선택신호가 로우일 때 뱅크 선택신호 0을 로우신호(로직 1)로 선택하여 4메가 비트 마스크롬(64,66)에인가하여, A20이 하이이고 카트리지 선택신호가 로우일 때 뱅크 선택신호 1을 로우신호(로직 1)로 선택하여 카트리지 메모리(21)를 구성하는 4메가 비트 마스크롬(65,67)의단자에 인가한다.
제7도는 2메가 바이트의 메모리를 갖는 카트리지의 다른 실시예 구성도로, 메모리로서 16메가 비트 마스크롬 1개를 사용한 경우이다. 도면에서와 같이 카트리지 메모리 제어로직부(22)는 상위 바이트 선택신호 및 하위바이트 선택신호를 논리곱하는 AND게이트(71)와, 상기 상위 바이트 선택신호 및 하위 바이트 선택신호를 부정 논리합하는 NOR 게이트(72)와, 상기 NOR 게이트(72)의 출력단에 제어단이 연결되고 하위바이트 선택신호단에 입력단이 연결된 3-상태 버퍼(73)로 구성된다. 상위바이트 선택신호가 로우이거나 하위바이트 선택신호가 로우이면 AND 게이트(71)를 로우로 동작시켜서신호를 인에이블시킨다.신호는 로우이면 바이트 억세스가 가능하며, 하이이며 워드 억세스가 가능한 메모리 입력신호로써, 상위 바이트 신호와 하위 바이트 신호가 모두 로우이면 NOR 게이트(72) 출력신호는 하이로 되어서신호를 하이로 하여 워드 억세스가 가능하도록 한다. 한편, 상위 바이트 신호나 하위바이트 신호 중 어느 한 신호가 하이이면, 즉 바이트 억세스이면 NOR 게이트(72) 출력은 로우가 되어서 바이트 억세스가 가능하게 된다. 16메가 비트 마스크 롬의 A-1/D15 단자는 워드억세스시 D15 출력신호로 사용되며, 바이트 억세스 시 최하위 비트(LSB) 어드레스 입력신호로 사용되는 것으로서 입출력이 가능하여 하위 바이트 선택 신호와 충돌이 일어날 수 있으므로 3-상태 버퍼(73)를 사용하여 완충시킨다. 즉, 바이트 억세스시 NOR 게이트(72) 출력이 하이이므로 3-상태 버퍼(73)는 오프되어 A-1/D15의 D15의 데이터 출력신호를 데이터 라인으로만 출력시킨다. 하위 바이트 선택신호가 하이이면 기수 바이트 어드레스를 억세스 가능하게 한다. 하위 바이트 선택신호가 로우이면 우수바이트 어드레스를 억세스 가능하게 한다. 카트리지 선택신호는 직접단자로 입력된다.
제8도는 4메가 바이트의 메모리를 갖는 카트리지의 일실시예 구성도로, 메모리로서 16메가 비트 마스크롬을 2개 사용한 경우이며, 상기 제6도의 경우와 제7도의 경우로부터 쉽게 구현할 수 있는 것이다. 즉, 2개의 16비트 마스크롬을 제어하기 위한 제어로직부(22)로서, 특정 어드레스 신호(A21)를 반전시키는 인버터(81)와, 상기 인버터(81)출력과 카트리지 선택신호를 논리합하는 OR 게이트(82)와, 상기 어드레스 신호(A21)와 카트리지 선택신호를 논리합하는 OR 게이트(83)와, 상위 바이트 선택신호 및 하위바이트 선택신호를 논리곱하는 AND 게이트(84)와, 상기 상위 및 하위 바이트 선택신호를 부정논리합하는 NOR 게이트(85)와, 상기 NOR 게이트 출력단에 제어단이 연결되고 상기 하위 바이트 선택신호단에 입력단이 연결된 30상태 버퍼(86)로 구성하여, 상기 제7도와 동일한 방법으로 카트리지 메모리(21)를 구성하는 두 마스크롬(87,88)의,, 및 A-1/D15 단자를 억세스하게 된다. 그리고 상기의 특정 어드레스 신호 A21는 뱅크를 선택하는 신호로서 A21가 로우이고 카트리지 선택신호가 로우일 때 뱅크 선택신호 0을 로우신호(로직 1)로 선택하여 16메가 비트 마스크롬(87)의단자에 인가하고, A21가 하이이고 카트리지 선택 신호가 로우일 때 선택신호1을 로우신호(논리 1)로 선택하여 16메가 비트 마스크롬(88)의단자에 인가한다.
제9도는 4메가 바이트의 메모리를 갖는 카트리지의 다른 실시예 구성도이며, 메모리로 32메가 비트 마스크롬(94)을 1개 사용한 경우로서, 카트리지 메모리 제어 로직부 (22)의 구성을 제7도의 경우와 동일하게 구성할 수 있으며,,, 및 A-1/D15의 억세스 또한 상기 제7도의 경우와 동일하다. 그러나 32메가비트 마스크 롬(94)의 어드레스 단자로는 A1∼A21까지의 어드레스가 입력된다. 그리고 카트리지 선택신호는 직접단자로 입력된다.
상기와 같이 구성되어 작동하는 본 발명은 한글, 한자 및 한글과 한자의 폰트 및 한글 한자 에뮬레이션 카트리지를 영문 폰트나 영문 에뮬레이션 소프트웨어 카트리지의 콘넥터에 공용으로 장착하여 사용이 가능하며, 사용자가 원하는 서체의 한글, 한자 및 한글과 한자 폰트 및 사용자가 원하는 에뮬레이션 카트리지를 LBP의 외부에서 간편하게 교환이 가능하며 LBP를 여러대 사용하는 경우 1벌의 한글, 한자 및 한글과 한자의 폰트 및 한글 한자 에뮬레이션 카트리지를 공용으로 하여 사용할 수 있어 편리하며, 사용목적에 따라 워드 억세스, 우수바이트 억세스, 및 기수바이트 억세스가 가능하여 카트리지 메모리의 임의의 억세스가 가능하여 카트리지 메모리의 불필요한 메모리 낭비를 방지할 수 있다.
또한, 상기 제2도와 같은 방식으로 구형되는 한글, 한자 및 한글·한자 에뮬레이션 대신에 동일 방식으로 구현되는 한글, 한자 및 한글과 한자 폰트 카트리지의 폰트 메모리와 함께 완성형(KS 모드) 및 각종 조합형 한글·한자 에뮬레이션 기능을 갖는 소프트웨어 프로그램 코드를 내장하는 메모리를 실현시켜 에뮬레이션/폰트 일체형 카트리지로 사용하거나, 상기 완성형 및 각종 조합형 한글 한자 에뮬레이션 기능을 갖는 소프트웨어 프로그램 코드를 내장하는 메모리만을 포함하는 별도의 카트리지를 구성하고 이를 별도의 한글, 한자 및 한글과 한자 폰트 카트리지와 함께 두 카트리지콘텍터 (34,35)에 장착하여 사용하기도 한다.
또 다른 방법으로서, 주로 사용된 한글·한자 에뮬레이션 및 폰트 내용을 비디오 콘트롤러(14) 내부 메모리에 내장시키고, 선택적으로 사용되는 한글·한자 에뮬레이션 및 폰트 내용을 상기한 바와 같은 한글·한자 에뮬레이션 카트리지나 또는 한글·한자 및 한글과 한자 폰트 카트리지에 내장시켜 옵션으로 사용할 수 있도록 한다.
본 발명에 의한 한글, 한자 폰트 카트리지를 채택한 LBP 시스팀에서는 하기와 같은 효과를 갖는다.
우선 사용자가 같은 사무실에서 여러대의 LBP를 사용하는 경우 하자 폰트 카트리지를 공용으로 사용하기 간편하다.
폰트 메모리를 고집적 마스크롬을 사용하여 설계함으로 PCB 크기가 현저히 줄어들며 마스크롬 값 또한 EPROM에 비교하여 저가격이며, 기준의 영문 폰트 카트리지 콘넥터에 한글, 한자 폰트 카트리지를 장착하여 사용하므로 재료비가 매우 절감된다.
종래의 LBP 시스팀에서 시스팀 내부의 한자 폰트 보드가 점유하였던 공간은 확장 메모리 및 I/O 보드를 장착가능하도록 설계가 가능하며, 콤팩트하게 설계가 가능하다. 사용자가 새로운 모델의 LBP를 추가로 구입시 고가의 한자 보드를 중복하여 구입할 필요가 없다.
다양한 서체의 한글, 한자를 사용하기를 원하는 사용자는 간편하게 원하는 서체의 폰트 카트리지로 교환하여 장착하기가 매우 편리하다.
폰트 카트리지 생산공정과 비디오 콘트롤러 생산공정을 분리하여 처리하는 것이 가능하므로 생산공정이 매우 간단하여지며 따라서 생산원가가 절감된다.
각각 기능이 틀린 한글, 한자 에뮬레이션 소프트웨어의 프로그램 코드를 다양하게 개발하여 추가로 사용자에게 공급하기가 용이하다.
또한 본 발명은 상술한 내용에 국한되지 않고 한글, 한자, 및 한글과 한자 폰트 및 에뮬레이션 기능을 사용하는 각종 LBP 시스팀 레이저 팩시밀리, 인텔리전트 복사기 (Intelligent Copier) 등에도 적용이 가능하다.

Claims (12)

  1. 외부에서 옵션으로 장착 및 교환이 가능한 카트리지를 구비하여 한글, 한자 및 영문문자를 프린트 출력할 수 있는 카트리지를 이용한 레이저 빔 프린터(LBP) 시스팀에 있어서, LBP 본체 내부의 비디오 콘트롤러 주회로(32)에 연결되어 있고 다수의 외부 메모리를 공통적으로 억세스 제어하는 메모리 억세스 제어로직수단(31); 상기 비디오 콘트롤러 주회로(32) 및 메모리 억세스 제어로직수단(31)에 각각 연결되어 있는 제1 및 제2카트리지 접속수단(34,35); 상기 제 1카트리지 접속수단(34)에 병렬 접속되는 영문 에뮬레이션 소프트웨어 카트리지(11)와 영문 폰트 카트리지(12); 및 특정 폰트 데이터 및 에뮬레이션 데이터를 저장하기 위한 카트리지 메모리(21)와 상기 해당 카트리지 메모리(21)의 고유 메모리 성분만을 제어하는 카트리지 메모리 제어 로직수단(22)을 구비한 적어도 하나의 카트리지(13)를 포함하여 구성됨을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  2. 제1항에 있어서, 상기 적어도 하나의 카트리지(13)는 한글 하자 폰트 카트리지 및 한글 한자 에뮬레이션 카트리지를 포함하는 것을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  3. 제1항에 있어서, 상기 적어도 하나의 카트리지(13)는 특정 폰트 메모리와 함께 한글 한자 에뮬레이션 기능을 갖는 소프트웨어 프로그램 코드를 내장한 메모리를 하나의 동일 카트리지 상에 구현한 에뮬레이션/폰트 일체형 카트리지임을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  4. 제1항에 있어서, 상기 적어도 하나의 카트리지(13)는 상기 제1카트리지 접속수단(34)에 접속되며, 한글 한자 에뮬레이션 기능을 갖는 소프트웨어 프로그램 코드를 저장한 메모리만을 내장한 카트리지; 및 상기 제2카트리지 접속수단(35)에 접속되며, 특정문자의 폰트 메모리를 내장한 카트리지로 구성되는 것을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  5. 제1항에 있어서, 상기 비디오 콘트롤러(14)의 내부 메모리에 주로 사용되는 한글 한자 에뮬레이션 및 폰트 내용을 내장시키고, 상기 외부의 특정 카트리지(13)의 메모리에는 선택적으로 사용되는 한글 한자 에뮬레이션 및 폰트 내용을 내장시켜 사용함을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  6. 제1항에 있어서, 상기카트리지(13)의 카트리지 메모리(21)는 고집적 마스크롬으로 구성됨을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  7. 제6항에 있어서, 상기 카트리지(13)의 카트리지 메모리 제어 로직수단(22)은 스몰 아웃라인 패키지(SOP) 타입의 로직소자로 구성됨을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  8. 제6항에 있어서, 상기 카트리지(13)의 카트리지 메모리(21)를 구성하는 고집적 마스크롬은 스몰 아웃라인 패키지(SOP) 타입의 소자임을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  9. 제1항에 있어서, 상기 메모리 억세스 제어 로직수단(31)은 특정 어드레스(A22)를 반전시키는 인버터(51)와, 상기 인버터 출력 및 특정 어드레스(A23)를 부정 논리곱하여 출력하는 제1 NAND 게이트(52)와, 상기 두 특정 어드레스(A22, A23)를 부정 논리곱하여 출력하는 제2 NAND 게이트(53)로 구성되는 카트리지 선택신호 처리수단(31a); 및 특정 어드레스(AO) 및 읽기(RD) 신호를 논리합하여 출력하는 제1OR게이트(54)와, 상기 읽기 신호 및 상위 바이트 신호를 논리합하는 제2OR게이트(55)로 구성되는 상위/하위 바이트 선택신호 처리수단(31b)을 구비하고 있는 것을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  10. 제9항에 있어서, 상기 특정 카트리지(13)는 특정 어드레스(A20)를 반전시키는 인버터(61)와, 상기 인버터 출력단 및 카트리지 선택신호단에 연결된 제1OR게이트(62)와, 상기 특정 어드레스단(A20) 및 카트리지 선택신호단에 연결된 제2OR게이트(63)로 구성되는 카트리지 메모리 제어로직 수단(22); 및 상기 제2OR게이트 출력단과 메모리 억세스 제어로직 수단(31)의 상위 바이트 선택신호단에 연결되어 있고 비디오 콘트롤러 주회로(32)로부터 어드레스와 데이터를 공급받는 제1 4메가 비트 마스크롬(64)과, 상기 제2 OR 게이트 출력단 및 메모리 억세스 제어로직 수단(31)의 하위 바이트 선택신호단에 연결되어 있고 상기 비디오 콘트롤러 주회로(32)로부터 어드레스와 데이터를 공급받는 제2 4메가 비트 마스크롬(66)과, 상기 제 1 OR 게이트출력단 및 상기 메모리 억세스 제어로직 수단(31)의 상위 바이트 선택신호단에 연결되어 있고 상기 비디오 콘트롤러 주회로(32)로부터 어드레스와 데이터를 공급받는 제3 4메가 비트 마스크롬(64)과, 상기 제1 OR 게이트 출력단 및 메모리 억세스 제어로직수단(31)의 하위 바이트 선택신호단에 연결되어 있고 상기 비디오 콘트롤러 주회로(32)로부터 어드레스(A1∼A19)와 데이터(D0∼D15)를 공급받는 제4 4메가 비트 마스크롬(67)으로 구성되는 카트리지 메모리 (21)를 구비하고 있는 것을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  11. 제9항에 있어서, 상기 카트리지(13)는 상위 바이트 선택신호 및 하위 바이트 선택신호를 논리곱하는 AND 게이트(71)와, 상기 상위 바이트 선택신호 및 하위 바이트 선택신호를 부정 논리합하는 NOR 게이트(72)와, 상기 NOR 게이트 출력단에 제어단이 연결되고 하위 바이트 선택 신호단에 입력단이 연결된 3-상태 버퍼(73)로 구성되는 카트리지 메모리 제어로직 수단(22); 및 상기 AND 게이트 출력단, NOR 게이트 출력단, 3-상태 버퍼 출력단, 및 카트리지 선택신호 처리수단(31a)의 카트리지 선택신호단에 연결되어 있고 상기 비디오 콘트롤러 주회로(32)로부터 어드레스(A1∼A20)와 데이터(D0∼D15)를 공급하는 16메가 비트 마스크롬(74)으로 구성되는 카트리지 메모리를 구비하고 있는 것을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
  12. 제9항에 있어서, 상기 카트리지(13)는 상위 바이트 선택신호 및 하위 바이트 선택신호를 논리곱하는 AND 게이트(91)와, 상기 상위 바이트 선택신호 및 하위 바이트 선택신호를 부정 논리합하는 NOR 게이트(92)와, 상기 NOR 게이트 출력단에 제어단이 연결되고 하위 바이트 선택신호단에 입력단이 연결된 3-상태 버퍼(93)로 구성되는 카트리지 메모리 제어로직 수단(22);워드 상기 AND 게이트 출력단, NOR 게이트 출력단, 3-상태 버퍼 출력단, 및 카트리지 선택신호 처리수단(31a)의 카트리지 선택신호단에 연결되어 있고 상기 비디오 콘트롤러 주회로(32)로부터 어드레스(A1∼A22)와 데이터(D0∼ D15)를 공급받는 32메가 비트 마스크롬(94)으로 구성되는 카트리지 메모리를 구비하고 있는 것을 특징으로 하는 카트리지를 이용한 LBP 시스팀.
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