KR930001190A - 디지탈 데이타의 에러 정정장치 - Google Patents

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KR930001190A
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백승권
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강진구
삼성전자 주식회사
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    • H03M13/276—Interleaving address generation
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    • G—PHYSICS
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Abstract

내용 없음

Description

디지탈 데이타의 에러 정정장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 에러 정정장치의 블럭구성도,
제2도는 제1도의 디셔플링에 해당하는 상세블럭도,
제3도는 디셔플링 메모리 맵을 나타낸 정확한 데이타의 저장 위치도.

Claims (4)

  1. ECC 아우터 엔코더(ECCOE), 셔플링(S), ECC 이너엔코더(ECCIE), 테이프, ECC 이너디코더(ECCID), 디셔플링(400), ECC 아우터디코더(ECCOD)로 구비하여 이중부호화 및 이중복호화를 수행하는 디지탈 신호처리 시스템에 있어서, 상기 디셔플링수단(400)이 라이트어드레스 시작번지부터 컬럼방향으로 순차적으로 증가하는 어드레스를 발생시키기 위한 메모리용 어드레스 발생회로부(100)와, 데이타 및 에러플래그를 저장하기 위한 디셔플링 메모리회로부(200)와, 데이타 및 에러 플래그의 메모리 입출력을 제어하기 위한 패드 콘트롤 회로부(300)로 구성됨을 특징으로 하는 디지탈 데이타의 에러정정장치.
  2. 제1항에 있어서, 상기 메모리용 어드레스 발생부(100)는 ID 신호를 입력으로 라이트 어드레스 발생부의 로오드신호 발생용 IDRI ROM(1)및 IDBL ROM(2)과 라이트 및 리이드 어드레스 발생부(3,4)와, 발생 어드레스를 선택출력하는 선택부(5,6)로 구성됨을 특징으로 하는 디지탈 데이타의 에러정정장치.
  3. 제1항에 있어서, 상기 디셔플링 메모리회로부(200)는 상기 메모리용 어드레스 발생부(100)로 부터 출력된 데이타를 저장하는 피일드 메모리부(7,8)와 에러 플래그를 저장하기 위한 플래그 메모리(9,10,11,12)로 구성됨을 특징으로 하는 디지탈 데이타의 에러정정장치.
  4. 제1항에 있어서, 상기 패드 콘트롤회로부(300)는 데이타신호를 입력으로 필드 메모리의 출력을 제어하는 패드콘트롤부(13)와, 에러 플래그 신호를 입력으로 플래그를 메모리의 출력을 제어하는 콘트롤부 (14,15,16,17)와, 상기 패드 콘트롤부(14,15,16,17)의 출력을 선택 출력하는 선택부(18)로 구성됨을 특징으로 하는 디지탈 데이타의 에러정정장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개되는 것임.
KR1019910011114A 1991-06-29 1991-06-29 디지탈 데이타의 에러 정정장치 KR930001190A (ko)

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