KR920008758A - 파워-온 리세트회로 - Google Patents

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KR920008758A
KR920008758A KR1019910018910A KR910018910A KR920008758A KR 920008758 A KR920008758 A KR 920008758A KR 1019910018910 A KR1019910018910 A KR 1019910018910A KR 910018910 A KR910018910 A KR 910018910A KR 920008758 A KR920008758 A KR 920008758A
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KR
South Korea
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circuit
power
capacitance
output terminal
logic element
Prior art date
Application number
KR1019910018910A
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English (en)
Inventor
사찌꼬 가미사끼
Original Assignee
세끼모또 타다히로
닛본덴기 가부시끼가이샤
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Publication date
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    • G11C11/4063—Auxiliary circuits, e.g. for addressing, decoding, driving, writing, sensing or timing
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
    • H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
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    • H03K3/356008—Bistable circuits ensuring a predetermined initial state when the supply voltage has been applied; storing the actual state when the supply voltage fails
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    • H03K3/027—Generators characterised by the type of circuit or by the means used for producing pulses by the use of logic circuits, with internal or external positive feedback
    • H03K3/037—Bistable circuits
    • H03K3/0375—Bistable circuits provided with means for increasing reliability; for protection; for ensuring a predetermined initial state when the supply voltage has been applied; for storing the actual state when the supply voltage fails

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Abstract

내용 없음

Description

파워-온 리세트회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명에 따른 제1의 양호한 실시예의 파워-온 리세트 회로를 도시한 회로도,
제6도및 제7도는 본 발명에 따른 제2및 제3의 양호한 실시예의 파워-원 리세트회로를 도시한 회로도.

Claims (4)

  1. 제1 및 제2의 입력터미날과 단일의 출력터미널을 갖는 제1의 선정된 입력 임계전압을 갖는 논리소자회로; 및 상기 제1의 선정된 입력 임계전압보다 더 작은 제2의 선정된 입력 임계전압을 갖는 인버터회로를 포함하고, 상기 인버터의 출력터미널이 상기 논리소자회로의 상기 제2입력터미널에 연결되고, 상기 논리소자회로의 출력터미널이 상기 인버터의 입력터미널에 연결되며, 이것에 의해 리세트신호가 상기 논리소자회로의 상기 출력터미널에서 얻어지고, 파워-온의 종료후에 발생된 외부신호에 기초하여 발생된 신호가 상기 논리소자회로의 상기 제1의 입력터미널에 공급될 때 상기 리세트신호의 상태가 변하는 것을 특징으로 하는 파워-온 리세트회로.
  2. 제1항에 있어서, 상기 논리소자회로가 NOR회로와 NAND회로에서 선택된 회로인 것을 특징으로 하는 파워-온 리세트회로.
  3. 제1항에 있어서, 상기 논리소자회로가 상기 출력터미널에서 제1캐패시턴스의 제1전극에 연결되며 상기 제1캐피시턴스의 제2전극이 전원에 연결되어 있고, 상기 인버터회로가 상기 출력터미널에서 제2캐패시턴스의 제1전극에 연결되며 상기 제2캐패시턴스의 제2전극이 접지에 연결되어 있는 것을 특징으로 하는 파워-온 리세트회로.
  4. 제3항에 있어서, 상기 논리소자회로가 상기 제1캐패시턴스와 병렬로 연결된 제1저항에 연결되어 있고, 상기 인버터회로가 상기 제2캐패시턴스와 병렬로 연결된 제2저항에 연결되어 있는 것을 특징으로 하는 파워- 온 리세트회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910018910A 1990-10-26 1991-10-25 파워-온 리세트회로 KR920008758A (ko)

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Application Number Priority Date Filing Date Title
JP90-289183 1990-10-26
JP2289183A JP2658551B2 (ja) 1990-10-26 1990-10-26 電源投入リセット回路

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JPH04162820A (ja) 1992-06-08
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JP2658551B2 (ja) 1997-09-30

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