KR910019328A - 클록 오우버래핑 방지회로 - Google Patents

클록 오우버래핑 방지회로 Download PDF

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KR910019328A
KR910019328A KR1019900005125A KR900005125A KR910019328A KR 910019328 A KR910019328 A KR 910019328A KR 1019900005125 A KR1019900005125 A KR 1019900005125A KR 900005125 A KR900005125 A KR 900005125A KR 910019328 A KR910019328 A KR 910019328A
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KR
South Korea
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clock
nand gate
output
prevention circuit
overwrapping
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KR1019900005125A
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KR930001440B1 (ko
Inventor
배종곤
Original Assignee
문정환
금성일렉트론 주식회사
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Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03KPULSE TECHNIQUE
    • H03K5/00Manipulating of pulses not covered by one of the other main groups of this subclass

Landscapes

  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Manipulation Of Pulses (AREA)

Abstract

내용 없음

Description

클록 오우버래핑 방지회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 3 도는 클록 오우버래핑 방지회로 제 4 도는 클록 오우버래핑 방지회로 각부 파형도.

Claims (1)

  1. 클록이 입력되고 그 출력이 낸드게이트(110)에 입력되는 인버터(100)와, 낸드게이트(111)의 출력이 입력되고 인버터(100)의 출력이 입력되어 낸드게이트(111)와 앤모스트랜지스터(102)의 게이트에 출력하는 낸드게이트(110)와, 클록이 입력되고 낸드게이트(110)의 출력이 입력되고 그 출력이 낸드게이트(110)와 앤모스트랜지스터(101)의 게이트에 출력되는 낸드게이트(111)를 포함하여 구성된 것을 특징으로 하는 클록오우버래핑 방지회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개되는 것임.
KR1019900005125A 1990-04-13 1990-04-13 클록 오우버래핑 방지회로 KR930001440B1 (ko)

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KR910019328A true KR910019328A (ko) 1991-11-30
KR930001440B1 KR930001440B1 (ko) 1993-02-27

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