KR900001114A - Cmos 소자의 출력 버퍼회로 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 회로도.
Claims (1)
- 인에이블 신호(31)가 인버터(33)을 통해 P형 트랜지스터(34)와 N형 트랜지스터(35)로 구성된 트랜스미션 게이트(300)와, P형 트랜지스터(36,37)가 VDD에 연결됨과 동시에 출력단(OUT)에 연결된 P형 트랜지스터(38)의 입력 게이트에 병렬로 연결되어 구성된 풀-업회로(310)와, N형 트랜지스터(39,40)가 VSS에 연결됨가 동시에 출력단(OUT)에 연결된 N형 트랜지스터(40)의 입력게이트에 병렬로 연결되어 구성된 풀-다운회로(320)로 이루어진 것을 특징으로 하는 CMOS 소자의 출력 버퍼회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019880007900A KR900001114A (ko) | 1988-06-29 | 1988-06-29 | Cmos 소자의 출력 버퍼회로 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019880007900A KR900001114A (ko) | 1988-06-29 | 1988-06-29 | Cmos 소자의 출력 버퍼회로 |
Publications (1)
Publication Number | Publication Date |
---|---|
KR900001114A true KR900001114A (ko) | 1990-01-31 |
Family
ID=68233734
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019880007900A KR900001114A (ko) | 1988-06-29 | 1988-06-29 | Cmos 소자의 출력 버퍼회로 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR900001114A (ko) |
-
1988
- 1988-06-29 KR KR1019880007900A patent/KR900001114A/ko not_active Application Discontinuation
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
WITN | Withdrawal due to no request for examination |