KR910010642A - 반도체 장치에 도핑된 산화물층 형성 공정 - Google Patents

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KR910010642A
KR910010642A KR1019900019053A KR900019053A KR910010642A KR 910010642 A KR910010642 A KR 910010642A KR 1019900019053 A KR1019900019053 A KR 1019900019053A KR 900019053 A KR900019053 A KR 900019053A KR 910010642 A KR910010642 A KR 910010642A
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KR
South Korea
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doped
oxide layer
silicon
substrate
forming
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Application number
KR1019900019053A
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English (en)
Inventor
리챠드 멕파르난드 로이
Original Assignee
빈센트 죠셉 로너
모토로라 인코포레이티드
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Publication date
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    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L21/00Processes or apparatus adapted for the manufacture or treatment of semiconductor or solid state devices or of parts thereof
    • H01L21/02Manufacture or treatment of semiconductor devices or of parts thereof
    • H01L21/04Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer
    • H01L21/18Manufacture or treatment of semiconductor devices or of parts thereof the devices having potential barriers, e.g. a PN junction, depletion layer or carrier concentration layer the devices having semiconductor bodies comprising elements of Group IV of the Periodic Table or AIIIBV compounds with or without impurities, e.g. doping materials
    • H01L21/30Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26
    • H01L21/302Treatment of semiconductor bodies using processes or apparatus not provided for in groups H01L21/20 - H01L21/26 to change their surface-physical characteristics or shape, e.g. etching, polishing, cutting
    • H01L21/306Chemical or electrical treatment, e.g. electrolytic etching

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Abstract

내용 없음

Description

반도체 장치에 도핑된 산화물층 형성 공정
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도 내지 제3도는 본 발명의 한 실시예에 따른 공정 단계를 도시한 단면도

Claims (3)

  1. 반도체장차에 도핑된 산화물층을 형성하는 공정에 있어서, 회로 요소를 가진 반도체기판과 상기 기판에 형성된 전기적 절연 영역을 형성하는 단계와, 도핑된 상화물층을 상기 기판위에 놓이도록 형성하는 단계 및 비도핑된 산화물 캡을 상기 비도핑된 산화물캡이 상기 도핑된 산화물 층과 접촉하는 상기 도핑된 산화물 층위에 놓이도록 형성하는 단계를 포함하는 것을 특징으로 하는 반도체 장치에 도핑된 산화물 층을 형성하는 공정
  2. 기판에 내부 -레벨 유전체 층을 형성하는 공정에 있어서, 다수의 반도체 기판을 CVD반응기에 배치하는 단계와 상기 기판을 가열하는 단계와 실리콘 산화가스를 흐르게 하는 단계와 B(CH3)3, PH3, B2H6및 P(OCH3)3또는 이들의 조합으로 구성된 그룹으로부터 선택된 실리콘 포함 가스를 유입하는 단계와 B(CH3)3, PH3,B2H6및 P(OCH3)3또는 이들의 조합으로 구성된 상기 그룹으로 부터 선택된 실리콘 불순물 가스를 유입하는단계와 도핑된 실리콘 산화물층을 상기 기판상에 침착시키는 단계와 상기실리콘 불순을 가스를 클리어링하는 단계및 비도핑된 실리콘 산화물층을 상기 도핑된 실리콘 산화물 층상에 침착시키는 단계을 포함하는 것을 특징으로 하는 반도체에 기판상에 내부-레벨 유전체 층을 형성하는 공정.
  3. 반도체 기판상에 플라즈마 침착 시스템에 의한 내부-레벨 유전체 층을 형성하는 공정에 있어서, 반도체기판을 PE CVD반응기 내에 시키는 단계와 N2O,O3.NO및 O2로 구성된 그룹으로부터 선택된 실리콘 산화가스를 흐르게하는 단계와 SiH4, Si2H6, Si(OC2H5)4, 및 SiH2CL2로 구성된 그룹으로부터 선택된 실리콘 포함가스를 유입하는 단계와 B(CH3)3, PH3,B2H6및 P(OCH3)3또는 이들의 조합으로 구성된 그룹으로부터 선택된 실리콘 불순물 가스를 유입하는 단계와 상기 가스를 RF에너지로 활성화시키는 단계와 도핑된 실리콘 산화물층을 상기 기판상에 침착시키는 단계와 상기 실리콘 불순물 가스를 클리어링 하는 단계 및 비도핑된 실리콘 산화물층을 상기 도핑된 실리콘 층상에 침착시키는 단계를 포함하는 것을 특징으로 하는 반도체 기판상에 플라즈마 침착 시스템에 의한 내부 -레벨 유전체 층을 형성하는 공정.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900019053A 1989-11-28 1990-11-23 반도체 장치에 도핑된 산화물층 형성 공정 KR910010642A (ko)

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