KR910003512A - 중앙처리장치와 주변 입출력 장치와의 인터페이스 회로 - Google Patents
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- G06F13/14—Handling requests for interconnection or transfer
- G06F13/20—Handling requests for interconnection or transfer for access to input/output bus
- G06F13/28—Handling requests for interconnection or transfer for access to input/output bus using burst mode transfer, e.g. direct memory access DMA, cycle steal
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 블럭도.
제3도는 본 발명의 실시예에 의한 타이밍도.
Claims (4)
- 제어 및 어드레스 신호와 연결되어 있고 DMA(Direct Memory Access)제어신호를 내장한 주변입출력장치(2a)와, 상기 주볍입출력장치(2a)의 DRQ(리드/라이트)신호와 연결되어 있는 NAND 게이트(2j)와, 상기 NAND 게이트(2j) 및 주변입출력장치(2a)의 DACK 신호와 연결되어 있는 AND게이트(2h)와, 상기 AND 게이트(2h)의 출력과 제어 및 어드레스 신호와 연결되어 명령의 추출 및 실행을 행하는 중앙처리장치(2b)와, 상기 중앙처리장치(2b)의BUSACK 신호 및 시프트 레지스터(2c)와 연결되어 있는 OR게이트(2i)와, 상기 중앙처리장치(2b)의 BUSACK 신호에연결되어 있는 인버터(2k)와, 상기 인버터(2k)의 출력 및 중앙처리장치(2b)의 클럭 신호와 연결되어 버스사용 기간을 결정하고 메모리 제어신호를 발생하는 시점을 결정해 주는 시프트 레지스터회로(2c)와, 상기 주변입출력장치(2a)의 DRQ(리드)신호 및 인버터(2k)출력과 연결되어 DMA동작 모드를 구별하는 플립플롭(2f)과, 상기 시프트 레지스터(2c) 및 플립플롭(2f)의 출력과 연결되어 DMA 동작시 상기 주변입출력장치(2a)의 특성에 따라 메모리 제어신호를 발생하는 메모리 제어신호 발생회로(2d)와, 상기 시프트 레지스터(2c) 및 메모리 제어신호발생회로(2d)와 연결되어 DMA동작 신호의 출력을 제어할때 이용되는 상기 제어 및 어드레스 신호를 전달하는 버퍼회로(2e)로 구성된것을 특징으로 하는 인터페이스 회로.
- 제1항에 있어서, 상기 제어 및 어드레스 신호에 연결되어 메모리(2g)를 더 포함한 것을 특징으로 하는 인터페이스 회로.
- 제1항에 있어서, 상기 메모리 제어신호 발생회로(2d)는 상기 시프트 레지스터(2c)의 첫번째 출력을 이용하여 DMA동작을 시작하기 위한 메모리 제어신호의 출력을 인에이블하는 것을 특징으로 하는 인터페이스 회로.
- 제1항에 있어서, 상기 플립플롭(2f)은 주변입출력장치(2a)의 DMA 리드/라이트 모드에 따라 토글(toggle)되어 동작하는 것을 특징으로 하는 인터페이스 회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019890010354A KR910008420B1 (ko) | 1989-07-21 | 1989-07-21 | 중앙처리장치와 주변입출력장치와의 인터페이스 회로 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019890010354A KR910008420B1 (ko) | 1989-07-21 | 1989-07-21 | 중앙처리장치와 주변입출력장치와의 인터페이스 회로 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR910003512A true KR910003512A (ko) | 1991-02-27 |
KR910008420B1 KR910008420B1 (ko) | 1991-10-15 |
Family
ID=19288285
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR1019890010354A KR910008420B1 (ko) | 1989-07-21 | 1989-07-21 | 중앙처리장치와 주변입출력장치와의 인터페이스 회로 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR910008420B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100377861B1 (ko) * | 2000-07-07 | 2003-03-29 | 한학수 | 전자소자 또는 칩용 절연성 박막 또는 박막형 패키지를 위한 조성물 |
-
1989
- 1989-07-21 KR KR1019890010354A patent/KR910008420B1/ko not_active IP Right Cessation
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100377861B1 (ko) * | 2000-07-07 | 2003-03-29 | 한학수 | 전자소자 또는 칩용 절연성 박막 또는 박막형 패키지를 위한 조성물 |
Also Published As
Publication number | Publication date |
---|---|
KR910008420B1 (ko) | 1991-10-15 |
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