KR910001772A - 반도체 메모리 장치 - Google Patents

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KR910001772A
KR910001772A KR1019900008380A KR900008380A KR910001772A KR 910001772 A KR910001772 A KR 910001772A KR 1019900008380 A KR1019900008380 A KR 1019900008380A KR 900008380 A KR900008380 A KR 900008380A KR 910001772 A KR910001772 A KR 910001772A
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dummy cells
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KR1019900008380A
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히로시 이와하시
Original Assignee
아오이 죠이치
가부시키가이샤 도시바
다케다이 마사다카
도시바 마이크로일렉트로닉스 가부시키가이샤
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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11CSTATIC STORES
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    • GPHYSICS
    • G11INFORMATION STORAGE
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    • G11C16/00Erasable programmable read-only memories
    • G11C16/02Erasable programmable read-only memories electrically programmable
    • G11C16/06Auxiliary circuits, e.g. for writing into memory
    • G11C16/26Sensing or reading circuits; Data output circuits
    • G11C16/28Sensing or reading circuits; Data output circuits using differential sensing or reference cells, e.g. dummy cells

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Abstract

내용 없음

Description

반도체 메모리 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1실시예에 의한 반도체메모리장치의 구성을 나타낸 회로도.

Claims (1)

  1. 제1 또는 제2의 기억상태에 있는 메모리셀(MC11-MCmn)과 상기 제1의 기억상태와 등가인 기억상태에 있는 제1의 더미셀(DC11~DCm1), 상기 제2의 기억상태와 등가인 기억상태에 있는 제2의 더미셀(DC12~DCm2), 상기 메모리셀(MC11~MCmn)에 접속된 제1의 부하회로(13), 상기 제1의 더미셀(DC11~DCm1)에 접속된 제2의 부하회로(14), 상기 제2의 더미셀(DC12~DCm2)에 접속된 제3의 부하회로(24), 상기 제1의 부하회로(13)로 부터의 출력과 상기 제2의 부하 회로(14)로부터의 출력 및 상기 제3의 부하회로(24)로부터의 출력을 비교하는 것에 의해서, 상기 메모리셀의 기억상태를 검출하는 기억상태 검출부(25)를 구비하고, 상기 제1 제2 및 제3이 부하회로(13,14,24)는 그 회로구성이 같은 것을 특징으로 하는 반도체메모리장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019900008380A 1989-06-12 1990-06-08 반도체 메모리장치 KR930008412B1 (ko)

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JP14867689A JPH0824000B2 (ja) 1989-06-12 1989-06-12 半導体メモリ装置
JP89-148676 1989-06-12
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KR930008412B1 (ko) 1993-08-31
JPH0312897A (ja) 1991-01-21
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DE69028048D1 (de) 1996-09-19

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