KR890008851A - 전기적으로 프로그래밍 가능한 메모리셀의 테스트 방법 및 그 집적회로 - Google Patents
전기적으로 프로그래밍 가능한 메모리셀의 테스트 방법 및 그 집적회로 Download PDFInfo
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 표준 메모리의 구조를 도시한 것이며,
제2도는 본 발명에 따른 메모리의 구조를 도시한 것이다.
Claims (9)
- 셀의 2진 상태는 비트 라인으로부터 독출되거나 기입될 수 있으며, 프로그래밍 단자가 독출모드에서 인가된 전압보다 높은 프로그래밍 전압을 비트라인으로 수신하거나 가하기 위하여 구비된, 독출 및 프로그래밍 모드에서 워드 라인에 의해 어드레싱 할 수 있는 셀들로 이루어진 전기적으로 프로그래밍 가능한 메모리를 테스트 하는 방법에 있어서, 셀을 테스트 하기 위하여, 독출 전압을 워드라인에 인가하고, 비트 라인을 프로그래밍단자에 연결하고, 프로그래밍 단자는 프로그래밍 전압보다 훨씬 낮은 값의 테스트 전압원에 연결하여 프로그래밍단자와 테스트 전압원 사이에 흐르는 전류를 측정하는 것으로 된 것을 특징으로 하는 전기적으로 프로그래밍 가능한 메모리의 테스팅 방법.
- 제1항에 있어서, 독출전압은 변화하도록 되어있으며, 독출전압의 함수로서 전류의 변이 곡선이 결정되도록 되어있는 것을 특징으로 하는 메모리의 테스트 방법.
- 제1항 또는 제2항에 있어서, 메모리는 p비트의 m워드로된 n라인으로 형성되며, 각 메모리 워드에 해당하는 데이타는 p데이타 입력/출력 패드들로부터 독출 또는 기입될 수 있게 되어있으며, 테스트는 p데이타 입력/출력 패드들 중에서 하나의 데이타 비트를 선택하기 위한 작동응 포함하며, 데이타 입력/출력 패드들 중 하나에는 제1레벨의 논리신호를, 다른 모든 데이타 입력/출력 패드들에는 제1레벨과 보수인 제2레벨의 논리신호를 인가함으로서 선택되어지도록 된 것을 특징으로 하는 메모리의 테스팅방법.
- 제1항 또는 제2항에 있어서, 시스템이 테스팅 모드에 있다는 것을 표시하기 위하여 특정신호가 집적 회로의 적어도 하나의 외부 단자에 가해 지도록 된 것을 특징으로 하는 메모리의 테스트방법.
- 제1항 또는 제2항에 있어서, 시스템이 테스팅 모드에 있다는 것을 표시하는 특정신호가 가해지지 않으며, 프로그래밍 전압보다 훨씬 낮은 2개의 특정 전압레벨 사이의 범위에 있는 전압을 가진 프로그래밍 단자에서 문제점들이 검출 되어지는 것을 특징으로 하는 메모리의 테스트 방법.
- 셀들의 상태는 비트 라인으로부터 독출 되거나 기입될 수 있으며, 프로그래밍 단자는 독출모드에서 인가된 전압보다 높은 프로그래밍 전압을 비트 라인에서 수신 및 인가되기 위해, 구비된, 독출 및 프로그래밍 모드에서 워드라인에 의해 어드레싱될 수 있는 메모리 셀들로 된 네트워크로 이루어진 전기적으로 프로그래밍 가능한 메모리 집적회로에 있어서, 전술한 회로는 테스팅 모드 신호를 수신하고(프로그래밍 모드 또는 테스팅 모드에서)프로그래밍 단자에 있는 전압이거나 또는 (독출 모드에서) 독출 전압을, 워드 라인을 향하여 분기하기 위한 제1논리회로, 및 특정 비트 라인과 프로그래밍 단자 사이의 연결을 프로그래밍 모드 및 테스팅 모드에서 허용하기 위한 제2논리 회로로 이루어지는 것을 특징으로 하는 메모리 집적회로.
- 제6항에 있어서, 테스팅 모드에서 제2논리 회로는 비트 라인과 데이타 입력/출력패드 사이에 연결된, 독출 증폭기를 금지 시키도록된 것을 특징으로 하는 집적회로.
- 제6항 또는 제7항에 있어서, 테스팅 모드 신호를 수신하기 위하여 테스팅 모드 단자를 포함하는 것을 특징으로 하는 집접회로.
- 제6항 또는 제7항에 있어서, 프로그래밍 단자에 있는 전압이 프로그래밍 전압보다 훨씬 낮은 2개의 특정 레벨들 사이에 있을때 테스팅 모드 신호를 주는, 전압 레벨 검출 회로를 포함하는 것을 특징으로 하는 집적회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
FR8716236 | 1987-11-24 | ||
FR8716236A FR2623653B1 (fr) | 1987-11-24 | 1987-11-24 | Procede de test de cellules de memoire electriquement programmable et circuit integre correspondant |
Publications (1)
Publication Number | Publication Date |
---|---|
KR890008851A true KR890008851A (ko) | 1989-07-12 |
Family
ID=9357084
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019880015652A KR890008851A (ko) | 1987-11-24 | 1988-11-24 | 전기적으로 프로그래밍 가능한 메모리셀의 테스트 방법 및 그 집적회로 |
Country Status (6)
Country | Link |
---|---|
US (1) | US4958324A (ko) |
EP (1) | EP0318363B1 (ko) |
JP (1) | JP2928794B2 (ko) |
KR (1) | KR890008851A (ko) |
DE (1) | DE3872673T2 (ko) |
FR (1) | FR2623653B1 (ko) |
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Publication number | Priority date | Publication date | Assignee | Title |
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1987
- 1987-11-24 FR FR8716236A patent/FR2623653B1/fr not_active Expired - Lifetime
-
1988
- 1988-11-09 US US07/269,169 patent/US4958324A/en not_active Expired - Lifetime
- 1988-11-18 DE DE8888402905T patent/DE3872673T2/de not_active Expired - Lifetime
- 1988-11-18 EP EP88402905A patent/EP0318363B1/fr not_active Expired - Lifetime
- 1988-11-24 KR KR1019880015652A patent/KR890008851A/ko not_active Application Discontinuation
- 1988-11-24 JP JP29714288A patent/JP2928794B2/ja not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
FR2623653B1 (fr) | 1992-10-23 |
EP0318363A1 (fr) | 1989-05-31 |
JP2928794B2 (ja) | 1999-08-03 |
DE3872673D1 (de) | 1992-08-13 |
EP0318363B1 (fr) | 1992-07-08 |
DE3872673T2 (de) | 1992-12-03 |
JPH01171200A (ja) | 1989-07-06 |
FR2623653A1 (fr) | 1989-05-26 |
US4958324A (en) | 1990-09-18 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
WITN | Application deemed withdrawn, e.g. because no request for examination was filed or no examination fee was paid |