KR900008596B1 - 메시지 데이타를 수신할 수 있는 페이징 수신기 - Google Patents

메시지 데이타를 수신할 수 있는 페이징 수신기 Download PDF

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도시히로 모리
다까시 오야기
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닛본덴기 가부시기가이샤
세끼모또 타다히로
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Abstract

내용 없음.

Description

메시지 데이타를 수신할 수 있는 페이징 수신기
제1도는 본 발명을 실시하는 페이징 수신기를 도시한 계통도.
제2도는 제1도의 수신기내에 포함되는 데이타 셋트 및 보유 회로의 상세한 구조를 도시한 도면.
제3a도 내지 제3d도는 본 발명의 페이징 수신기에 적용할 수 있는 신호들의 포오맷을 도시한 도면.
제4a도 내지 제4n도는 제1도 및 제2도의 여러 부분들내에서 나타나는 예시적인 파형을 도시한 타이밍도.
제5도는 제1도에 도시한 바와 같은 중앙 처리 장치(CPU)에 의해 실행되는 기본 루틴을 도시한 플로우 챠트.
* 도면의 주요부분에 대한 부호의 설명
10 : 안테나 20 : 무선부
30 : 파형 성형기 50 : PROM
60 : 레벨 전이기 70 : CPU
70a : LCD 구동기 80 : LCD
90 : DC/DC 변환기 100 : 디코더
101 : 해독 회로 105, 106 : 계수기
107 : SR 플립플롭 109 : 경보 제어기
110 : 동기 신호 검출기 111, 260, 270 : 인버터
120 : 바테리 130 : 완충 증폭기
140 : 경보 혼 200 : 데이타 셋트 및 보유회로
210, 230 : D형 플립플롭 250 : 전이 레지스터
본 발명은 메시지 데이타를 수신할 수 있는 페이징 수신기(paging receiver)에 관한 것이다.
최근의 전자 공학 분야의 발달은 페이징 수신기를 소형이면서 고성능으로 개발시키려는 경향이 있다. 실제로, 간단한 페이징 기능 뿐만 아니라 메시지 데이타 수신 기능을 갖춘 페이징 수신기는 현재 시판중에 있고 데이타 서비스 산업분야에서 널리 사용되고 있다. 그러나, 데이타 서비스의 대중화는 요금이 체납되어 있는 수신기들까지에도 귀중한 정보를 공급한다는 문제점을 발생시킨다. 이점을 고려하여, 엔이씨 코포레이션이 출원한 일본국 특허 출원 제59-24337호(1984년)에 기초를 두고 있는 미합중국 특허 출원 제697,334호, 영국 특허 출원 제GB 2 154 347A호, 및 캐나다 특허 출원 제473,573호에는 페이징 통신 시스템이 제안되어 왔다. 제안된 페이징 통신 시스템은 다수의 수신기들이 기저국으로부터 송신된 페이징 신호에 응답하여 그룹(group)으로 호출되도록 구성되어 있다. 기저국은 메시지 데이타의 수신을 금지하거나 이 금지기능을 취소하기에 적합한 제어 신호를 각각의 수신기에 송신한다. 해당 메시지 데이타가 다수의비지정 수신기용으로 되는 호출 번호(공통 어드레스 번호) 이후에 송신되는 동안 제어 기능이 수신기에 지정된 페이징 번호에 추가된다.
그러나, 이러한 시스템은 수신기내에 장치된 바테리등과 같은 전원이 제거될 때, 메시지 데이타 수신 금지 기능이 취소되어, 체납 수신기도 메시지 데이타를 다시 수신하게 한다는 결점을 갖는다. 또한, 종래 기술의 시스템은 잡음의 영향을 받기 쉬운데, 그 이유는 메시지 데이타 수신 금지 및 이 금지 기능을 취소하기에 적합한 검출 펄스가 단일 비트, 즉 논리 1 또는 0만으로 실행되기 때문이다.
그러므로, 본 발명의 목적은 기저국이 데이타 서비스로부터 체납 수신기를 제외시키고 각각 무선 링크를 통해 이 수신기를 데이타 서비스상태로 다시 복원시킬 수 있게 하는 메시지 데이타를 수신할 수 있는 페이징 수신기를 제공하는 것이다.
본 발명의 다른 목적은 메시지 데이타를 수신할 수 있는 개량된 페이징 수신기를 제공하는 것이다.
수신기에 지정되는 제1호출 번호 및 본 발명의 다수의 비지정 페이징 수신기에 데이타 서비스를 하기에 적합한 제2호출 번호 수신시에 메시지 데이타를 수신할 수 있는 페이징 수신기는 제1호출 번호에 추가되는 메시지 데이타에 포함되는 선정된 패턴을 검출하기 위한 검출 수단, 및 제2호출 번호에 대응하는 최소한 하나의 데이타 서비스를 제어하기 위해 검출 수단으로부터의 제어 신호에 응답하고 최소한 수신기의 주전원과 상이한 최소한 하나의 제1전원 및 제어 신호에 응답하여 유지 회로의 출력 논리를 반전 및 보유하기 위한 보유 회로를 포함하는 제어 수단으로 구성된다.
본 발명의 또 하나의 페이징 수신기는 페이징 수신기에 지정되는 제1식별 번호 및 이 페이징 수신기를 포함하는 다수의 페이징 수신기에 지정되는 제2식별 번호를 따르는 메시지를 수신하기 위한 메시지 수신기, 제어 신호를 발생시키기 위해 제1식별 번호를 따르는 메시지내에 포함되는 선정된 패턴을 검출하기 위한 검출기, 및 제2식별 번호를 따르는 메시지의 수신을 제어하기 위해 제어 신호에 응답하는 제어기로 구성된다. 제어기는 페이징 수신기의 주전원과 별도인 제1전원에 의해 활성화 된다.
본 발명의 소정의 페이징 수신기를 포함하는 다수의 페이징 수신기에 지정되는 공통 호출 번호를 따르는 메시지의 수신을 제어하는 방법은 공통 호출번호 및 소정의 페이징 수신기에 지정되는 각각의 호출 번호를 따르는 메시지를 수신하는 스텝, 제어 신호를 발생시키기 위해 각각의 호출 번호를 따르는 메시지내에 포함되는 선정된 패턴을 검출하는 스텝, 소정의 페이징 수신기의 주 전원이 제거되는지 여부에 관계없이 보유된 제어 신호에 응답하여 제어 신호를 보유하는 스텝, 및 공통 호출 번호를 따르는 메시지의 수신을 제어하는 스텝을 포함한다.
이하, 첨부 도면을 참조하여 본 발명의 목적, 특징 및 장점들에 대해서 상세하게 설명하겠다.
제1도를 참조하면, 본 발명을 실시하는 메시지 데이타를 수신할 수 있는 페이징 수신기가 도시되어 있다. 도시한 바와 같이, 안테나(10)을 통해 들어오는 무선 신호는 무선부(20)에 의해 증폭, 검출 및 복조되고, 다음에, 파형 성형기(30)에 의해 디지탈 신호로 변환된다. 디코더(100)은 나중에 기술되는 바와 같이 이 디지탈 신호를 소거가능한 해독 전용 메모리(PROM, 50)내에 기억되는 다수의 고유 호출 번호들과 비교하여, 레벨 전이기(60)을 통해 중앙 처리 장치(CPU, 70)에 호출 수신을 알린다. 액정 표시기(LCD) 구동기(70a)는 LCD(80)을 구동시키기 위해 CPU(70)내에 내장된다.
수신기의 스위치(40)이 온 상태인 동안, 바테리(150)으로부터의 전압은 무선부(20), 파형 성형기(30) 및 디코더(100)에 인가됨과 동시에 DC/DC 변환기(90)을 통해 레벨 전이기(60) 및 CPU(70)에 인가된다.
디코더(100)은 PROM(50)으로부터 데이타를 독출하기 위한 해독 회로(101), 익스클루시브-NOR(EX-NOR) 게이트(102), 익스클루시브-OR(EX-OR) 게이트(103), NOR 게이트(104), 계수기(105 및 106), SR 플립플롭(107), OR 게이트(108), 경보 제어기(109), 동기 신호 검출기(110), 인버터(111), 및 본 발명의 특징을 이루는 데이타 셋트 및 보유 회로(200)으로 구성된다.
경보 제어기(109)가 엔에이블되면, 경보 혼(alarm horn, 140)이 완충 증폭기(130)을 통해 구동된다. 바테리(120)은 데이타 셋트 및 보유 회로(200)에 접속된다.
이 특정한 실시예에서, 2개의 호출번호들은 상술한 수신기 호출번호들로서 PROM(50)내에 기억되는데, 앞으로는, 이 수신기 호출번호들 중 1개의 호출 번호를 호출 A라고 하고, 다른 호출 번호를 호출 B라고 하겠다. 호출 A는 각각의 수신기에 지정되는 페이징 번호를 나타내고, 호출 B는 각각의 수신기에 공통으로 지정되는 공통 번호를 나타낸다.
제2도를 참조하면, 제1도의 데이타 셋트 및 보유 회로(200)의 상세한 구조가 도시되어 있다. 이 예에서, 회로(200)은 D 플립플롭(210), AND 게이트(220), D형 플립플롭(230), OR 게이트(240), 전이 레지스터(250), 인버터(260 및 270), 및 AND 게이트(280)으로 구성되는 것으로 도시되어 있다.
제2도에서, 데이타 셋트 및 보유 회로(200)의 전원은 전지(120)이다. 입력 k는 회로를 초기 상태로 설정하는 것이며, D-플립플롭(230)의 출력 Q와 입력 k는 AND 게이트(220)의 입력으로 된다. 이 AND 게이트의 출력은 D-플립플롭(210)을 초기설정하고, 입력 k는 OR 게이트(240)을 통하여 레벨 전이기(250)을 초기 설정한다. 한편, 제1도의 우하단부에 표시되어 있는 CPU로부터의 신호 g1, g2를 이루는 g신호 중에서, 신호 g2는 레벨 전이기(250)을 전이 동작시키는 클럭이며, 또한 CPU(70)으로부터의 제어 패턴 g1은 1비트씩 전이 레지스터(250)에 들어온다. 따라서, 4비트의 제어 패턴 g1(Q4, Q3, Q2, Q1)이 1010이면, AND 게이트(280)은 논리가 0에서 1로 되고 D 플립플롭(210)의 출력 Q(출력 라인 f)는 반전된다. 제어 패턴 g(g1, g2)가 출력되는 것은, 제5도에 도시되어 있는 바와 같이, 개별 어드레스 A에 따르는 데이타에 포함된 하이픈 또는 공간의 유무와 신호 f의 상태들에 의해 결정된다. 이러한 결정은 제5도의 스텝(201- 208, 212, 213)에서 이루어진다.
제3a도 내지 제3d도는 이 특정한 실시예에 적용할 수 있는 신호 포오맷을 도시한 것이다. 상세하게 말하자면, 제3b도는 동기 신호 SC, 식별신호 ID1, ID2, …, IDN, 및 메시지 신호 M1, M2,…로 구성되는 송신 신호의 포오맷을 도시한 것이다. 제3c도에 도시한 바와 같이, 동기 신호 SC는 "0111110011010010000101011101100"의 패턴을 가질 수 있다. 제3d도는 식별신호와 메시지 신호에 적용할 수 있는 워드를 도시한 것이다. 식별 신호 및 메시지 신호는 식별 비트, 또는 최상위 비트(MSB)에 기초를 두고 서로 구별된다. 즉, MSB가 논리 0이면, 이것을 뒤따르는 신호가 식별 신호 ID1, ID2,…라는 것을 표시하고, MSB가 논리 1이면, 뒤따르는 신호가 메시지 신호 M1, M2,…라는 것을 표시한다. 워드는 21개의 데이타 비트(비트 1에서 21) 및 10개의 검사 비트(비트 22에서 31)로 구성되는 BCH(Bose-Chaudhuri Hocquenghem)(31, 21)의 포오맷을 갖는다.
제1도 및 제2도의 여러 부분들내에서 나타나는 신호들의 파형들은 제4도 내지 제4n도내에 타이밍도로 도시되어 있다. CPU(70)에 의해 실행될 기본 루틴은 제5도내에 플로우챠트로 도시되어 있다.
동작시에, 무선부(20)에 의해 출력된 복조파는 파형 성형기(30)에 의해 제3b도에 도시한 바와 같이 성형되고, 다음에, 디코더(100)에 공급된다. 제4a도에 도시한 바와 같이, 호출 A 및 B는 메시지 데이타 MA 및 MB가 각각 부가되어 있는 신호 m으로서 송신된다고 가정하겠다. 동기 신호 검출기(110)이 동기 신호를 검출하자 마자, 해독 회로(101) 및 계수기(105 및 106)은 식별 신호의 후속 검출을 준비하기 위해 프리셋트 된다. PROM(50)내에 기억되는 호출 A 및 B는 해독회로(101)에 의해 독출되고, 호출 A 및 B에 대응하는 패턴과 함께 1비트씩 직렬로 EX-NOR 게이트(102) 및 EX-OR 게이트(103)에 각각 인가되어, 독출된 데이타는 1비트씩 수신된 데이타와 비교 된다.
제4b도에 신호 a에 표시한 바와 같이, 호출 A의 검출이 상기 과정에 의해 확인되면, SR 플립플롭(107)은 OR 게이트(108)에 공급된 신호 a로 셋트된다. 결과적으로, 호출 신호 검출 신호 b(제4c도) 및 수신된 호출 식별 신호 c(제4d도)는 레벨 전이기(60)을 통해 CPU(70)으로 전달된다. 레벨 전이된 신호 b'를 검출했을때, CPU(70)은 호출 신호가 검출되었다[예, 제5도의 스텝(200)]는 것을 결정한 다음, 레벨 전이된 신호 c'의논리 레벨을 결정한다[스텝(201)]. 제4d도에 신호 c로 표시한 바와 같이, CPU(70)이 논리 하이(high) 레벨 또는 "H"를 식별하면, CPU(70)은 호출 A가 검출되었다[호출 A, 스텝(201)]는 것을 결정하고, 클럭 e(제4f도)에 응답하여, 수신 데이타 d에서 후속 메시지 데이타를 디코드하는데[스텝(202)], 클럭 e는 디코더(100)으로부터 공급되는 것이고 수신된 데이타 d(제4e도)와 동기된다.
후속적으로, CPU(70)은 데이타 셋트 및 보유 회로(200)의 출력 f(제4g도)를 검사한다[스텝(203)]. 신호 f가 로우 레벨 또는 "L"이라는 것[L, 스텝(203)]을 결정하였을 때, 즉 수신기가 공통 번호에 기초를 둔 서비스를 수신할 자격이 있다는 것을 나타낼때, CPU(70)은 수신 데이타의 제1디지트를 검사한다(스텝(204 및 205)]. 제1디지트가 표 1에 도시한 바와 같이 공간을 나타내는 "1100"이면[예, 스텝(205)], CPU(70)은 수신기를 정상 대기 상태로 복원시킨다음, 스텝(200)으로 복귀된다.
[표 1]
Figure kpo00001
제1디지트가 표 1에 도시한 바와 같이 하이픈(-)를 나타내는 "1101"이면[예, 스텝(204)], CPU(70)은 경보 지정 신호 j(제4k)도를 호출 A의 논리(즉, 하이 레벨)로 셋트시키고[스텝(206)], 경보 제어 신호 i(제4j도)를 발생시킨다. 이 신호(i 및 j)에 응답하여, 경보 제어기(109)는, 출력 h를 완충 증폭기(103)으로 전달하여 경보 혼(140)을 구동시킨다. 한편, CPU(70)은 신호 g(제4h도)를 발생시킨다[스텝(208)]. 그다음에, CPU(70)은 N을 1만큼 증가시키고[스텝(209)], 결과 N이 홀수 인지의 여부를 결정한다[스텝(210)]. N의 초기치가 0이기 때문에, 상술한 결과 N이 홀수이면[예, 스텝(210)], CPU(70)은 LCD(80)상에 유용한 정보 서비스가 종료되었다는 것을 사용자에게 통지하는데 본 발명의 특정한 실시예내에서 "OUT SERVICE"라는 메시지를 발생시킨다[스텝 211].
데이타 셋트 및 보유 회로(200)내에서, D형 플립플롭(210)의 출력은 신호 g에 의해 반전된다. 제2도에 도시한 바와 같이, 신호 g는 "1010"의 패턴을 나타내는 성분 g1, 및 성분 g1에 대응하는 4-비트 클럭을 나타내는 성분 g2로 구성된다. 상기 상태에서, 메시지 데이타 MB를 갖고 있는 호출 B 신호, 즉 m(제4a도)은 PROM(50)내에 기억되는 호출 B 데이타와 1비트씩 비교되도록 EX-OR 게이트(103)에 인가된다. 그러나, EX-OR 게이트(103)의 출력이 NOR 게이트(104)에 인가된 제어 신호 f에 의해 금지 되었기 때문에, 호출 B는 수신되지 않는다(제4c도 및 제4d도).
다음에, 호출 A의 수신을 검출하였을때, 신호 f가 하이 레벨 또는 "H"이기 때문에, 제4도에 도시한 바와 같이, CPU(70)은 메시지 데이타의 제1디지트가 공간도 아니고 하이픈도 아닌 경우[아니오, 스텝(212), 및 아니오, 스텝(213)]에, 경보 지정 신호 j를 호출 A의 논리로 셋트 시킨다[스텝(214)]. 동시에, CPU(70)은 경보 제어기(109)를 엔에이블시키기 위해 경보 제어 신호 j를 전달한다[스텝(215)]. 결국, 경보혼(140)은 완충 증폭기(130)을 통해 구동되고, 수신 데이타는 LCD(80)상에 발생된다[스텝(216)]. 제1디지트가 하이픈이면[예, 스텝(213)], 수신기는 대기 상태로 복원되어 전혀 응답하지 않게 되고, 프로그램은 스텝(200)으로 복귀된다. 또한, 최초 디지트가 공간이면[예, 스텝(212)], CPU(70)은 경보 지정 신호 j를 호출 A의 논리로 셋트시키고[스텝(206)], 수신기에 경보하도록 경보 제어 신호 i를 전달하여[스텝(207)], 데이타 셋트 및 보유 회로(200)내에 내장되는 D형 플립플롭(210)의 논리를 반전시키도록 신호 g를 발생시킨다[스텝(208)]. 그다음, CPU(70)은 N을 1만큼 증가시키어[스텝(209)], 결과 N이 짝수이기 때문에[아니오, 스텝(210)], 수신기가 서비스 받을 수 있다는 것을 사용자에게 알리기 위해 LCD(80)상에 메시지 "IN SERVICE"를 표시한다[스텝(217)].
상기 상태하에서, 호출 B에 관련된 메시지가 검출되면[호출 B, 스텝(201)], CPU(70)은 수신 데이타로부터 후속 메시지 데이타를 디코드하고[스텝(218)], 경보 지정 신호 j를 호출 B의 논리로 셋트시키며[스텝(219)], 수신기에 경보하도록 경보 제어 신호 i를 발생시키고[스텝(220)], LCD(80)상에 수신 메시지 데이타를 발생 시킨다[스텝(221)].
이 특정한 실시예에서, 수신기 사용자가 데이타 셋트 및 보유 회로(200)을 가동시키기 위한 바테리(120)을 고의로 제거하면, 전력 신호 n은 인버터(111)을 통해 NOR 게이트(104)에 공급된다. 이 구성에서, 바테리(120)이 제거되면, 신호 n은 로우 레벨, 또는 L로 되어, NOR 게이트(104)를 디스에이블시키므로, 수신기가 호출 B를 감지하지 못하게 한다.
상술한 바와 같이, 본 발명에 따른 페이징 수신기는 선정된 제어 신호의 검출에 응답하고, 수신기를 구동시킬 수 있는 전원과 상이한 전원에 의해 구동되는 데이타 셋트 및 보유 회로를 갖추고 있으며, 이 수신기의 동작은 데이타 셋트 및 보유 회로의 출력에 의해 제어된다. 이것은 무선 기저국으로 하여금 체납 수신기들에 대한 데이타 서비스를 무선 링크를 통해 종료 및 복원시키게 하여, 데이타 공급 서비스의 효율적 관리에 많은 기여를 하게 된다.
본 분야에 숙련된 기술자들은 본 발명의 범위를 벗어나지 않고서 본 발명을 여러가지 형태로 변형시킬 수 있다.

Claims (12)

  1. 수신기에 지정되는 제1호출 번호(A) 및 다수의 비지정 페이징 수신기에 데이타 서비스를 하기에 적합한 제2호출 번호(B) 수신시에 메시지 데이타를 수신할 수 있는 페이징 시스템에 있어서, 상기 제1호출번호에 추가되는 메시지 데이타내에 포함되는 선정된 패턴을 검출하기 위한 검출 수단(70), 및 상기 제2호출번호에 대응하는 최소한 하나의 데이타 서비스를 제어하기 위해 상기 검출 수단으로부터의 제어 신호(g, n)에 응답하는 제어 수단을 포함하되, 상기 제어 수단이 수신기의 주 전원(150)과 상이한 제1전원(120) 및 상기 제어 신호에 응답하여 상기 보유 회로의 출력 논리를 반전 및 보유하기 위한 보유 회로(200)을 최소한 포함하는 것을 특징으로 하는 페이징 수신기.
  2. 제1항에 있어서, 제어 신호(g)가 펄스열로 구성되는 것을 특징으로 하는 페이징 수신기.
  3. 제2항에 있어서, 보유 회로(200)이 펄스열을 디코드하기 위한 디코더(250, 260, 270, 280)을 포함하는 것을 특징으로 하는 페이징 수신기.
  4. 제1항에 있어서, 제어 수단이 제1전원(120)의 존재/부재를 나타내는 최소한 하나의 신호(n)을 제어 신호로서 사용하는 것을 특징으로 하는 페이징 수신기.
  5. 제1항에 있어서, 선정된 패턴이 제2호출 신호에 대응하는 데이타 서비스를 종료하기 위한 제1패턴(하이픈) 및 상기 서비스에서 제외된 페이징 수신기에 대한 데이타 서비스를 복원시키기 위한 제2패턴(공간)을 최소한 포함하는 것을 특징으로 하는 페이징 수신기.
  6. 제5항에 있어서, 검출 수단(70)이 상기 제1패턴을 수신할 때 제어 신호(g)를 전달하고, 제어 수단(200)이 상기 제어 신호에 응답하여 제2호출 신호에 대응하는 데이타 서비스를 종료하기 위한 수단을 포함하는 것을 특징으로 하는 페이징 수신기.
  7. 수신기에 지정되는 제1식별 신호(A) 및 상기 수신기를 포함하는 다수의 페이징 수신기에 지정되는 제2식별 신호(B)를 따르는 메시지를 수신하기 위한 수단, 제1제어 신호(g)를 발생시키도록 상기 제1식별 번호를 따르는 메시지내에 포함되는 선정된 패턴(공간, 하이픈)을 검출하기 위한 수단(70), 및 상기 제2식별 번호(B)의 수신을 제어하기 위해 상기 제어 신호(g)에 응답하고, 상기 수신기의 주 전원(150)과 별도인 제1전원에 의해 활성화되는 제어 수단(200, 111, 104)를 포함하는 것을 특징으로 하는 페이징 수신기.
  8. 제7항에 있어서, 상기 제어 신호(g)가 펄스열로 구성되는 것을 특징으로 하는 페이징 수신기.
  9. 제8항에 있어서, 상기 제어 수단(200, 111, 104)가 제2제어 신호(f)를 발생시키도록 상기 펄스열을 디코드하기 위한 디코더(250, 260, 276, 280) 및 상기 디코더로부터의 상기 제2제어 신호(f)를 보유하기 위한 보유 회로(210)을 포함하는 것을 특징으로 하는 페이징 수신기.
  10. 제7항에 있어서, 상기 제어 수단(200, 111, 104)가 상기 제2식별 신호(B)를 따르는 메시지의 수신을 금지하기 위해 상기 제1전원(120)의 제거에 응답하는 수단(111, 140)를 포함하는 것을 특징으로 하는 페이징 수신기.
  11. 제7항에 있어서, 상기 선정된 패턴이 제1 및 제2패턴(하이픈, 공간)을 포함하되, 상기 검출 수단(70)이 제1 및 제2검출 신호를 각각 발생시키도록 상기 제1 및 제2패턴을 검출하기 위한 수단을 포함하고, 상기 제어 수단(200)이 상기 제1검출 신호에 응답하여 제2식별 번호(B)를 따르는 메시지의 수신을 금지하고 상기 제2검출 신호에 응답하여 메시지 수신의 상기 금지를 해제하는 것을 특징으로 하는 페이징 수신기.
  12. 소정의 페이징 수신기를 포함하는 다수의 페이징 수신기들에 지정되는 공통 호출 번호(B)를 따르는 메시지의 수신을 제어하는 방법에 있어서, 공통 호출 번호(B) 및 상기 소정의 페이징 수신기에 지정되는 개별적인 호출 번호(A)를 따르는 메시지를 수신하는 스텝, 제어 신호(g)를 발생시키도록 상기 개별적인 호출 번호(A)를 따르는 메시지내에 포함되는 선정된 패턴(하이픈, 공간)을 검출하는 스텝, 상기 소정의 페이징 수신기에서 주 전원(150)이 제거되는지 여부에 관계없이 상기 제어 신호(g)를 보유하는 스텝, 및 보유된 제어 신호(g)에 응답하여, 상기 공통 호출 번호(B)의 수신을 제어하는 스텝을 포함하는 것을 특징으로 하는 방법.
KR1019870003486A 1986-04-12 1987-04-11 메시지 데이타를 수신할 수 있는 페이징 수신기 KR900008596B1 (ko)

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