KR900003722A - 타이머 장치 - Google Patents
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 제시된 실시예가 그 일부분을 이루는 싱글-칩 마이크로 컴퓨터의 블럭 선도,
제2A 내지 2B도는 본 발명의 제시된 실시예를 포함하는 타이머의 메모리 맵을 도시한 도면,
제3도는 제시된 실시예의 타이머의 주요 구성부를 도시한 블럭 선도.
Claims (3)
- 부합 레지스터와, 부합 레지스터에 결합된 제1입력과 제1타이밍 기준 신호의 소스에 결합된 제2입력을 가지며, 부합 레지스터 및 제1타이밍 기준 신호의 내용 사이에 선정된 관계식이 일어남에 따라 출력을 발생시키는 비교기와, 부합 인식 래치와, 비교기의 출력에 응답하여 제1선정된 상태로 부합 인식 래치를 세트하기 위한 제1논리 수단과 제1논리 수단을 디스에이블 하기 위한 제2논리 수단을 구비하는 것을 특징으로 하는 타이머 장치.
- 데이타 프로세서와, 타이머 장치를 구비하며, 타이머 장치는, 부합 레지스터와, 부합 레지스터를 로드하기 위한 데이타 프로세서에 의해 제어되는 부합 레지스터 로드 수단과, 부합 레지스터에 결합된 제1입력과, 제1타이밍 기준 신호의 소스에 결합된 제2입력을 가지며, 부합 레지스터 및 제1타이밍 기준 신호의 내용 사이에 선정된 관계식이 일어남에 따라 출력을 발생시키는 비교기와, 부합 인식 래치와, 비교기의 출력에 응답하여 제1선정된 상태로 부합 인식 래치를 세트하기 위한 제1논리 수단과 제1논리 수단을 디스에이블 하기 위한 데이타 프로세서에 의해 제어되는 제2논리 수단을 구비하는 것을 특징으로 하는 시스템.
- 데이타 프로세서와 적어도 두개의 타이머 서브 시스템을 구비하며, 데이타 프로세서는 상기 적어도 두개의 타이머 서브 시스템중 하나를 동시에 서비스할 수 있는 시스템에 있어서, 상기 적어도 두개의 타이머 서브 시스템 각각은, 부합 레지스터와, 부합 레지스터를 로드하기 위한 데이타 프로세서에 의해 제어되는 부합 레지스터 로드 수단과, 부합 레지스터에 결합된 제1입력과, 제1타이밍 기준 신호의 소스에 결합된 제2입력을 가지며, 부합 레지스터 및 제1타이밍 기준 신호의 내용 사이에 선정된 관계식이 일어남에 따라 출력을 발생시키는 비교기와, 부합 인식 래치와 비교기의 출력에 응답하여 제1선정된 상태로 부합 인식 래치를 세트하기 위한 제1논리 수단과, 제1논리 수단을 디스에이블 하기 위한 데이타 프로세서에 의해 제어되는 제2논리 수단을 구비하는 것을 특징으로 시스템.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US234111 | 1981-02-13 | ||
US07/234,111 US5042005A (en) | 1988-08-19 | 1988-08-19 | Timer channel with match recognition features |
US134,111 | 1988-08-19 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR900003722A true KR900003722A (ko) | 1990-03-26 |
KR960005388B1 KR960005388B1 (ko) | 1996-04-24 |
Family
ID=22879975
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019890011623A KR960005388B1 (ko) | 1988-08-19 | 1989-08-16 | 타이머 장치 |
Country Status (6)
Country | Link |
---|---|
US (1) | US5042005A (ko) |
EP (1) | EP0355465B1 (ko) |
JP (1) | JPH0612504B2 (ko) |
KR (1) | KR960005388B1 (ko) |
DE (1) | DE68919018T2 (ko) |
HK (1) | HK1000386A1 (ko) |
Families Citing this family (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5233573A (en) * | 1992-07-01 | 1993-08-03 | Motorola Inc. | Digital data processor including apparatus for collecting time-related information |
US5325873A (en) * | 1992-07-23 | 1994-07-05 | Abbott Laboratories | Tube placement verifier system |
US5325341A (en) * | 1992-08-31 | 1994-06-28 | Motorola, Inc. | Digital timer apparatus and method |
US5758137A (en) * | 1995-10-26 | 1998-05-26 | International Business Machines Corporation | Method and system for processing timer requests within a computer |
US5732225A (en) * | 1995-11-13 | 1998-03-24 | Motorola Inc. | Integrated circuit timer system having a global bus for transferring information between local buses |
US5729721A (en) * | 1995-11-13 | 1998-03-17 | Motorola, Inc. | Timebase synchronization in separate integrated circuits or separate modules |
US5721888A (en) * | 1995-11-13 | 1998-02-24 | Motorola, Inc. | Performing flexible logical operations with timer channel outputs |
US5701421A (en) * | 1995-11-13 | 1997-12-23 | Motorola, Inc. | Pin and status bus structure for an integrated circuit |
US5634045A (en) * | 1995-11-13 | 1997-05-27 | Motorola, Inc. | Integrated circuit input/output processor having improved timer capability |
US5721889A (en) * | 1995-11-13 | 1998-02-24 | Motorola, Inc. | Data transfer between integrated circuit timer channels |
US5631853A (en) * | 1995-11-13 | 1997-05-20 | Motorola Inc. | Flexible configuration of timebases in a timer system |
US5812833A (en) * | 1995-11-13 | 1998-09-22 | Motorola, Inc. | Timer bus structure for an integrated circuit |
US5790843A (en) * | 1996-09-19 | 1998-08-04 | International Business Machines Corporation | System for modifying microprocessor operations independently of the execution unit upon detection of preselected opcodes |
US6405335B1 (en) | 1998-02-25 | 2002-06-11 | Texas Instruments Incorporated | Position independent testing of circuits |
US6550015B1 (en) | 1999-02-10 | 2003-04-15 | Advanced Micro Devices Inc. | Scalable virtual timer architecture for efficiently implementing multiple hardware timers with minimal silicon overhead |
US6728915B2 (en) | 2000-01-10 | 2004-04-27 | Texas Instruments Incorporated | IC with shared scan cells selectively connected in scan path |
US6769080B2 (en) | 2000-03-09 | 2004-07-27 | Texas Instruments Incorporated | Scan circuit low power adapter with counter |
FR2895101A1 (fr) * | 2005-12-16 | 2007-06-22 | St Microelectronics Sa | Dispositif multifonctionnel temporisateur/compteur d'evenements et procede de mise en oeuvre d'un tel dispositif. |
US10591892B2 (en) | 2015-06-05 | 2020-03-17 | Renesas Electronics America Inc. | Configurable mapping of timer channels to protection groups |
Family Cites Families (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4326247A (en) * | 1978-09-25 | 1982-04-20 | Motorola, Inc. | Architecture for data processor |
JPS5848167A (ja) * | 1981-09-16 | 1983-03-22 | Sharp Corp | コントロ−ル装置 |
US4618968A (en) * | 1983-11-04 | 1986-10-21 | Motorola, Inc. | Output compare system and method automatically controlilng multiple outputs in a data processor |
JPH06103507B2 (ja) * | 1984-11-02 | 1994-12-14 | 株式会社日立製作所 | パルス入出力プロセッサ及びそれを用いたマイクロコンピュータ |
GB8529226D0 (en) * | 1985-11-27 | 1986-01-02 | Diamond H Controls Ltd | Timer |
JPS62227243A (ja) * | 1986-03-29 | 1987-10-06 | Toshiba Corp | 伝送制御方式 |
US4912708A (en) * | 1988-03-22 | 1990-03-27 | Siemens Transmission Systems, Inc. | Automatic microprocessor fault recovery system |
US4926319A (en) * | 1988-08-19 | 1990-05-15 | Motorola Inc. | Integrated circuit timer with multiple channels and dedicated service processor |
-
1988
- 1988-08-19 US US07/234,111 patent/US5042005A/en not_active Expired - Lifetime
-
1989
- 1989-07-27 DE DE68919018T patent/DE68919018T2/de not_active Expired - Fee Related
- 1989-07-27 EP EP89113867A patent/EP0355465B1/en not_active Expired - Lifetime
- 1989-08-16 KR KR1019890011623A patent/KR960005388B1/ko not_active IP Right Cessation
- 1989-08-17 JP JP1210830A patent/JPH0612504B2/ja not_active Expired - Lifetime
-
1997
- 1997-10-21 HK HK97101990A patent/HK1000386A1/xx unknown
Also Published As
Publication number | Publication date |
---|---|
JPH0612504B2 (ja) | 1994-02-16 |
DE68919018D1 (de) | 1994-12-01 |
JPH02252010A (ja) | 1990-10-09 |
EP0355465A3 (en) | 1990-11-07 |
DE68919018T2 (de) | 1995-05-18 |
EP0355465A2 (en) | 1990-02-28 |
EP0355465B1 (en) | 1994-10-26 |
HK1000386A1 (en) | 1998-03-13 |
KR960005388B1 (ko) | 1996-04-24 |
US5042005A (en) | 1991-08-20 |
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Legal Events
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A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
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