KR880011997A - 자동 이득 조절 시스템 - Google Patents

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KR880011997A
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민성기
명찬규
이재신
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강진구
삼성반도체통신 주식회사
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    • H—ELECTRICITY
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  • Control Of Amplification And Gain Control (AREA)
  • Analogue/Digital Conversion (AREA)

Abstract

내용없음

Description

자동 이득 조절 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제 2 도는 본 발명의 블록도
제 3 도는 제 2 도의 잡음 오동작 방지회로의 구체회로도
제 4 도는 제 2 도의 엎다운 카운터 및 논리회로와 구체회로도

Claims (1)

  1. 자동이득 조절 시스템에 있어서, 입력 신호를 데이터버스 상의 디지털 값에 따라 스텝으로 증폭 또는 감쇄된 출력 신호를 출력하는 이득조절 수단과, 상기 출력 신호가 출력하는 이득조절 수단과, 상기 출력 신호가 소정의 윈도우 기준전압 범위에 있는 가를 디지털 출력으로 판단하는 비교 수단과, 상기 디지탈 출력을 입력하여 소정의 카운팅을 하므로써 잡음에 대한 오동작을 방지하는 수단과, 소정의 클럭펄스를 발생하며 분주하여 엎카운팅을 할 때는 분주된 클럭을 출력하며 다운카운팅을 할 때는 분자하지 않은 플럭펄스 출력하고 상기 클럭에서 소정의 지연된 리세트 클럭을 발생하는 수단과, 상기 오동작 방지 수단의 출력과 상기 리세트 클럭을 입력하여 래치하는 래치수단과, 상기 클럭과 래치 신호를 입력하여 엎 또는 다운카운팅을 하는 엎다운 카운터 및 논리수단을 구비함을 특징으로 하는 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019870001891A 1987-03-02 1987-03-02 자동이득 조절시스템 KR900001507B1 (ko)

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