KR880008187A - 멀티프로세서 메모리 배열 방법 및 장치 - Google Patents

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Abstract

내용 없음.

Description

멀티프로세서 메모리 배열 방법 및 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 실시예를 포함하는 멀티프로세서 시스템의 블럭 다이어그램,
제4도는 제1도의 시스템의 메모리의 상태 전이 다이어그램,
제6도는 EXEC 호출에 응답하는 제1도 시스템의 작동 흐름도.

Claims (12)

  1. 다른 메모리(22)를 각각 포함하는 복수의 프로세서(11 내지 12)를 가지는 장치에 있어서, 제1부분(42)과 제2부분(41)으로 논리적으로 분할되는 각 메모리와, 제1메모리 부분에 포함된 프로세스를 메모리에 할당하는 제1제어수단(30)과, 관련된 프로세서의 제2메모리 부분에 포함된 메모리에 프로세서를 할당하도록 각 프로세스에 관련된 복수의 제2제어 수단(31)과, 제2제어수단 수단에 관련된 프로세서의 제1 및 제2메모리 부분 사이에 메모리를 선택적으로 전공하도록 제2제어 수단과 협동하는 제1제어 수단을 구비하는 것을 특징으로 하는 메모리 배열장치.
  2. 제1항에 있어서, 제1제어 수단이 프로세서에 프로세스를 할당하며(611), 관련된 프로세서에 할당된 프로세스에 대한 메모리를 할당하는 650 내지 657) 제2제어 수단을 특징으로 하는 메모리 배열장치.
  3. 제1항에 있어서, 제1제어 수단이 프로세스가 할당된 프로세서인 두 부분으로 된 각 할당된 프로세스에 대한 제2메모리 부분으로 제1메모리 부분에 포함된 메모리를 전송하며 프로세서에 프로세스를 할당하는 수단(610 내지 614, 630 내지 632)을 포함하고, 제2제어 수단은 각각 관련된 프로세서에 할당된 프로세스에 제2메모리 부분을 포함된 메모리를 할당하는 수단(650 내지 657)을 포함하는 것을 특징으로 하는 메모리 배열 장치.
  4. 제1항에 있어서, 제1제어 수단 및 제2제어 수단은 프로세스에 할당되지 않고 제2부분에 포함된 메모리 양에 근거하여 제2제어 수단에 관련된 프로세서의 제1메모리 부분 및 제2메모리 부분 사이에서 메모리를 전송시키도록 협동하는 것을 특징으로 하는 메모리 배열장치.
  5. 제1항에 있어서, 제2제어 수단은 할당된 메모리에 관련된 프로세스의 제2메모리 부분으로 할당 환원하며, 상기 제1제어 수단 및 제2제어 수단은 제2메모리 부분에서 제1메모리 부분으로 메모리를 전송하도록 협동하며, 상기 두 부분은 제2제어 수단에 관련된 프로세서이며, 제2메모리 부분에서의 미할당된 메모리의 양이 예정 최대치를 초과할 때 상기 전송이 이루어지고, 제2메모리 부분에서 미할당된 양이 예정된 최소치를 초과할 때 제1메모리 부분으로부터 제2메모리 부분으로 메모리가 전공되는 것을 특징으로 하는 메모리 배열장치.
  6. 제1항에 있어서, 각 메모리는 종합 메모리 부분(42), 미할당 국부 메모리 부분(45), 할당된 국부 메모리 부분(46)으로 논리적으로 분주되며, 제1제어 수단은 프로세스가 할당된 프로세서의 미할당 국부 메모리 부분에 할당된 종합 메모리 부분에 포함된 프로세서 메모리를 전송시키고(612 내지 614, 630 내지 632), 프로세서에 프로세스를 할당하며(611), 제2제어 수단은 관련된 프로세서에 할당된 메모리에 전송된 메모리를 전송시키도록 관련된 프로세서의 할당된 국부 메모리에 미할당된 국부 메모리 부분으로부터 메모리를 전송하며 (650 내지 657), 관련된 프로세서에 할당된 프로세스로부터 전송된 메모리를 할당 환원하도록 관련된 프로세서의 미할당 국부 메모리 부분으로 할당된 국부 메모리 부분에서 메모리를 전송하며, 제1제어 수단과 제2제어 수단은 종합 메모리 부분과 미할당 국부 메모리 부분 사이의 메모리 전송을 위해 협동하며, 두 메모리 부분은 예정된 상태의 발생에 응답하여 제2제어 수단에 관련된 프로세서인 것을 특징으로 하는 메모리 배열장치.
  7. 제6항에 있어서, 제2제어 수단은 두 메모리 부분이 관련된 프로세서인 미할당된 국부 메모리 부분에 포함된 메모리 양의 표시를 저장하도록 하는 제2엔트리 (201)를 포함하는 다른 제2테이블 수단과, 종합 메모리 부분이 소정양의 메모리를 포함하면 제1제어 수단이 복제를 허용하도록 요청하고, 복제된 프로세스에 의해 요구되는 메모리양을 종합 메모리 부분이 포함하는 지를 판단하는 제2테이블 수단의 제1엔트리를 검사하도록, 제2제어 수단에 관련된 프로세서에 할당된 프로세스의 복제에 대한 호출에 응답하는 작동 시스템 커늘 구단(31)을 포함하며, 제1제어 수단은, 관련된 프로세서의 종합 메모리 부분에 포함된 메모리의 양의 표시를 저장하도록, 그리고 복수의 프로세서의 다른 하나와 관련된 복수의 엔트리(212 내지 213)를 포함하는 제1테이블 수단과, 프로세서의 종합 메모리 부분이 소정의 메모리를 포함하는가를 판단하도록 요청제 2제어 수단의 프로세서에 관련된 제1테이블 수낟의 엔트리를 검사하고(510,511),종합 메모리 부분에서 소정의 메모리 양을 미할당 국부 메모리 부분에 전송하기 시작하도록 소정 양만큼 제1테이블 수단에서 프로세서에 관련된 엔트리를 감소시키며 (512 내지 513), 종합 메모리 부분이 소정의 메모리 양을 포함하면, 복제를 위한 요청 승인을 제2제어 수단에 통보하도록(514), 복제 허용 요청에 응답하는 작동 시스템 관리자 수단(30)과, 종합 메모리 부분에서 미할당 국부 메모리 부분으로 소정 양의 메모리의 전송을 완성하기 위하여 요구되는 양만큼 제1엔트리를 감소시키고 제2엔트리를 증가시키며(520 내지 522), 복제된 프로세서에 할당을 위해 할당된 국부 메모리 부분에 미할당 국부 메모리에서 소정 양의 메모리를 전공하도록 소정 양만큼 제2테이블 수단의 제2엔트리를 감소시키도록(523 내지 527) 승인 통보에 응답하는 요청 제2제어 수단의 커늘 수단을 포함하는 것을 특징으로 하는 메모리 배열장치.
  8. 제6항에 있어서, 제1제어 수단이, 관련된 프로세서의 종합 메모리 부분에서 메모리 양의 표시를 저장하고 복수의 프로세서중 다른 하나에 관련된 복수의 엔트리(212 내지 213)를 포함하는 제1테이블 수단과, 변환된 프로세스에 할당하는 프로세서를 선택하고(610 내지 611), 선택된 프로세서는 복수의 프로세서이고 변환된 프로세스에 의해 요구되는 메모리의 양을 포함하는 종합 메모리 부분을 가지며, 호출 프로세서에 선택을 통보하며(613 내지 614) 선택된 프로세서의 미할당 국부 메모리 부분에 종합 메모리 부분에서 소정의 메모리 양을 전송시키기 위해 소정 양만큼 선택된 프로세서내에 관련된 제1테이블 수단의 엔트리를 감소시키도록(612), 프로세서의 변환에 대한 호출 프로세서로부터의 호출에 응답하는 작동 시스템 프로세서 관리 수단(30)을 포함하며, 제2제어 수단은 두 메모리 부분이 관련된 프로세서안 미할당 국부 메모리 부분에서 메모리의 양의 표시를 저장하도록 제2엔트리 (202)와 종합 메모리 부분에서 메모리의 양의 표시를 저장하도록 제1엔트리(201)를 포함하는 다른 제2테이블 수단과, 종합 메모리 부분에서 미할당 국부 메모리로 소정 메모리 양의 전송을 완성시키도록 소정 양만큼 제2테이블 수단의 제1엔트리를 감소시키고 제2엔 트리를 중가시키며 (650 내지 652), 변환된 프로세스에의 할당에 대하여 미할당 국부 메모리 부분에서 할당 국부 메모리 부분으로 메모리의 소정 양을 전송시키도록 소정 앙만큼 제2테이블 수단의 제2엔트리를 감소하도록(653 내지 657), 관련된 프로세서의 선택을 호출 프로세서로부터의 통보에 응답하는 작동 시스템 커늘 수단(31)을 포함하는 것을 특징으로 하는 메모리 배열장치.
  9. 제6항에 있어서, 제2제어 수단은, 두 메모리 부분이 관련된 프로세서인 미할당 국부 메모리 부분에서 메모리 양의 표시를 저장하도록 제2엔트리(202)와 종합메모리 부분에서 메모리 양의 표시를 저장하도록 제1엔트리(201)를 포함하는 다른 제2테이블 수단과, 호출을 만족시키기에 적절한 메모리의 양을 미할당 국부 메모리 부분이 포함하는지를 판단하도록 제2테이블 수단의 제2엔트리를 검사하고(700 내지 702), 미할당 국부 메모리 부분이 적절한 메모리 양을 포함하지 않으면 종합 메모리 부분에서 국부 메모리 부분으로 메모리의 제2양을 전송시키기 위하여 제1제어 수단에 요청하며(703 내지 706), 미할당 국부 메모리 부분이 적절한 메모리 양을 포함한다면 호출 프로세서에 할당을 위해 미할당 국부 메모리 부분에서 할당된 국부 메모리 부분으로 제1양의 메모리를 전송시키도록 제1양만큼 제2테이블 수단의 제2엔트리를 감소시키도록(713 내지 717), 관련된 프로세서에 할당된 프로세서에 제1메모리 양의 할당을 위해 호출에 응답하는 작동 시스템 커늘 수단(31)을 포함하며, 제1제어 수단은, 관련된 프로세서의 종합 메모리 부분에서 메모리 앙의 표시를 저장하고 복수의 프로세서의 다른 하나에 관련된 복수의 엔트리(212 내지 213)를 포함하는 제1테이블 수단과, 요청 제2제어 수단에 결과를 통보하고(1104-1105), 미할당된 국부 메모리 부분으로 종합 메모리 부분에서 메모리의 적은 양의 전송을 개시하게 하는관련된 프로세서의 종합 메모리 부분에서 메모리의 전 양과 더 적은 제2양만큼 요청 제2제어 수단의 프로세서에 관련된 제1테이블 엔트리를 감소시키도록(1100 내지 1103) 전송 요청에 응답하는 작동 시스템 처리 관리자 수단(30)과, 종합 메모리 부분에서 미할당 국부 메모리 부분에 메모리 양의 전송을 완성하기 위하여 전송되는 양만큼 제2테이블 수단의 제1엔트리를 감소시키고 제2엔트리를 증가시키고(710 내지 711), 미할당된 국부 메모리 부분이 제1메모리 양을 포함하는 가를 판단하기 위하여 제2테이블 수단의 제1엔트리를 검사하며(712), 미할당된 국부 메모리 부분이 제1메모리 양을 포함하면 호출 프로세서에 할당을 위하여 미할당 국부 메모리 부분에서 할당된 국부 메모리 부분으로 메모리의 제1양을 전송하기 위하여 제1양만큼 제2엔트리를 감소시키도록(713 내지 717) 통보에 응답하는 요청 제2제어 수단의 커늘 수단을 포함하는 것을 특징으로 하는 메모리 배열장치.
  10. 제6항에 있어서, 제2제어 수단은, 종합 메모리 부분에서 메모리 양의 표시를 저장하는 제1엔트리(201)와 미할당된 국부 메모리 부분에서 메모리의 양 표시를 저장하는 제2엔트리(202)를 포함하며, 두메모리 부분은 관련된 프로세서이며, 프로세서로부터 메모리의 제1양을 할당 환원 하도록 미할당 국부 메모리에 할당 국부 메모리에서 제1메모리 양을 전송시키도록 제1양만큼 제2테이블 수단의 제2엔트리를 증가시키며 (870 내지 872), 그후에 미할당 국부 메모리 부분이 예정된 메모리 양을 초과하면 국부 메모리 부분에서 종합 메모리 부분에 메모리의 제2양을 전송시키도록 제1제 수단을 요청하고(904,907), 미할당 국부 메모리 부분이 예정된 양을 초과하는 당을 포함하는 가를 판단하도록 제2테이블 수단의 제2엔트리를 검사하도록(804,900 내지 903) 할당된 메모리의 제1양의 관련 프로세서에 할당된 프로세서에서 할당 환원에 대한 호출에 응답하는 작동 시스템 커늘 수단(31)을 포함하고, 제1제어 수단은, 관련된 프로세서의 종합 메모리 부분에 메모리 방의 표시를 저장하도록 그리고 복수의 프로세서 중의 하나에 관련된 복수의 엔트리(212 내지 213)를 포함하는 제1테이블 수단과, 미할당 국부 메모리 부분에서 종합 메모리 부분으로 메모리 양을 전송하기 시작하도록 제2양만큼 요청 제2제어 수단의 프로세스에 관련된 제1테이블 수단의 엔트리를 증가시키며, 요청 제2제어 수단에 그를 통보하도록 전송 요청에 응답하는 작동 시스템 프로세서 관리수단(30)과, 미할당 국부 메모리 부분에서 종합 메모리 부분으로 메모리 양의 전송을 완성시키도록 제2양만큼 제2테이블 수단의 제1엔트리를 증분시키고, 제2엔트리를 감소시키도록 통보에 응답하는 요청 제2제어 수단(920 내지 922)의 커늘 수단을 포함하는 것을 특징으로 하는 메모리 배열장치.
  11. 제1 및 제2부분(42, 41)으로 논리적으로 분주된 다른 메모리(22)를 포함하는 복수의 프로세서(11 내지 12)를 가지는 시스템에 메모리를 할당하는 방법에 있어서, 메모리의 제1양을 프로세서에 할당하도록 제1메모리 부분에 포함된 프로세서 메모리를 할당하도록 제1제어 배열(31)을 요청하는 단계와, 요청에 응답하여, 제1제어 배열이 제1프로세서의 제1메모리 방을 프로세서에 할당하며 (510 내지 527, 610 내지 657), 제2메모리 양을 프로세서에 할당하도록 제1프로세서의 제2메모리 부분에 포함된 프로세서 메모리에에 할당하며 그리고 제1프로세서에 전용으로 제2제어 장치(31)를 요구하는 (700,800) 단계와, 요청에 응답하여, 제2제어장치가 제1프로세서의 메모리의 제2양을 프로세서에 할당하며 (701 내지 717,801 내지 806), 제1 및 제2제어장치가 제2프로세서의 제1 및 제2메모리 부분 사이에서 메모리를 전송하는(704 내지 706,710 711,1100 내지 1105)것을 특징으로 하는 메모리 배열장치.
  12. 제11항에 있어서, 메모리의 제1양을 할당하는 단계가, 제1제어장치가 제1메모리 부분에서 제1메모리 양을 가지는 제1프로세서를 할당하고(611), 제1제어장치가 제1프로세서의 제2메모리 부분으로 제1메모리부분에서 메모리의 제1 양을 전송하며 (612 내지 632), 할당에 응답하여, 제1프로세서에 전용인 제2제어장치에 의하여 제1메모리 양을 프로세서에 할당하고(650 내지 675), 제1프로세서의 제2메모리 부분에 포함된 제1프로세서 메오리에 할당되는 프로세서에 할당하는 단계를 구비하고, 제2메모리 양을 할당하도록 제2제어장치에 요청하는 단계가, 메모리의 제2양을 할당하기 위해 제1프로세서에 전용인 제2제어장치에 요청하는 단계(700)와, 제1프로세서에 할당된 프로세서에 할당되는 제2메모리 양을 할당 환원하기 위하여 제2제어장치에 요청하는 단계(800)를 구비하며, 메모리를 할당하는 제2제어장치가 할당 요청에 응답하여 제2제어장치가 제1프로세서의 제2메모리 양을 프로세서에 할당하는 단계(701 내지 717)와, 할당 환원 요청에 응답하여 제2제어장치가 프로세스에서 제1프로세서의 제2메모리 부분에 제3메모리 양을 할당 환원하는 단계(801 내지 806)를 구비하는 것을 특징으로 하는 메모리 배열장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019870014590A 1986-12-22 1987-12-21 멀티 프로세서 메모리 관리 방법 및 장치 KR970001901B1 (ko)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100369280B1 (ko) * 1999-05-19 2003-01-24 인터내셔널 비지네스 머신즈 코포레이션 컴퓨터 시스템의 하나의 논리적 분할부에서의 최대 인터랙티브 퍼포먼스를 나머지 분할부들에서의 최대 인터랙티브 퍼포먼스와 무관하게 지정하는 장치 및 방법
US8891523B2 (en) 2011-06-03 2014-11-18 Samsung Electronics Co., Ltd. Multi-processor apparatus using dedicated buffers for multicast communications

Families Citing this family (61)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5093913A (en) * 1986-12-22 1992-03-03 At&T Laboratories Multiprocessor memory management system with the flexible features of a tightly-coupled system in a non-shared memory system
US5136706A (en) * 1987-04-30 1992-08-04 Texas Instruments Incorporated Adaptive memory management system for collection of garbage in a digital computer
US5109515A (en) * 1987-09-28 1992-04-28 At&T Bell Laboratories User and application program transparent resource sharing multiple computer interface architecture with kernel process level transfer of user requested services
US5282201A (en) * 1987-12-22 1994-01-25 Kendall Square Research Corporation Dynamic packet routing network
US5055999A (en) 1987-12-22 1991-10-08 Kendall Square Research Corporation Multiprocessor digital data processing system
US5335325A (en) * 1987-12-22 1994-08-02 Kendall Square Research Corporation High-speed packet switching apparatus and method
US5761413A (en) * 1987-12-22 1998-06-02 Sun Microsystems, Inc. Fault containment system for multiprocessor with shared memory
US5089953A (en) * 1987-12-28 1992-02-18 Sundstrand Corporation Control and arbitration unit
US5142674A (en) * 1988-03-08 1992-08-25 International Business Machines Corporation Interchange object data base index which eliminates the need for private copies of interchange documents files by a plurality of application programs
JPH0291747A (ja) * 1988-09-29 1990-03-30 Hitachi Ltd 情報処理装置
US5142622A (en) * 1989-01-31 1992-08-25 International Business Machines Corporation System for interconnecting applications across different networks of data processing systems by mapping protocols across different network domains
US5305440A (en) * 1989-05-15 1994-04-19 International Business Machines Corporation File extension by clients in a distributed data processing system
CA2019300C (en) * 1989-06-22 2001-06-12 Kendall Square Research Corporation Multiprocessor system with shared memory
JPH0697449B2 (ja) * 1989-09-20 1994-11-30 株式会社日立製作所 多重化共有メモリ制御方法、多重化共有メモリシステムおよび共有メモリ拡張方法
US5283900A (en) * 1989-10-02 1994-02-01 Spectron Microsystems, Inc. Real-time operating system and virtual digital signal processor for the control of a digital signal processor
US5218695A (en) * 1990-02-05 1993-06-08 Epoch Systems, Inc. File server system having high-speed write execution
JPH06105440B2 (ja) * 1990-03-08 1994-12-21 株式会社日立製作所 主メモリ管理方法
US5347634A (en) * 1990-03-15 1994-09-13 Hewlett-Packard Company System and method for directly executing user DMA instruction from user controlled process by employing processor privileged work buffer pointers
US5276896A (en) * 1990-06-11 1994-01-04 Unisys Corporation Apparatus for implementing data communications between terminal devices and user programs
JPH0496830A (ja) * 1990-08-15 1992-03-30 Hitachi Ltd 分散処理システムにおけるデータ管理方法
US5269013A (en) * 1991-03-20 1993-12-07 Digital Equipment Corporation Adaptive memory management method for coupled memory multiprocessor systems
US5303362A (en) * 1991-03-20 1994-04-12 Digital Equipment Corporation Coupled memory multiprocessor computer system including cache coherency management protocols
CA2057446C (en) * 1991-04-04 1998-02-17 Brian Neil Baker Shared memory access and data structure access control
US5327570A (en) * 1991-07-22 1994-07-05 International Business Machines Corporation Multiprocessor system having local write cache within each data processor node
US5809551A (en) * 1991-08-23 1998-09-15 International Business Machines Corporation Pending page release
US5410700A (en) * 1991-09-04 1995-04-25 International Business Machines Corporation Computer system which supports asynchronous commitment of data
CA2078310A1 (en) * 1991-09-20 1993-03-21 Mark A. Kaufman Digital processor with distributed memory system
CA2078312A1 (en) 1991-09-20 1993-03-21 Mark A. Kaufman Digital data processor with improved paging
GB2273800A (en) * 1992-12-24 1994-06-29 Ibm Distributed data processing system
JP2826028B2 (ja) * 1993-01-28 1998-11-18 富士通株式会社 分散メモリ型プロセッサシステム
US5559980A (en) * 1993-03-18 1996-09-24 Lucent Technologies Inc. Method and apparatus for detecting references to deallocated memory in a dynamic memory allocation system
US5617537A (en) * 1993-10-05 1997-04-01 Nippon Telegraph And Telephone Corporation Message passing system for distributed shared memory multiprocessor system and message passing method using the same
JPH08123763A (ja) * 1994-10-26 1996-05-17 Nec Corp 分散処理システムにおけるメモリ割り当て方式
US6058460A (en) * 1996-06-28 2000-05-02 Sun Microsystems, Inc. Memory allocation in a multithreaded environment
US5813042A (en) * 1997-02-19 1998-09-22 International Business Machines Corp. Methods and systems for control of memory
US6092155A (en) * 1997-07-10 2000-07-18 International Business Machines Corporation Cache coherent network adapter for scalable shared memory processing systems
FR2771526B1 (fr) 1997-11-27 2004-07-23 Bull Sa Architecture pour la gestion de donnees vitales dans une machine multi-modulaire et procede pour la mise en oeuvre d'une telle architecture
US6449699B2 (en) * 1999-03-29 2002-09-10 International Business Machines Corporation Apparatus and method for partitioned memory protection in cache coherent symmetric multiprocessor systems
US6618742B1 (en) 2000-01-10 2003-09-09 Imagex.Com, Inc. Method for job impact learning
US6618820B1 (en) 2000-01-10 2003-09-09 Imagex.Com, Inc. Method for configuring an application server system
US6631480B2 (en) 1999-11-10 2003-10-07 Symantec Corporation Methods and systems for protecting data from potential corruption by a crashed computer program
US6662310B2 (en) 1999-11-10 2003-12-09 Symantec Corporation Methods for automatically locating url-containing or other data-containing windows in frozen browser or other application program, saving contents, and relaunching application program with link to saved data
US6630946B2 (en) 1999-11-10 2003-10-07 Symantec Corporation Methods for automatically locating data-containing windows in frozen applications program and saving contents
US6690951B1 (en) 1999-12-20 2004-02-10 Telefonaktiebolaget Lm Ericsson (Publ) Dynamic size allocation system and method
US6823472B1 (en) * 2000-05-11 2004-11-23 Lsi Logic Corporation Shared resource manager for multiprocessor computer system
US20030217184A1 (en) * 2000-12-30 2003-11-20 Govindan Nair Method and apparatus for allocating buffers shared among protocol layers in a protocol stack
US7143281B2 (en) * 2001-10-12 2006-11-28 Hewlett-Packard Development Company, L.P. Method and apparatus for automatically changing kernel tuning parameters
US20030115402A1 (en) * 2001-11-16 2003-06-19 Fredrik Dahlgren Multiprocessor system
US7302548B1 (en) * 2002-06-18 2007-11-27 Cisco Technology, Inc. System and method for communicating in a multi-processor environment
US6985916B2 (en) * 2002-08-29 2006-01-10 International Business Machines Corporation Method, system, and article of manufacture for returning physical volumes
US7085897B2 (en) * 2003-05-12 2006-08-01 International Business Machines Corporation Memory management for a symmetric multiprocessor computer system
US7568025B2 (en) * 2003-06-27 2009-07-28 Bank Of America Corporation System and method to monitor performance of different domains associated with a computer system or network
US20060080514A1 (en) * 2004-10-08 2006-04-13 International Business Machines Corporation Managing shared memory
US7689794B2 (en) * 2004-10-22 2010-03-30 Scientific-Atlanta, Llc System and method for handling memory allocation failures through reserve allocation of event data
JP4842720B2 (ja) * 2006-06-29 2011-12-21 株式会社日立製作所 ストレージシステム及びデータ複製方法
US7428629B2 (en) * 2006-08-08 2008-09-23 International Business Machines Corporation Memory request / grant daemons in virtual nodes for moving subdivided local memory space from VN to VN in nodes of a massively parallel computer system
JP4696151B2 (ja) * 2008-10-23 2011-06-08 株式会社エヌ・ティ・ティ・ドコモ 情報処理装置およびメモリ管理方法
US8239701B2 (en) * 2009-07-28 2012-08-07 Lsi Corporation Methods and apparatus for power allocation in a storage system
US8271811B2 (en) * 2009-11-05 2012-09-18 Lsi Corporation Methods and apparatus for load-based power management of PHY logic circuits of a SAS device based upon a current workload
US10776256B2 (en) * 2018-05-16 2020-09-15 International Business Machines Corporation Sharing consumed off-heap for parallel data loading
US11740800B2 (en) * 2021-06-22 2023-08-29 Micron Technology, Inc. Alleviating memory hotspots on systems with multiple memory controllers

Family Cites Families (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4514728A (en) * 1980-02-25 1985-04-30 At&T Bell Laboratories Store group bus allocation system
US4384323A (en) * 1980-02-25 1983-05-17 Bell Telephone Laboratories, Incorporated Store group bus allocation system
US4685125A (en) * 1982-06-28 1987-08-04 American Telephone And Telegraph Company Computer system with tasking
US4511964A (en) * 1982-11-12 1985-04-16 Hewlett-Packard Company Dynamic physical memory mapping and management of independent programming environments
US4754394A (en) * 1984-10-24 1988-06-28 International Business Machines Corporation Multiprocessing system having dynamically allocated local/global storage and including interleaving transformation circuit for transforming real addresses to corresponding absolute address of the storage

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100369280B1 (ko) * 1999-05-19 2003-01-24 인터내셔널 비지네스 머신즈 코포레이션 컴퓨터 시스템의 하나의 논리적 분할부에서의 최대 인터랙티브 퍼포먼스를 나머지 분할부들에서의 최대 인터랙티브 퍼포먼스와 무관하게 지정하는 장치 및 방법
US8891523B2 (en) 2011-06-03 2014-11-18 Samsung Electronics Co., Ltd. Multi-processor apparatus using dedicated buffers for multicast communications

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Publication number Publication date
JPS63239551A (ja) 1988-10-05
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