KR870011749A - 증폭기 - Google Patents

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KR870011749A
KR870011749A KR870004993A KR870004993A KR870011749A KR 870011749 A KR870011749 A KR 870011749A KR 870004993 A KR870004993 A KR 870004993A KR 870004993 A KR870004993 A KR 870004993A KR 870011749 A KR870011749 A KR 870011749A
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KR870004993A
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Inventor
엥겔로자
Original Assignee
이반 밀러 레르너
엔. 브이. 필립스 글로아이람펜파브리켄
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Publication date
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03G—CONTROL OF AMPLIFICATION
    • H03G3/00—Gain control in amplifiers or frequency changers
    • H03G3/20—Automatic control
    • H03G3/30—Automatic control in amplifiers having semiconductor devices
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00—Automatic control of frequency or phase; Synchronisation
    • H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08—Details of the phase-locked loop
    • H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
    • H03L7/093—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal using special filtering or amplification characteristics in the loop

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  • Amplifiers (AREA)
  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Manipulation Of Pulses (AREA)
  • Circuits Of Receivers In General (AREA)

Abstract

내용 없음

Description

증폭기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따르는 두 캐스케이드 배열부를 갖는 증폭기의회로 다이어그램.
제2도는 제1도의 증폭기의 각 부분내의 쌍안정 트리거 회로의 히스테리시스 특성도.
제3도는 제1도의 증폭기의 톱니파형 출력 특성도.

Claims (6)

  1. 임계회로 및 임계회로에 접속된 증폭기단을 구비하는, 진폭가변 입력신호를 증폭시키고 바람직하지 않은 d.c.오프셋을 감소시키기 위한 증폭기에 있어서, 임계회로가 입력신호 진폭이 제 1임계 레벨이하로 될 때, 활성 상태로부터 초기 상태로 변화하고, 입력신호 진폭이 제2임계 레벨을 초과할 때, 초기 상태로부터 활성 상태로 변화하는 쌍안정 트리거 회로를 포함하며, 상기 두 임계레벨은 입력신호의 최대 소망 진폭 변화보다 더 큰 히스테리시스로 경계되고, 상기 쌍안정 트리거 회로는 증폭기의 신호 경로 내에 함체된 d.c.보상회로에 접속되며, 트리거 신호를 활성 상태에서 상기회로에 인가하여 신호경로를 통하여 일정 스텝값으로 d.c.보상회로에 인가된 신호의 d.c.레벨을 감소시키는 것을 특징으로 하는 증폭기.
  2. 제1항에 있어서, 증폭기단의 입력이 임계회로의 입력이며, d.c.보상회로가 증폭기단의 출력에 접속되는 것을 특징으로 하는 증폭기.
  3. 제2항에 있어서, 상기 증폭기단, 임계회로 및d.c.보상회로가 그것의 회로 배열에 상호 대응하는 n부분의 캐스케이드 배열의 단일부를 구성하며, 신호 방향으로의 (n-1)부분 각각의 감소 단계값은 수반되는 부분의 히스테리시스보다 더 큰 것을 특징으로 하는 증폭기.
  4. 제3항에 있어서, 증폭기의 입력에 전위된 부분의 임계레벨은 증폭기의 입력레벨에 걸쳐 실제적으로 규칙적으로 분배되며, 감소 단계값과 증폭기의 출력에 전위된 부분의 히스테리시스는 상호 실제적으로 동일한 것을 특징으로 하는 증폭기.
  5. 제1항 또는 2항에 있어서, 상기 증폭기단, 임계회로 및 d.c.보상회로가 적어도 두 부분의 병렬장치중 단일부분을 구성하며, 상기 부분의 히스테리시스 범위가 증폭기의 입력신호 범위에 걸쳐 상호 비중첩 위치로 분배되는 것을 특징으로 하는 증폭기.
  6. 한 단부가 동기AM검출기에 접속되고, 다른 단부가RF수신 신호의 반송파와 위상 결합되는 국부 반송파를 발생시키기 위한, 루프 배열내에 연속적으로 배열된 위상 검출기, 루프필터 및 전압 제어 발진기를 구비하는 위상 고정 루프에 접속되는RF입력을 갖는 직접 혼합 동기 AM수신기에 있어서, 선행항중 어느 한 항에 청구된 바와같은 증폭기가 위상 검출기와, 루프의 위상 제어 신호내의 기생d.c.오프셋을 억제시키기 위한 루프 필터 사이에 배열되는 것을 특징으로 하는 직접 혼합 동기 AM수신기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019870004993A 1986-05-23 1987-05-20 증폭기 KR960005378B1 (ko)

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Application Number Priority Date Filing Date Title
NL8601316 1986-05-23
NL8601316A NL8601316A (nl) 1986-05-23 1986-05-23 Versterkingsinrichting met zelfinstellende dode zone in het bijzonder voor toepassing in een direktmengende am-synchroonontvanger.

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KR870011749A true KR870011749A (ko) 1987-12-26
KR960005378B1 KR960005378B1 (ko) 1996-04-24

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EP (1) EP0247666B1 (ko)
JP (1) JPS62290206A (ko)
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CN (1) CN1007110B (ko)
DD (1) DD256598A5 (ko)
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KR960005378B1 (ko) 1996-04-24
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EP0247666B1 (en) 1993-02-03
CN87103771A (zh) 1988-02-24
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