KR860009428A - 셈플 및 홀드 회로 장치 - Google Patents

셈플 및 홀드 회로 장치 Download PDF

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KR860009428A
KR860009428A KR1019860003989A KR860003989A KR860009428A KR 860009428 A KR860009428 A KR 860009428A KR 1019860003989 A KR1019860003989 A KR 1019860003989A KR 860003989 A KR860003989 A KR 860003989A KR 860009428 A KR860009428 A KR 860009428A
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coupled
switch
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hold circuit
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Inventor
페릭스 토멘 베르너
Original Assignee
엔. 브이. 필립스 글로아이람펜파브리켄
이반 밀러 레르너
엔. 브이. 필립스 글로아이람 펜파브리켄
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Publication date
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    • G11C27/02—Sample-and-hold arrangements
    • G—PHYSICS
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    • G11C27/024—Sample-and-hold arrangements using a capacitive memory element
    • G11C27/026—Sample-and-hold arrangements using a capacitive memory element associated with an amplifier

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  • Analogue/Digital Conversion (AREA)
  • Amplifiers (AREA)
  • Electronic Switches (AREA)

Abstract

내용 없음

Description

셈플 및 홀드 회로 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따라 샘플 및 홀드 회로 장치의 다이어그램.
제2도는 제1도에 도시된 샘플 및 홀드 회로 장치의 실제예.
* 도면의 주요부분에 대한 부호의 설명
5 : 차동 증폭기 8, 12 : 증폭기
32, 33, 40, 53 : P채널 MOS트랜지스터 34, 35, 55 : N채널 MOS트랜지스터

Claims (2)

  1. 입력단자, 적어도 두 개의 스위치, 캐패시터, 좌동 증폭기 및, 부호 변환 형태의 제2증폭기를 구비하여, 상기 입력단자가 제1스위치를 거쳐 차동 증폭기의 입력에 결합되고, 제2증폭기의 출력이 제2스위치를 거쳐 차동 증폭기의 입력에 결합되며, 상기 제2증폭기가 상기 차동 증폭기의 출력 단자에 결합된 입력 단자를 가지는 샘플 및 홀드 회로 장치에 있어서, 캐패시터가 제1스위치와 차동 증폭기 사이에 결합하여 장착되고, 장치가 또한 제3스위치를 거쳐 차동 증폭기의 출력에 결합되는 입력을 갖는 제3증폭기를 구비하고, 제3증폭기의 출력 단자가 제4스위치를 거쳐 제1스위치에 결합되는 캐패시터의 측면(전극)에 결합되며, 제3증폭기의 입력단자 및 출력단자가 제2캐패시터를 포함하는 브랜치를 거쳐 상호 결합되는 것을 특징으로 하는 샘플 및 홀드 회로 장치.
  2. 제1항에 있어서, 제2증폭기 및 제3증폭기의 전달 특성이 실질적으로 동일하게 되는 방식으로 제2증폭기 및 제3증폭기가 구성되는 것을 특징으로 하는 샘플 및 홀드 회로 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019860003989A 1985-05-24 1986-05-22 샘플 및 홀드 회로 장치 KR940010421B1 (ko)

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KR940010421B1 KR940010421B1 (ko) 1994-10-22

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