KR860002915A - 디지탈 전송 시스템 - Google Patents

디지탈 전송 시스템 Download PDF

Info

Publication number
KR860002915A
KR860002915A KR1019850007099A KR850007099A KR860002915A KR 860002915 A KR860002915 A KR 860002915A KR 1019850007099 A KR1019850007099 A KR 1019850007099A KR 850007099 A KR850007099 A KR 850007099A KR 860002915 A KR860002915 A KR 860002915A
Authority
KR
South Korea
Prior art keywords
timing
control means
master
frame
transmission
Prior art date
Application number
KR1019850007099A
Other languages
English (en)
Other versions
KR900003238B1 (ko
Inventor
미사오 후꾸다 (외 2)
Original Assignee
야마모도 다꾸마
후지쓰 가부시끼 가이샤
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Priority claimed from JP59201021A external-priority patent/JPS6178237A/ja
Priority claimed from JP59276354A external-priority patent/JPS61157039A/ja
Priority claimed from JP60064371A external-priority patent/JPH0691525B2/ja
Application filed by 야마모도 다꾸마, 후지쓰 가부시끼 가이샤 filed Critical 야마모도 다꾸마
Publication of KR860002915A publication Critical patent/KR860002915A/ko
Application granted granted Critical
Publication of KR900003238B1 publication Critical patent/KR900003238B1/ko

Links

Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04BTRANSMISSION
    • H04B15/00Suppression or limitation of noise or interference
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L5/00Arrangements affording multiple use of the transmission path
    • H04L5/14Two-way operation using the same type of signal, i.e. duplex
    • H04L5/1423Two-way operation using the same type of signal, i.e. duplex for simultaneous baseband signals
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L5/00Arrangements affording multiple use of the transmission path
    • H04L5/14Two-way operation using the same type of signal, i.e. duplex
    • H04L5/1469Two-way operation using the same type of signal, i.e. duplex using time-sharing
    • H04L5/1484Two-way operation using the same type of signal, i.e. duplex using time-sharing operating bytewise
    • H04L5/1492Two-way operation using the same type of signal, i.e. duplex using time-sharing operating bytewise with time compression, e.g. operating according to the ping-pong technique

Landscapes

  • Engineering & Computer Science (AREA)
  • Signal Processing (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Cable Transmission Systems, Equalization Of Radio And Reduction Of Echo (AREA)
  • Bidirectional Digital Transmission (AREA)

Abstract

내용 없음

Description

디지탈 전송 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 제1실시예에 따른 마스터(master)측 송ㆍ수신 장치의 블록도.
제4도는 본 발명의 제1실시예에 따른 슬레이브(slave)측 송ㆍ수신 장치의 블록도.
* 도면의 주요부분에 대한 부호의 설명.
40,50,70,80:송ㆍ수신(T/R)장치 30:전송선 18,19:타이밍 제어수단
43,44,53,54:제1전송제어수단.

Claims (29)

  1. 적어도 2개의 송수신(T/R)장치 및 그들 사이에 접속된 단일 전송선으로 이루어져 있고 그 시스템이 전이중통신방식으로 운용되는 디지탈 전송 시스템에 있어서,상기 T/R 장치중 적어도 하나는 타이밍 제어수단 및 제1전송제어수단의 양수단을 포함하고 있으며, 타이밍제어수단은 모든 소정기간동안에만 T/R장치의 내부클록을 이러한 T/R 장치에 인가된 수신신호에 동기되도록 동작하고, 제1전송제어수단은 모든 상기 소정기간동안에만 다른 T/R 장치에 제공될 자신측 송신신호의 전송을 금지하도록 동작하는 것을 특징으로 하는 디지탈 전송 시스템.
  2. 제1항에 있어서, 상기 T/R 장치중 하나는 마스터클록 소오스에 의해 정해진 내부클록으로 구동된 마스터측 T/R 장치로서 작용하고 다른 T/R 장치는 장시 마스터클록 소오스에 종속한 슬레이브측 클록 소오스에 의해 정해진 내부클록으로 구성된 슬레이브측 T/R 장치로서 작동하며, 상기 타이밍 제어수단 및 상기 제1전송제어수단의 양수단은 슬레이브측 T/R 장치에 포함되고, 제2전송제어수단은 마스터측 T/R 장치에 포함되는 것을 특징으로 하는 디지탈 통신 시스템.
  3. 제2항에 있어서, 마스터측 T/R 장치의 상기 제2전송제어수단은 각 프레임을 설정하기 위해 프레임 펄스, 타이밍펄스, 및 송신데이타를 이 순서로 순차적으로 송싱시키도록 동작하고, 슬레이브측 T/R 장치에서, 프레임동기는 이와같이 전송된 프레임펄스의 사용으로 수행되고 그리고나서 상기 타이밍제어수단은 수신데이타로서 이와 같이 전송된 송신데이타를 재생하기 위해 이와 같이 전송된 타이밍 펄스의 사용으로 타이밍재생을 개시하며, 동시에 슬레이브측 T/R 장치의 상기 제1전송제어수단은 마스터측 T/R 장치로부터 제공된 상기 타이밍펄스 및 상기 프레임펄스의 수신동안에만 마스터측 T/R 장치에 제공될 자신측 송신신호의 전송을 금지하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  4. 제3항에 있어서, 마스터측 T/R 장치의 상기 제2전송제어수단이 또한 각 상기 프레임에서와 자신측 송신데이타의 종료후에 비신호지속기간을 발생시키도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  5. 제4항에 있어서, 슬레이브측 T/R 장치의 상기 제1전송제어수단은 제1순차제어기 및 제1선택기로 구성되고, 마스터측 T/R 장치의 상기 제2전송제어수단은 제2순차제어기 및 제2선택기로 구성되며, 제2선택기는 프레임펄스, 타이밍펄스, 송신데이타 및 비신호 지속기간 부분이 이 순서로 발생되도록 제2순차 제어기에 의해 제어되며, 제1선택기는 자신측 송신신호의 발생의 마스터측 T/R 장치로부터 제공된 타이밍펄스 및 프레임펄스의 수신중에만 금지되도록 슬레이브측 T/R 장치의 양쪽에서 제1순차제어기에 의해 제어되는 것을 특징으로 하는 디지탈 통신 시스템.
  6. 제5항에 있어서, 슬레이브측 T/R 장치의 상기 타이밍 제어수단은 또한 슬레이브측 T/R 장치의 내부 클록이 마스터측 T/R 장치로부터 제공된 수신신호에 동기되는 경우에 특별한 시간을 결정하는 제1순차제어기로 구성되는 것을 특징으로 하는 디지탈 통신 시스템.
  7. 제6항에 있어서, 슬레이브측 T/R 장치의 타이밍제어수단에서 상기 제1순차제어기는 또한 마스터측 T/R 장치로부터 제공된 타이밍펄스 및 프레임펄스의 수신동안에만 내부에 선등화를 개시하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  8. 제7항에 있어서, 상기 제1순차제어기는 또한 비신호지속기간동안에만 슬레이브측 T/R 장치에서 반향억압회로의 적응조정을 개시하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  9. 제8항에 있어서, 상기 제2순차제어기는 또한 슬레이브측 T/R 장치로 전송될 타이밍펄스 및 상기 프레임펄스의 발생동안 마스터측 T/R 장치의 반향억압회로의 적응조정을 개시하도록 동작되는 것을 특징으로 하는 디지탈 통신 시스템.
  10. 제9항에 있어서, 상기 순차제어기 각각은 각 제어순서를 규정하는 여러 데이타를 내부에 기억시키는 리드온리메모리(ROM)로 이루어지는 것을 특징으로 하는 디지탈 통신 시스템.
  11. 제10항에 있어서, 슬레이브측 T/R 장치에서, 상기 제1순차제어기는 상기 제1선택기, 상기 반향억압회로, 동기회로 및 타이밍재생회로와 상호 동작하여, 타이밍재생회로는 상기 제1순차제어기의 제어하에 상기 선등화를 형성하는 등화기로부터 출력을 수신하고 수신신호와 동기된 내부클록인 출력클록을 발생시키도록 동작하며, 동기회로는 판별기로부터 출력을 수신하고 제1순차제어기로 제공될 제어신호를 발생시키도록 동작하고, 판별기로부터의 출력은 상기 등화기로부터의 출력에 응하여 결정된 "1" 및 "0"의 비트열인 것을 특징으로 하는 디지탈 통신 시스템.
  12. 제11항에 있어서, 상기 동기회로는 상기 프레임펄스를 발견하는 프레임패턴 검출회로, 관련검출이 확실히 설정되는가를 조사하기 위해 프레임패턴 검출회로로부터 검출출력을 수신하는 프레임동기백업회로 및 상기 검출출력을 수신하고 관련검출이 적합하게 설정되는 매시간마다 각 상기 프레임으로 구성된 소정비트수를 계수하여 프레임 동기의 정확한 설정이 상기 타이밍펄스의 존재를 나타내는 클록 윈도우 펄스를 발생시키는 제1순차제어기에 알려지도록 되어 있는 프레임 동기계수기로 구성되어 있는 것을 특징으로 하는 디지탈 통신 시스템.
  13. 제12항에 있어서, 상기 타이밍재생회로는 상기 동화기로부터 출력을 공통적으로 수신하는 상측 및/ 또는 하측비교기, 상기 비교기로부터 양비교출력에 관해 OR 신호를 발생시키기 위한 OR 게이트, 상기 클록윈도우펄스가 그곳에 인가되는데 매시간마다 OR신호가 그곳을 통과하도록 허용하는 AND 게이트, 및 슬레이브 클록과 같은 내부클록을 타이밍펄스에 동기시켜 이것에 의해 슬레이브측 T/R 장치의 기본클록으로서 사용될 상기 출력클록을 발생시키는 디지탈 위상고정 루우프(D.PLL)로 구성되는 것을 특징으로 하는 디지탈 통신 시스템.
  14. 제1항에 있어서, 상기 T/R 장치중 하나가 마스터클록 소오스에 의해 정해진 내부클록으로 구동된 마스터측 T/R 장치로서 작동되고, 다른 것은 상기 마스터클록 소오스에 종속한 슬레이브 클록 소오스에 의해 정해진 내부클록으로 구동된 슬레이브측 T/R 장치로서 작동되며, 상기 타이밍제어수단은 제1타이밍제어수단 및 제2타이밍제어수단으로서 슬레이브측 T/R 장치 및 마스터측 T/R 장치의 각각에 포함되며, 상기 제1전송제어수단은 슬레이브측 T/R 장치에 포함되고, 동일한 제2전송제어수단은 마스터측 T/R 장치에 포함되는 것을 특징으로 하는 디지탈 통신 시스템.
  15. 제14항에 있어서, 마스터측 T/R 장치의 상기제2전송제어수단은 각 프레임을 설정하기 위해 프레임펄스, 타이밍펄스, 및 송신데이타를 이 순서로 순차적으로 송신시키도록 동작하고, 슬레이브측 T/R 장치에서 프레임동기는 이와같이 전송된 프레임펄스의 사용으로 수행되고, 그리고나서 상기 제1타이밍 제어수단은 수신데이타로서 이와같이 전송된 송신데이타를 재생하기 위해 이와같이 전송된 타이밍펄스의 사용으로 타이밍 재생을 개시하며, 동시에 슬레이브측 T/R 장치의 상기 제1전송제어수단은 우선 마스터측 T/R 장치로부터 제공된 상기 타이밍펄스 및 상기 프레임펄스의 수신동안에만 마스터측 T/R 장치에 제공될 자신측 송신신호의 전송을 금지하도록 동작하며, 그후에 제1전송제어수단은 이러한 순서로 순차적으로 배열된 프레임펄스, 송신데이타, 및 타이밍펄스의 형태로 상기 송신신호의 전송을 개시하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  16. 제15항에 있어서, 상기 제1 및 제2전송제어수단의 각각은 또한 상기 각 프레임에서 비신호지속기간을 발생시키도록 동작하며, 제1전송제어수단에 의해 삽입된 비신호지속기간은 타이밍펄스를 추적하고, 제2전송제어수단에 의해 삽입된 비신호 지속기간은 송신데이타를 추적하며, 여기서 각 비신호지속기간은 이순서로 배열된 제1지속기간 및 제2지속기간으로 구성되고, 제1지속기간은 상기 전송선으로의 전송동안 발생된 전송지연시간의 2배와 같도록 결정되며, 제2지속기간은 다른측 T/R 장치로부터 제공된 타이밍펄스를 받아들이는데 충분한 길이를 갖도록 결정되는 것을 특징으로 하는 디지탈 통신 시스템.
  17. 제16항에 있어서, 마스터측 T/R 장치의 상기 제2타이밍 제어수단은 상기 비신호 지속기간의 상기 제2지속기간동안 슬레이브측 T/R 장치로부터 제공된 수신타이밍펄스의 사용으로 타이밍재생을 수행하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  18. 제17항에 있어서, 상기 제2타이밍 제어수단은 자신측으로부터 발생된 타이밍펄스 및 프레임 펄스의 사용으로 마스터측 T/R 장치의 반향억압회로에 대한 적응조정을 개시하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  19. 제18항에 있어서, 상기 제1타이밍 제어수단은 자신측으로부터 발생된 타이밍펄스의 사용으로 슬레이브측 T/R 장치의 반향억압회로에 대한 적응조정을 개시하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  20. 제19항에 있어서, 슬레이브측 T/R 장치의 상기 제1전송제어수단은 제1순차제어기로 구성되고 제1선택기는 프레임펄스, 송신데이타, 타이밍펄스, 및 비신호 지속기간부분이 이 순서로 발생되도록 제1순차제어기에 의해 제어되며, 마스터측 T/R 장치의 상기 제2전송제어수단은 제2순차제어기로 구성되고 제2선택기는 프레임펄스, 타이밍펄서, 송신데이타, 및 비신호 지속기간부분이 이 순서로 발생되도록 제2순차제어기에 의해 제어되며, 슬레이브측 T/R 장치의 상기 제1타이밍 제어수단은 상기 제1순차제어기의 한부분으로서 형성되며, 마스터측 T/R 장치의 상기 제2타이밍 제어수단은 상기 제2순차제어기의 한 부분으로서 형성되는 것을 특징으로 하는 디지탈 통신 시스템.
  21. 제20항에 있어서, 상기 제1 및 제2숭차제어기의 각각은 각 제어순서를 규정하는 여러 데이타를 내부에 기억시키는 리드온리메모리(ROM)로 이루어지는 것을 특징으로 하는 디지탈 통신 시스템.
  22. 제19항에 있어서, 마스터측 T/R 장치에서 상기 제2타이밍제어수단은 또한 수신타이밍펄스 이외에 자신측의 상기 송신데이타를 잇따르는 비신호 지속기간의 상기 제1지속기간에 존재하는 수신데이타의 사용으로 상기 타이밍재생을 수행하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  23. 제2항에 있어서, 상기 마스터측 T/R 장치는 마스터측의 상용 타이밍재생회로와 상호 동작되는 위상성분 추출수단을 사용하는 것을 특징으로 하는 디지탈 통신 시스템.
  24. 제23항에 있어서, 슬레이브측 T/R 장치의 상기 주파수성분 추출수단은 마스터측 T/R 장치로부터 제공된 수신신호로부터 주파수 성분을 추출시키도록 동작하여 슬레이브축의 상기 타이밍 재생회로의 도움으로 슬레이브측 T/R 장치의 내부클록을 주파수 및 위상에서 수신신호에 동기시키며 그리고나서 이와같이 동기된 신호를 위상조정신호로서 마스터측 T/R 장치로 귀환시키며, 마스터측 T/R 장치의 위상추출수단은 데이타 전송이 개시되는 매시간마다 자신측의 타이밍 재생동작을 개시하기 위해 사용된 마스터측에서의 트레이닝 신호의 발생동안에만 마스터측의 타이밍 재생회로의 도움으로 마스터측의 내부클록을 위상에 있어서 이와 같이 제공된 위상조정신호에 동기시키도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  25. 제24항에 있어서, 마스터측 T/R 장치에서, 상기 위상추출수단 및 상기 타이밍 재생회로는 마스터클록을 수신하고 서로 다른 위상을 갖는 주파수 분할된 출력펄스를 발생시키도록 동작하는 제1주파수 디바이더, 제2주파수 디바이더로부터 제공된 선택신호에 따라서 상기 출력펄스중 어느 하나를 제공하도록 동작하는 선택기, 그것에 인가된 입력에 응해서 미분된 출력을 발생시키도록 동작된 미분회로, 그것의 입력은 판별기가 수신신호에 응하여 논리 "1" 및 "0"을 발생시키는 기능을 하는 마스터측의 상용판별기로부터 공급된 출력신호이고 미분회로에 제공된 입력이 상기 트레이닝 신호의 제어하게 통과도도록 동작하는 스위치, 그것의 제1입력에서 미분출력을 수신하는 제1AND게이트, 상기 제1AND게이트로부터의 결과 출력을 그것의 제1입력에서 그리고 상기 선택기에 의해 선택된 상기 출력펄스를 그것의 출력에서 수신하는 제2AND게이트, 및 한편으로 상기 제1AND게이트의 제2입력에 주파수 분할 출력펄스를 공급하기 위해 상기 제2AND게이트로부터 결과 출력을 수신하도록 동작되고 다른 한편으로 마스터측 내부클록으로서 사용되는 제3주파수 디바이더로 구성된 단일회로로 형성되는 것을 특징으로 하는 디지탈 통신 시스템.
  26. 제2항에 있어서, 마스터측 T/R 장치의 상기 제2전송제어수단은 각 프레임을 설정하기 위해 프레임펄스 및 송신데이타를 이 순서로 순차적으로 전송하도록 동작하며, 반면에, 슬레이브측 T/R 장치에서 프레임 동기는 이와같이 전송된 프레임펄스의 사용으로 수행되고 그리고나서 상기 타이밍제어수단은 또한 이와같이 전송된 송신데이타를 수신데이타로서 재생시키기 위해 이와 같이 전송된 프레임펄스의 사용으로 타이밍 재생을 개시하며, 동시에 슬레이브측 T/R 장치의 상기 제2전송제어수단은 마스터측 T/R 장치로부터 제공된 상기 프레임 펄스의 수신 동안에만 마스터측 T/R 장치로 제공될 자신측 송신신호의 전송을 금지하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  27. 제26항에 있어서, T/R 장치 수신장치에서 상기 프레임펄스는 선등화를 수행하는 자신측의 상용 등화기로부터의 출력을 공통적으로 수신하는 상측 및/또는 하측 비교기, 상기 비교기로부터의 2개의 비교된 출력에 관해 OR 신호를 발생시키기 위한 OR게이트, 내부클록과 동기로 OR출력의 논리("1" 또는 "0")를 순간적으로 보유하도록 동작하는 플립플롭, 프레임펄스 검출신호를 발생시키고 또한 이와 같이 발생된 프레임펄스 검출신호에 의존한 클록 윈도우 펄스를 발생시키도록 동작하는 프레임 동기회로, 프레임 펄스의 에지부를 통과시키기 위해 그것의 제1입력에서 상기 클록 윈도우 펄스를 그리고 그것의 제2입력에서 상기 OR 출력을 각각 수신하는 AND게이트, 이와같이 통과된 에지부의 위상을 시프트시키도록 동작하고 위상 시프트된 예지부가 수신데이타의 각 중심부를 취할 수 있도록 하는 지연회로, 및 상기 위상시프트된 에지부에 위해 위상에서 제어되는 출력클록을 자신측 내부클록으로서 발생시키도록 동작되는 디지탈 고정루우프(D.PLL)회로로 구성되는 단일회로에 의해 상기 프레임 동기 및 상기 타이밍 재생을 수행하는 것을 특징으로 하는 디지탈 통신 시스템.
  28. 제14항에 있어서, 마스터측 T/R 장치의 상기 제2전송 제어수단은 각 프레임을 설정하기 위해 프레임펄스와 송신데이타를 이러한 순서로 순차적으로 전송시키도록 동작되며, 슬레이브측 T/R 장치에서, 프레임 동기는 이와 같이 전송된 프레임 펄스의 사용으로 수행되고 그리고나서 상기 제1타이밍제어수단은 이와 같이 전송된 송신데이타를 수신데이타로서 재생시키기 위해 또한 이와 같이 전송된 프레임펄스의 사용으로 타이밍 재생을 개시하며, 동시에 슬레이브측 T/R 장치의 상기 제1전송제어수단은 우선 마스터측 T/R 장치로부터 제공된 상기 프레임펄스의 수신동안에만 마스터측 T/R 장치로 제공될 자신측 송신신호의 전송을 금지시키도록 동작하고 그후에 제1전송제어수단이 이러한 순서로 순차적으로 배열된 프레임 펄스 및 송신데이타의 형태에서 상기 송신신호의 전송을 개시하도록 동작하는 것을 특징으로 하는 디지탈 통신 시스템.
  29. 제28항에 있어서, T/R 수신장치에서 상기 프레임 펄스는 선등화를 수행하는 자신측의 상요동화기로부터의 출력을 공통적으로 수신하는 상측 및 하측비교기, 상기 비교기로부터의 비교된 출력에 관해 OR신호를 발생시키기 위한 OR게이트, 내부클록과, 동기로 OR출력의 논리("1" 또는"0")를 순간적으로 보유하도록 동작하는 플립플롭, 프레임펄스 검출신호를 발생시키고 또한 이와 같이 발생된 프레임펄스 검출신호에 의존한 클록윈도우 펄스를 발생시키도록 동작하는 프레임 동기회로, 프레임펄스의 에지부를 통과 시키도록 그것의 제1입력에서 상기 클록윈도우 펄스를 그리고 그것의 제2입력에서 상기 OR 출력을 수신하는 AND게이트, 이와같이 통과된 에지부의 위상을 시프트시키도록 동작하여 위상시프트된 에지부가 수신데이타의 각 중심부를 취할 수 있도록 하는 지연회로, 및 상기 위상지연에지부에 위해 위상에서 제어되는 출력클록을 자신측 내부클록으로서 발생되도록 동작하는 디지탈 위상고정루우프(D.PLL)회로로 구성되는 단일회로에 의해 상기 프레임 동기 및 상기 타이밍재생을 수행하는 것을 특징으로 하는 디지탈 통신 시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019850007099A 1984-09-26 1985-09-26 디지탈 전송시스템 KR900003238B1 (ko)

Applications Claiming Priority (6)

Application Number Priority Date Filing Date Title
JP59201021A JPS6178237A (ja) 1984-09-26 1984-09-26 引き込み方式
JP59-201021 1984-09-26
JP59276354A JPS61157039A (ja) 1984-12-28 1984-12-28 加入者線伝送装置
JP59-276354 1984-12-28
JP60064371A JPH0691525B2 (ja) 1985-03-28 1985-03-28 タイミング再生装置
JP60-064371 1985-03-28

Publications (2)

Publication Number Publication Date
KR860002915A true KR860002915A (ko) 1986-04-30
KR900003238B1 KR900003238B1 (ko) 1990-05-11

Family

ID=27298459

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019850007099A KR900003238B1 (ko) 1984-09-26 1985-09-26 디지탈 전송시스템

Country Status (4)

Country Link
EP (1) EP0176098B1 (ko)
KR (1) KR900003238B1 (ko)
CA (1) CA1246174A (ko)
DE (1) DE3582383D1 (ko)

Families Citing this family (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
IT1178913B (it) * 1984-03-26 1987-09-16 Cselt Centro Studi Lab Telecom Sistema per la trassmissione bidire zionale con cancellazione d eco
CN102215037B (zh) * 2010-04-06 2013-10-02 安凯(广州)微电子技术有限公司 一种延迟信号产生电路

Family Cites Families (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
GB1401436A (en) * 1971-10-14 1975-07-16 Gen Electric Co Ltd Pulse transmission systems
JPS5321963B2 (ko) * 1973-11-12 1978-07-06
JPS601947A (ja) * 1983-06-17 1985-01-08 Nec Corp 二線全二重通信方式
IT1178913B (it) * 1984-03-26 1987-09-16 Cselt Centro Studi Lab Telecom Sistema per la trassmissione bidire zionale con cancellazione d eco

Also Published As

Publication number Publication date
KR900003238B1 (ko) 1990-05-11
EP0176098A2 (en) 1986-04-02
EP0176098B1 (en) 1991-04-03
EP0176098A3 (en) 1987-09-02
DE3582383D1 (de) 1991-05-08
CA1246174A (en) 1988-12-06

Similar Documents

Publication Publication Date Title
US4442527A (en) Synchronization systems
US4573173A (en) Clock synchronization device in data transmission system
IE852018L (en) Frame synchronization device
EP0178622B1 (en) Timing recovery circuit for manchester coded data
KR880003494A (ko) 비트 동기화 회로 및 그 방법
US4390985A (en) Device for the synchronization of digital data transmitted in packets
US5111486A (en) Bit synchronizer
US3437755A (en) Multiplex channel gate pulse generator from an intermixture of time division multiplex pulse trains
KR860002915A (ko) 디지탈 전송 시스템
JP2693758B2 (ja) フレームパルス発生方式
JPH06507769A (ja) クロック同期方法および回路
JPH0149062B2 (ko)
US5050193A (en) Device for synchronizing a clock in relation to an incident digital signal, in particular at high transmission rates
JPS6242544B2 (ko)
US5222107A (en) Transmission and reception synchronization device for a communication network station particularly for automotive vehicles
JPS5931274B2 (ja) ボタン電話装置における同期方式
JPH08256164A (ja) 通信システム
JP2982860B2 (ja) クロック抽出回路
JP2707803B2 (ja) 同期切替方式
JPH0254622A (ja) タイミング再生回路
JPH0221183B2 (ko)
JPS5989050A (ja) フレ−ム同期引込み方式
JPH0715426A (ja) データ伝送システムならびにこのシステムで用いられるデータ送信回路およびデータ受信回路
JPH01260944A (ja) 通信端末装置
JPS58188952A (ja) パラレル・シリアル・デ−タ伝送回路

Legal Events

Date Code Title Description
A201 Request for examination
E902 Notification of reason for refusal
G160 Decision to publish patent application
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
LAPS Lapse due to unpaid annual fee