KR850006089A - 논리 전가산 기회로 - Google Patents

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아이. 엠. 레르너
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Abstract

내용 없음

Description

논리 전가산 기회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따라 전가산기 회로부의 구성도,
제2도는 본 발명에 따른 전가산기 회로의 논리 게이트 실시예도,
제3도는 본 발명에 따른 전가산기 회로의 앞보기 자리올림 신호 회로도.
*도면의 부호에 대한 설명
1:반전용 OR게이트, 3:반전용 AND게이트, 5:논리게이트, 7,9:전자식스위치, 10:전가산기회로부, 20:합계회로, 37,38:상보트랜지스터, 40:반전기, 50:앞보기 자리올림 신호회로.

Claims (8)

  1. n비트, n은 2보다 크거나 동일로 각각 구성된 2진수 a 및 b를 가산하고 2진수 a 및 b중 각 비트 ai, bi, 여기서 0≤i≤n에 반전용 OR게이트 및 반전용 AND게이트를 구비하고 있으며, 상기 게이트는 비트신호 ai및 bi를 수신하여 반전된 OR신호및 반전된 AND신호를형성하고, 또한 비트신호 ai및 bi와 이에 연관된 자리올림신호 Ci및 반전로부터 합신호 Si를 형성하는 합계회로와,반전된 모든 OR신호 및 AND 신호 및및 ai·bi, 여기서 0≤i≤n로부터 유의 n+1를 갖는 앞보기 자리올림 신호 Cn+1를 발상하는 앞보기 자리올림신호 회로를 구비하는 논리 전가산기 회로에 있어서, 각 합계회로는 비트신호 ai및 bi와 반전된 AND신호를 수신하여 이 회로의 제1출력상에는 논리신호를 이 회로이 제2출력상에는 반전된 논리신호·(ai+bi)를 형성하는 논리게이트를 구비하고, 또한 자리올림신호 Ci및 반전의 제어하에서, 논리게이트의 제1출력 또는 제2출력을 제1접합에 연결하여 제1접합상에서 반전된 합신호S i를 발생하는 전자식 스위치를 구비하는 것을 특징으로 하는 논리전가산기회로.
  2. 제1항의 논리가산기 회로에 있어서, 전가신기 회로는 OR신호및 AND신호 ai·bi와 자리올림신호 Ci및 반전로부터 반전된 자리올림신호 Ci+1를발생하는 자리올림신호회로를 구비하고, 상기 자리올림신호 회로는 자리올림신호 Ci및 반전 Ci의 제어하에서 반전용 OR게이트의 출력이나 반전용 AND게이트의 출력을 제2접합상에 연결시키는 전자식 스위치를 구비하고, 반전된 자리올림 신호 Ci+1는 상기 제2접합상에서 발생되는 것을 특징으로 하는 논리 전가산기 회로.
  3. 상보 절연게이트 전계효과 트랜지스터로 구성된 제2항의 논리 전가산기 회로에 있어서, 전자식 스위치 모두는 4개의 N채널 전계효과 트랜지스터를 구비하고 있으며, 이들 트랜지스터중 제1 및 제2트랜지스터는 상기 논리게이트의 제2 및 제1출력을 제1접합에 연결하고, 제3및 제4트랜지스터는 반전용 OR게이트의 출력 및 반전용 AND게이트의 출력을 제2접합에 연결하며, 제1및 제3트랜지스터는 자리올림신호 Ci로 제어되고 제2 및 제4트랜지스터는 반전된 자리올림신호로 제어되는 것을 특징으로 하는 논리 전가산기회로.
  4. 제3항의 논리 전가신기 회로에 있어서, 자리올림신호 Ci로 제어되는 P채널 전계효과 트랜지스터는 제2 및 제4트랜지스터와 병렬로 연결되는 것을 특징으로 하는 논리 전가산기 회로.
  5. 제3항의 논리 전가산기 회로에 있어서, 직렬 연결된 두 반전기는 제2접합에 연결되어 출력상에 자리올림 신호 Ci+1및 반전된 자리올림신호 Ci+1를 각각 발생하는 것을 특징으로 하는 논리 전가산기 회로.
  6. 제3,4,5항중 어느 한 항의 논리 전가산기 회로에 있어서, 논리게이트는 게이트 전극상에서 비트신호 ai및 bi를 각각 수신하는 직렬 연결의 두 P채널트랜지스터 및 이 두 P채널 트랜지스터와 병렬로 연결되는 게이트 전극에서 반전된 AND신호를 수신하는하나의 P채널 트랜지스터와, 병렬 연결의 P체널 트랜지스터와 , 직렬로 연결된 병렬 연결의 두 N채널 트랜지스터를 구비하고 있으며, 상기 N채널 트랜지스터의 게이트 전극은 비트신호 ai·bi를 각각 수신하고, 또한 병렬 연결된 두 N채널 트랜지스터와 직렬로 연결되고 게이트전극이 반전된 AND신호를수신하는 다른 한 N채널 트랜지스터를 구비하고, 논리 게이트는 또한 P채널 및 N채널로 구성되고 게이트 전극이 논리게이트의 제1출력을 형성하는 상기 P채널 및 N채널 트랜지스터의 접합에 연결되는 반전기를 구비하고 있으며, 반전기의 출력은 논리게이트의 제2출력을 형성하는 것을 특징으로 하는 논리 전가산기 회로.
  7. 선행된 항중 어느 한항의 논리 전가산기 회로에 있어서, 앞보기 자리올림신호 회로는 게이트 전극이 승순유의를 갖는 AND신호를수신하는 제1직렬연결의 트랜지스터를 구비하고, 게이트전극이 가장 낮은 유의의 AND신호 a0·b0를수신하는 트랜지스터는 게이트전극이 유의 0를 갖는 자리올림신호 C0를 수신하는 자리올림 트랜지스터와 직렬 연결되고, 한 트랜지스터는 자리올림 트랜지스터의 직렬 연결각부와 병렬로 연결되고, 앞보기 자리올림 신호회로는 상기 제1직렬 연결로부터 m개 트랜지스터, m은 1내지 n중 어느 값으로 가정를 구비하고 상기한 트랜지스터의 게이트전극은 OR신호 am-1+bm-1를 수신하는 것을 특징으로 하는 논리 전가산기 회로.
  8. 제7항의 논리 전가산기 회로에 있어서, 앞보기 자리올림신호 회로와 직렬 및 병렬로 연결뢴 트랜지스터는 두 전력 공급단자 사이에서 단일 P채널 전계효과 트랜지스터와 직렬로 연결된 N채널 전계효과 트랜지스터인 것을 특징으로 하는 논리 전가산기 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019850000755A 1984-02-09 1985-02-06 논리 전가산기 회로 KR930000207B1 (ko)

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