KR20080091925A - 인터페이스 시스템 및 이를 이용한 평판 표시장치 - Google Patents
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- G09G2330/06—Handling electromagnetic interferences [EMI], covering emitted as well as received electromagnetic radiation
Abstract
Description
2비트 | 3비트 |
00 | 000 |
01 | 001 |
10 | 011 |
11 | 111 |
3bit | 전류 방향 | 송신저항 인가전압 |
000 | ↑↑↑(-6㎃) | -600㎷ |
001 | ↑↑↓(-2㎃) | -200㎷ |
011 | ↑↓↓(2㎃) | 200㎷ |
111 | ↓↓↓(6㎃) | 600㎷ |
Claims (15)
- 외부로부터 다수의 비트를 가지는 제 1데이터 및 제 2데이터를 공급받고, 공급받은 제 1데이터 및 제 2데이터의 비트를 순차적으로 출력하기 위한 직렬 변환부와;상기 직렬 변환부로부터 공급되는 2비트를 3비트로 변환하기 위한 디코더와, 상기 3비트에 대응하여 전류들의 흐름을 제어하기 위한 구동부와, 상기 전류들의 전류흐름에 대응하여 전압이 인가되는 송신저항을 포함하는 송신회로와;상기 송신저항에 인가되는 전압을 공급받는 수신저항과, 상기 수신저항의 양측단에 인가되는 전압을 증폭하기 위한 앰프들과, 상기 앰프들로부터 공급되는 전압을 비교하면서 상기 3비트를 복원하기 위한 비교부들과, 상기 3비트를 이용하여 상기 2비트를 복원하기 위한 엔코더를 포함하는 수신회로와;상기 수신회로로부터 공급되는 상기 2비트를 순차적으로 저장하면서 상기 제 1데이터 및 제 2데이터를 복원하기 위한 직병렬 변환부와;상기 송신회로를 제어하기 위한 안정화회로들을 구비하는 것을 특징으로 하는 인터페이스 시스템.
- 제 1항에 있어서,상기 구동부는 상기 3비트의 서로 다른 비트를 입력받고, 입력받은 비트에 대응하여 상기 송신저항으로 공급되는 전류의 흐름을 제어하기 위한 3개의 구동회 로를 구비하는 것을 특징으로 하는 인터페이스 시스템.
- 제 2항에 있어서,상기 구동회로들 각각은제 1전압과 접속되며 제 1전압으로부터 일정전류가 흐르도록 채널폭이 제어되는 제 1트랜지스터와,제 2전압과 접속되는 제 2트랜지스터와,상기 제 1트랜지스터 및 제 2트랜지스터 사이에 위치되는 제 3트랜지스터 및 제 4트랜지스터와,상기 제 3트랜지스터 및 제 4트랜지스터와 병렬로 접속되는 제 5트랜지스터 및 제 6트랜지스터를 구비하는 것을 특징으로 하는 인터페이스 시스템.
- 제 3항에 있어서,상기 제 1전압은 상기 제 2전압 보다 높은 전압값으로 설정되는 것을 특징으로 하는 인터페이스 시스템.
- 제 3항에 있어서,상기 제 3트랜지스터 및 제 4트랜지스터는 상기 3비트 중 특정비트에 의하여 턴-온 및 턴-오프가 제어되고,상기 제 5트랜지스터 및 제 6트랜지스터는 상기 특정 비트의 반전 비트에 의 하여 턴-온 및 턴-오프가 제어되는 것을 특징으로 하는 인터페이스 시스템.
- 제 5항에 있어서,상기 제 3트랜지스터 및 제 5트랜지스터는 피모스(PMOS)로 형성되고, 제 4트랜지스터 및 제 6트랜지스터는 엔모스(NMOS)로 형성되는 것을 특징으로 하는 인터페이스 시스템.
- 제 3항에 있어서,상기 제 3트랜지스터 및 제 4트랜지스터 사이의 제 1노드와 상기 제 5트랜지스터 및 제 6트랜지스터 사이의 제 2노드를 포함하며, 상기 제 1노드와 제 2노드 사이에 위치되는 제 1저항 및 제 2저항을 구비하는 것을 특징으로 하는 인터페이스 시스템.
- 제 7항에 있어서,상기 제 1저항 및 제 2저항은 동일한 저항값으로 설정되는 것을 특징으로 하는 인터페이스 시스템.
- 제 7항에 있어서,상기 안정화회로는 상기 구동회로들 각각마다 설치되며, 상기 제 1저항 및 제 2저항 사이의 제 3노드에 인가되는 전압값에 대응하여 상기 제 2트랜지스터의 게이트전극과 소오스전극의 전압을 제어하는 것을 특징으로 하는 인터페이스 시스템.
- 제 9항에 있어서,상기 안정화회로 각각은상기 제 2전압과 접속되는 제 11트랜지스터와,상기 제 1전압과 상기 제 11트랜지스터 사이에 위치되는 제 7트랜지스터 및 제 8트랜지스터와,상기 제 7트랜지스터 및 제 8트랜지스터와 병렬로 접속되는 제 9트랜지스터 및 제 10트랜지스터와,상기 제 2전압과 접속되며, 상기 제 9트랜지스터와 커렌트 미러로 접속되는 제 12트랜지스터와,상기 제 12트랜지스터와 상기 제 2전압 사이에 접속되며, 게이트전극이 상기 제 2트랜지스터의 게이트전극과 접속되는 제 13트랜지스터를 구비하는 것을 특징으로 하는 인터페이스 시스템.
- 제 10항에 있어서,상기 제 11트랜지스터는 외부로부터 공급되는 제 1바이어스 전압에 대응되는 전류가 흐르도록 채널폭이 설정되고,상기 제 8트랜지스터는 외부로부터 공급되는 기준전압에 대응하여 상기 제 11트랜지스터로 공급되는 전류를 제어하는 것을 특징으로 하는 인터페이스 시스템.
- 제 11항에 있어서,상기 제 10트랜지스터의 게이트전극은 상기 제 3노드에 접속되며, 상기 제 10트랜지스터는 상기 제 3노드로부터 공급되는 전압에 대응하여 상기 제 11트랜지스터로 공급되는 전류를 제어하는 것을 특징으로 하는 인터페이스 시스템.
- 제 12항에 있어서,상기 제 13트랜지스터는 다이오드 형태로 접속되어 상기 제 12트랜지스터로부터 공급되는 전류를 상기 제 2전압으로 공급하는 것을 특징으로 하는 인터페이스 시스템.
- 제 10항에 있어서,상기 제 7트랜지스터, 제 9트랜지스터 및 제 12트랜지스터는 피모스(PMOS)로 형성되고, 상기 제 8트랜지스터, 제 10트랜지스터, 제 11트랜지스터 및 제 13트랜지스터는 엔모스(NMOS)로 형성되는 것을 특징으로 하는 인터페이스 시스템.
- 외부 시스템으로부터 데이터들을 공급받는 타이밍 제어부와;상기 타이밍 제어부로부터 공급되는 데이터들을 이용하여 데이터신호들을 생성하고, 생성된 데이터신호들을 데이터선들로 공급하기 위한 데이터 구동부와;주사선들로 주사신호를 순차적으로 공급하기 위한 주사 구동부와;상기 주사선들 및 데이터선들의 교차부에 위치되며, 상기 데이터신호에 대응되는 휘도의 빛을 생성하기 위한 화소들과;상기 외부 시스템과 상기 타이밍 제어부 사이에 데이터를 전송하기 위하여 상기 제 1항 내지 제 14항 중 어느 한 항에 기재된 인터페이스 시스템을 구비하는 것을 특징으로 하는 평판 표시장치.
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