KR20050035725A - 어드레싱 전력을 최소화한 방전 디스플레이 장치 및 그구동 방법 - Google Patents

어드레싱 전력을 최소화한 방전 디스플레이 장치 및 그구동 방법 Download PDF

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Abstract

본 발명에 따른 장치는, 방전 디스플레이 패널; 제어부; 이 제어부로부터의 어드레스 신호를 처리하여 표시 데이터 신호들을 발생시키고, 발생된 표시 데이터 신호들을 상기 방전 디스플레이 패널의 어드레스 전극 라인들에 인가하는 어드레스 구동부; 및 이 어드레스 구동부의 전력 회생(recovery) 회로를 포함한 방전 디스플레이 장치이다. 여기서, 전력 회생 회로의 동작 타이밍이 어드레스 전극 라인들에 인가되는 표시 데이터 신호들에 따라 변한다.

Description

어드레싱 전력을 최소화한 방전 디스플레이 장치 및 그 구동 방법{Discharge display apparatus minimizing addressing power, and method for driving the apparatus}
본 발명은, 방전 디스플레이 장치 및 그 구동 방법에 관한 것으로서, 보다 상세하게는, 어드레싱 전력의 회생 회로가 구비된 방전 디스플레이 장치 및 그 구동 방법에 관한 것이다.
도 1은 통상적인 방전 디스플레이 패널로서의 플라즈마 디스플레이 패널의 구조를 보여준다. 도 2는 도 1의 패널의 한 디스플레이 셀의 예를 보여준다. 도 1 및 2를 참조하면, 통상적인 면방전 플라즈마 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm), 유전층(11, 15), Y 전극 라인들(Y1, ..., Yn), X 전극 라인들(X1, ..., Xn), 형광층(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다.
어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)은 뒤쪽 글라스 기판(13)의 앞쪽에 일정한 패턴으로 형성된다. 아래쪽 유전층(15)은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)의 앞쪽에서 전면(全面) 도포된다. 아래쪽 유전층(15)의 앞쪽에는 격벽(17)들이 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 디스플레이 셀의 방전 영역을 구획하고 각 디스플레이 셀 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광층(16)은, 격벽(17)들 사이에서 형성된다.
X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)과 직교되도록 앞쪽 글라스 기판(10)의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 디스플레이 셀을 설정한다. 각 X 전극 라인(X1, ..., Xn)과 각 Y 전극 라인(Y1, ..., Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(도 2의 Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(도 2의 Xnb, Ynb)이 결합되어 형성된다. 앞쪽 유전층(11)은 X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(12) 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전층(11)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.
이와 같은 플라즈마 디스플레이 패널에 일반적으로 적용되는 구동 방식은, 초기화, 어드레스 및 디스플레이 유지 단계가 단위 서브-필드에서 순차적으로 수행되게 하는 방식이다. 초기화 단계에서는 구동될 디스플레이 셀들의 전하 상태가 균일하게 된다. 어드레스 단계에서는, 턴 온(turn on)될 디스플레이 셀들의 전하 상태와 턴 오프(turn off)될 디스플레이 셀들의 전하 상태가 설정된다. 디스플레이 유지 단계에서는, 턴 온(turn on)될 디스플레이 셀들이 디스플레이 방전을 수행한다.
여기서, 상기 단위 서브-필드들이 단위 프레임에 여러개 포함됨으로써, 각 서브-필드의 디스플레이 유지 시간들에 의하여 원하는 계조가 디스플레이될 수 있다.
도 3은 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들에 대한 통상적인 어드레스-디스플레이 분리(Address-Display Separation) 구동 방법을 보여준다. 도 3을 참조하면, 단위 프레임은 시분할 계조 표시를 실현하기 위하여 8 개의 서브-필드들(SF1, ..., SF8)로 분할된다. 또한, 각 서브-필드(SF1, ..., SF8)는 어드레스 주기(A1, ..., A8)와 디스플레이 유지 주기(S1, ..., S8)로 분할된다.
각 어드레스 주기(A1, ..., A8)에서는, 어드레스 전극 라인들(도 1의 AR1, AG1, ..., AGm, ABm)에 표시 데이터 신호가 인가됨과 동시에 각 Y 전극 라인(Y1, ..., Yn)에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가되는 동안에 높은 레벨의 표시 데이터 신호가 인가되면 상응하는 방전셀에서 어드레스 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다.
각 디스플레이 유지 주기(S1, ..., S8)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)과 모든 X 전극 라인들(X1, ..., Xn)에 디스플레이 방전용 펄스가 교호하게 인가되어, 상응하는 어드레스 주기(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 표시 방전을 일으킨다. 따라서 플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 디스플레이 유지 주기(S1, ..., S8)의 길이에 비례한다. 단위 프레임에서 차지하는 디스플레이 유지 주기(S1, ..., S8)의 길이는 255T(T는 단위 시간)이다. 따라서 단위 프레임에서 한 번도 표시되지 않은 경우를 포함하여 256 계조로써 표시할 수 있다.
여기서, 제1 서브-필드(SF1)의 디스플레이 유지 주기(S1)에는 20에 상응하는 시간(1T)이, 제2 서브-필드(SF2)의 디스플레이 유지 주기(S2)에는 21에 상응하는 시간(2T)이, 제3 서브-필드(SF3)의 디스플레이 유지 주기(S3)에는 22에 상응하는 시간(4T)이, 제4 서브-필드(SF4)의 디스플레이 유지 주기(S4)에는 23에 상응하는 시간(8T)이, 제5 서브-필드(SF5)의 디스플레이 유지 주기(S5)에는 24에 상응하는 시간(16T)이, 제6 서브-필드(SF6)의 디스플레이 유지 주기(S6)에는 25에 상응하는 시간(32T)이, 제7 서브-필드(SF7)의 디스플레이 유지 주기(S7)에는 26에 상응하는 시간(64T)이, 그리고 제8 서브-필드(SF8)의 디스플레이 유지 주기(S8)에는 27에 상응하는 시간(128T)이 각각 설정된다.
이에 따라, 8 개의 서브-필드들중에서 표시될 서브-필드를 적절히 선택하면, 어느 서브-필드에서도 표시되지 않는 0(영) 계조를 포함하여 모두 256 계조의 표시가 수행될 수 있음을 알 수 있다.
위와 같은 어드레스-디스플레이 분리 구동 방법에 의하면, 단위 프레임에서 각 서브-필드(SF1, ..., SF8)의 시간 영역이 분리되어 있으므로, 각 서브-필드(SF1, ..., SF8)에서 어드레스 주기와 표시 주기의 시간 영역도 서로 분리되어 있다. 따라서, 어드레스 주기에서 각 XY 전극 라인쌍이 자신의 어드레싱이 수행된 후에 다른 XY 전극 라인쌍들이 모두 어드레싱될 때까지 기다려야 한다. 결국 각 서브-필드에 대하여 어드레스 주기가 차지하는 시간이 길어져 표시 주기가 상대적으로 짧아지므로, 플라즈마 디스플레이 패널로부터 출사되는 빛의 휘도가 상대적으로 낮아지는 문제점이 있다. 이러한 문제점을 개선하기 위하여 알려진 방법이 도 4에 도시된 바와 같은 어드레스-디스플레이 동시(Address-While-Display) 구동 방법이다.
도 4는 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들에 대한 통상적인 어드레스-디스플레이 동시(Address-While-Display) 구동 방법을 보여준다. 도 4를 참조하면, 단위 프레임은 시분할 계조 표시를 위하여 8 개의 서브-필드들(SF1, ..., SF8)로 구분된다. 여기서, 각 단위 서브-필드는 구동되는 Y 전극 라인들(Y1, ..., Yn)을 기준으로 서로 중첩되어 단위 프레임을 구성한다. 따라서, 모든 시점에서 모든 서브-필드들(SF1, ..., SF8)이 존재하므로, 각 어드레스 단계의 수행을 위하여 각 디스플레이 방전용 펄스 사이에 어드레스용 시간 슬롯이 설정된다.
각 서브-필드에서는 리셋, 어드레스 및 디스플레이 유지 단계들이 수행되고, 각 서브-필드에 할당되는 시간은 계조에 상응하는 디스플레이 방전 시간에 의하여 결정된다. 예를 들어, 8 비트 영상 데이터로써 프레임 단위로 256 계조를 표시하는 경우에 단위 프레임(일반적으로 1/60초)이 255 단위 시간으로 이루어진다면, 최하위 비트(Least Significant Bit)의 영상 데이터에 따라 구동되는 제1 서브-필드(SF1)는 1(20) 단위 시간, 제2 서브-필드(SF2)는 2(21) 단위 시간, 제3 서브-필드(SF3)는 4(22) 단위 시간, 제4 서브-필드(SF4)는 8(23) 단위 시간, 제5 서브-필드(SF5)는 16(24) 단위 시간, 제6 서브-필드(SF6)는 32(25) 단위 시간, 제7 서브-필드(SF7)는 64(26) 단위 시간, 그리고 최상위 비트(Most Significant Bit)의 영상 데이터에 따라 구동되는 제8 서브-필드(SF8)는 128(27) 단위 시간을 각각 가진다. 즉, 각 서브-필드들에 할당된 단위 시간들의 합은 255 단위 시간이므로, 255 계조 표시가 가능하며, 여기에 어느 서브-필드에서도 디스플레이 방전이 되지 않는 계조를 포함하면 256 계조 표시가 가능하다.
상기와 같은 통상적인 방전 디스플레이 장치에 있어서, 각 어드레스 주기(도 3의 경우, A1, ..., A8)에서 어드레스 전극 라인들(도 1의 AR1, AG1, ..., AGm, ABm)의 구동 전력을 회생시키기 위한 전력 회생(recovery) 회로가 구비된다. 이 전력 회생(recovery) 회로의 동작 타이밍은 일정하게 설정된다. 하지만, 각 주사 시간에서 턴-온(turn on)될 디스플레이 셀들의 개수가 변함으로 인하여, 방전 디스플레이 패널(도 1의 1)의 캐페시턴스가 변한다. 이에 따라, 상기 전력 회생(recovery) 회로의 동작 타이밍이 방전 디스플레이 패널(1)의 캐페시턴스에 대하여 적절하지 못하여, 어드레싱 전압(VA)의 파형이 왜곡되고 소비 전력이 증대하는 문제점이 있다.
본 발명의 목적은, 어드레싱 전력을 회생시키는 회로의 동작을 개선하여, 어드레싱 전압의 파형이 왜곡되지 않고 소비 전력이 줄어들 수 있는 방전 디스플레이 장치 및 그 구동 방법을 제공하는 것이다.
상기 목적을 이루기 위한 본 발명의 장치는, 방전 디스플레이 패널; 제어부; 상기 제어부로부터의 어드레스 신호를 처리하여 표시 데이터 신호들을 발생시키고, 발생된 표시 데이터 신호들을 상기 방전 디스플레이 패널의 어드레스 전극 라인들에 인가하는 어드레스 구동부; 및 상기 어드레스 구동부의 전력 회생(recovery) 회로를 포함한 방전 디스플레이 장치이다. 여기서, 상기 전력 회생 회로의 동작 타이밍이 상기 어드레스 전극 라인들에 인가되는 표시 데이터 신호들에 따라 변한다.
상기 목적을 이루기 위한 본 발명의 방법은, 방전 디스플레이 패널; 제어부; 상기 제어부로부터의 어드레스 신호를 처리하여 표시 데이터 신호들을 발생시키고, 발생된 표시 데이터 신호들을 상기 방전 디스플레이 패널의 어드레스 전극 라인들에 인가하는 어드레스 구동부; 및 상기 어드레스 구동부의 전력 회생(recovery) 회로를 포함한 방전 디스플레이 장치의 구동 방법이다. 여기서, 상기 전력 회생 회로의 동작 타이밍이 상기 어드레스 전극 라인들에 인가되는 표시 데이터 신호들에 따라 변한다.
본 발명의 상기 방전 디스플레이 장치 및 그 구동 방법에 의하면, 상기 전력 회생 회로의 동작 타이밍이 상기 어드레스 전극 라인들에 인가되는 표시 데이터 신호들에 따라 변한다. 이에 따라, 상기 전력 회생 회로의 동작 타이밍이 상기 방전 디스플레이 패널의 가변적 캐페시턴스에 대하여 적절해질 수 있으므로, 어드레싱 전압의 파형이 왜곡되지 않고 소비 전력이 줄어들 수 있다.
이하, 본 발명에 따른 실시예들이 상세히 설명된다.
도 1 및 5를 참조하면, 본 발명의 일 실시예의 방전 디스플레이 장치는 플라즈마 디스플레이 패널(1), 영상 처리부(66), 제어부(62), 어드레스 구동부(63), X 구동부(64) 및 Y 구동부(65)를 포함한다. 영상 처리부(66)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. 제어부(62)는 영상 처리부(66)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다. 어드레스 구동부(63)는, 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(SA)를 처리하여 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 어드레스 전극 라인들(도 1의 AR1, AG1, ..., AGm, ABm)에 인가한다. X 구동부(64)는 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 X 구동 제어 신호(SX)를 처리하여 X 전극 라인들에 인가한다. Y 구동부(65)는 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 Y 구동 제어 신호(SY)를 처리하여 Y 전극 라인들에 인가한다.
어드레스 구동부(63)는 각 어드레스 주기(도 3의 경우, A1, ..., A8)에서 어드레스 전극 라인들(도 1의 AR1, AG1, ..., AGm, ABm)의 구동 전력을 회생시키기 위한 전력 회생(recovery) 회로를 포함한다. 이 전력 회생 회로의 동작 타이밍은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)에 인가되는 표시 데이터 신호들에 따라 변한다. 이에 따라, 전력 회생 회로의 동작 타이밍이 플라즈마 디스플레이 패널(1)의 가변적 캐페시턴스에 대하여 적절해질 수 있으므로, 어드레싱 전압의 파형이 왜곡되지 않고 소비 전력이 줄어들 수 있다.
도 6은 도 5의 장치의 어드레스 구동부(63)에 포함된 전력 회생(recovery) 회로(63b)를 보여준다. 도 1, 5 및 6을 참조하면, 어드레스 구동 회로(63)는, 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(SA)를 처리하여 표시 데이터 신호들(SAR1, SAG1, ..., SAGm, SABm)을 발생시키고, 발생된 표시 데이터 신호들을 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)에 인가한다. 이 어드레스 구동 회로(63)의 전원 전압(VA) 즉, 어드레싱 전압은 전력 회생(recovery) 회로(63b)의 동작에 의하여 제어된다. 그 이유는, 표시 데이터 신호들(SAR1, SAG1, ..., SAGm, SABm)의 인가가 종료되는 시점에서 플라즈마 디스플레이 패널(1)의 디스플레이 셀들에 불필요하게 남아 있는 전하들을 수집하고, 표시 데이터 신호들(SAR1, SAG1, ..., SAGm, SABm)의 인가가 시작되는 시점에서 상기 수집된 전하들을 디스플레이 셀들에 인가하기 위함이다. 전력 회생(recovery) 회로(63b)에서 공진 코일(LPR)의 인덕턴스는 플라즈마 디스플레이 패널(1)의 평균 동작 캐페시턴스에 대하여 공진을 수행할 수 있도록 설정된다.
이 전력 회생 회로(63b)의 동작 타이밍은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)에 인가되는 표시 데이터 신호들에 따라 변한다. 즉, 전력 회생 회로(63b)의 동작 타이밍은 각 주사 주기에서 턴-온(turn on)될 디스플레이 셀들의 개수에 따라 변한다. 이에 따라, 전력 회생 회로(63b)의 동작 타이밍이 플라즈마 디스플레이 패널(1)의 가변적 캐페시턴스에 대하여 적절해질 수 있으므로, 어드레싱 전압의 파형이 왜곡되지 않고 소비 전력이 줄어들 수 있다.
도 7은 도 6의 전력 회생(recovery) 회로(63b)의 동작 타이밍을 보여준다. 도 7에서 참조 부호 SVPP는 어드레스 구동 회로(도 6의 63a)의 전원 전압 단자(도 6의 VPP)에 인가되는 전원 전압 신호를 가리킨다. 참조 부호 SS1은 제1 스위치(도 6의 S1)의 제어 신호를, SS2는 제2 스위치(도 6의 S2)의 제어 신호를, SS3은 제3 스위치(도 6의 S3)의 제어 신호를, 그리고 SS4는 제4 스위치(도 6의 S4)의 제어 신호를 각각 가리킨다. 참조 부호 TS는 단위 주사 시간을, VG는 접지 전압을, 그리고 VON은 각 스위치(S1 내지 S4)의 턴-온(turn on)을 위한 제어 전압을 가리킨다.
도 6 및 7을 참조하여, 어드레싱 주기(도 3의 경우 A1 내지 A8)의 단위 주사 시간(TS)에서의 전력 회생(recovery) 회로(63b)의 동작을 단계적으로 설명하면 다음과 같다.
표시 데이터 신호(SAR1, SAG1, ..., SAGm, SABm)의 인가가 종료되는 시점(t5)에 있어서, 제2 스위치(S2)만이 턴 온(turn on)됨에 의하여, 플라즈마 디스플레이 패널(1)의 디스플레이 셀들에 불필요하게 남아 있는 전하들이 어드레스 구동 회로(63a)의 전원전압 인가 단자(VPP), 공진 코일(LPR) 및 제2 스위치(S2)를 통하여 충방전용 캐페시터(CPR)에 수집된다.
다음에, 제4 스위치(S4)만이 턴 온(turn on)됨에 의하여, 어드레스 구동 회로(63)의 전원 전압(VA)은 접지 전압이 된다.
여기서, 제4 스위치(S4)만이 턴 온(turn on)되는 시점은 제2 스위치(S2)가 턴-오프(turn off)되는 시점에 따라 결정된다. 제2 스위치(S2)가 턴-오프(turn off)되는 시점은 t6 내지 t7 시간 사이에서 표시 데이터 신호들(SAR1, SAG1, ..., SAGm, SABm)에 따라 결정된다. 보다 상세하게는, 단위 주사 시간(TS)에서의 플라즈마 디스플레이 패널(1)의 캐페시턴스에 비례하는 턴-온(turn on)될 디스플레이 셀들의 개수에 비례하여 제2 스위치(S2)의 턴-오프(turn off) 시점이 지연된다. 즉, 단위 주사 시간(TS)에서의 플라즈마 디스플레이 패널(1)의 캐페시턴스에 비례하는 턴-온(turn on)될 디스플레이 셀들의 개수에 비례하여, 디스플레이 셀들에 불필요하게 남아 있는 전하들을 수집하는 시간이 변한다.
다음에, 표시 데이터 신호(SAR1, SAG1, ..., SAGm, SABm)의 인가가 시작되는 시점(t2)에 있어서, 제1 스위치(S1)만이 턴 온(turn on)됨에 의하여, 충방전용 캐페시터(CPR)에 수집되었던 전하들이 제1 스위치(S1), 공진 코일(LPR) 및 어드레스 구동 회로(63a)의 전원전압 인가 단자(VPP)를 통하여 플라즈마 디스플레이 패널(1)의 디스플레이 셀들에 인가된다.
그리고, 제3 스위치(S1)만이 턴 온(turn on)됨에 의하여, 어드레스 구동 회로(63a)에 전원 전압(VA)이 인가되고, 표시 데이터 신호(SAR1, SAG1, ..., SAGm, SABm)의 인가가 진행된다.
여기서, 제3 스위치(S3)만이 턴 온(turn on)되는 시점은 제1 스위치(S1)가 턴-오프(turn off)되는 시점에 따라 결정된다. 제1 스위치(S1)가 턴-오프(turn off)되는 시점은 t3 내지 t4 시간 사이에서 표시 데이터 신호들(SAR1, SAG1, ..., SAGm, SABm)에 따라 결정된다. 보다 상세하게는, 단위 주사 시간(TS)에서의 플라즈마 디스플레이 패널(1)의 캐페시턴스에 비례하는 턴-온(turn on)될 디스플레이 셀들의 개수에 비례하여 제1 스위치(S1)의 턴-오프(turn off) 시점이 지연된다. 즉, 단위 주사 시간(TS)에서의 플라즈마 디스플레이 패널(1)의 캐페시턴스에 비례하는 턴-온(turn on)될 디스플레이 셀들의 개수에 비례하여, 상기 수집된 전하들을 상기 디스플레이 셀들에 인가하는 시간이 변한다.
상기 단계들은, 각각의 XY 전극 라인쌍에 대하여 주기적 및 순차적으로 주사가 수행됨에 동기하여, 주기적 및 지속적으로 반복 수행된다.
본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.
이상 설명된 바와 같이, 본 발명에 따른 방전 디스플레이 장치 및 그 구동 방법에 의하면, 전력 회생 회로의 동작 타이밍이 어드레스 전극 라인들에 인가되는 표시 데이터 신호들에 따라 변한다. 이에 따라, 전력 회생 회로의 동작 타이밍이 방전 디스플레이 패널의 가변적 캐페시턴스에 대하여 적절해질 수 있으므로, 어드레싱 전압의 파형이 왜곡되지 않고 소비 전력이 줄어들 수 있다.
도 1은 통상적인 방전 디스플레이 패널로서의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다.
도 2는 도 1의 패널의 한 디스플레이 셀의 예를 보여주는 단면도이다.
도 3은 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들에 대한 통상적인 어드레스-디스플레이 분리(Address-Display Separation) 구동 방법을 보여주는 타이밍도이다.
도 4는 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들에 대한 통상적인 어드레스-디스플레이 동시(Address-While-Display) 구동 방법을 보여주는 타이밍도이다.
도 5는 본 발명의 일 실시예의 방전 디스플레이 장치로서의 플라즈마 디스플레이 장치를 보여주는 블록도이다.
도 6은 도 5의 장치의 어드레스 구동부에 포함된 전력 회생(recovery) 회로를 보여주는 도면이다.
도 7은 도 6의 전력 회생(recovery) 회로의 동작 타이밍을 보여주는 도면이다.
<도면의 주요 부분에 대한 부호의 설명>
1...플라즈마 디스플레이 패널, 10...앞쪽 글라스 기판,
11, 15...유전층, 12...보호층,
13...뒤쪽 글라스 기판, 14...방전 공간,
16...형광층, 17...격벽,
X1, ..., Xn...X 전극 라인, Y1, ..., Yn...Y 전극 라인,
A1, ..., Am...어드레스 전극 라인, Xna, Yna...투명 전극 라인,
Xnb, Ynb...금속 전극 라인, SF1, ...SF8...서브-필드,
62...논리 제어부,63..어드레스 구동부,
64...X 구동부,65...Y 구동부,
66...영상 처리부,63a...어드레스 구동 회로,
63b...전력 회생(recovery) 회로,VA...어드레싱 전압,

Claims (13)

  1. 방전 디스플레이 패널; 제어부; 상기 제어부로부터의 어드레스 신호를 처리하여 표시 데이터 신호들을 발생시키고, 발생된 표시 데이터 신호들을 상기 방전 디스플레이 패널의 어드레스 전극 라인들에 인가하는 어드레스 구동부; 및 상기 어드레스 구동부의 전력 회생(recovery) 회로를 포함한 방전 디스플레이 장치에 있어서,
    상기 전력 회생 회로의 동작 타이밍이 상기 어드레스 전극 라인들에 인가되는 표시 데이터 신호들에 따라 변하는 방전 디스플레이 장치.
  2. 제1항에 있어서,
    상기 전력 회생 회로의 동작 타이밍이 상기 표시 데이터 신호들에 따른 상기 방전 디스플레이 패널의 캐페시턴스에 따라 변하는 방전 디스플레이 장치.
  3. 제2항에 있어서,
    상기 전력 회생 회로의 동작 타이밍이 턴-온(turn on)될 디스플레이 셀들의 개수에 따라 변하는 방전 디스플레이 장치.
  4. 제1항에 있어서, 상기 전력 회생 회로가,
    상기 표시 데이터 신호의 인가가 종료되는 시점에서 상기 디스플레이 셀들에 불필요하게 남아 있는 전하들을 수집하고, 상기 표시 데이터 신호의 인가가 시작되는 시점에서 상기 수집된 전하들을 상기 디스플레이 셀들에 인가하는 방전 디스플레이 장치.
  5. 제4항에 있어서,
    상기 디스플레이 셀들에 불필요하게 남아 있는 전하들을 수집하는 시간이 상기 표시 데이터 신호들에 따른 상기 방전 디스플레이 패널의 캐페시턴스에 비례하는 방전 디스플레이 장치.
  6. 제5항에 있어서,
    상기 디스플레이 셀들에 불필요하게 남아 있는 전하들을 수집하는 시간이 턴-온(turn on)될 디스플레이 셀들의 개수에 비례하는 방전 디스플레이 장치.
  7. 제4항에 있어서,
    상기 수집된 전하들을 상기 디스플레이 셀들에 인가하는 시간이 상기 표시 데이터 신호들에 따른 상기 방전 디스플레이 패널의 캐페시턴스에 비례하는 방전 디스플레이 장치.
  8. 제7항에 있어서,
    상기 수집된 전하들을 상기 디스플레이 셀들에 인가하는 시간이 턴-온(turn on)될 디스플레이 셀들의 개수에 비례하는 방전 디스플레이 장치.
  9. 제4항에 있어서,
    상기 디스플레이 셀들에 불필요하게 남아 있는 전하들을 수집하는 시간 및 상기 수집된 전하들을 상기 디스플레이 셀들에 인가하는 시간이 상기 표시 데이터 신호들에 따른 상기 방전 디스플레이 패널의 캐페시턴스에 비례하는 방전 디스플레이 장치.
  10. 제9항에 있어서,
    상기 디스플레이 셀들에 불필요하게 남아 있는 전하들을 수집하는 시간 및 상기 수집된 전하들을 상기 디스플레이 셀들에 인가하는 시간이 턴-온(turn on)될 디스플레이 셀들의 개수에 비례하는 방전 디스플레이 장치.
  11. 방전 디스플레이 패널; 제어부; 상기 제어부로부터의 어드레스 신호를 처리하여 표시 데이터 신호들을 발생시키고, 발생된 표시 데이터 신호들을 상기 방전 디스플레이 패널의 어드레스 전극 라인들에 인가하는 어드레스 구동부; 및 상기 어드레스 구동부의 전력 회생(recovery) 회로를 포함한 방전 디스플레이 장치의 구동 방법에 있어서,
    상기 전력 회생 회로의 동작 타이밍이 상기 어드레스 전극 라인들에 인가되는 표시 데이터 신호들에 따라 변하는 방전 디스플레이 장치의 구동 방법.
  12. 제11항에 있어서,
    상기 전력 회생 회로의 동작 타이밍이 상기 표시 데이터 신호들에 따른 상기 방전 디스플레이 패널의 캐페시턴스에 따라 변하는 방전 디스플레이 장치의 구동 방법.
  13. 제12항에 있어서,
    상기 전력 회생 회로의 동작 타이밍이 턴-온(turn on)될 디스플레이 셀들의 개수에 따라 변하는 방전 디스플레이 장치의 구동 방법.
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