KR100421014B1 - 플라즈마 디스플레이 패널 구동 시스템의 자기 결합인덕터를 이용한 전력 회수 장치 및 설계 방법 - Google Patents

플라즈마 디스플레이 패널 구동 시스템의 자기 결합인덕터를 이용한 전력 회수 장치 및 설계 방법 Download PDF

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Abstract

본 발명은 플라즈마 디스플레이 패널 구동 장치 및 방법에 관한 것으로서, 특히 자기 결합 인덕터 회로를 이용하여 절연 게이트 드라이버를 추가하지 않고 낮은 무효 전력 및 방열량을 줄이기 위한 플라즈마 디스플레이 패널 구동을 위한 자기 결합 인덕터를 이용한 전력 회수 장치 및 설계 방법에 관한 것이다.
본 발명에 의하면 PDP 충/방전 시에 전력 회수를 위한 회로에 자기 결합 인덕터를 적용하고, 전력 회수 회로의 스위칭 소자의 소오스 단자를 접지에 연결시키도록 설계함으로써, 무효 전력의 회수율을 향상시킬 수 있는 효과가 발생되며, 스위칭 손실이 0이 되도록 하며, 패널 전압의 스텝 변화를 발생시키지 않아 EMI를 줄일 수 있는 효과가 발생되며, 게이트 드라이브 단의 회로 구성을 간략화시킬 수 있을 뿐만 아니라 종래의 PDP 구동 회로에 비하여 회로 소자 수를 줄일 수 있는 효과가 발생된다.

Description

플라즈마 디스플레이 패널 구동 시스템의 자기 결합 인덕터를 이용한 전력 회수 장치 및 설계 방법{Energy recovery apparatus and energy recovery circuit design method using a coupled inductor in the plasma display panel drive system}
본 발명은 플라즈마 디스플레이 패널 구동 장치 및 방법에 관한 것으로서,특히 자기 결합 인덕터 회로를 이용하여 절연 게이트 드라이버를 추가하지 않고 낮은 무효 전력 및 방열량을 줄이기 위한 플라즈마 디스플레이 패널 구동을 위한 자기 결합 인덕터를 이용한 전력 회수 장치 및 설계 방법에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널(Plasma Display Panel ; PDP)은 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 차세대 평판 디스플레이 장치로서, 플라즈마 디스플레이 패널은 크기에 따라 수십에서 수백만개 이상의 픽셀이 매트릭스(matrix)형태로 배열되어 있다.
도 1은 종래 기술에 해당되는 Webber에 의해 제안된 AC-PDP 유지 방전 회로의 구성도이다. AC-PDP의 경우 디스플레이 패널은 패널 커패시턴스(capacitance) Cp를 가지는 부하로 가정할 수 있다. PDP 구동 회로의 기본적인 동작은 미국 특허 공보번호 US4,866,349에 설명되어 있다.
도 2(a)-(j)는 스위칭 시퀀스에 따른 출력 전압 Vp와 인덕터 Lc에 흐르는 전류 IL의 파형을 나타낸다. AC-PDP 유지 방전 회로는 스위칭 시퀀스에 따라 다음과 같이 4개의 모드로 나타낼 수 있다.
1) 모드 1
MOSFET 스위치 Sa1이 도통되기 직전에 Sx2는 도통되어 있고 패널의 양단 전압 Vp는 0V로 유지되어 있다. t0에서 Sa1이 도통되면 모드 1의 동작이 시작된다. 이 구간 동안 Cc1-Sa1-Da1-Lc1-C(panel)의 경로로 LC 공진회로가 형성되어, Lc1 인덕터에 공진 전류가 흐르고 Vp는 증가한다. t1에서 인덕터 Lc1의 전류는 0, Vp는 +Vpk가 된다.
2) 모드 2
t1에서 Sa1은 차단되고, Sy1이 도통된다. 이 때 Sy1의 양단 전압은 t1에서 Vpk에서 만큼 스텝 변화를 가지게 되어 스위칭 손실이 발생된다. 모드 2 구간동안 Vp는 +Vs로 유지하고 패널은 방전을 유지한다.
3) 모드 3
t2에서 Sa2가 도통되고 Sy1이 차단된다. 모드 3 구간동안 C(panel)-Lc1-Da2-Sa2-Cc1의 경로로 LC 공진회로가 형성되어, Lc1 인덕터에 공진 전류가 흐르고 Vp는 감소한다. t3에서 인덕터 Lc1의 전류는 0, Vp는 -Vpk가 된다.
4) 모드 4
t3에서 Sa2는 차단되고 Sy2가 도통된다. 이 때 Sy2의 양단 전압은 t3에서 -Vpk이므로 스위칭 손실이 발생하게 된다. 모드 4 구간 동안 Vp는 0V로 유지한다. t0에서 Sx2가 차단되고, Sb1이 도통되면 다른 반주기 동안 반복된다.
이와 같은 종래의 기술에 의한 전력 회수 회로는 4개의 스위치가 필요하여 게이트 드라이버(gate driver)가 많아지고, 전력 회수부의 스위치가 접지에 연결되지 않아 아이솔레이션 게이트 드라이버(isolation gate driver)를 써야 하므로 고주파 스위칭시 이상적인 스위칭이 용이하지 않다. 즉 스위칭 온(on) 신호가 매우 짧을 때(300ns) 아이솔레이션 게이트 드라이버의 지연 시간 등으로 실제로 스위칭 온 되지 않을 수도 있게 되어 오동작이 발생되는 문제점이 있었다. 뿐만 아니라 패널 저항 소자, 소자 저항 등의 존재시 도 2(i)와 같이 패널 전압에 스텝 변화가 생겨 EMI 및 무효 전력이 커지게 되는 문제점이 있었다.
본 발명이 이루고자 하는 기술적 과제는 상술한 문제점을 해결하기 위하여 자기결합 인덕터 회로를 이용하여 전력회수 회로의 소자 수를 줄이고, 무효전력 및 EMI를 줄이기 위한 자기 결합 인덕터를 이용한 전력 회수 장치 및 설계 방법을 제공하는데 있다.
도 1은 종래의 기술에 의한 플라즈마 디스플레이 패널 구동 장치의 구성도이다.
도 2(a)-(j)는 도 1의 플라즈마 디스플레이 패널 구동 장치에 적용되는 주요신호의 파형도이다.
도 3은 본 발명에 의한 자기 결합 인덕터를 이용한 전력 회수 장치의 구성도이다.
도 4(a)-(i)는 도 3의 전력 회수 회로에 적용되는 주요 신호의 파형도이다.
도 5는 본 발명에 의한 자기 결합 인덕터를 이용한 전력 회수 장치가 적용된 플라즈마 디스플레이 패널 구동 시스템의 구성도이다.
상기 기술적 과제를 달성하기 위하여 본 발명에 의한 자기 결합 인덕터를 이용한 전력 회수 장치는 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 장치에 있어서, 소정의 전력 회수 시이퀀스 스위칭 제어신호에 상응하여 입력단자와 접지와의 전기적 도통/차단을 스위칭하기 위한 제1,2스위칭 수단 및 상기 플라즈마 디스플레이 패널의 양 단자에 1차 코일 및 2차 코일의 각각의 제1단자가 접속되고, 상기 1차 코일 및 2차 코일의 각각의 제2단자는 상기 제1,2스위칭 수단의 각각의 입력단자에 접속되어, 상기 1,2차 코일이 자기적으로 결합된 자기 결합 인덕터를 포함함을 특징으로 한다.
상기 다른 기술적 과제를 달성하기 위하여 본 발명에 의한 자기 결합 인덕터를 이용한 전력 회수 회로 설계 방법은 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 회로 설계 방법에 있어서, 1차 코일 및 2차 코일이 자기적으로 결합된 자기 결합 인덕터를 상기 플라즈마 디스플레이 패널의 양 단자에 연결하고, 소정의 전력 회수 시이퀀스에 상응하여 상기 1차 및 2차 코일의 전류를 접지로 도통시키거나 차단시키는 스위칭 프로세스에 의하여, 서스테인 구간에서의 충/방전 모드에서상기 플라즈마 디스플레이 패널의 전압을 선형적으로 충방전시키도록 전력 회수 회로를 설계함을 특징으로 한다.
이하 첨부된 도면을 참조하여 본 발명의 바람직한 실시 예에 대하여 상세히 설명하기로 한다.
도 3에 도시된 바와 같이, 본 발명에 의한 자기 결합 인덕터를 이용한 전력 회수 장치는 스캔 전극 서스테인 스위칭 회로(10), 공통 전극 서스테인 스위칭 회로(20), 전력 회수부(30), 플라즈마 디스플레이 패널(40; CP) 및 제1,2비절연 게이트 드라이버(50-1, 50-2; GD1, GD2)를 구비한다.
스캔 전극 서스테인 스위칭 회로(10) 및 공통 전극 서스테인 회로(20)는 PDP 발광 기간 동안 패널(CP)에 고주파의 교류 구형파 전압을 인가하기 위한 복수의 스위치(Sy1, Sy2, Sx1, Sx2)들로 구성되어 있으며, 발광 기간 동안 (Sy1, Sy2), (Sx1, Sx2)의 쌍으로 교대로 도통/차단을 반복한다.
전력 회수부(30)는 서스테인 구간 동안에 패널 전압 및 커패시터 무효 전류(capacitive displacement current)의 급격한 변화를 막아 소비전력을 억제하기 위한 회로로서, 구체적으로 자기 결합 인덕터(CI), 2개의 스위치(Sa, Sb) 및 2개의 다이오드(Da, Db)로 구성된다. 다이오드 Da, Db는 부품수 감소를 위하여 MOSFET 스위치 Sa, Sb의 내장된 바디 다이오드(body diode)를 이용할 수 있으며, 경우에 따라서는 성능 향상을 위하여 MOSFET 스위치 Sa, Sb의 드레인-소오스 단자에 부가로 추가하여 설계할 수도 있다. 그리고, 자기 결합 인덕터(CI)는 1차측-2차측 권선수의 비를 1:1로 설계하는 것이 효과적이며, 1차측 인덕턴스는 La로, 2차측인덕턴스는 Lb로 표시한다.
이에 따라서, 본 발명에 의한 회로 구성에 의한 전력 회수부(30)의 스위치 Sa, Sb는 소오스 단자가 접지에 연결되어 있어서 boot strap 회로 등 절연 게이트 드라이버(isolated gate driver)가 필요하지 않아 전체 회로가 간략해지고 고주파 저손실 게이트 드라이버 설계가 용이해 진다.
도 4는 본 발명에 의한 전력 회수 회로의 주요 전압/전류 파형도이다. 기본적으로 서스테인 스위치의 on/off 구동신호는 기존의 회로의 on/off 구동신호와 동일하다. 그러면, 각 스위칭 신호 인가시 전력 회수 장치의 동작원리를 모드별로 세부적으로 나누어 설명하면 다음과 같다.
1) 모드 1(t0-t1)
t=t0 직전의 시간에는 스위치 Sy1과 Sx2가 도통되어 패널 전압 Vp는 Vs로 유지되어 방전을 서스테인하고 있다. t=t0에서, 전력회수부 스위치 Sa가 도통하면, 결합 인덕터(coupled inductor)의 La의 전류 iLa는 Vs/La의 기울기로 선형적으로 증가한다. t=t1에서 iLa(t1)는 Vs(t1-t0)/La가 된다. 이 구간동안 다이오드 Db는 역방향 바이어스가 걸려 Lb의 전류는 영이 된다. t=t1에서 Sy1이 차단되면 모드 1은 끝난다.
2) 모드 2(t1-t2)
t=t1에서 스위치 Sy1이 차단되면 공진 경로 Sx2-Cp-La-Sa의 경로로 패널이 서서히 방전하여 Vp는 감소하게 된다. 모드 2동안 iLa및 Vp는 수학식 1과 같이 표현된다.
여기서,,
여기에서 주목할 점은 종래의 기술에 의한 회로와 달리 iLa(t1)의 존재로 기생 저항의 존재 시에도 Vp가 정확히 0V로 감소하도록 할 수 있다는 점이다. Vp가 영이 되면 모드 2는 끝난다.
3) 모드 3(t2-t3)
t=t2에서 Vp가 영이 되면 결합 인덕터(coupled inductor)의 전압이 영이 되고, 1차측으로 흐르던 전류 iLa(t2)는 절반의 값으로 각각 Dy2(Sy2의 body diode)-La-Sa와 Db-Lb-Sx2의 경로로 흐르도록 유지된다. 이 구간 동안 스위치 Sy2를 턴 온(turn on)하면, 다이오드 Dy2가 도통된 상태이므로 영전압 스위칭으로 스위칭 손실없이 턴 온 할 수 있다. 패널 전압 Vp는 이 구간 동안 Sx2-Cp-Sy2의 경로로 영으로 유지된다. t=t3에서 스위칭 Sx2가 차단되면 모드 3은 끝난다.
4) 모드 4(t3-t4)
t=t4에서 Sx2가 차단되면, 인덕터는 흐르던 전류를 유지하려는 성질 때문에전압 극성이 반전되어 인덕터의 끝점은 음이 된다. 이 때 1차측(La) 전류는 2차측으로 전달되어 다시 iLa(t2)의 초기값을 가지고, 공진 경로 Db-Lb-Cp-Sy2의 경로로 패널이 충전하게 된다. 모드 4 동안 iLb및 Vp는 수학식 3, 4와 같이 표현된다.
여기에서, iLa(t2)를 적절히 크도록 설계하면, 패널 전압 Vp는 -Vs까지 서서히 충전하여 정확히 Vs까지 증가하도록 설계가 가능하다. 그 조건에서 t=t4 시 Vp는 -Vs가 되고 모드 4는 끝난다.
5) 모드 5(t4-t5)
t=t4에서 패널 전압이 -Vs가 되면, 2차측 전류 iLb는 경로 Db-Lb-Dx1(Sx1의 body diode)의 경로로 기울기 -Vs/Lb로 선형적으로 감소한다. Dx1이 도통되어 있으므로 스위치 Sx1을 턴 온 하면 영전압 스위칭으로 스위칭 손실 없이 턴 온 할 수 있게 된다. 이 구간동안 패널 전압은 -Vs가 되어 서스테인을 유지한다. t=t5에서 iLb가 영이 되면 모드 5는 끝난다.
6) 모드 6(t5-t0')
t=t5에서 iLb가 영이 되고 회로는 가스-방전(gas-discharging) 전류만 서스테인하여 패널의 발광을 유지하게 된다. 보통 모드 5와 모드 6의 시간은 패널 및 방전의 특성에 따라 설계 규격으로 주어진다. t=t0'에서 전력 회수 스위칭 Sb가 턴 온 하면 다른 반주기 동작을 반복한다.
도 4는 본 발명에 의한 자기 결합 인덕터를 이용한 전력 회수 장치를 적용한 플라즈마 디스플레이 패널 구동 장치의 구성도로서, 스캔 전극 드라이브 보드(Scan Electrode Drive Board ; 100), 공통 전극 드라이브 보드(Common Electrode Drive Board ; 200), 플라즈마 디스플레이 패널(300), 어드레스 스캔 드라이브 IC(400) 및 전력 회수부(500)로 구성되는 것을 특징으로 한다.
공통 전극 드라이브 보드(200)에는 X전극 서스테인 스위치(Sx1, Sx2), X전극 램프 파형 발생 회로(Xrr, Ds, Rs 및 램프신호 발생회로)가 내장되며, 스캔 전극 드라이브 보드(100)에는 Y전극 서스테인 스위치(Sy1, Sy2), Y전극 램프 파형 발생 회로(Yfr, Yrr, Cset, Dset, Rset 및 램프신호 발생회로), 분리회로(Yp) 및 스캔 펄스 발생 회로(100a, Ysc, Ysp, D_Ysink, Rsc, Dsc, C_Ysink)가 내장된다.
그리고, 공통 전극 드라이브 보드(200)와 스캔 전극 드라이브 보드(100)는 플라즈마 디스플레이 패널(300)의 X전극 단자 및 Y전극 단자에 각각 연결되어 있으며, 또한 플라즈마 디스플레이 패널(300)의 어드레스 단자에는 어드레스 드라이브 IC(400)가 연결되어 있다.
또한, 본 발명에서 제안한 전력 회수부(500)를 구성하는 자기 결합 인덕터의 1차측 및 2차측 코일은 각각 스캔 전극 드라이브 보드(100) 및 공통 전극 드라이브 보드(200)에 케이블 또는 PCB 패턴에 의하여 전기적으로 연결된다.
스캔 전극 및 공통 전극 서스테인 스위치들은 PDP 발광 기간 동안 패널(40; CP)에 고주파의 교류 구형파 전압을 인가하기 위한 역할을 실행한다.
분리 회로(Yp)는 ADS(Address Display Separation)방식에서 PDP(40)의 서스테인 구간과 다른 구간(어드레스 구간과 리세트 구간)의 회로 동작 분리를 위한 스위치이다.
X,Y전극 램프 파형 발생 회로는 리세트 구간동안 패널에 램프형 고압 전압을 발생시키기 위한 회로이다.
스캔 펄스 발생 회로는 어드레스 구간동안 쉬프트 레지스터 +전압 버퍼로 구성된 스캔 드라이버 IC(100a)가 PDP 스크린의 수평 동기신호 인가를 위한 동작을 하고, 다른 구간에서는 단락된다.
위의 회로에 포함된 각종 스위치들은 일 실시 예로써 전계효과 트랜지스터(MOSFET)로 구성한다.
서스테인 구간에서 전력 회수를 위한 플라즈마 디스플레이 패널 구동 동작 및 스위칭 시퀀스는 위에서 언급한 도 3 및 도 4에 도시된 회로 구성 및 파형 설명과 동일하므로 세부적인 동작 설명은 생략하기로 한다.
본 발명은 방법, 장치, 시스템 등으로서 실행될 수 있다. 소프트웨어로 실행될 때, 본 발명의 구성 수단들은 필연적으로 필요한 작업을 실행하는 코드 세그먼트들이다. 프로그램 또는 코드 세그먼트들은 프로세서 판독 가능 매체에 저장되어 질 수 있으며 또는 전송 매체 또는 통신망에서 반송파와 결합된 컴퓨터 데이터 신호에 의하여 전송될 수 있다. 프로세서 판독 가능 매체는 정보를 저장 또는 전송할수 있는 어떠한 매체도 포함한다. 프로세서 판독 가능 매체의 예로는 전자 회로, 반도체 메모리 소자, ROM, 플레쉬 메모리, E2PROM, 플로피 디스크, 광 디스크, 하드 디스크, 광 섬유 매체, 무선 주파수(RF) 망, 등이 있다. 컴퓨터 데이터 신호는 전자 망 채널, 광 섬유, 공기, 전자계, RF 망, 등과 같은 전송 매체 위로 전파될 수 있는 어떠한 신호도 포함된다.
첨부된 도면에 도시되어 설명된 특정의 실시 예들은 단지 본 발명의 예로서 이해되어 지고, 본 발명의 범위를 한정하는 것이 아니며, 본 발명이 속하는 기술 분야에서 본 발명에 기술된 기술적 사상의 범위에서도 다양한 다른 변경이 발생될 수 있으므로, 본 발명은 보여지거나 기술된 특정의 구성 및 배열로 제한되지 않는 것은 자명하다.
상술한 바와 같이, 본 발명에 의하면 PDP 충/방전 시에 전력 회수를 위한 회로에 자기 결합 인덕터를 적용하고, 전력 회수 회로의 스위칭 소자의 소오스 단자를 접지에 연결시키도록 설계함으로써, 무효 전력의 회수율을 향상시킬 수 있는 효과가 발생되며, 스위칭 손실이 0이 되도록 하며, 패널 전압의 스텝 변화를 발생시키지 않아 EMI를 줄일 수 있는 효과가 발생되며, 게이트 드라이브 단의 회로 구성을 간략화시킬 수 있을 뿐만 아니라 종래의 PDP 구동 회로에 비하여 회로 소자 수를 줄일 수 있는 효과가 발생된다.

Claims (16)

  1. 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 장치에 있어서,
    소정의 전력 회수 시이퀀스 스위칭 제어신호에 상응하여 입력단자와 접지와의 전기적 도통/차단을 스위칭하기 위한 제1,2스위칭 수단; 및
    상기 플라즈마 디스플레이 패널의 양 단자에 1차 코일 및 2차 코일의 각각의 제1단자가 접속되고, 상기 1차 코일 및 2차 코일의 각각의 제2단자는 상기 제1,2스위칭 수단의 각각의 입력단자에 접속되어, 상기 1,2차 코일이 자기적으로 결합된 자기 결합 인덕터를 포함함을 특징으로 하는 자기 결합 인덕터를 이용한 전력 회수 장치.
  2. 제1항에 있어서, 상기 자기 결합 인덕터의 1차측 및 2차측 코일의 권선수의 비는 1:1로 설계함을 특징으로 하는 자기 결합 인덕터를 이용한 전력 회수 장치.
  3. 제1항에 있어서, 상기 제1,2스위칭 수단은 각각 MOSFET 스위치임을 특징으로 하는 자기 결합 인덕터를 이용한 전력 회수 장치.
  4. 제3항에 있어서, 상기 MOSFET 스위치의 드레인 단자와 소오스 단자 사이에 다이오드를 부가함을 특징으로 하는 자기 결합 인덕터를 이용한 전력 회수 장치.
  5. 제4항에 있어서, 상기 다이오드는 상기 MOSFET 스위치에 내장된 바디 다이오드를 이용함을 특징으로 하는 자기 결합 인덕터를 이용한 전력 회수 장치.
  6. 제3항에 있어서, 상기 MOSFET 스위치의 소오스 단자는 접지에 연결되고, 드레인 단자는 상기 자기 결합 인덕터에 연결되며, 게이트 단자에는 비절연 게이트 드라이버의 출력단자가 결합된 회로 구조를 갖는 것을 특징으로 하는 자기 결합 인덕터를 이용한 전력 회수 장치.
  7. 제1항에 있어서, 서스테인 구간의 충/방전 모드에서 상기 자기 결합 인덕터의 전류는 선형적으로 가변됨을 특징으로 하는 자기 결합 인덕터를 이용한 전력 회수 장치.
  8. 리세트 구간, 어드레스 구간 및 서스테인 구간을 반복하는 스위칭 시퀀스에 의한 플라즈마 디스플레이 패널 구동 장치에 있어서,
    서스테인 구간 동안에 상기 플라즈마 디스플레이 패널의 Y전극에 고주파의 구형파 전압을 인가시키기 위한 Y전극 서스테인 스위칭 회로;
    서스테인 구간과 어드레스 구간 및 리세트 구간의 회로 동작을 분리시키기 위한 분리 회로;
    리세트 구간 동안에 상기 플라즈마 디스플레이 패널의 Y전극에 램프형 고압 전압을 인가시키기 위한 Y전극 램프 파형 발생회로;
    어드레스 구간 동안 수평동기신호를 인가하고, 그 외의 구간에서는 단락되는 스캔 펄스 발생회로;
    서스테인 구간 동안에 상기 플라즈마 디스플레이 패널의 X전극에 고주파의 구형파 전압을 인가시키기 위한 X전극 서스테인 스위칭 회로;
    리세트 구간 동안에 상기 플라즈마 디스플레이 패널의 X전극에 램프형 고압 전압을 인가시키기 위한 X전극 램프 파형 발생회로; 및
    서스테인 구간의 상기 플라즈마 디스플레이 패널의 충/방전 시에 상기 플라즈마 디스플레이 패널의 양 단자에 자기 결합 인덕터로 구성된 전력 회수 회로를 포함하여, 상기 플라즈마 디스플레이 패널의 전압을 선형적으로 충방전시키도록 스위칭 시이퀀스를 제어함을 특징으로 하는 플라즈마 디스플레이 패널 구동 장치.
  9. 제8항에 있어서, 상기 전력 회수 회로는
    소정의 전력 회수 시이퀀스 스위칭 제어신호에 상응하여 입력단자와 접지와의 전기적 도통/차단을 스위칭하기 위한 제1,2스위칭 수단; 및
    상기 플라즈마 디스플레이 패널의 X,Y 단자에 1차 코일 및 2차 코일의 각각의 제1단자가 접속되고, 상기 1차 코일 및 2차 코일의 각각의 제2단자는 상기 제1,2스위칭 수단의 각각의 입력단자에 접속되어, 상기 1,2차 코일이 자기적으로 결합된 자기 결합 인덕터를 포함함을 특징으로 하는 플라즈마 디스플레이 패널 구동 장치.
  10. 제8항에 있어서, 상기 자기 결합 인덕터의 1차측 및 2차측 코일의 권선수의 비는 1:1로 설계함을 특징으로 하는 플라즈마 디스플레이 패널 구동 장치.
  11. 제8항에 있어서, 상기 제1,2스위칭 수단은 각각 MOSFET 스위치임을 특징으로 하는 플라즈마 디스플레이 패널 구동 장치.
  12. 제11항에 있어서, 상기 MOSFET 스위치의 드레인 단자와 소오스 단자 사이에 다이오드를 부가함을 특징으로 하는 플라즈마 디스플레이 패널 구동 장치.
  13. 제12항에 있어서, 상기 다이오드는 상기 MOSFET 스위치에 내장된 바디 다이오드를 이용함을 특징으로 하는 플라즈마 디스플레이 패널 구동 장치.
  14. 제11항에 있어서, 상기 MOSFET 스위치의 소오스 단자는 접지에 연결되고, 드레인 단자는 상기 자기 결합 인덕터에 연결되며, 게이트 단자에는 비절연 게이트 드라이버의 출력단자가 결합된 회로 구조를 갖는 것을 특징으로 하는 플라즈마 디스플레이 패널 구동 장치.
  15. 제8항에 있어서, 서스테인 구간의 충/방전 모드에서 상기 자기 결합 인덕터의 전류는 선형적으로 가변됨을 특징으로 하는 플라즈마 디스플레이 패널 구동 장치.
  16. 플라즈마 디스플레이 패널 구동 시스템의 전력 회수 회로 설계 방법에 있어서,
    1차 코일 및 2차 코일이 자기적으로 결합된 자기 결합 인덕터를 상기 플라즈마 디스플레이 패널의 양 단자에 연결하고, 소정의 전력 회수 시이퀀스에 상응하여 상기 1차 및 2차 코일의 전류를 접지로 도통시키거나 차단시키는 스위칭 프로세스에 의하여, 서스테인 구간에서의 충/방전 모드에서 상기 플라즈마 디스플레이 패널의 전압을 선형적으로 충방전시키도록 전력 회수 회로를 설계함을 특징으로 하는 자기 결합 인덕터를 이용한 전력 회수 회로 설계 방법.
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