KR20050112782A - 안정된 어드레싱을 수행하는 방전 디스플레이 패널의 구동장치 - Google Patents

안정된 어드레싱을 수행하는 방전 디스플레이 패널의 구동장치 Download PDF

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Abstract

본 발명에 따른 방전 디스플레이 패널의 구동 장치는 방전 디스플레이 패널의 어드레스 전극 라인들을 구동하는 어드레스 구동부를 포함한다. 이 어드레스 구동부는 제1 전원 공급 단자(T1), 제2 전원 공급 단자(T2), 주 회로(63b + 63a), 및 내부 보호 회로(63c)를 포함한다. 제1 전원 공급 단자(T1)에는 전원 공급 전위(VAIN)가 인가된다. 제2 전원 공급 단자(T2)에는 제1 전원 공급 단자(T1)로부터 어드레싱 전위(VA)를 공급받는다. 주 회로(63b + 63a)는 스위칭 동작에 의하여 상기 방전 디스플레이 패널의 선택된 어드레스 전극 라인들에 어드레싱 전위(VA)를 주기적으로 인가한다. 내부 보호 회로(63c)는, 제1 및 제2 전원 공급 단자들(T1, T2) 사이에 연결되어, 제2 전원 공급 단자(T2)의 어드레싱 전위(VA)가 제1 전원 공급 단자(T1)의 전원 공급 전위(VAIN)보다 설정 값 이상으로 높아지면, 제2 전원 공급 단자(T2)로부터 제1 전원 공급 단자(T1)로의 전류 통로를 발생시킨다.

Description

안정된 어드레싱을 수행하는 방전 디스플레이 패널의 구동 장치{Apparatus of driving discharge display panel which performs stable addressing}
본 발명은, 방전 디스플레이 패널의 구동 장치에 관한 것으로서, 보다 상세하게는, 방전 디스플레이 패널의 어드레스 전극 라인들을 구동하는 어드레스 구동부를 포함하는 방전 디스플레이 패널의 구동 장치에 관한 것이다.
도 1은 통상적인 방전 디스플레이 패널로서의 3-전극 면방전 방식의 플라즈마 디스플레이 패널(1)의 구조를 보여준다. 도 2는 도 1의 플라즈마 디스플레이 패널(1)의 한 디스플레이 셀의 예를 보여준다. 도 1 및 2를 참조하면, 통상적인 면방전 방전 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm), 유전층(11, 15), Y 전극 라인들(Y1, ..., Yn), X 전극 라인들(X1, ..., Xn), 형광층(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다.
어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)은 뒤쪽 글라스 기판(13)의 앞쪽에 일정한 패턴으로 형성된다. 아래쪽 유전층(15)은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)의 앞쪽에서 전면(全面) 도포된다. 아래쪽 유전층(15)의 앞쪽에는 격벽(17)들이 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm )과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 디스플레이 셀의 방전 영역을 구획하고 각 디스플레이 셀 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광층(16)은, 격벽(17)들 사이에서 형성된다.
X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)은 어드레스 전극 라인들(AR1, AG1, ..., AGm, ABm)과 직교되도록 앞쪽 글라스 기판(10)의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 디스플레이 셀을 설정한다. 각 X 전극 라인(X1, ..., Xn)과 각 Y 전극 라인(Y1, ..., Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인(도 2의 Xna, Yna)과 전도도를 높이기 위한 금속 전극 라인(도 2의 Xnb, Ynb)이 결합되어 형성된다. 앞쪽 유전층(11)은 X 전극 라인들(X1, ..., Xn)과 Y 전극 라인들(Y1, ..., Yn)의 뒤쪽에 전면(全面) 도포되어 형성된다. 강한 전계로부터 패널(1)을 보호하기 위한 보호층(12) 예를 들어, 일산화마그네슘(MgO)층은 앞쪽 유전층(11)의 뒤쪽에 전면 도포되어 형성된다. 방전 공간(14)에는 플라즈마 형성용 가스가 밀봉된다.
이와 같은 방전 디스플레이 패널에 일반적으로 적용되는 구동 방식은, 초기화, 어드레스 및 디스플레이 유지 단계가 단위 서브-필드에서 순차적으로 수행되게 하는 방식이다. 초기화 단계에서는 구동될 디스플레이 셀들의 전하 상태가 균일하게 된다. 어드레스 단계에서는, 선택될 디스플레이 셀들의 전하 상태와 선택되지 않을 디스플레이 셀들의 전하 상태가 설정된다. 디스플레이 유지 단계에서는, 선택될 디스플레이 셀들에서 디스플레이 방전이 수행된다. 이때, 디스플레이 방전을 수행하는 디스플레이 셀들의 플라즈마 형성용 가스로부터 플라즈마가 형성되고, 이 플라즈마로부터의 자외선 방사에 의하여 상기 디스플레이 셀들의 형광층(16)이 여기되어 빛이 발생된다.
여기에서, 상기 단위 서브-필드들이 단위 프레임에 여러개 포함됨으로써, 각 서브-필드의 디스플레이 유지 시간들에 의하여 원하는 계조가 디스플레이될 수 있다.
도 3은 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들에 대한 통상적인 구동 방법을 보여준다. 도 3을 참조하면, 모든 단위 프레임들 각각은 시분할 계조 표시를 실현하기 위하여 8 개의 서브필드들(SF1, ..., SF8)로 분할된다. 또한, 각 서브필드(SF1, ..., SF8)는 리셋팅 시간(R1, ..., R8), 어드레싱 시간(A1, ..., A8), 및 디스플레이-유지 시간(S1, ..., S8)으로 분할된다.
모든 디스플레이 셀들의 방전 조건들은 각 리셋팅 시간(R1, ..., R8)에서 균일해지면서 동시에 다음 단계에서 수행될 어드레싱에 적합해지도록 된다.
각 어드레싱 시간(A1, ..., A8)에서는, 어드레스 전극 라인들(도 1의 AR1 , ..., ABm)에 표시 데이터 신호가 인가됨과 동시에 각 Y 전극 라인(Y1, ..., Y n)에 상응하는 주사 펄스가 순차적으로 인가된다. 이에 따라 주사 펄스가 인가되는 동안에 높은 레벨의 표시 데이터 신호가 인가되면 상응하는 방전셀에서 어드레싱 방전에 의하여 벽전하들이 형성되며, 그렇지 않은 방전셀에서는 벽전하들이 형성되지 않는다.
각 디스플레이-유지 시간(S1, ..., S8)에서는, 모든 Y 전극 라인들(Y1, ..., Yn)과 모든 X 전극 라인들(X1, ..., Xn)에 디스플레이-유지용 펄스가 교호하게 인가되어, 상응하는 어드레싱 시간(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 표시 방전을 일으킨다. 따라서 플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 디스플레이-유지 시간(S1, ..., S8)의 길이에 비례한다. 단위 프레임에서 차지하는 디스플레이-유지 시간(S1, ..., S8)의 길이는 255T(T는 단위 시간)이다. 따라서 단위 프레임에서 한 번도 표시되지 않은 경우를 포함하여 256 계조로써 표시할 수 있다.
여기에서, 제1 서브필드(SF1)의 디스플레이-유지 시간(S1)에는 20에 상응하는 시간(1T)이, 제2 서브필드(SF2)의 디스플레이-유지 시간(S2)에는 21에 상응하는 시간(2T)이, 제3 서브필드(SF3)의 디스플레이-유지 시간(S3)에는 22에 상응하는 시간(4T)이, 제4 서브필드(SF4)의 디스플레이-유지 시간(S4)에는 23에 상응하는 시간(8T)이, 제5 서브필드(SF5)의 디스플레이-유지 시간(S5)에는 24에 상응하는 시간(16T)이, 제6 서브필드(SF6)의 디스플레이-유지 시간(S6)에는 25에 상응하는 시간(32T)이, 제7 서브필드(SF7)의 디스플레이-유지 시간(S7)에는 26에 상응하는 시간(64T)이, 그리고 제8 서브필드(SF8)의 디스플레이-유지 시간(S8)에는 27 에 상응하는 시간(128T)이 각각 설정된다.
이에 따라, 8 개의 서브필드들중에서 표시될 서브필드를 적절히 선택하면, 어느 서브필드에서도 표시되지 않는 0(영) 계조를 포함하여 모두 256 계조의 디스플레이가 수행될 수 있다.
상기와 같이 구동하는 방전 디스플레이 패널(1)의 통상적인 구동 장치에는 영상 처리부, 제어부, 구동부들, 및 전원 공급부가 구비된다. 영상 처리부는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. 제어부는 구동부들이 동작할 수 있는 구동 제어 신호들을 발생시킨다. 구동부들은 방전 디스플레이 패널의 각 전극 라인들에 구동 신호들을 인가한다. 전원 공급부는, 구동부들에 구동 전위들을 공급하고, 구동부들과 제어부에 동작 전위들을 공급한다.
상기 어드레스 구동부는 어드레스 주기(도 3의 A1, ..., A8)에서 모든 어드레스 전극 라인들(도 1의 AR1, AG1, ..., AGm, ABm)에 표시 데이터 신호를 주기적으로 인가한다. 이를 위하여, 어드레스 구동부의 많은 스위칭 소자들은 주사 펄스들과 동기하여 연속적으로 스위칭을 수행해야만 한다. 이에 따라, 스위칭 노이즈가 생성되어 어드레싱 전위에 인가되므로, 어드레싱 전위가 보다 높아지면서 스위칭 소자들에 대하여 오버-슛(Over-shoot)으로서 작용한다. 이에 따라, 어드레싱이 불안정해지고, 스위칭 소자들이 발열로 인하여 스위칭 소자들의 기능이 점점 저하되거나 스위칭 소자들이 파괴되는 문제점들이 있다.
본 발명의 목적은, 방전 디스플레이 패널에 대하여 안정된 어드레싱을 수행하고 어드레스 구동부의 스위칭 소자들의 발열을 줄일 수 있는 방전 디스플레이 패널의 구동 장치를 제공하는 것이다.
상기 목적을 이루기 위한 본 발명의 방전 디스플레이 패널의 구동 장치는 방전 디스플레이 패널의 어드레스 전극 라인들을 구동하는 어드레스 구동부를 포함한다. 상기 어드레스 구동부는 제1 전원 공급 단자(T1), 제2 전원 공급 단자(T2), 주 회로(63b + 63a), 및 내부 보호 회로(63c)를 포함한다. 상기 제1 전원 공급 단자(T1)에는 전원 공급 전위(VAIN)가 인가된다. 상기 제2 전원 공급 단자(T2)에는 상기 제1 전원 공급 단자(T1)로부터 어드레싱 전위(VA)를 공급받는다. 상기 주 회로(63b + 63a)는 스위칭 동작에 의하여 상기 방전 디스플레이 패널의 선택된 어드레스 전극 라인들에 어드레싱 전위(VA)를 주기적으로 인가한다. 상기 내부 보호 회로(63c)는, 상기 제1 및 제2 전원 공급 단자들(T1, T2) 사이에 연결되어, 상기 제2 전원 공급 단자(T2)의 어드레싱 전위(VA)가 상기 제1 전원 공급 단자(T1)의 전원 공급 전위(VAIN)보다 설정 값 이상으로 높아지면, 상기 제2 전원 공급 단자(T2)로부터 상기 제1 전원 공급 단자(T1)로의 전류 통로를 발생시킨다.
본 발명의 상기 방전 디스플레이 패널의 구동 장치에 의하면, 상기 주 회로(63b + 63a)에서 스위칭 노이즈가 생성되어 어드레싱 전위에 인가되는 경우, 상기 내부 보호 회로(63c)에서 상기 제2 전원 공급 단자(T2)로부터 상기 제1 전원 공급 단자(T1)로의 전류 통로가 발생된다. 이에 따라, 어드레싱 전위가 높아지지 않고 스위칭 소자들에 대하여 오버-슛(Over-shoot)으로서 작용하지 않는다. 이에 따라, 어드레싱이 안정되고, 스위칭 소자들의 발열이 줄어들어 스위칭 소자들의 기능이 저하되지 않고 스위칭 소자들이 파괴되지 않는다.
이하, 본 발명에 따른 실시예들이 상세히 설명된다. 여기에서, 본 발명의 구동 장치에 의하여 구동되는 방전 디스플레이 패널로서의 플라즈마 디스플레이 패널, 및 그 구동 방법에 대해서는 도 1 내지 3을 참조하여 설명한 바와 같다.
도 4를 참조하면, 본 발명의 일 실시예에 의한 방전 디스플레이 패널(1)의 구동 장치는 영상 처리부(66), 논리 제어부(62), 어드레스 구동부(63), X 구동부(64) 및 Y 구동부(65)를 포함한다. 영상 처리부(66)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호 예를 들어, 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호들을 발생시킨다. 제어부(62)는 영상 처리부(66)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다. 어드레스 구동부(63)는, 논리 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(S A)를 처리하여 표시 데이터 신호를 발생시키고, 발생된 표시 데이터 신호를 어드레스 전극 라인들에 인가한다. X 구동부(64)는 제어부(62)로부터의 구동 제어 신호들(SA, SY , SX)중에서 X 구동 제어 신호(SX)를 처리하여 X 전극 라인들에 인가한다. Y 구동부(65)는 논리 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 Y 구동 제어 신호(SY)를 처리하여 Y 전극 라인들에 인가한다.
도 1, 4, 및 5를 참조하면, 도 4의 어드레스 구동부(63)는 제1 전원 공급 단자(T1), 제2 전원 공급 단자(T2), 주 회로(63b + 63a), 및 내부 보호 회로(63c)를 포함한다.
제1 전원 공급 단자(T1)에는 전원 공급 전위(VAIN)가 인가된다. 제2 전원 공급 단자(T2)에는 제1 전원 공급 단자(T1)로부터 어드레싱 전위(VA)를 공급받는다. 주 회로(63b + 63a)는 스위칭 동작에 의하여 상기 방전 디스플레이 패널의 선택된 어드레스 전극 라인들에 어드레싱 전위(VA)를 주기적으로 인가한다.
내부 보호 회로(63c)는, 제1 및 제2 전원 공급 단자들(T1, T2) 사이에 연결되어, 제2 전원 공급 단자(T2)의 어드레싱 전위(VA)가 제1 전원 공급 단자(T1)의 전원 공급 전위(VAIN)보다 설정 값 이상으로 높아지면, 제2 전원 공급 단자(T2)로부터 제1 전원 공급 단자(T1)로의 전류 통로를 발생시킨다.
내부 보호 회로(63c)는 저항기(R63), 다이오드(D63), 및 바이패스 캐페시터(CBP)를 포함한다. 저항기(R63)는, 제1 및 제2 전원 공급 단자들(T1, T2) 사이에 연결되어, 제2 전원 공급 단자(T2)의 어드레싱 전위(VA)가 제1 전원 공급 단자(T1)의 전원 공급 전위(VAIN)보다 설정 값 이상으로 높아지는 경우에 다이오드(D63)가 턴-온(turn-on)될 수 있는 전압을 제공한다. 다이오드(D63)의 에노드는 제2 전원 공급 단자(T2)에 연결되고, 캐소드는 제1 전원 공급 단자(T1)에 연결된다. 다이오드(D63)의 에노드와 접지단 사이에 연결된 바이패스 캐페시터(CBP)는 제1 및 제2 전원 공급 단자들(T1, T2)에 인가되는 교류 노이즈를 접지측으로 흘려준다.
주 회로(63b + 63a)에서 스위칭 노이즈가 생성되어 어드레싱 전위(VA)에 인가되는 경우, 다이오드(D63)가 턴-온(turn-on)됨에 따라, 내부 보호 회로(63c)에서 제2 전원 공급 단자(T2)로부터 제1 전원 공급 단자(T1)로의 넓은 전류 통로가 발생된다. 이에 따라, 어드레싱 전위(VA)가 높아지지 않고 스위칭 소자들에 대하여 오버-슛(Over-shoot)으로서 작용하지 않는다. 이에 따라, 어드레싱이 안정되고, 스위칭 소자들의 발열이 줄어들어 스위칭 소자들의 기능이 저하되지 않고 스위칭 소자들이 파괴되지 않는다.
어드레스 구동 회로(63)는, 제어부(62)로부터의 구동 제어 신호들(SA, SY, SX)중에서 어드레스 신호(SA)를 처리하여 표시 데이터 신호(SAR1, S AG1, ..., SAGm, SABm)를 발생시키고, 발생된 표시 데이터 신호를 어드레스 전극 라인들(AR1, A G1, ..., AGm, ABm)에 인가한다. 이 어드레스 구동 회로(63)의 전원 전압(VA ) 즉, 선택된 어드레스 전극 라인들에 인가될 어드레싱 전위는 전력 회생 회로(63b)의 동작에 의하여 제어된다. 그 이유는, 표시 데이터 신호(SAR1, SAG1, ..., SAGm , SABm)의 인가가 종료되는 시간에서 방전 디스플레이 패널(1)의 디스플레이 셀들에 불필요하게 남아 있는 전하들을 수집하고, 표시 데이터 신호(SAR1, SAG1, ..., SAGm , SABm)의 인가가 시작되는 시간에서 상기 수집된 전하들을 디스플레이 셀들에 인가하기 위함이다. 통상적인 전력 회생 회로(63b)에서 공진 코일(LPR)의 인덕턴스는 방전 디스플레이 패널(1)의 평균 동작 캐페시턴스에 대하여 공진을 수행할 수 있도록 설정된다.
도 6은 도 5의 어드레스 구동 회로(63a)를 보여준다. 도 7은 도 5의 전력 회생 회로(63b)의 출력 신호 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호와의 관계를 보여준다.
도 5 내지 7을 참조하여, 주 회로(63b + 63a)의 동작을 단계적으로 설명하면 다음과 같다.
표시 데이터 신호(SAR1, SAG1, ..., SAGm, SABm)의 인가가 종료되는 시점(t4)에 있어서, 어드레스 구동 회로(63a)에서는 모든 트랜지스터들(FR1L, FR1U, ..., F BmL, FBmU)이 턴 오프(turn off)되고, 전력 회생 회로(63b)에서는 제2 스위치(S2)만이 턴 온(turn on)된다. 이에 의하여, 방전 디스플레이 패널(1)의 디스플레이 셀들에 불필요하게 남아 있는 전하들이 어드레스 구동 회로(63a)의 상부 트랜지스터들(FR1U, ..., FBmU)의 내부 다이오드들, 전원 전위 단자(VPP), 전력 회생 회로(63b)의 공진 코일(LPR) 및 제2 스위치(S2)를 통하여 충방전용 캐페시터(CPR)에 수집된다. 이 동작은, 전력 회생 회로(63b)의 출력 신호(SVPP) 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호(SSEL)의 전위가 접지 전위가 될 때까지 진행된다. 여기에서, 충방전용 캐페시터(CPR)의 만충전 전위는 어드레싱 전위(VA)의 절반이지만, 공진 코일(LPR)의 작용으로 인하여 전력 회생 회로(63b)의 출력 신호(SVPP) 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호(SSEL)의 전위가 접지 전위까지 저하될 수 있다. 여기에서, 방전 디스플레이 패널(1)의 디스플레이 셀들에 불필요하게 남아 있는 전하들이 어드레스 구동 회로(63a)의 상부 트랜지스터들(FR1U, ..., FBmU)의 내부 다이오드들 및 공진 코일(LPR)을 통하여 이동하므로, 전력 회생 회로(63b)의 출력 신호(SVPP) 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호(SSEL)의 전위가 접지 전위까지 저하되는 시간(t4 ~ t6)이 상대적으로 길다.
다음에, 전력 회생 회로(63b)의 출력 신호(SVPP) 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호(SSEL)의 전압이 접지 전압(VG)까지 저하되는 시점(t6)으로부터 소정의 시점(다음 펄스 주기에서의 t1)까지의 시간(t6 ~ 다음 펄스 주기에서의 t1)에서, 어드레스 구동 회로(63a)의 모든 상부 트랜지스터들(FR1U, ..., FBmU)이 턴 온(turn on)되고 전력 회생 회로(63b)의 제4 스위치(S2)만이 턴 온(turn on)된다. 이에 따라, 전력 회생 회로(63b)의 출력 신호(SVPP) 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호(SSEL)의 전위가 접지 전위로서 유지된다.
다음에, 표시 데이터 신호(SAR1, SAG1, ..., SAGm, SABm)의 인가가 시작되는 시점(t1)으로부터, 전력 회생 회로(63b)의 출력 신호(SVPP) 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호(SSEL)의 전위가 어드레싱 전위(VA)까지 상승되는 시점(t3)까지의 시간(t1 ~ t3)에 있어서, 어드레스 구동 회로(63a)의 선택된 상부 트랜지스터들(FR1U, ..., FBmU)이 턴 온(turn on)되고 전력 회생 회로(63b)의 제1 스위치(S1)만이 턴 온(turn on)된다. 이에 따라, 충방전용 캐페시터(CPR)에 수집되었던 전하들이 제1 스위치(S1), 공진 코일(LPR) 및 어드레스 구동 회로(63a)의 전원 전위 단자(VPP)를 통하여 방전 디스플레이 패널(1)의 선택된 디스플레이 셀들에 인가된다. 여기에서, 충방전용 캐페시터(CPR)의 만충전 전위는 어드레싱 전위(VA)의 절반이지만, 공진 코일(LPR)의 작용으로 인하여 전력 회생 회로(63b)의 출력 신호(SVPP) 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호(SSEL)의 전위가 어드레싱 전위(VA)까지 상승될 수 있다.
그리고, 전력 회생 회로(63b)의 출력 신호(SVPP) 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호(SSEL)의 전위가 어드레싱 전위(VA)까지 상승되는 시점(t3)으로부터 표시 데이터 신호(SAR1, SAG1, ..., SAGm, SABm )의 인가가 종료되는 시점(t4)까지의 시간(t3 ~ t4)에서, 어드레스 구동 회로(63a)의 선택된 상부 트랜지스터들(FR1U, ..., FBmU)이 턴 온(turn on)된 상태를 유지하고, 전력 회생 회로(63b)의 제3 스위치(S3)만이 턴 온(turn on)된다. 이에 따라, 전력 회생 회로(63b)의 출력 신호(SVPP) 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호(SSEL)의 전위가 어드레싱 전위(VA)로서 유지된다.
도 8은 도 5의 내부 보호 회로(63c)가 존재하지 않는 경우에 제2 전원 공급 단자(T2)의 어드레싱 전위(VT2)를 보여준다. 도 8을 참조하면, 주 회로(63b + 63a)는 어드레스 주기(도 3의 A1, ..., A8)에서 모든 어드레스 전극 라인들(도 1의 AR1, AG1, ..., AGm, ABm)에 표시 데이터 신호를 주기적으로 인가한다. 이를 위하여, 어드레스 구동 회로(63a)의 많은 스위칭 소자들은 주사 펄스들과 동기하여 연속적으로 스위칭을 수행해야만 한다. 이에 따라, 스위칭 노이즈가 생성되어 어드레싱 전위(VAIN)에 인가되므로, 보다 높아진 어드레싱 전위(VACT)가 스위칭 소자들에 대하여 오버-슛(Over-shoot)으로서 작용한다. 이에 따라, 어드레싱이 불안정해지고, 스위칭 소자들이 발열로 인하여 스위칭 소자들의 기능이 점점 저하되거나 스위칭 소자들이 파괴될 수 있다.
하지만, 도 5의 실시예와 같이 내부 보호 회로(63c)가 존재하는 경우, 주 회로(63b + 63a)에서 스위칭 노이즈가 생성되어 어드레싱 전위(VA)에 인가되는 경우, 다이오드(D63)가 턴-온(turn-on)됨에 따라, 내부 보호 회로(63c)에서 제2 전원 공급 단자(T2)로부터 제1 전원 공급 단자(T1)로의 넓은 전류 통로가 발생된다. 이에 따라, 어드레싱 전위(VA)가 높아지지 않고 스위칭 소자들에 대하여 오버-슛(Over-shoot)으로서 작용하지 않는다. 이에 따라, 어드레싱이 안정되고, 스위칭 소자들의 발열이 줄어들어 스위칭 소자들의 기능이 저하되지 않고 스위칭 소자들이 파괴되지 않는다.
이상 설명된 바와 같이, 본 발명에 따른 방전 디스플레이 패널의 구동 장치에 의하면, 주 회로(63b + 63a)에서 스위칭 노이즈가 생성되어 어드레싱 전위에 인가되는 경우, 내부 보호 회로(63c)에서 제2 전원 공급 단자(T2)로부터 제1 전원 공급 단자(T1)로의 전류 통로가 발생된다. 이에 따라, 어드레싱 전위가 높아지지 않고 스위칭 소자들에 대하여 오버-슛(Over-shoot)으로서 작용하지 않는다. 이에 따라, 어드레싱이 안정되고, 스위칭 소자들의 발열이 줄어들어 스위칭 소자들의 기능이 저하되지 않고 스위칭 소자들이 파괴되지 않는다.
본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.
도 1은 통상적인 방전 디스플레이 패널로서의 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다.
도 2는 도 1의 플라즈마 디스플레이 패널의 한 디스플레이 셀의 예를 보여주는 단면도이다.
도 3은 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들에 대한 통상적인 구동 방법을 보여주는 타이밍도이다.
도 4는 본 발명의 일 실시예에 의한 방전 디스플레이 패널의 구동 장치를 보여주는 블록도이다.
도 5는 도 4의 어드레스 구동부에 포함된 내부 보호 회로 및 전력 회생 회로를 보여주는 도면이다.
도 6은 도 5의 어드레스 구동 회로를 보여주는 도면이다.
도 7은 도 5의 전력 회생 회로의 출력 신호 및 선택된 어드레스 전극 라인들에 인가되는 구동 신호와의 관계를 보여주는 파형도이다.
도 8은 도 5의 내부 보호 회로가 존재하지 않는 경우에 제2 전원 공급 단자의 어드레싱 전위를 보여주는 파형도이다.
도 9는 도 5의 제2 전원 공급 단자의 어드레싱 전위를 보여주는 파형도이다.
<도면의 주요 부분에 대한 부호의 설명>
1...플라즈마 디스플레이 패널, 10...앞쪽 글라스 기판,
11, 15...유전층, 12...보호층,
13...뒤쪽 글라스 기판, 14...방전 공간,
16...형광층, 17...격벽,
X1, ..., Xn...X 전극 라인, Y1, ..., Yn...Y 전극 라인,
AR1, ..., ABm...어드레스 전극 라인, Xna, Yna...투명 전극 라인,
Xnb, Ynb...금속 전극 라인, SF1, ...SF8...서브-필드,
62...논리 제어부, 63..어드레스 구동부, 64...X 구동부, 65...Y 구동부,
66...영상 처리부, 63a...어드레스 구동 회로,
63b...전력 회생 회로, 63c...내부 보호 회로,
T1, T2...전원 공급 단자.

Claims (4)

  1. 방전 디스플레이 패널의 어드레스 전극 라인들을 구동하는 어드레스 구동부를 포함하는 방전 디스플레이 패널의 구동 장치에 있어서,
    상기 어드레스 구동부가,
    전원 공급 전위(VAIN)가 인가되는 제1 전원 공급 단자(T1);
    상기 제1 전원 공급 단자(T1)로부터 어드레싱 전위(VA)를 공급받는 제2 전원 공급 단자(T2);
    스위칭 동작에 의하여 상기 방전 디스플레이 패널의 선택된 어드레스 전극 라인들에 어드레싱 전위(VA)를 주기적으로 인가하는 주 회로(63b + 63a); 및
    상기 제1 및 제2 전원 공급 단자들(T1, T2) 사이에 연결되어, 상기 제2 전원 공급 단자(T2)의 어드레싱 전위(VA)가 상기 제1 전원 공급 단자(T1)의 전원 공급 전위(VAIN)보다 설정 값 이상으로 높아지면, 상기 제2 전원 공급 단자(T2)로부터 상기 제1 전원 공급 단자(T1)로의 전류 통로를 발생시키는 내부 보호 회로(63c)를 포함한 구동 장치.
  2. 제1항에 있어서, 상기 내부 보호 회로(63c)가,
    상기 제1 및 제2 전원 공급 단자들(T1, T2) 사이에 연결된 저항기(R63); 및
    그 에노드가 상기 제2 전원 공급 단자(T2)에 연결되고, 그 캐소드가 상기 제1 전원 공급 단자(T1)에 연결된 다이오드(D63)를 포함한 구동 장치.
  3. 제2항에 있어서, 상기 내부 보호 회로(63c)가,
    교류 노이즈를 접지측으로 흘려주는 바이패스 캐페시터(CBP)를 더 포함한 구동 장치.
  4. 제3항에 있어서, 상기 내부 보호 회로(63c)에서,
    상기 다이오드(D63)의 에노드와 접지단 사이에 상기 바이패스 캐페시터(CBP)가 연결된 구동 장치.
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