KR20030014883A - 플라즈마 디스플레이 패널의 구동방법 - Google Patents

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Abstract

본 발명은 화질을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
본 발명의 플라즈마 디스플레이 패널의 구동방법은 방전셀을 선택하기 위하여 제 1전극들에 순차적으로 스캔펄스가 인가되는 단계와, 제 1전극과 교차되게 형성되는 어드레스전극들에 스캔펄스에 동기되는 데이터펄스가 인가되는 단계와, 스캔펄스가 인가되기 전에 제 1전극에 인가되는 리셋펄스의 폭이 스캔펄스의 인가순서에 따라 상이하게 설정되는 단계를 포함한다.

Description

플라즈마 디스플레이 패널의 구동방법{DRIVING METHOD OF PLASMA DISPLAY PANEL}
본 발명은 플라즈마 디스플레이 패널의 구동방법에 관한 것으로 특히, 화질을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동방법에 관한 것이다.
최근, 평판 디스플레이 장치로서 대형패널의 제작이 용이한 플라즈마 디스플레이 패널(이하 "PDP"라 함)이 주목받고 있다. PDP로는 도 1에 도시된 바와 같이 3전극을 구비하고 교류전압에 의해 구동되는 3전극 교류 면방전형 PDP가 대표적이다.
도 1을 참조하면, 3전극 교류 면방전형 PDP의 방전셀은 상부기판(10) 상에 형성되어진 제 1 전극(12Y) 및 제 2 전극(12Z)과, 하부기판(18) 상에 형성되어진 어드레스전극(20X)을 구비한다.
제 1 전극(12Y)과 제 2 전극(12Z)이 나란하게 형성된 상부기판(10)에는 상부 유전층(14)과 보호막(16)이 적층된다. 상부 유전층(14)에는 플라즈마 방전시 발생된 벽전하가 축적된다. 보호막(16)은 플라즈마 방전시 발생된 스퍼터링에 의한 상부 유전층(14)의 손상을 방지함과 아울러 2차 전자의 방출 효율을 높이게 된다. 보호막(16)으로는 통상 산화마그네슘(MgO)이 이용된다.
어드레스전극(20X)이 형성된 하부기판(18) 상에는 하부 유전층(22), 격벽(24)이 형성되며, 하부 유전층(22)과 격벽(24) 표면에는 형광체(26)가 도포된다. 어드레스전극(20X)은 제 1 전극(12Y) 및 제 2 전극(12Z)과 교차되는 방향으로 형성된다. 격벽(24)은 어드레스전극(20X)과 나란하게 형성되어 방전에 의해 생성된 자외선 및 가시광이 인접한 방전셀에 누설되는 것을 방지한다. 형광체(26)는 플라즈마 방전시 발생된 자외선에 의해 여기되어 적색, 녹색 또는 청색 중 어느 하나의 가시광선을 발생하게 된다. 상/하판과 격벽 사이에 마련된 방전공간에는 가스방전을 위한 불활성 가스가 주입된다.
이러한 방전셀은 도 2에 도시된 바와 같이 매트릭스 형태로 배치된다. 도 2에서 방전셀(1)은 제 1 전극라인(Y1 내지 Ym), 제 2 전극라인(Z1 내지 Zm) 및 어드레스전극라인(X1 내지 Xn)의 교차부에 마련된다. 제 1 전극라인(Y1 내지 Ym)은 순차적으로 구동되고, 제 2 전극라인(Z1 내지 Zm)은 공통적으로 구동된다. 어드레스전극라인들(X1 내지 Xn)은 기수번째 라인들과 우수번째 라인들로 분할되어 구동된다.
이러한 3전극 교류 면방전형 PDP는 다수개의 서브필드로 분리되어 구동되고, 각 서브필드기간에는 비디오 데이터의 가중치에 비례시킨 횟수의 발광이 진행됨으로써 계조표시가 행해지게 된다.
실례로, 8비트의 비디오 데이터를 이용하여 256 계조로 화상이 표시되는 경우 각 방전셀(1)에서의 1 프레임 표시기간(예를 들면, 1/60초=약 16.7msec)은 도 3에 도시된 바와 같이 8개의 서브필드(SF1 내지 SF8)로 분할된다.
각 서브필드(SF1 내지 SF8)는 다시 리셋 기간, 어드레스 기간 및 서스테인 기간으로 분할하고, 서스테인 기간에 1:2:4:8:…:128의 비율로 가중치를 부여하게 된다. 여기서, 리셋기간은 방전셀을 초기화하는 기간이고, 어드레스기간은 비디오데이터의 논리값에 따라 선택적인 어드레스방전이 발생하게 하는 기간이며, 서스테인 기간은 상기 어드레스방전이 발생된 방전셀에서 방전이 유지되게 하는 기간이다. 리셋 기간과 어드레스기간은 각 서브필드 기간에 동일하게 할당된다.
도 4는 종래의 PDP의 구동방법을 나타내는 파형도이다.
도 4를 참조하면, 종래의 PDP의 구동방법은 리셋기간, 어드레스 기간 및 서스테인 기간으로 나뉘어 구동된다.
리셋기간에는 제 1전극라인(Y1 내지 Ym)에 공통적으로 리셋펄스(RP)가 공급되어 방전셀을 초기화시킨다. 어드레스 기간에는 제 1전극라인(Y1 내지 Ym)에 순차적으로 스캔펄스(SP)가 인가됨과 아울러 어드레스전극라인(X)에 스캔펄스(SP)에 동기되는 데이터펄스(DP)가 인가된다. 이때, 스캔펄스(SP) 및 데이터펄스(DP)가 인가된 방전셀들에서는 어드레스방전이 일어난다. 서스테인 기간에는 제 1전극라인(Y1 내지 Ym) 및 제 2전극라인(Z1 내지 Zm)에 교번적으로 서스테인펄스(SUSPy,SUSPz)가 인가되어 어드레스방전이 발생된 방전셀에서 소정시간동안 서스테인방전을 일으킨다.
리셋기간에 인가되는 리셋펄스(RP)를 상세히 설명하면 다음과 같다. 먼저, 리셋펄스(RP)가 소정의 기울기를 가지고 상승하는 t1기간에 방전셀들에서 리셋방전이 일어난다. 따라서, t1기간에 방전셀들에는 소정의 벽전하가 형성된다. t2기간에는 소정의 전압값을 가지고 t1기간에 형성된 벽전하를 유지한다. t3기간에는 t2기간보다 낮은 전압값을 가지고 t1기간에 형성된 벽전하를 유지한다. t4기간에는 전압값이 소정의 기울기를 가지고 서서히 하강하면서 방전셀에 형성된 벽전하를 균일하게 분포시킨다. 이와 같이 리셋기간에 방전셀들에 형성된 벽전하는 벽전하의 양에 해당하는 벽전압을 방전셀에 제공하여 어드레스 방전이 쉽게 일어날 수 있게 한다.
이러한 리셋기간에 이어 어드레스기간에는 제 1전극라인(Y1 내지 Ym)에 순차적으로 주사펄스(SP)가 공급되고, 주사펄스(SP)에 동기되는 데이터펄스(DP)가 어드레스전극라인(X1 내지 Xn)에 공급된다. 이때, 데이터펄스(DP)는 패널에 표시되는 화상에 의해 공급 유/무가 결정된다. 한편, 주사펄스(SP) 및 데이터펄스(DP)가 공급된 방전셀들에서는 어드레스방전이 일어난다. 이와 같은 어드레스 방전이 발생된 방전셀들에서는 어드레스방전에 의해 소정의 벽전하가 형성된다.
이어서, 서스테인 기간에는 제 1전극라인(Y1 내지 Ym)과 제 2전극라인(Z1 내지 Zm)에 교번적으로 서스테인 펄스(SUSPy,SUSPz)가 공급됨으로써 어드레스 방전이 발생된 방전셀들에서 서스테인 방전이 소정의 기간동안 유지되게 한다.
하지만, 이와 같은 종래의 PDP에서는 제 1전극라인(Y1 내지 Ym)에 리셋펄스(RP)가 공급된 후 스캔펄스(SP)가 공급되는 시간이 상이하게 설정된다. 즉, 도 5와 같이 제 Y1 번째 제 1전극라인(Y1)에는 리셋펄스(RP)가 인가된 후 t5시간 후에 스캔펄스(SP)가 인가된다. 또한, 제 Ym/2 번째 제 1전극라인(Ym/2)에는 리셋펄스(RP)가 인가된 후 t6시간 후에 스캔펄스(SP)가 인가된다. 아울러, 제 Ym 번째 제 1전극라인(Ym)에는 리셋펄스(RP)가 인가된 후 t7시간 후에 스캔펄스(SP)가 인가된다. 여기서, t7, t6 및 t5의 시간의 크기는 t7〉t6〉t5의 순으로 정해진다.
다시 말하여, 종래의 PDP에서는 리셋펄스(RP)후에 제 1전극라인(Y1 내지 Ym)에 인가되는 스캔펄스(SP)의 인가순서가 상이하게 설정된다. 한편, 리셋방전에 의해 생성된 벽전하들은 재결합등에 의하여 시간이 흐를수록 소멸되게 된다. 따라서, 리셋펄스(RP)가 인가된 후 제 1전극라인(Y1 내지 Ym)에 인가되는 스캔펄스(SP)의 인가순서가 상이하기 때문에 방전셀의 균일성이 저하되게 된다. 또한, 리셋펄스(RP)가 인가된 후 소정시간 이후에 스캔펄스(SP)가 인가되는 방전셀들은 리셋방전에 의해 생성된 벽전하들의 소멸(즉, 변전하들에 의한 벽전압의 하강)에 의하여 어드레스 방전이 발생되지 않을 수 있다. 아울러, 리셋펄스(RP)가 인가된 후 소정시간 이후에 스캔펄스(SP)가 인가되는 방전셀들은 리셋방전에 의해 생성된 벽전하들의 소멸에 의하여 약한 어드레스 방전이 발생되고, 이에 따라 서스테인 방전이 발생되지 않아 화질의 저하를 초래한다.
따라서, 본 발명의 목적은 화질을 향상시킬 수 있도록 한 플라즈마 디스플레이 패널의 구동방법을 제공하는데 있다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 방전셀 구조를 나타내는 사시도.
도 2는 도 1에 도시된 방전셀이 매트릭스 형태로 배치된 플라즈마 디스플레이 패널을 나타내는 도면.
도 3은 종래의 플라즈마 디스플레이 패널의 계조표현 방법을 나타내는 도면.
도 4는 도 1에 도시된 종래의 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 5는 종래의 제 1전극에 인가되는 구동파형을 상세히 나타내는 파형도.
도 6은 본 발명의 제 1실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 7은 본 발명의 제 2실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 8은 본 발명의 제 3실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 9는 본 발명의 제 4실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 10은 본 발명의 제 5실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 11은 본 발명의 제 6실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 12는 본 발명의 제 7실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도.
도 13은 도 12의 리셋방전에 의해 생성된 전하를 나타내는 도면.
< 도면의 주요 부분에 대한 부호의 설명 >
1 : 방전셀10 : 상부기판
12Y : 제 1전극12Z : 제 2전극
14,22 : 유전체층16 : 보호막
18 : 하부기판20X : 어드레스전극
24 : 격벽26 : 형광체층
상기 목적을 달성하기 위하여 본 발명의 플라즈마 디스플레이 패널의 구동방법은 방전셀을 선택하기 위하여 제 1전극들에 순차적으로 스캔펄스가 인가되는 단계와, 제 1전극과 교차되게 형성되는 어드레스전극들에 스캔펄스에 동기되는 데이터펄스가 인가되는 단계와, 스캔펄스가 인가되기 전에 제 1전극에 인가되는 리셋펄스의 폭이 스캔펄스의 인가순서에 따라 상이하게 설정되는 단계를 포함한다.
상기 리셋펄스의 펄스 폭은 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 캔펄스가 인가될 수 있도록 설정된다.
상기 리셋펄스는, 소정의 기울기를 가지고 제 1전압까지 상승하는 상승구간과, 제 1전압을 소정시간 유지하는 제 1유지구간과, 제 1전압보다 낮은 전압값을 가지는 제 2전압을 일정시간 유지하는 제 2유지구간과, 제 2전압으로부터 소정의 기울기를 가지고 하강하는 하강구간을 포함한다.
상기 제 1유지구간의 폭은 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 스캔펄스가 인가될 수 있도록 설정된다.
상기 상승구간, 제 2유지구간 및 하강구간의 폭은 제 1전극들에 인가되는 모든 리셋펄스들에서 동일하게 설정된다.
상기 제 2유지구간의 폭은 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 스캔펄스가 인가될 수 있도록 설정된다.
상기 상승구간, 제 1유지구간 및 하강구간의 폭은 제 1전극들에 인가되는 모든 리셋펄스들에서 동일하게 설정된다.
상기 제 1유지구간 및 제 2유지구간의 폭은 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 스캔펄스가 인가될 수 있도록 설정된다.
상기 제 1전극은 소정의 블록으로 분활되고, 블록내에 포함되어 있는 제 1전극들에 인가되는 리셋펄스의 제 1유지구간 및 제 2유지구간중 적어도 하나 이상의 구간의 폭은 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 스캔펄스가 인가될 수 있도록 설정된다.
상기 제 1전극라인들은 상부블록과 하부블록으로 나뉘고, 상부블록과 하부블록은 동시에 구동된다.
본 발명의 플라즈마 디스플레이 패널의 구동방법은 방전셀을 선택하기 위하여 제 1전극들에 순차적으로 스캔펄스가 인가되는 단계와, 제 1전극과 교차되게 형성되는 어드레스전극들에 스캔펄스에 동기되는 데이터펄스가 인가되는 단계와, 스캔펄스가 인가되기 전에 상이한 시점에서 제 1전극들에 리셋펄스가 인가되는 단계를 포함한다.
상기 리셋펄스의 인가시점은 모든 제 1전극들에서 동일한 시간이 경과한 후 스캔펄스가 인가될 수 있도록 설정된다.
상기 제 1전극라인들은 상부블록과 하부블록으로 나뉘어 동시에 구동된다.
본 발명의 플라즈마 디스플레이 패널의 구동방법은 리셋기간에 제 1전극들에 램프파형의 리셋펄스가 인가되는 단계와, 어드레스 기간에 제 1전극들에 스캔펄스가 인가되는 단계와, 어드레스 기간에 켜질 방전셀을 선택하기 위하여 스캔펄스들에 동기되는 데이터펄스가 인가되는 단계와, 램프파형이 제 1전극들에 인가될 때 제 1전극과 인접되게 형성되는 제 2전극들에 제 1전압이 인가되는 단계와, 제 1전극들에 첫번째 스캔펄스가 인가되기 전에 제 2전극들에 제 2전압이 인가되는 단계를 포함한다.
상기 제 2전압의 전압레벨은 제 1전압의 전압레벨 보다 높게 설정된다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하 도 6 내지 도 13을 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.
도 6은 본 발명의 제 1실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 6을 참조하면, 본 발명의 제 1실시예에 의한 PDP의 구동방법은 리셋/어드레스 기간 및 서스테인 기간으로 나뉘어 구동된다. 리셋/어드레스 기간에는 제 1전극라인(Y1 내지 Ym)에 리셋펄스(RP) 및 스캔펄스(SP)가 인가된다. 서스테인 기간에는 제 1전극라인(Y1 내지 Ym) 및 제 2전극라인(Z1 내지 Zm)에 교번적으로 서스테인펄스(SUSPy,SUSPz)가 인가된다.
이와 같은 본 발명의 제 1 실시예에 의한 PDP의 구동방법에서는 리셋펄스(RP)가 공급된 후 스캔펄스(SP)가 공급되는 시간(t8)이 모든 제 1전극라인(Y1 내지 Ym)에서 동일하게 설정된다. 따라서, 모든 방전셀에 스캔펄스(SP)가 공급될 때 방전셀에는 균일한 벽전하들이 형성된다.
이를 상세히 설명하면, 제 Y1번째 제 1전극라인(Y1)에 공급되는 리셋펄스(RP)는 소정의 기울기를 가지고 제 1전압까지 상승하는 t1기간, 제 1전압값을 유지하는 t2기간, 제 1전압값보다 낮은 제 2전압값을 유지하는 t3기간 및 소정의 기울기를 가지고 하강하는 t4기간으로 나뉘어 구동된다.
t1 기간에 리셋펄스(RP)는 소정의 기울기를 가지고 제 1전압까지 상승한다. 이때, 방전셀에서는 리셋방전이 발생되어 소정의 벽전하들이 형성된다. t2 기간에는 제 1전압을 가지고 소정시간(즉, t2의 시간)동안 t1기간에 형성된 벽전하들을 유지한다. t3 기간에는 제 1전압보다 낮은 전압값인 제 2전압값을 소정시간(즉, t3의 시간)동안 유지하며 방전셀에 형성된 벽전하를 유지한다. t4 기간에는 제 1전압값이 소정의 기울기를 가지고 서서히 하강하면서 방전셀에 형성된 벽전하를 균일하게 분포시킨다. 이와같은 리셋펄스(RP)가 공급된 후 소정시간(t8) 후에 스캔펄스(SP)가 인가된다.
한편, 제 Y2번째 제 1전극라인(Y2)에 공급되는 리셋펄스(RP)는 소정의 기울기를 가시고 상승하는 t1기간, 제 1전압값을 유지하는 t5기간, t5기간에 공급되는 전압값보다 낮은 제 2전압값을 유지하는 t3기간 및 소정의 기울기를 가지고 하강하는 t4기간으로 나뉘어 구동된다. 여기서, 리셋펄스(RP)가 공급된 후 소정시간(t8) 후에 스캔펄스(SP)가 인가될 수 있도록 t1, t3 및 t4의 기간은 동일하게 설정되는 반면에 제 1전압값을 유지하는 t5기간은 제 Y1번째 제 1전극라인(Y1)에서 제 1전압값을 유지하는 t2기간보다 크게 설정된다. 따라서, 본 발명의 실시예에 의한 PDP의 구동방법에 의하면 리셋펄스(RP)가 공급된 후 스캔펄스(SP)가 인가되는 시간(t8)이 모든 제 1전극라인(Y1 내지 Ym)에서 동일하게 설정된다.
다시 말하여, 리셋펄스(RP)가 공급된 후 소정시간(t8) 후에 스캔펄스(SP)가 인가될 수 있도록 모든 제 1전극라인(Y1)에 공급되는 리셋펄스(RP)의 t1, t3 및 t4기간은 모든 제 1전극라인(Y1 내지 Ym)에서 동일하게 설정되는 반면에 제 1전압값을 유지하는 기간(t2,t5,t6,…,t7)은 상이하게 설정된다. 따라서, 본 발명의 제 1실시예에 의한 PDP에 의하면 모든 방전셀에 일정한(균일한) 벽전하가 형성된 후 어드레스 방전이 일어나기 때문에 화질을 향상시킬 수 있다.
도 7은 본 발명의 제 2 실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 7을 참조하면,본 발명의 제 2실시예에 의한 플라즈마 디스플레이 패널의 구동방법에서는 적어도 2개 이상의 제 1전극라인(Y)에 동일한 리셋펄스(RP)가 공급된다. 즉, 본 발명의 제 2실시예에서는 블록별로 상이한 리셋펄스(RP)가 공급된다.
이를 상세히 설명하면, 제 1블록(여기서는 Y1 및 Y2전극)에 공급되는 리셋펄스(RP)는 소정의 기울기를 가지고 제 1전압까지 상승하는 t1기간, 제 1전압값을 유지하는 t2기간, 제 1전압값보다 낮은 제 2전압값을 유지하는 t3기간 및 소정의 기울기를 가지고 하강하는 t4기간으로 나뉘어 구동된다.
t1 기간에 리셋펄스(RP)는 소정의 기울기를 가지고 제 1전압까지 상승한다. 이때, 방전셀에서는 리셋방전이 발생되어 소정의 벽전하들이 형성된다. t2 기간에는 제 1전압을 가지고 소정시간(즉, t2의 시간)동안 t1기간에 형성된 벽전하들을 유지한다. t3 기간에는 제 1전압보다 낮은 전압값인 제 2전압값을 소정시간(즉, t3의 시간)동안 유지하며 방전셀에 형성된 벽전하를 유지한다. t4 기간에는 제 1전압값이 소정의 기울기를 가지고 서서히 하강하면서 방전셀에 형성된 벽전하를 균일하게 분포시킨다. 이와 같이 제 1블록(Y1 및 Y2전극)에 동일한 리셋펄스(RP)가 공급되면 제 Y1 전극라인(Y1)에 공급되는 스캔펄스(SP)는 t8의 시간후에 공급된다. 또한, 제 Y2 전극라인(Y2)에 공급되는 스캔펄스(SP)는 t9의 시간후에 공급된다. 즉, 제 1블록에 포함되어 있는 전극라인들(Y1,Y2)에는 동일한 폭을 가지는 리셋펄스(RP)가 인가되기 때문에 리셋펄스(RP)후에 스캔펄스(SP)가 인가되는 시간이 상이해진다. 하지만, 제 1블록에 포함되어 있는 전극라인들(Y1,Y2)에는 순차적으로 스캔펄스가 인가되기 때문에 리셋펄스(RP)에 의해 형성된 벽전하들이 재결합되지 않는다.
한편, 제 2블록(여기서는 Y3 및 Y4전극)에 공급되는 리셋펄스(RP)는 소정의 기울기를 가지고 상승하는 t1기간, 제 1전압값을 유지하는 t5기간, t5기간에 공급되는 전압값보다 낮은 제 2전압값을 유지하는 t3기간 및 소정의 기울기를 가지고 하강하는 t4기간으로 나뉘어 구동된다. 여기서, 리셋펄스(RP)가 공급된 후 소정시간(t8,t9) 후에 스캔펄스(SP)가 인가될 수 있도록 t1, t3 및 t4의 기간은 동일하게 설정되는 반면에 제 1전압값을 유지하는 t5기간은 제 1블록의 t2기간보다 크게 설정된다. 따라서, 본 발명의 실시예에 의한 PDP의 구동방법에 의하면 리셋펄스(RP)가 공급된 후 스캔펄스(SP)가 인가되는 시간(t8,t9)이 블록별로 동일하게 설정된다.
다시 말하여, 리셋펄스(RP)가 공급된 후 소정시간(t8,t9) 후에 스캔펄스(SP)가 인가될 수 있도록 모든 제 1블록에 공급되는 리셋펄스(RP)의 t1, t3 및 t4기간은 모든 블록에서 동일하게 설정되는 반면에 제 1전압값을 유지하는 기간(t2,t5,…,t6)은 상이하게 설정된다. 따라서, 본 발명의 제 1실시예에 의한 PDP에 의하면 모든 블록들에 균일한 벽전하를 형성시킬 수 있다.
도 8은 본 발명의 제 3실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 8을 참조하면, 본 발명의 제 3실시예에 의한 PDP의 구동방법은 리셋/어드레스 기간 및 서스테인 기간으로 나뉘어 구동된다. 리셋/어드레스 기간에는 제 1전극라인(Y1 내지 Ym)에 리셋펄스(RP) 및 스캔펄스(SP)가 인가된다. 서스테인 기간에는 제 1전극라인(Y1 내지 Ym) 및 제 2전극라인(Z1 내지 Zm)에 교번적으로 서스테인펄스(SUSPy,SUSPz)가 인가된다.
이와 같은 본 발명의 제 3실시예에 의한 PDP의 구동방법에서는 리셋펄스(RP)가 공급된 후 스캔펄스(SP)가 공급되는 시간(t8)이 모든 제 1전극라인(Y1 내지 Ym)에서 동일하게 설정된다. 따라서, 모든 방전셀에 스캔펄스(SP)가 공급될 때 방전셀에는 균일한 벽전하들이 형성된다.
이를 상세히 설명하면, 제 Y1번째 제 1전극라인(Y1)에 공급되는 리셋펄스(RP)는 소정의 기울기를 가지고 제 1전압까지 상승하는 t1기간, 제 1전압값을 유지하는 t2기간, 제 1전압값보다 낮은 제 2전압값을 유지하는 t3기간 및 소정의 기울기를 가지고 하강하는 t4기간으로 나뉘어 구동된다.
t1 기간에 리셋펄스(RP)는 소정의 기울기를 가지고 제 1전압까지 상승한다. 이때, 방전셀에서는 리셋방전이 발생되어 소정의 벽전하들이 형성된다. t2 기간에는 제 1전압을 가지고 소정시간(즉, t2의 시간)동안 t1기간에 형성된 벽전하들을 유지한다. t3 기간에는 제 1전압보다 낮은 전압값인 제 2전압값을 소정시간(즉, t3의 시간)동안 유지하며 방전셀에 형성된 벽전하를 유지한다. t4 기간에는 제 1전압값이 소정의 기울기를 가지고 서서히 하강하면서 방전셀에 형성된 벽전하를 균일하게 분포시킨다. 이와같은 리셋펄스(RP)가 공급된 후 소정시간(t8) 후에 스캔펄스(SP)가 인가된다.
한편, 제 Y2번째 제 1전극라인(Y2)에 공급되는 리셋펄스(RP)는 소정의 기울기를 가시고 상승하는 t1기간, 제 1전압값을 유지하는 t2기간, t2기간에 공급되는 전압값보다 낮은 제 2전압값을 유지하는 t5기간 및 소정의 기울기를 가지고 하강하는 t4기간으로 나뉘어 구동된다. 여기서, 리셋펄스(RP)가 공급된 후 소정시간(t8) 후에 스캔펄스(SP)가 인가될 수 있도록 t1, t2 및 t4의 기간은 모든 제 1전극라인(Y1 내지 Ym)에서 동일하게 설정되는 반면에 제 2전압값을 유지하는 t5기간은 제 Y1번째 제 1전극라인(Y1)에서 제 2전압값을 유지하는 t3기간보다 크게 설정된다. 따라서, 본 발명의 실시예에 의한 PDP의 구동방법에 의하면 리셋펄스(RP)가 공급된 후 스캔펄스(SP)가 인가되는 시간(t8)이 모든 제 1전극라인(Y1 내지 Ym)에서 동일하게 설정된다.
다시 말하여, 리셋펄스(RP)가 공급된 후 소정시간(t8) 후에 스캔펄스(SP)가 인가될 수 있도록 모든 제 1전극라인(Y1)에 공급되는 리셋펄스(RP)의 t1, t2 및 t4기간은 동일하게 설정되는 반면에 제 2전압값을 유지하는 기간(t3,t5,t6,…,t7)은 상이하게 설정된다. 따라서, 본 발명의 제 3실시예에 의한 PDP에 의하면 모든 방전셀에 일정한(균일한) 벽전하가 형성된 후 어드레스 방전이 일어나기 때문에 화질을 향상시킬 수 있다.
한편, 본 발명에서는 모든 방전셀에 일정한 벽전하가 형성된 후 어드레스 방전이 일어날 수 있도록 제 1 및 제 3 실시예를 혼합하여 실시할 수 있다. 즉, 제 1전압을 유지하는 기간 및 제 2전압을 유지하는 기간을 순차적으로(즉, 스캔펄스(SP)가 인가되는 순서) 넓게 설정할 수 있다.
도 9는 본 발명의 제 4실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 9를 참조하면, 본 발명의 제 4실시예에 의한 플라즈마 디스플레이 패널의 구동방법에서는 적어도 2개 이상의 제 1전극라인(Y)에 동일한 리셋펄스(RP)가 공급된다. 즉, 본 발명의 제 4실시예에서는 블록별로 상이한 리셋펄스(RP)가 공급된다.
이를 상세히 설명하면, 제 1블록(여기서는 Y1 및 Y2전극)에 공급되는 리셋펄스(RP)는 소정의 기울기를 가지고 제 1전압까지 상승하는 t1기간, 제 1전압값을 유지하는 t2기간, 제 1전압값보다 낮은 제 2전압값을 유지하는 t3기간 및 소정의 기울기를 가지고 하강하는 t4기간으로 나뉘어 구동된다.
t1 기간에 리셋펄스(RP)는 소정의 기울기를 가지고 제 1전압까지 상승한다. 이때, 방전셀에서는 리셋방전이 발생되어 소정의 벽전하들이 형성된다. t2 기간에는 제 1전압을 가지고 소정시간(즉, t2의 시간)동안 t1기간에 형성된 벽전하들을 유지한다. t3 기간에는 제 1전압보다 낮은 전압값인 제 2전압값을 소정시간(즉, t3의 시간)동안 유지하며 방전셀에 형성된 벽전하를 유지한다. t4 기간에는 제 1전압값이 소정의 기울기를 가지고 서서히 하강하면서 방전셀에 형성된 벽전하를 균일하게 분포시킨다. 이와 같이 제 1블록(Y1 및 Y2전극)에 동일한 리셋펄스(RP)가 공급되면 제 Y1 전극라인(Y1)에 공급되는 스캔펄스(SP)는 t8의 시간후에 공급된다. 또한, 제 Y2 전극라인(Y2)에 공급되는 스캔펄스(SP)는 t9의 시간후에 공급된다. 즉, 제 1블록에 포함되어 있는 전극라인들(Y1,Y2)에는 동일한 폭을 가지는 리셋펄스(RP)가 인가되기 때문에 리셋펄스(RP)후에 스캔펄스(SP)가 인가되는 시간이 상이해진다. 하지만, 제 1블록에 포함되어 있는 전극라인들(Y1,Y2)에는 순차적으로 스캔펄스가 인가되기 때문에 리셋펄스(RP)에 의해 형성된 벽전하들이 재결합되지 않는다.
한편, 제 2블록(여기서는 Y3 및 Y4전극)에 공급되는 리셋펄스(RP)는 소정의 기울기를 가지고 상승하는 t1기간, 제 1전압값을 유지하는 t2기간, t2기간에 공급되는 전압값보다 낮은 제 2전압값을 유지하는 t5기간 및 소정의 기울기를 가지고 하강하는 t4기간으로 나뉘어 구동된다. 여기서, 리셋펄스(RP)가 공급된 후 소정시간(t8,t9) 후에 스캔펄스(SP)가 인가될 수 있도록 t1, t2 및 t4의 기간은 동일하게 설정되는 반면에 제 2전압값을 유지하는 t5기간은 제 1블록의 t3기간보다 크게 설정된다. 따라서, 본 발명의 실시예에 의한 PDP의 구동방법에 의하면 리셋펄스(RP)가 공급된 후 스캔펄스(SP)가 인가되는 시간(t8,t9)이 블록별로 동일하게 설정된다.
다시 말하여, 리셋펄스(RP)가 공급된 후 소정시간(t8,t9) 후에 스캔펄스(SP)가 인가될 수 있도록 모든 제 1블록에 공급되는 리셋펄스(RP)의 t1, t2 및 t4기간은 모든 블록에서 동일하게 설정되는 반면에 제 1전압값을 유지하는 기간(t3,t5,…,t6)은 상이하게 설정된다. 따라서, 본 발명의 제 1실시예에 의한 PDP에 의하면 모든 블록들에 균일한 벽전하를 형성시킬 수 있다.
도 10은 본 발명의 제 5실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 10을 참조하면, 본 발명의 제 5실시예에 의한 플라즈마 디스플레이 패널의 구동방법에서는 모든 제 1전극라인들(Y1 내지 Ym)에서 리셋펄스(RP)가 공급된 후 스캔펄스(SP)가 공급되는 시간(t8)이 동일할 수 있도록 리셋펄스(RP)의 인가시점이 상이하게 설정된다. 따라서, 모든 방전셀에 스캔펄스(SP)가 공급될 때 방전셀에는 균일한 벽전하들이 형성된다.
이를 상세히 설명하면, 제 Y1번째 제 1전극라인(Y1)에 리셋펄스(RP)가 공급된 후 t8의 시간후에 스캔펄스(SP)가 공급된다. 제 Y2번째 제 1전극라인(Y1)에 공급되는 리셋펄스(RP)는 제 Y1번째 제 1전극라인(Y1)에 공급되는 리셋펄스(RP)보다 늦은 시간에 인가된다. 이때, 제 Y2번째 제 1전극라인(Y1)에 공급되는 리셋펄스(RP)의 공급타이밍은 리셋펄스(RP)가 인가되는 t8의 시간후에 스캔펄스(SP)가 인가될 수 있도록 설정된다. 즉, 본 발명의 제 5실시예에 의하면 모든 제 1전극라인(Y1 내지 Ym)들에서 리셋펄스(RP)의 인가시점을 상이하게 설정하여 방전셀에 균일한 벽전하를 형성시킬 수 있다. 따라서, 본 발명의 제 5실시예에 의한 PDP에 의하면 모든 방전셀에 일정한(균일한) 벽전하가 형성된 후 어드레스 방전이 일어나기 때문에 화질을 향상시킬 수 있다.
한편, 이와 같은 본 발명의 제 1 내지 제 5실시예는 듀얼 스캔방식의 플라즈마 디스플레이 패널에도 적용될 수 있다.
예를 들어, 제 1실시예를 듀얼 스캔방식의 플라즈마 디스플레이 패널에 적용하면 도 11과 같은 구동파형이 나타난다.
도 11을 참조하면, 본 발명의 제 6실시예에 의한 플라즈마 디스플레이 패널의 구동방법에서 제 1전극라인들(Y1 내지 Ym)은 상부블록(Y1 내지 Ym/2)과 하부블록(Ym/2+1 내지 Ym)으로 나뉘어 구동된다. 상부블록에 포함되어 있는 제 1전극라인들(Y1 내지 Ym/2)은 본 발명의 제 1실시예와 동일한 방법으로 구동된다. 또한, 하부블록에 포함되어 있는 제 1전극라인들(Ym/2+1 내지 Ym)은 상부블록과 동일한 방법으로 구동된다. 따라서, 본 발명의 제 6실시예에 의한 플라즈마 디스플레이 패널의 구동방법에 의하면 모든 방전셀에 일정한 벽전하가 형성된 후 어드레스 방전이 일어나기 때문에 화질을 향상시킬 수 있다. 한편, 이러한 듀얼스캔방식은 본 발명의 제 2 내지 제 5실시예에도 동일하게 적용될 수 있다.
도 12는 본 발명의 제 7실시예에 의한 플라즈마 디스플레이 패널의 구동방법을 나타내는 파형도이다.
도 12를 참조하면, 본 발명의 제 7실시 예에 의한 PDP의 구동방법은 리셋기간, 어드레스 기간 및 서스테인 기간으로 나뉘어 구동된다. 리셋기간에는 제 1전극라인(Y1 내지 Ym)에 리셋펄스(RP)가 인가되어 방전셀에 균일한 벽전하를 형성한다. 어드레스 기간에는 제 1전극라인(Y1 내지 Ym)에 스캔펄스(SP)가 인가됨과 아울러 어드레스전극라인(X1 내지 Xn)에 데이터펄스(DP)가 인가된다. 이때, 스캔펄스(SP) 및 데이터펄스(DP)가 인가된 방전셀들에서는 어드레스 방전이 일어난다. 서스테인 기간에는 제 1전극라인(Y1 내지 Ym) 및 제 2전극라인(Z1 내지 Zm)에 교번적으로 서스테인 펄스(SUSPy,SUSPz)가 인가되어 어드레스 방전에 일어난 방전셀에서 서스테인 방전을 일으킨다.
이와 같은 본 발명의 제 7실시예에 의한 PDP의 구동방법에서는 제 1전극라인(Y1 내지 Ym)에 리셋펄스(RP)가 인가될때 제 2전극라인(Z1 내지 Zm)에는제 1전압(Vz1)이 인가된다. 또한, 제 1전극라인(Y1 내지 Ym)에 스캔펄스(SP)가 인가될 때 제 2전극라인(Z1 내지 Zm)에는 제 1전압(Vz1) 보다 높은 전압값을 가지는 제 2전압(Vz2)이 인가된다. 제 2전극라인(Z1 내지 Zm)에 인가되는 제 2전압(Vz2)은 리셋펄스(RP) 종료후 첫번째 제 1전극라인(Y1)에 스캔펄스(SP)가 인가되기 전에 공급된다. 이와 같은 제 2전압(Vz2)은 마지막 스캔펄스(SP)가 제 1전극라인(Ym)에 공급될 때 까지 유지된다. 이와 같이 제 2전압(Vz2)이 제 2전극라인(Z)에 공급되면 리셋기간에 생성된 벽전하의 소멸을 방지하여 안정적인 어드레스 방전을 일으킬 수 있다.
이를 상세히 설명하면, 리셋 기간에 발생되는 리셋방전에 의해 도 13과 같이 어드레스전극(X)에는 양의 벽전하가 형성되고, 제 1 및 제 2전극(Y,Z)에는 음의 벽전하가 형성된다. 즉, 제 1전극(Y)에는 양의 리셋펄스(RP)가 인가되어 음의 벽전하가 형성된다. 또한, 제 1전극(Y)과 인접되게 형성되어 있는 제 2전극(Z)에는 제 1전압(Vz1)이 인가되어 음의 벽전하가 형성된다. 한편, 제 1전극(Y) 및 제 2전극(Z)보다 상대적으로 낮은 전위를 가지는 어드레스전극(X)에는 양의 벽전하가 형성된다. 이와 같은 리셋기간 이후에 제 2전극(Z)에는 제 1전압(Vz1) 보다 높은 전압을 가지는 제 2전압(Vz2)이 인가된다.
제 2전극(Z)에 정극성의 제 2전압(Vz2)이 인가되면 제 2전극(Z)에 형성된 음의 벽전하들의 재결합을 방지하게 된다. 즉, 제 2전극(Z)에 정극성의 제 2전압(Vz2)이 인가되어 제 2전극(Z)에 형성된 벽전하들을 유지하게 된다. 이와 같이 본 발명의 제 3실시예에서는 리셋펄스(RP)가 인가된 후 첫번째 스캔펄스(SP)가인가되기 전에 제 2전극(Z)에 제 2전압(Vz2)을 인가하여 방전셀에 형성된 벽전하의 재결합을 방지하게 된다. 따라서, 본 발명의 제 7실시예에 의한 PDP에 의하면 안정된 어드레스 방전을 일으킬 수 있으므로 PDP의 화질을 향상시킬 수 있다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널의 구동방법에 의하면 모든 방전셀에서 리셋펄스가 인가된 후 스캔펄스가 인가되는 시간을 라인별 또는 블록별로 동일하게 설정하여 방전셀에 균일한 벽전하를 형성할 수 있다. 따라서, 어드레스 기간에 데이터펄스가 인가된 방전셀들에서는 안정된 어드레스 방전을 일으킬 수 있다.
또한, 본 발명의 따른 플라즈마 디스플레이 패널의 구동방법에 의하면 리셋방전에 의해 생성된 벽전하의 재결합을 방지하므로 어드레스 기간에 안정된 어드레스 방전을 일으킬 수 있다. 즉, 본 발명에 따른 플라즈마 디스플레이 패널에 의하면 플라즈마 디스플레이 패널의 화질을 향상시킬 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.

Claims (15)

  1. 방전셀을 선택하기 위하여 제 1전극들에 순차적으로 스캔펄스가 인가되는 단계와,
    상기 제 1전극과 교차되게 형성되는 어드레스전극들에 상기 스캔펄스에 동기되는 데이터펄스가 인가되는 단계와,
    상기 스캔펄스가 인가되기 전에 상기 제 1전극에 인가되는 리셋펄스의 폭이 상기 스캔펄스의 인가순서에 따라 상이하게 설정되는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1 항에 있어서,
    상기 리셋펄스의 펄스 폭은 상기 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 상기 스캔펄스가 인가될 수 있도록 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 제 1항에 있어서,
    상기 리셋펄스는,
    소정의 기울기를 가지고 제 1전압까지 상승하는 상승구간과,
    상기 제 1전압을 소정시간 유지하는 제 1유지구간과,
    상기 제 1전압보다 낮은 전압값을 가지는 제 2전압을 일정시간 유지하는 제2유지구간과,
    상기 제 2전압으로부터 소정의 기울기를 가지고 하강하는 하강구간을 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  4. 제 3항에 있어서,
    상기 제 1유지구간의 폭은 상기 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 상기 스캔펄스가 인가될 수 있도록 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 4항에 있어서,
    상기 상승구간, 제 2유지구간 및 하강구간의 폭은 제 1전극들에 인가되는 모든 리셋펄스들에서 동일하게 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 제 3항에 있어서,
    상기 제 2유지구간의 폭은 상기 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 상기 스캔펄스가 인가될 수 있도록 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  7. 제 6항에 있어서,
    상기 상승구간, 제 1유지구간 및 하강구간의 폭은 제 1전극들에 인가되는 모든 리셋펄스들에서 동일하게 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  8. 제 3항에 있어서,
    상기 제 1유지구간 및 제 2유지구간의 폭은 상기 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 상기 스캔펄스가 인가될 수 있도록 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  9. 제 3항에 있어서,
    상기 제 1전극은 소정의 블록으로 분활되고, 상기 블록내에 포함되어 있는 상기 제 1전극들에 인가되는 리셋펄스의 제 1유지구간 및 제 2유지구간중 적어도 하나 이상의 구간의 폭은 상기 리셋펄스가 인가된 후 모든 제 1전극들에서 동일한 시간이 경과한 후 상기 스캔펄스가 인가될 수 있도록 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  10. 제 3항에 있어서,
    상기 제 1전극라인들은 상부블록과 하부블록으로 나뉘고, 상기 상부블록과 하부블록은 동시에 구동되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  11. 방전셀을 선택하기 위하여 제 1전극들에 순차적으로 스캔펄스가 인가되는 단계와,
    상기 제 1전극과 교차되게 형성되는 어드레스전극들에 상기 스캔펄스에 동기되는 데이터펄스가 인가되는 단계와,
    상기 스캔펄스가 인가되기 전에 상이한 시점에서 상기 제 1전극들에 리셋펄스가 인가되는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  12. 제 11항에 있어서,
    상기 리셋펄스의 인가시점은 모든 제 1전극들에서 동일한 시간이 경과한 후 상기 스캔펄스가 인가될 수 있도록 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  13. 제 11항에 있어서,
    상기 제 1전극라인들은 상부블록과 하부블록으로 나뉘어 동시에 구동되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  14. 리셋기간에 제 1전극들에 램프파형의 리셋펄스가 인가되는 단계와,
    어드레스 기간에 상기 제 1전극들에 스캔펄스가 인가되는 단계와,
    상기 어드레스 기간에 켜질 방전셀을 선택하기 위하여 상기 스캔펄스들에 동기되는 데이터펄스가 인가되는 단계와,
    상기 램프파형이 상기 제 1전극들에 인가될 때 상기 제 1전극과 인접되게 형성되는 제 2전극들에 제 1전압이 인가되는 단계와,
    상기 제 1전극들에 첫번째 스캔펄스가 인가되기 전에 상기 제 2전극들에 제 2전압이 인가되는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  15. 제 14항에 있어서,
    상기 제 2전압의 전압레벨은 상기 제 1전압의 전압레벨 보다 높게 설정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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