KR100838071B1 - 디스플레이 패널의 구동장치 및 그 방법 - Google Patents

디스플레이 패널의 구동장치 및 그 방법 Download PDF

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Abstract

본 발명은, 적어도 하나 레벨 이상의 전원들로부터 복수개의 전극 라인들 각각에 전원을 인가하여 디스플레이 패널을 구동하는 것으로, 제1레벨의 전원과 각각의 상기 전극 라인들의 연결을 제어하는 제1 제어스위치들과, 상기 각각의 전극 라인들과 제2레벨의 전원의 연결을 제어하는 제2 제어스위치들을 구비하고, 상기 모든 전극 라인들에 상기 제1레벨 또는 제2레벨의 전원이 인가됨에 있어서, 상기 전극 라인들을 2이상의 그룹으로 나누고, 상기 제1 제어스위치 및 상기 제2 제어스위치의 스위칭 타이밍을 상기 그룹별로 달리하는 디스플레이 패널의 구동장치를 제공한다.

Description

디스플레이 패널의 구동장치 및 그 방법{Apparatus of driving plasma display panel and method thereof}
도 1은 본 발명에 따른 디스플레이 패널의 구동장치가 적용되는 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다.
도 2는 도 1의 플라즈마 디스플레이 패널을 구동하기 위한 플라즈마 디스플레이 패널의 구동장치를 간략히 도시한 블록도이다.
도 3은 도 2의 플라즈마 디스플레이 패널의 구동장치에서 Y 구동부를 개략적으로 도시한 회로도이다.
도 4는 단위 프레임을 복수개의 서브필드들로 구성하여 구동하는 플라즈마 디스플레이 패널의 구동 방법을 보여주는 타이밍도이다.
도 5는 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들이 순서대로 2개의 그룹으로 나뉘는 것을 개략적으로 도시한 도면이다.
도 6은 본 발명에 따른 바람직한 실시예로서, 도 5의 플라즈마 디스플레이 패널에 대하여 도 3의 각 구동부에서 출력하는 구동신호를 개략적으로 도시한 타이밍도이다.
도 7은 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들이 홀수번째 전극 라인들과 짝수번째 전극 라인들 2개의 그룹으로 나뉘는 것을 개략적으로 도시한 도 면이다.
도 8은 본 발명에 따른 바람직한 다른 실시예로서, 도 7의 플라즈마 디스플레이 패널에 대하여 도 3의 각 구동부에서 출력하는 구동신호를 개략적으로 도시한 타이밍도이다.
<도면의 주요 부분에 대한 부호의 설명>
12: 논리 제어부, 14, 600: Y 구동부,
18, 500: X 구동부, 16 : 어드레스 구동부,
601: 주사 스위칭부.
본 발명은 디스플레이 패널의 구동장치 및 그 방법에 관한 것으로서, 보다 상세하게는 고전압, 고주파수의 전기적 에너지를 이용하여 짧은 시간 동안 반복적인 방전에 의하여 화상을 표시하는 디스플레이 패널의 구동장치 및 그 방법에 관한 것이다.
평판 디스플레이 장치로서 대형 패널의 제작이 용이한 플라즈마 디스플레이 패널(Plasma Display Panel, PDP)이 주목받고 있다. 플라즈마 디스플레이 패널은 방전현상을 이용하여 화상을 표현하는 디스플레이 장치인데, 일반적으로 플라즈마 디스플레이 패널은 구동 전압의 형태에 따라서 직류형과 교류형으로 나눌 수 있으며, 직류형의 경우 방전시간의 지연시간이 긴 단점으로 인하여 교류형 플라즈마 디 스플레이 패널의 개발이 많이 이루어지고 있다.
교류형 플라즈마 디스플레이 패널로는 3전극을 구비하고 교류 전압에 의하여 구동되는 3전극 교류 면방전 방식의 플라즈마 디스플레이 패널이 대표적이다. 일반적인 3-전극 면방전 방식의 플라즈마 디스플레이 패널은 다층의 판으로 이루어져 있으며, 종래의 화면표시장치인 음극선관(CRT)에 비하여 두께가 얇고 가벼우면서도 넓은 화면을 제공할 수 있기에 공간적으로 유리하다.
통상의 플라즈마 디스플레이 패널의 일 예로서, 3-전극 면방전 방식의 플라즈마 디스플레이 패널과 그 구동장치, 및 구동방법이 본 출원인의 미국 특허 제6,744,218호(명칭: Method of driving a plasma display panel in which the width of display sustain pulse varies)에 개시되어 있다. 상기 미국특허에 개시된 플라즈마 디스플레이 패널과 그 구동장치, 및 구동방법에 관한 사항은 본 명세서에 포함되는 것으로 하고, 그 자세한 설명은 생략한다.
플라즈마 디스플레이 패널은 유지 전극과 어드레스 전극이 교차되는 영역에 형성되는 다수개의 디스플레이 셀들을 구비하며, 하나의 디스플레이 셀은 세 개(적색, 녹색, 청색)의 방전셀들로 구성되며, 상기 방전셀들의 방전 상태를 조절함에 따라 화상의 계조를 표현한다.
플라즈마 디스플레이 패널의 계조를 표현하기 위하여 플라즈마 디스플레이 패널에 인가되는 하나의 프레임을 발광 횟수가 다른 8개의 서브필드들로 구성하여 256 계조를 표현할 수가 있다. 즉, 256 계조로 화상을 표시하고자하는 경우에 1/60초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들로 나누어진다. 상기 각 각의 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재하여 플라즈마 디스플레이 패널이 구동된다.
플라즈마 디스플레이 패널의 단위광이 증가하면서 방전을 위한 방전 유지전압의 크기가 증가되며, 휘도를 증가시키기 위하여 주파수가 높아진다. 또한, 이러한 플라즈마 디스플레이 패널의 구동을 위하여, 각각의 전극 라인들에 고전압 고주파수 성분의 전압이 인가된다. 그리고, 이를 위하여 스위칭 소자에 의한 스위칭이 필요하다.
한편, 하나의 전극 라인을 통하여 패널 커패시터에 전원을 2가지 레벨의 전원을 인가하기 위하여, 2 개의 스위칭 소자에 의하여 각각의 전극 라인들에 전원이 인가되는 것을 제어한다. 이때, 플라즈마 디스플레이 패널의 구동방법에 따라, 특정 구간에 모든 Y 전극 라인에 동일한 신호가 인가될 수 있다. 또한, 특정 구간에 모든 Y 전극 라인에 연결되는 상기 스위칭 소자들에서 동시에 온(ON) 및 오프(OFF) 작동될 수 있다.
이 경우에, 모드 Y 전극 라인들에서 전류 흐름에 급격한 변화가 발생할 수 있으며, 그로 인하여 많은 량의 EMI 방사가 발생할 수 있는 문제점이 있다.
본 발명은, 동일한 신호가 인가되는 전극 라인들을 2 이상의 그룹으로 나누고, 각각의 그룹별로 신호가 인가되는 타이밍을 달리하여, 급격한 전류 변화에 따른 EMI 방사를 저감시킬 수 있는 디스플레이 패널의 구동장치 및 그 방법를 제공하는 것을 목적으로 한다.
본 발명은, 적어도 하나 레벨 이상의 전원들로부터 복수개의 전극 라인들 각각에 전원을 인가하여 디스플레이 패널을 구동하는 것으로, 제1레벨의 전원과 각각의 상기 전극 라인들의 연결을 제어하는 제1 제어스위치들과, 상기 각각의 전극 라인들과 제2레벨의 전원의 연결을 제어하는 제2 제어스위치들을 구비하고, 상기 모든 전극 라인들에 상기 제1레벨 또는 제2레벨의 전원이 인가됨에 있어서, 상기 전극 라인들을 2이상의 그룹으로 나누고, 상기 제1 제어스위치 및 상기 제2 제어스위치의 스위칭 타이밍을 상기 그룹별로 달리하는 디스플레이 패널의 구동장치를 제공한다.
상기 제1 제어스위치가 닫히고 상기 제2 제어스위치가 열리는 타이밍 또는 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫히는 타이밍을 상기 그룹별로 달리하는 것이 바람직하다.
상기 전극 라인들을 제1그룹과 제2그룹으로 나누고, 상기 제2그룹의 전극 라인들에 대하여 상기 제1 제어스위치가 닫히고 상기 제2 제어스위치가 열리는 타이밍 또는 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫히는 타이밍이, 상기 제1그룹의 전극 라인들에서의 타이밍보다 뒤지는 것이 바람직하다.
상기 전극 라인들이 상기 디스플레이 패널의 일방향으로 연장되도록 배치되고, 상기 디스플레이 패널의 일단으로부터 타단의 방향으로 홀수번째 전극 라인들이 제1그룹이 되고, 짝수번째 전극 라인들이 제2그룹이 되도록, 상기 전극 라인들이 나뉘는 것이 바람직하다.
상기 전극 라인들이 상기 디스플레이 패널의 일방향으로 연장되도록 배치되고, 상기 전극 라인들이 일단으로부터 타단의 방향으로 순서에 따라 그룹으로 나뉘는 것이 바람직하다.
상기 전극 라인들이 각각의 그룹에 동일한 개수의 전극 라인들이 포함되도록 그룹으로 나뉘는 것이 바람직하다.
X 전극라인 및 Y 전극라인과 어드레스 전극라인이 교차되는 영역에 방전셀이 형성되고, 상기 전극 라인들이, X 전극라인과 Y 전극라인 및 어드레스 전극라인들 중에서 적어도 하나 이상인 것이 바람직하다.
본 발명의 다른 측면은, X 전극라인 및 Y 전극라인과 어드레스 전극라인이 교차되는 영역에 방전셀이 형성되고, 적어도 하나 레벨 이상의 전원들로부터 복수개의 상기 Y 전극 라인들 각각에 전원을 인가하여 디스플레이 패널을 구동하고, 제1레벨의 전원과 각각의 상기 Y 전극 라인들의 연결을 제어하는 제1 제어스위치들과, 상기 각각의 Y 전극 라인들과 제2레벨의 전원의 연결을 제어하는 제2 제어스위치들을 구비하고, 상기 모든 Y 전극 라인들에 상기 제1레벨 또는 제2레벨의 전원이 인가됨에 있어서, 상기 모든 Y 전극 라인들을 2이상의 그룹으로 나누고, 상기 제1 제어스위치 및 상기 제2 제어스위치의 스위칭 타이밍을 상기 그룹별로 달리하는 디스플레이 패널의 구동장치를 제공한다.
디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치에 따른 복수개의 서브-필드들이 존재하고, 상기 각각의 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재하고, 상기 어드레스 주기 에, 상기 패널의 일단으로부터 타단의 방향으로 상기 Y 전극 라인들에 순차적으로 스캔 펄스가 인가되고, 각각의 상기 방전셀들 중에서 표시하고자 하는 방전셀의 상기 어드레스 전극라인들에 데이터 펄스가 인가되어 표시하고자 하는 방전셀을 선택함에 있어서, 상기 스캔 펄스가 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫힘으로써 인가되는 것이 바람직하다.
상기 리셋주기가 제1 리셋주기 및 제2 리셋주기를 구비하고, 상기 제1 리셋주기가, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫힌 상태에서, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열리는 제1주기와, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열린 상태에서, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열리는 제2주기, 및 상기 Y 전극 라인들에 제1레벨로부터 일정한 기울기를 가지며 제3레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제3주기를 포함하는 것이 바람직하다.
상기 제2 리셋주기가, 상기 제1 그룹과 제2 그룹의 Y 전극 라인들이 상기 제1레벨을 유지하는 제4주기와, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열린 상태에서, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫히는 제5주기와, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫힌 상태에서, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제 어스위치들이 닫히는 제6주기를 포함하는 것이 바람직하다.
본 발명의 다른 측면은, 적어도 하나 레벨 이상의 전원들로부터 복수개의 전극 라인들 각각에 전원을 인가하는 것으로, 제1레벨의 전원과 각각의 상기 전극 라인들의 연결을 제어하는 제1 제어스위치들과, 상기 각각의 전극 라인들과 상기 제1레벨보다 낮은 제2레벨의 전원의 연결을 제어하는 제2 제어스위치들을 포함하는 구동장치에 의하여 디스플레이 패널을 구동하는 것으로, 상기 모든 전극 라인들에 상기 제1레벨 또는 제2레벨의 전원이 인가됨에 있어서, 상기 전극 라인들을 2이상의 그룹으로 나누고, 상기 제1 제어스위치가 닫히고 상기 제2 제어스위치가 열리는 타이밍 또는 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫히는 타이밍을 상기 그룹별로 달리하는 디스플레이 패널의 구동방법을 제공한다.
본 발명에 따르면, 동일한 신호가 인가되는 전극 라인들을 2 이상의 그룹으로 나누고, 각각의 그룹별로 신호가 인가되는 타이밍을 달리하여, 급격한 전류 변화에 따른 EMI 방사를 저감시킬 수 있다.
이하, 첨부된 도면을 참조하여 바람직한 실시예에 따른 본 발명을 상세히 설명하기로 한다.
도 1은 3-전극 면방전 방식의 플라즈마 디스플레이 패널의 구조를 보여주는 내부 사시도이다.
도면을 참조하면, 면방전 플라즈마 디스플레이 패널(1)의 앞쪽 및 뒤쪽 글라스 기판들(10, 13) 사이에는, 어드레스 전극 라인들(AR1∼ABm), 유전층(11, 15), Y 전극 라인들(Y1∼Yn), X 전극 라인들(X1∼Xn), 형광층(16), 격벽(17) 및 보호층으로서의 일산화마그네슘(MgO)층(12)이 마련되어 있다.
어드레스 전극 라인들(AR1∼ABm)은 뒤쪽 글라스 기판(13)의 앞쪽에 일정한 패턴으로 형성된다. 아래쪽 유전층(15)은 어드레스 전극 라인들(AR1∼ABm)의 앞쪽에서 전면(全面) 도포된다. 아래쪽 유전층(15)의 앞쪽에는 격벽(17)들이 어드레스 전극 라인들(AR1∼ABm)과 평행한 방향으로 형성된다. 이 격벽(17)들은 각 방전셀(14)의 방전 영역을 구획하고 각 방전셀(14) 사이의 광학적 간섭(cross talk)을 방지하는 기능을 한다. 형광층(16)은 뒤쪽 글라스 기판(13)위에 형성되는 아래쪽 유전층(15)과 격벽(17)들 사이에 형성되는 공간의 내면에 형성된다.
X 전극 라인들(X1∼Xn)과 Y 전극 라인들(Y1∼Yn)은 어드레스 전극 라인들(AR1 ∼ABm)과 직교되도록 앞쪽 글라스 기판(10)의 뒤쪽에 일정한 패턴으로 형성된다. 각 교차점은 상응하는 방전셀(14)을 설정한다. 각 X 전극 라인(X1∼Xn)과 각 Y 전극 라인(Y1 ∼Yn)은 ITO(Indium Tin Oxide) 등과 같은 투명한 도전성 재질의 투명 전극 라인과 전도도를 높이기 위한 금속 전극 라인이 결합되어 형성된다. 여기서, X 전극 라인들(X1∼Xn)은 각각의 방전셀(14)에서 유지 전극이 되고, Y 전극 라인들(Y1∼Yn)은 각각의 방전셀(14)에서 주사 전극이 되고, 어드레스 전극 라인들(AR1 ∼ABm) 각각의 방전셀(14)에서 어드레스 전극이 된다.
이때, 상기 Y 전극 라인들이 표시하고자 하는 방전셀들을 선택하기 위하여 스캔 펄스가 순차적으로 인가되는 주사(scan) 전극이 된다.
도 2는 도 1의 플라즈마 디스플레이 패널을 구동하기 위한 플라즈마 디스플레이 패널의 구동장치를 간략히 도시한 블록도이다.
도면을 참조하면, 플라즈마 표시 패널(1)의 구동 장치(20)는 영상 처리부(21), 논리 제어부(22), 어드레스 구동부(23), X 구동부(24), 및 Y 구동부(25)를 포함한다. 영상 처리부(21)는 외부 아날로그 영상 신호를 디지털 신호로 변환하여 내부 영상 신호들을 발생시킨다. 내부 영상 신호는 각각 8 비트의 적색(R), 녹색(G) 및 청색(B) 영상 데이터, 클럭 신호, 수직 및 수평 동기 신호 등이 될 수 있다. 논리 제어부(22)는 영상 처리부(21)로부터의 내부 영상 신호에 따라 구동 제어 신호들(SA, SY, SX)을 발생시킨다.
이때, 어드레스 구동부(23), X 구동부(24) 및 Y 구동부(25) 등의 구동부에서 상기 구동 제어 신호들(SA, SY, SX)로부터 입력받아 각각의 구동 신호들을 발생시키고, 발생된 구동 신호를 각각의 전극 라인들에 인가한다.
즉, 어드레스 구동부(23)는, 논리 제어부(22)로부터 입력되는 어드레스 신호(SA)에 따른 표시 데이터 신호를 어드레스 전극 라인들에 인가한다. X 구동부(24)는 논리 제어부(22)로부터 입력되는 X 구동 제어 신호(SX)를 처리하여, X 전극 라인들에 인가한다. Y 구동부(25)는 논리 제어부(22)로부터 입력되는 Y 구동 제어 신호(SY)를 처리하여, Y 전극 라인들에 인가한다.
도 3은 도 2의 플라즈마 디스플레이 패널의 구동장치에서 Y 구동부를 개략적으로 도시한 회로도이다.
도면을 참조하면, 본 발명의 플라즈마 디스플레이 패널의 구동장치는, 유지펄스 인가부(610), 제1 스위칭부(605), 제2 스위칭부(617), 제3 전압 인가부(607), 제4 전압 인가부(609), 주사 스위칭부(601), 제5 전압 인가부(603), 제6 전압 인가부(615), 및 에너지 회수부(620)를 구비한다.
상기 유지펄스 인가부(610)는 제1 전압 인가부(611)와 접지 전압 인가부(612)를 포함한다. 상기 제1 전압 인가부(611)는 Y 전극들(Cp의 제2단)에 구동신호를 출력하기 위하여, 제1전압(Vs)을 제1 노드(N1)에 출력한다. 상기 접지 전압 인가부(612)는 접지 전압(Vg)을 제1 노드(N1)에 출력한다.
상기 제1 스위칭부(605)는 일단이 제1 노드(N1)에 접속되고 타단은 제2 노드(N2)에 접속된 제7 스위칭 소자(S7)를 포함한다. 상기 제2 스위칭부(617)는 일단이 제2 노드(N2)에 접속되고 타단은 제3 노드(N3)에 접속된 제15 스위칭 소자(S15)를 포함한다.
상기 제3 전압 인가부(607)는 제1 노드(N1)와 제2 노드(N2) 사이에 접속되고 제1 전압(Vs)을 제3전압(Vset)까지 일정한 기울기로 점진적으로 상승시키면서 제2 노드(N2)에 출력한다. 상기 제4 전압 인가부(609)는 제3 노드(N3)에 접속되고 제1 전압(Vs)을 제4 전압(Vnf)까지 일정한 기울기로 점진적으로 하강시키면서 제3 노 드(N3)에 출력한다.
상기 주사 스위칭부(601)는 제1블록 스위칭부(601o)와 제2블록 스위칭부(601e)를 구비한다. 제1블록 스위칭부(601o)와 제2블록 스위칭부(601e) 각각은 서로 직렬 접속된 제1 주사 스위칭 소자(SC1, SC21) 및 제2 주사 스위칭 소자(SC2, SC22)를 구비한다. 이때, 제1 주사 스위칭 소자(SC1, SC21)와 제2 주사 스위칭 소자(SC2, SC22)의 사이에 형성된 제4 노드(N4, N24)가 패널의 Y 전극들(Cp의 제2 단)에 접속된다.
제1블록 스위칭부(601o)와 제2블록 스위칭부(601e) 각각은 Y 전극 라인들에 대한 전원의 인가를 제어할 수 있는 스캔 IC들로 이루어질 수 있다. 이때, 모든 Y 전극 라인들이 복수개의 단위로 나뉘고, 각각의 단위에 대하여 하나의 스캔 IC가 연결될 수 있도록, 주사 스위칭부(601)가 복수개의 스캔 IC들로 이루어질 수 있다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동장치는, 적어도 하나 레벨 이상의 전원들로부터 복수개의 전극 라인들 각각에 전원을 인가하여 디스플레이 패널을 구동하는 것으로, 제1 제어스위치들(SC1, SC21)과 제2 제어스위치들(SC2, SC22)을 구비한다. 본 실시예에서 제1 제어스위치들(SC1, SC21)과 제2 제어스위치들(SC2, SC22)은 각각 제1 주사 스위칭 소자(SC1, SC21)와 제2 주사 스위칭 소자(SC2, SC22)가 될 수 있다.
제1 주사 스위칭 소자(SC1, SC21)는 제1레벨의 전원(Vsch)과 각각의 전극 라인들, 본 실시예의 경우 Y 전극 라인들(Yi)의 연결을 제어한다. 제2 주사 스위칭 소자(SC2, SC22)는 각각의 전극 라인들, 본 실시예의 경우 Y 전극 라인들(Yi)과 제 2레벨의 전원(Vscl)의 연결을 제어한다.
이때, 모든 Y 전극 라인들(Yi)에 제1레벨(Vsch) 또는 제2레벨(Vscl)의 전원이 인가됨에 있어서, 상기 모든 Y 전극 라인들(Yi)을 2이상의 그룹으로 나누고, 상기 제1 주사 스위칭 소자(SC1, SC21)와 제2 주사 스위칭 소자(SC2, SC22)의 스위칭 타이밍을 그룹별로 달리한다. 즉, 제1 주사 스위칭 소자(SC1, SC21)가 닫히고 제2 주사 스위칭 소자(SC2, SC22)가 열리는 타이밍을 상기 그룹별로 달리할 수 있다. 또는, 제1 주사 스위칭 소자(SC1, SC21)가 열리고 제2 주사 스위칭 소자(SC2, SC22)가 닫히는 타이밍을 상기 그룹별로 달리할 수 있다.
본 실시예에서는 상기 모든 Y 전극 라인들(Yi)을 제1그룹(도 5의 G11, 도 7의 G21)과 제2그룹(도 5의 G12, 도 7의 G22)으로 나눌 수 있다. 제2그룹(도 5의 G12, 도 7의 G22)의 Y 전극 라인들에 대하여 제1 주사 스위칭 소자(SC1, SC21)가 닫히고 제2 주사 스위칭 소자(SC2, SC22)가 열리는 타이밍 또는 제1 주사 스위칭 소자(SC1, SC21)가 열리고 제2 주사 스위칭 소자(SC2, SC22)가 닫히는 타이밍이, 제1그룹(도 5의 G11, 도 7의 G21)의 Y 전극 라인들에서의 타이밍보다 뒤지도록 할 수 있다. 이때, 모든 Y 전극 라인들(Yi)은 도 5 또는 도 7에 도시된 방법에 의하여 2개의 그룹으로 나눌 수 있다.
모든 Y 전극 라인들(Yi)을 두 개의 그룹으로 나누고, 제1 주사 스위칭 소자(SC1, SC21)와 제2 주사 스위칭 소자(SC2, SC22)의 스위칭 타이밍을 그룹별로 달리하여 전류 및 전압 변화를 분산시킬 수 있다. 따라서, 스캔 IC를 통하여 Y 전극 라인들(Yi)에 흐르는 전류의 피크값 및 평균값이 종래의 경우에 비하여 줄어들고, 그로 인하여 EMI 방사량도 감소시킬 수 있다.
상기 제5 전압 인가부(603)는 제5 전압원(Vsch)을 구비하고 제1 주사 스위칭 소자(SC1, SC21)에 접속되어 제1 주사 스위칭 소자(SC1, SC21)로 제1레벨의 제5전압(Vsch)을 출력한다. 상기 제6 전압 인가부(615) 및 상기 제4 전압 인가부(609)는 제3 노드(N3) 및 제2 주사 스위칭 소자(SC2, SC22)에 접속되어 제2레벨의 제6전압(Vscl)을 출력한다.
상기 에너지 회수부(620)는 패널(Cp) 내에 전하를 축적하거나 패널(Cp) 내의 전하를 저장한다.
제1 전압 인가부(611)는 일단이 제1 전압원(Vs)에 접속되고, 타단이 제1 노드(N1)에 접속된 제8 스위칭 소자(S8)를 구비한다. 접지 전압 인가부(612)는 일단이 접지에 접속되고, 타단이 제1 노드(N1)에 접속된 제9 스위칭 소자(S9)를 구비한다. 유지펄스 인가부(610)는 유지펄스를 발생하기 위하여 제8 스위칭 소자(S8)와 제9 스위칭 소자(S9)를 교대로 턴 온 시킨다.
상기 제8 스위칭 소자(S8) 및 제9 스위칭 소자(S9)는 각각 드레인(drain) 단자, 게이트(gate) 단자, 및 소스(source) 단자를 구비하는 전계효과 트랜지스터(Field Effected Transistor, FET)가 될 수 있다. 이때, 드레인 단자는 전원(Vs)과 연결되고, 게이트 단자는 구동부(미도시)와 연결되고, 소스 단자는 Y 전극 라인(Yi)과 연결될 수 있다.
제3 전압 인가부(607)는 제4 커패시터(C4)와 제10 스위칭 소자(S10)를 구비한다. 상기 제4 커패시터(C4)는 일단이 제1 노드(N1)에 접속되고 타단은 제3 전압 원(Vset)에 접속된다. 상기 제10 스위칭 소자(S10)는 제3 전압원(Vset)과 제2 노드(N3) 사이에 접속된다.
제1 스위칭부(605)의 제7 스위칭 소자(S7)가 턴 오프 되고, 제2 스위칭부(617)의 제15 스위칭 소자(S15)가 턴 온 되고, 제1 전압 인가부(612)의 제8 스위칭 소자(S9)가 턴 온 되고, 제3 전압 인가부(607)의 제10 스위칭 소자(S10)가 턴 온 되고, 주사 스위칭부(601)의 제1 주사 스위칭 소자(SC1, SC21)가 턴 온 됨으로써, 제5 전압(Vsch)에서 제3 전압(Vset)까지 일정한 기울기로 서서히 상승하여 최종적으로 상승최고전압(Vset+Vsch)이 제4 노드(N4)를 통하여 모든 Y 전극 라인들(Yi)에 출력된다.
제4 전압 인가부(609)는 일단이 제3 노드(N3)에 접속되고, 타단이 제4 전압원(Vnf)에 접속된 제11 스위칭 소자(S11)를 구비한다. 제1 전압 인가부(611)의 제8 스위칭 소자(S8), 제1 스위칭부(605)의 제7 스위칭 소자(S7), 제2 스위칭부(617)의 제15 스위칭 소자(S15) 및 제4 전압 인가부(609)의 제11 스위칭 소자(S11)가 턴 온 됨으로써, 제1 전압(Vs)에서 제4 전압(Vnf)까지 서서히 하강한 전압이 제3 노드(N3)에 출력된다.
이를 위하여, 이에 앞서 모든 Y 전극 라인들(Yi)에 대하여 제1 주사 스위칭 소자(SC1, SC21)가 턴 오프 되고, 제2 주사 스위칭 소자(SC2, SC22)가 턴 온 되어, 스캔 IC(601)에 의하여 제5 전압(Vsch)의 인가가 차단된다. 이때, 스캔 IC(601)에서의 전체 Y 전극 라인들에 대하여 급격한 전류 변화가 발생할 수 있으며, 그로 인하여 EMI 방사량이 증가할 수 있다.
따라서, 본 발명에서는 모든 Y 전극 라인들을 2이상의 그룹으로 나누고, 제1 주사 스위칭 소자(SC1, SC21)가 열리고 제2 주사 스위칭 소자(SC2, SC22)가 닫히는 타이밍을 그룹별로 달리한다. 이에 따라, 급격한 전류 변화에 따른 EMI 방사량을 저감시킬 수 있다.
제6 전압 인가부(615)는 제3 노드(N3)와 제6 전압원(Vscl) 사이에 접속된 제12 스위칭 소자(S12)를 구비한다. 제12 스위칭 소자(S12)가 턴 온 되어 제3 노드(N2)에 제6 전압(Vscl)을 출력한다.
주사 스위칭부(601)의 제1 주사 스위칭 소자(SC1)가 턴 온 되고 제2 주사 스위칭 소자(SC2)가 턴 오프 되면, 제5 전압(Vsch)이 제4 노드(N4)를 거쳐 Y 전극들(Cp의 제2 단)에 출력된다. 반면에 주사 스위칭부(601)의 제1 주사 스위칭 소자(SC1)가 턴 오프 되고 제2 주사 스위칭 소자(SC2)가 턴 온 되면, 제3 노드(N3)에 출력된 각 전압, 즉 제1 전압(Vs), 접지 전압(Vg), 제4 전압(Vnf), 제6 전압(Vscl)이 제4 노드(N4)를 거쳐 Y 전극들(Cp의 제2단)에 출력된다.
에너지 회수부(620)는 에너지 저장부(621), 에너지 회수 스위칭부(622), 및 인덕터(L2)를 구비한다. 상기 에너지 저장부(621)는 패널(Cp) 내의 전하를 저장한다. 상기 에너지 회수 스위칭부(622)는 에너지 저장부(621)에 접속되고 에너지 저장부(621)에 저장된 전하를 패널(Cp) 내에 축적하거나 패널(Cp) 내의 전하를 에너지 저장부(621)에 저장하는 것을 제어한다. 상기 인덕터(L2)는 일단이 에너지 회수 스위칭부(622)에 접속되고 타단이 제1 노드(N1)에 접속된다.
에너지 저장부(621)는 패널 내의 전하를 저장하도록 커패시터(C5)를 구비할 수 있다. 에너지 회수 스위칭부(622)는 일단이 에너지 저장부(621)에 접속되고 타단이 인덕터(L2)에 접속된 제13 스위칭 소자(S13)와 제14 스위칭 소자(S14)를 구비한다. 또한, 제13 스위칭 소자(S13)와 제14 스위칭 소자(S14) 사이에 방향이 다른 두개의 제3 및 제4 다이오드(D3,D4)가 접속될 수 있다.
도 4는 단위 프레임을 복수개의 서브필드들로 구성하여 구동하는 플라즈마 디스플레이 패널의 구동 방법을 보여주는 타이밍도이다.
도면을 참조하면, 단위 프레임(FR)은 시분할 계조 표시를 실현하기 위하여 8 개의 서브필드들(SF1∼SF8)로 분할된다. 또한, 각 서브필드(SF1∼SF8)는 리셋 주기(R1∼R8), 어드레스 주기(A1∼A8), 및 유지방전 주기(S1∼S8)로 분할된다.
플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 유지방전 주기(S1∼S8)의 길이에 비례한다. 단위 프레임에서 차지하는 유지방전 주기(S1∼S8)의 길이는 255T(T는 단위 시간)이다. 이때, 제n 서브필드(SFn)의 유지방전 주기(Sn)에는 2n에 상응하는 시간이 각각 설정된다. 이에 따라, 8 개의 서브필드들 중에서 표시될 서브필드를 적절히 선택하면, 어느 서브필드에서도 표시되지 않는 0(영) 계조를 포함하여 모두 256 계조의 표시가 수행될 수 있다.
도 5는 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들이 순서대로 2개의 그룹으로 나뉘는 것을 개략적으로 도시한 도면이다. 도 6은 본 발명에 따른 바람직한 실시예로서, 도 5의 플라즈마 디스플레이 패널에 대하여 도 3의 각 구동부에서 출력하는 구동신호를 개략적으로 도시한 타이밍도이다.
도면을 참조하면, 플라즈마 디스플레이 패널의 구동방법은, 적어도 하나 레벨 이상의 전원들로부터 복수개의 전극 라인들 각각에 전원을 인가하는 것으로, 제1 제어스위치들(SC1, SC21)과 제2 제어스위치들(SC2, SC22)을 구비하는 도 3의 플라즈마 디스플레이 패널의 구동장치에 의하여 디스플레이 패널을 구동한다. 제1 주사 스위칭 소자(SC1, SC21)는 제1레벨의 전원(Vsch)과 각각의 전극 라인들, 본 실시예의 경우 Y 전극 라인들(Yi)의 연결을 제어한다. 제2 주사 스위칭 소자(SC2, SC22)는 각각의 전극 라인들, 본 실시예의 경우 Y 전극 라인들(Yi)과 제1 레벨보다 낮은 제2레벨의 전원(Vscl)의 연결을 제어한다.
이때, 모든 Y 전극 라인들(Yi)에 제1레벨(Vsch) 또는 제2레벨(Vscl)의 전원이 인가됨에 있어서, 상기 모든 Y 전극 라인들(Yi)을 2이상의 그룹으로 나누고, 상기 제1 주사 스위칭 소자(SC1, SC21)와 제2 주사 스위칭 소자(SC2, SC22)의 스위칭 타이밍을 그룹별로 달리한다. 즉, 제1 주사 스위칭 소자(SC1, SC21)가 닫히고 제2 주사 스위칭 소자(SC2, SC22)가 열리는 타이밍을 상기 그룹별로 달리할 수 있다. 또는, 제1 주사 스위칭 소자(SC1, SC21)가 열리고 제2 주사 스위칭 소자(SC2, SC22)가 닫히는 타이밍을 상기 그룹별로 달리할 수 있다.
플라즈마 디스플레이 패널을 구동하기 위한 단위 프레임은 시분할 계조 디스플레이를 위하여 각각의 계조 가중치에 따른 복수개의 서브-필드들로 나뉜다. 또한, 각각의 서브필드(SF)는 리셋 기간(PR), 어드레스 기간(PA) 및 유지 기간(PS)으로 나뉜다.
리셋 기간(PR)은 제1 리셋주기(PR1)와, 제2 리셋주기(PR2)를 구비하여, 전체 방전셀들을 초기화한다.
상기 제1 리셋주기(PR1)에는 Y 전극 라인들에 제1레벨(Vsch)로부터 일정한 기울기를 가지며 제3레벨(Vsch+Vset)까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가된다. 이때, X 전극 라인들과 어드레스 전극 라인들은 그라운드 레벨(Vg)로 바이어싱 된다.
상기 제2 리셋주기(PR2)에는 Y 전극 라인들에 제4레벨(Vs)로부터 일정한 기울기를 가지며 제5레벨(Vnf)까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 인가된다. 이때, X 전극 라인들은 바이어스전압(Vb)으로 바이어싱되어 리셋 방전이 수행된다. 리셋 방전에 의해 전체 방전셀을 초기화된다.
상기 제1 리셋주기(PR1)는, 제1주기(P11)와, 제2주기(P12), 및 제3주기(P13)를 포함한다. 상기 제1주기(P11)에는 제2 그룹(G12)에 해당하는 제1 제어스위치들 즉 제1 주사 스위칭 소자(SC21)가 열리고(OFF) 제2 제어스위치들 즉 제2 주사 스위칭 소자(SC22)가 닫힌(ON) 상태에서, 제1 그룹(G11)에 해당하는 제1 주사 스위칭 소자(SC1)가 닫히고(ON) 제2 주사 스위칭 소자(SC2)가 열린다(OFF).
상기 제2주기(P12)에는 제1 그룹(G11)에 해당하는 제1 주사 스위칭 소자(SC1)가 닫히고(ON) 제2 주사 스위칭 소자(SC2)가 열린(OFF) 상태에서, 제2 그룹(G12)에 해당하는 제1 주사 스위칭 소자(SC21)가 닫히고(ON) 제2 주사 스위칭 소자(SC22)가 열린다(OFF). 상기 제3주기(P13)에는 Y 전극 라인들(Yi)에 제1레벨(Vsch)로부터 일정한 기울기를 가지며 제3레벨(Vsch+Vset)까지 일정한 기울기로 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가된다.
상기 제2 리셋주기(PR2)는, 제4주기(P14)와, 제5주기(P15), 및 제6주기(P16)를 포함한다. 상기 제4주기(P14)에는 제1 그룹(G11)과 제2 그룹(G12)의 Y 전극 라인들이 제1레벨(Vsch)을 유지한다.
상기 제5주기(P15)에는 제2 그룹(G12)에 해당하는 제1 주사 스위칭 소자(SC21)가 닫히고(ON) 제2 주사 스위칭 소자(SC22)가 열린(OFF) 상태에서, 제1 그룹(G11)에 해당하는 제1 주사 스위칭 소자(SC1)가 열리고(OFF) 제2 주사 스위칭 소자(SC2)가 닫힌다(ON). 상기 제6주기(P16)에는 제1 그룹(G11)에 해당하는 제1 주사 스위칭 소자(SC1)가 열리고(OFF) 제2 주사 스위칭 소자(SC2)가 닫힌(ON) 상태에서, 제2 그룹(G12)에 해당하는 제1 주사 스위칭 소자(SC21)가 열리고(OFF) 제2 주사 스위칭 소자(SC22)가 닫힌다(ON).
본 실시예에서는, 도 5에 도시된 바와 같이, Y 전극 라인들이 패널의 일단으로부터 타단의 방향으로 순서에 따라 제1그룹(G11)과 제2그룹(G12)으로 나뉜다. 이때, Y 전극 라인들의 개수가 짝수인 경우에는 각각의 그룹(G11, G12)이 동일한 개수의 Y 전극 라인들을 갖는 것이 바람직하다. 또한, 그룹들간의 Y 전극 라인들 개수의 차가 가장 작게 되도록 Y 전극 라인들이 나뉘는 것이 바람직하다.
제2그룹(G12)의 Y 전극 라인들에 대하여 제1 제어스위치(SC21)가 열리고 제2 제어스위치(SC22)가 닫히는 타이밍이, 제1그룹(G11)의 Y 전극 라인들에 대하여 제1 제어스위치(SC1)가 열리고 제2 제어스위치(SC2)가 닫히는 타이밍과 엇갈리도록 한다.
예를 들어, 도 6에 도시된 바와 같이, 제2그룹(G12)에서의 스위치 제어 타이 밍이 제1그룹(G11)에서의 스위치 제어 타이밍보다 시간적으로 뒤지도록, 스위치 제어 타이밍이 제어된다. 따라서, 전체 Y 전극 라인들에 대한 전류 변화가 단계적으로 나뉘어 이루어짐으로, 한 시점에서의 전류 변화량이 줄어들고, 그로 인하여 EMI 방사량이 저감될 수 있다.
어드레스 기간(PA)에는 Y 전극들(Y1, ...,Yn)에 주사펄스가 순차적으로 인가되고, A 전극들(A1, ...,Am)에는 상기 주사펄스에 맞춰 표시 데이터 신호가 인가되어 어드레스 방전이 수행된다. 어드레스 방전에 의해 유지 기간(PS)에서 발생하는 유지방전이 수행될 방전셀이 선택된다.
어드레스 기간(PA)에는 모든 Y 전극 라인들이 스캔하이전압(Vsch+Vscl)으로 바이어싱된 상태에서, 모든 Y 전극 라인들에 대하여 순차적으로 스캔하이전압(Vsch+Vscl)보다 낮은 레벨의 스캔로우전압(Vscl)의 스캔 펄스(scan pulse)가 인가된다. 이때, 표시 데이터 신호는 정극성의 어드레스전압(Va)을 갖는 데이터 펄스가 스캔 펄스에 맞춰 인가된다.
모든 Y 전극 라인들의 스캔하이전압(Vsch+Vscl)으로 바이어싱은 제1 주사 스위칭 소자(SC1, SC21)가 닫히고 제2 주사 스위칭 소자(SC2, SC22)가 열림으로써 이루어진다. 또한, 스캔 펄스는 제1 주사 스위칭 소자(SC1, SC21)가 열리고 제2 주사 스위칭 소자(SC2, SC22)가 닫힘으로써 발생될 수 있다.
유지 기간(PS)에서는 X 전극 라인들과 Y 전극 라인들에 유지펄스가 교호하게 인가되어 유지방전이 수행된다. 유지방전에 의해 각 서브필드마다 할당된 계조 가 중치에 따라 휘도가 표현된다. 유지펄스는 유지방전전압(Vs)과 그라운드 전압(Vg)를 교대로 갖는다.
한편, 도 6에서 도시된 바와 다른 구동신호가 도 3의 각 구동부에서 출력되는 것이 가능하며 도 6에 도시된 것에 한정되지 않는다.
도 7은 도 1의 플라즈마 디스플레이 패널의 Y 전극 라인들이 홀수번째 전극 라인들과 짝수번째 전극 라인들 2개의 그룹으로 나뉘는 것을 개략적으로 도시한 도면이다. 도 8은 본 발명에 따른 바람직한 다른 실시예로서, 도 7의 플라즈마 디스플레이 패널에 대하여 도 3의 각 구동부에서 출력하는 구동신호를 개략적으로 도시한 타이밍도이다.
도면을 참조하면, 플라즈마 디스플레이 패널의 구동방법은, 적어도 하나 레벨 이상의 전원들로부터 복수개의 전극 라인들 각각에 전원을 인가한다.Y 전극 라인들을 2이상의 그룹(G21, G22)으로 나누고, 제1 제어스위치(SC1)가 열리고 제2 제어스위치(SC2)가 닫히는 타이밍을 그룹별(G21, G22)로 달리한다.
본 실시예는 도 5 및 도 6에 도시된 실시예와는 이하에서 설명되는 Y 전극 라인들이 그룹으로 나뉘는 방법을 달리하는 것으로, 이하에서 설명되는 것 이외의 사항은 도 5 및 도 6을 참조한다.
플라즈마 디스플레이 패널을 구동하기 위한 단위 프레임은 시분할 계조 디스플레이를 위하여 각각의 계조 가중치에 따른 복수개의 서브-필드들로 나뉜다. 또한, 각각의 서브필드(SF)는 리셋 기간(PR), 어드레스 기간(PA) 및 유지 기간(PS)으로 나뉜다. 리셋 기간(PR)은 제1 리셋주기(PR1)와, 제2 리셋주기(PR2)를 구비한다.
상기 제1 리셋주기(PR1)는, 제1주기(P21)와, 제2주기(P22), 및 제3주기(P23)를 포함한다. 상기 제1주기(P21)에는 제2 그룹(G22)에 해당하는 제1 제어스위치들 즉 제1 주사 스위칭 소자(SC21)가 열리고(OFF) 제2 제어스위치들 즉 제2 주사 스위칭 소자(SC22)가 닫힌(ON) 상태에서, 제1 그룹(G21)에 해당하는 제1 주사 스위칭 소자(SC1)가 닫히고(ON) 제2 주사 스위칭 소자(SC2)가 열린다(OFF).
상기 제2주기(P22)에는 제1 그룹(G21)에 해당하는 제1 주사 스위칭 소자(SC1)가 닫히고(ON) 제2 주사 스위칭 소자(SC2)가 열린(OFF) 상태에서, 제2 그룹(G22)에 해당하는 제1 주사 스위칭 소자(SC21)가 닫히고(ON) 제2 주사 스위칭 소자(SC22)가 열린다(OFF). 상기 제3주기(P23)에는 Y 전극 라인들(Yi)에 제1레벨(Vsch)로부터 일정한 기울기를 가지며 제3레벨(Vsch+Vset)까지 일정한 기울기로 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가된다.
상기 제2 리셋주기(PR2)는, 제4주기(P24)와, 제5주기(P25), 및 제6주기(P26)를 포함한다. 상기 제4주기(P24)에는 제1 그룹(G21)과 제2 그룹(G22)의 Y 전극 라인들이 제1레벨(Vsch)을 유지한다.
상기 제5주기(P25)에는 제2 그룹(G22)에 해당하는 제1 주사 스위칭 소자(SC21)가 닫히고(ON) 제2 주사 스위칭 소자(SC22)가 열린(OFF) 상태에서, 제1 그룹(G21)에 해당하는 제1 주사 스위칭 소자(SC1)가 열리고(OFF) 제2 주사 스위칭 소자(SC2)가 닫힌다(ON). 상기 제6주기(P26)에는 제1 그룹(G21)에 해당하는 제1 주사 스위칭 소자(SC1)가 열리고(OFF) 제2 주사 스위칭 소자(SC2)가 닫힌(ON) 상태에서, 제2 그룹(G22)에 해당하는 제1 주사 스위칭 소자(SC21)가 열리고(OFF) 제2 주사 스 위칭 소자(SC22)가 닫힌다(ON).
본 실시예에서는, 도 7에 도시된 바와 같이, 패널의 일단으로부터 타단의 방향으로 홀수번째 전극 라인들이 제1그룹(G21)이 되고, 짝수번째 전극 라인들이 제2그룹(G22)이 되도록, Y 전극 라인들이 나뉜다. 이때, Y 전극 라인들의 개수가 짝수인 경우에는 각각의 그룹(G11, G12)가 동일한 개수의 Y 전극 라인들을 갖는 것이 바람직하다. 또한, 그룹들간의 Y 전극 라인들 개수의 차가 가장 작게 되도록 Y 전극 라인들이 나뉘는 것이 바람직하다.
도 8에 도시된 바와 같이, 제2그룹(G22)에서의 스위치 제어 타이밍이 제1그룹(G21)에서의 스위치 제어 타이밍보다 시간적으로 뒤지도록, 스위치 제어 타이밍이 제어된다. 따라서, 전체 Y 전극 라인들에 대한 전류 변화가 단계적으로 나뉘어 이루어짐으로, 한 시점에서의 전류 변화량이 줄어들고, 그로 인하여 EMI 방사량이 저감될 수 있다.
한편 어드레스 기간(PA)에는 모든 Y 전극 라인들이 스캔하이전압(Vsch+Vscl)으로 바이어싱된 상태에서, 먼저 홀수번째 Y 전극 라인들에 대하여 순차적으로 스캔하이전압(Vsch+Vscl)보다 낮은 레벨의 스캔로우전압(Vscl)의 스캔 펄스가 인가된다. 다음으로 짝수번째 Y 전극 라인들에 대하여 순차적으로 스캔하이전압(Vsch+Vscl)보다 낮은 레벨의 스캔로우전압(Vscl)의 스캔 펄스가 인가된다. 이때, 표시 데이터 신호는 정극성의 어드레스전압(Va)을 갖는 데이터 펄스가 스캔 펄스에 맞춰 인가된다.
본 발명에 따른 디스플레이 패널의 구동장치 및 그 방법에 의하면, 동일한 신호가 인가되는 전극 라인들을 2 이상의 그룹으로 나누고, 각각의 그룹별로 신호가 인가되는 타이밍을 달리하여, 급격한 전류 변화에 따른 EMI 방사를 저감시킬 수 있다.
본 발명은 첨부된 도면에 도시된 일 실시예를 참고로 설명되었으나, 이는 예시적인 것에 불과하며, 당해 기술분야에서 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시예가 가능하다는 점을 이해할 수 있을 것이다. 따라서, 본 발명의 진정한 보호 범위는 첨부된 청구 범위에 의해서만 정해져야 할 것이다.

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  10. X 전극라인 및 Y 전극라인과 어드레스 전극라인이 교차되는 영역에 방전셀이 형성되고, 적어도 하나 레벨 이상의 전원들로부터 복수개의 상기 Y 전극 라인들 각각에 전원을 인가하여 디스플레이 패널을 구동하고, 제1레벨의 전원과 각각의 상기 Y 전극 라인들의 연결을 제어하는 제1 제어스위치들과, 각각의 상기 Y 전극 라인들과 제2레벨의 전원의 연결을 제어하는 제2 제어스위치들을 구비하고,
    모든 상기 Y 전극 라인들을 제1그룹과 제2그룹으로 나누고, 상기 제2그룹의 Y 전극 라인들에 대하여 상기 제1 제어스위치가 닫히고 상기 제2 제어스위치가 열리는 타이밍 또는 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫히는 타이밍이, 상기 제1그룹의 전극 라인들에서의 타이밍보다 뒤지고,
    디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치에 따른 복수개의 서브-필드들이 존재하고, 각각의 상기 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재하고,
    상기 리셋주기가, 상기 Y 전극라인들에 제1레벨로부터 일정한 기울기를 가지며 제3레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋주기와, 상기 Y 전극라인들에 제4레벨로부터 일정한 기울기를 가지며 제5레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 인가되는 제2 리셋주기를 구비하고,
    상기 제1 리셋주기가, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫힌 상태에서, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열리는 제1주기와, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열린 상태에서, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열리는 제2주기, 및 상기 Y 전극 라인들에 제1레벨로부터 일정한 기울기를 가지며 제3레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제3주기를 구비하는 디스플레이 패널의 구동장치.
  11. 제10항에 있어서,
    상기 제2 리셋주기가, 상기 제1 그룹과 제2 그룹의 Y 전극 라인들이 상기 제1레벨을 유지하는 제4주기와, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열린 상태에서, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫히는 제5주기와, 상기 Y 전극라인들에 제4레벨로부터 일정한 기울기를 가지며 제5레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 인가되는 제6주기를 구비하는 디스플레이 패널의 구동장치.
  12. X 전극라인 및 Y 전극라인과 어드레스 전극라인이 교차되는 영역에 방전셀이 형성되고, 적어도 하나 레벨 이상의 전원들로부터 복수개의 상기 Y 전극 라인들 각각에 전원을 인가하여 디스플레이 패널을 구동하고, 제1레벨의 전원과 각각의 상기 Y 전극 라인들의 연결을 제어하는 제1 제어스위치들과, 각각의 상기 Y 전극 라인들과 제2레벨의 전원의 연결을 제어하는 제2 제어스위치들을 구비하고,
    모든 상기 Y 전극 라인들을 제1그룹과 제2그룹으로 나누고, 상기 제2그룹의 Y 전극 라인들에 대하여 상기 제1 제어스위치가 닫히고 상기 제2 제어스위치가 열리는 타이밍 또는 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫히는 타이밍이, 상기 제1그룹의 전극 라인들에서의 타이밍보다 뒤지고,
    디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치에 따른 복수개의 서브-필드들이 존재하고, 각각의 상기 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재하고,
    상기 리셋주기가, 상기 Y 전극라인들에 제1레벨로부터 일정한 기울기를 가지며 제3레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋주기와, 상기 Y 전극라인들에 제4레벨로부터 일정한 기울기를 가지며 제5레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 인가되는 제2 리셋주기를 구비하고,
    상기 제2 리셋주기가, 상기 제1 그룹과 상기 제2 그룹의 Y 전극 라인들이 상기 제1레벨을 유지하는 제4주기와, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열린 상태에서, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫히는 제5주기와, 상기 Y 전극라인들에 제4레벨로부터 일정한 기울기를 가지며 제5레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 인가되는 제6주기를 구비하는 디스플레이 패널의 구동장치.
  13. 제12항에 있어서,
    상기 제1 리셋주기가, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫힌 상태에서, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열리는 제1주기와, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열린 상태에서, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열리는 제2주기, 및 상기 Y 전극 라인들에 제1레벨로부터 일정한 기울기를 가지며 제3레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제3주기를 구비하는 디스플레이 패널의 구동장치.
  14. 제11항 또는 제12항에 있어서,
    상기 제6주기에, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫힌 상태에서, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫히는 디스플레이 패널의 구동장치.
  15. 제11항 또는 제12항에 있어서,
    상기 어드레스 주기에, 상기 패널의 일단으로부터 타단의 방향으로 상기 Y 전극 라인들에 순차적으로 스캔 펄스가 인가되고, 각각의 상기 방전셀들 중에서 표시하고자 하는 방전셀의 상기 어드레스 전극라인들에 데이터 펄스가 인가되어 표시하고자 하는 방전셀을 선택함에 있어서, 상기 스캔 펄스가 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫힘으로써 인가되는 디스플레이 패널의 구동장치.
  16. 삭제
  17. 제11항 또는 제12항에 있어서,
    상기 Y 전극 라인들이 상기 디스플레이 패널의 일방향으로 연장되도록 배치되고, 상기 Y 전극 라인들이 일단으로부터 타단의 방향으로 순서에 따라 상기 제1그룹과 상기 제2그룹으로 나뉘는 디스플레이 패널의 구동장치.
  18. 제11항 또는 제12항에 있어서,
    상기 Y 전극 라인들이 상기 디스플레이 패널의 일방향으로 연장되도록 배치되고, 상기 디스플레이 패널의 일단으로부터 타단의 방향으로 홀수번째 Y 전극 라인들이 제1그룹이 되고, 짝수번째 Y 전극 라인들이 제2그룹이 되도록, 상기 Y 전극 라인들이 그룹으로 나뉘는 디스플레이 패널의 구동장치.
  19. 제11항 또는 제12항에 있어서,
    상기 Y 전극 라인들이 각각의 그룹에 동일한 개수의 전극 라인들이 포함되도록 그룹으로 나뉘는 디스플레이 패널의 구동장치.
  20. 제11항 또는 제12항에 있어서,
    상기 제1레벨이 상기 제2레벨보다 높은 레벨인 디스플레이 패널의 구동장치.
  21. X 전극라인 및 Y 전극라인과 어드레스 전극라인이 교차되는 영역에 방전셀이 형성되고, 적어도 하나 레벨 이상의 전원들로부터 복수개의 상기 Y 전극 라인들 각각에 전원을 인가하여 디스플레이 패널을 구동하고, 제1레벨의 전원과 각각의 상기 Y 전극 라인들의 연결을 제어하는 제1 제어스위치들과, 각각의 상기 Y 전극 라인들과 제2레벨의 전원의 연결을 제어하는 제2 제어스위치들을 제어하는 것으로,
    모든 상기 Y 전극 라인들을 제1그룹과 제2그룹으로 나누고, 상기 제2그룹의 Y 전극 라인들에 대하여 상기 제1 제어스위치가 닫히고 상기 제2 제어스위치가 열리는 타이밍 또는 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫히는 타이밍이, 상기 제1그룹의 전극 라인들에서의 타이밍보다 뒤지고,
    디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치에 따른 복수개의 서브-필드들이 존재하고, 각각의 상기 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재하고,
    상기 리셋주기가, 상기 Y 전극라인들에 제1레벨로부터 일정한 기울기를 가지며 제3레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋주기와, 상기 Y 전극라인들에 제4레벨로부터 일정한 기울기를 가지며 제5레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 인가되는 제2 리셋주기를 구비하고,
    상기 제1 리셋주기가, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫힌 상태에서, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열리는 제1주기와, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열린 상태에서, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열리는 제2주기, 및 상기 Y 전극 라인들에 제1레벨로부터 일정한 기울기를 가지며 제3레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제3주기를 구비하는 디스플레이 패널의 구동방법.
  22. 제21항에 있어서,
    상기 제2 리셋주기가, 상기 제1 그룹과 제2 그룹의 Y 전극 라인들이 상기 제1레벨을 유지하는 제4주기와, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열린 상태에서, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫히는 제5주기와, 상기 Y 전극라인들에 제4레벨로부터 일정한 기울기를 가지며 제5레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 인가되는 제6주기를 구비하는 디스플레이 패널의 구동방법.
  23. X 전극라인 및 Y 전극라인과 어드레스 전극라인이 교차되는 영역에 방전셀이 형성되고, 적어도 하나 레벨 이상의 전원들로부터 복수개의 상기 Y 전극 라인들 각각에 전원을 인가하여 디스플레이 패널을 구동하고, 제1레벨의 전원과 각각의 상기 Y 전극 라인들의 연결을 제어하는 제1 제어스위치들과, 각각의 상기 Y 전극 라인들과 제2레벨의 전원의 연결을 제어하는 제2 제어스위치들을 제어하는 것으로,
    모든 상기 Y 전극 라인들을 제1그룹과 제2그룹으로 나누고, 상기 제2그룹의 Y 전극 라인들에 대하여 상기 제1 제어스위치가 닫히고 상기 제2 제어스위치가 열리는 타이밍 또는 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫히는 타이밍이, 상기 제1그룹의 전극 라인들에서의 타이밍보다 뒤지고,
    디스플레이 주기로서의 프레임마다 시분할 계조 디스플레이를 위하여 각각의 계조 가중치에 따른 복수개의 서브-필드들이 존재하고, 각각의 상기 서브-필드마다 리셋 주기, 어드레스 주기, 및 유지방전 주기들이 존재하고,
    상기 리셋주기가, 상기 Y 전극라인들에 제1레벨로부터 일정한 기울기를 가지며 제3레벨까지 지속적으로 상승하는 상승 램프 펄스 파형의 전압이 인가되는 제1 리셋주기와, 상기 Y 전극라인들에 제4레벨로부터 일정한 기울기를 가지며 제5레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 인가되는 제2 리셋주기를 구비하고,
    상기 제2 리셋주기가, 상기 제1 그룹과 상기 제2 그룹의 Y 전극 라인들이 상기 제1레벨을 유지하는 제4주기와, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 닫히고 상기 제2 제어스위치들이 열린 상태에서, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫히는 제5주기와, 상기 Y 전극라인들에 제4레벨로부터 일정한 기울기를 가지며 제5레벨까지 지속적으로 하강하는 하강 램프 펄스 파형의 전압이 인가되는 제6주기를 구비하는 디스플레이 패널의 구동방법.
  24. 제21항 또는 제23항에 있어서,
    상기 어드레스 주기에, 상기 패널의 일단으로부터 타단의 방향으로 상기 Y 전극 라인들에 순차적으로 스캔 펄스가 인가되고, 각각의 상기 방전셀들 중에서 표시하고자 하는 방전셀의 상기 어드레스 전극라인들에 데이터 펄스가 인가되어 표시하고자 하는 방전셀을 선택함에 있어서, 상기 스캔 펄스가 상기 제1 제어스위치가 열리고 상기 제2 제어스위치가 닫힘으로써 인가되는 디스플레이 패널의 구동방법.
  25. 제22항 또는 제23항에 있어서,
    상기 제6주기에, 상기 제1 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫힌 상태에서, 상기 제2 그룹에 해당하는 상기 제1 제어스위치들이 열리고 상기 제2 제어스위치들이 닫히는 디스플레이 패널의 구동방법.
  26. 제21항 또는 제23항에 있어서,
    상기 Y 전극 라인들이 각각의 그룹에 동일한 개수의 전극 라인들이 포함되도록 그룹으로 나뉘는 디스플레이 패널의 구동방법.
  27. 제21항 또는 제23항에 있어서,
    상기 Y 전극 라인들이 상기 디스플레이 패널의 일방향으로 연장되도록 배치되고, 상기 Y 전극 라인들이 일단으로부터 타단의 방향으로 순서에 따라 상기 제1그룹과 상기 제2그룹으로 나뉘는 디스플레이 패널의 구동방법.
  28. 제21항 또는 제23항에 있어서,
    상기 Y 전극 라인들이 상기 디스플레이 패널의 일방향으로 연장되도록 배치되고, 상기 디스플레이 패널의 일단으로부터 타단의 방향으로 홀수번째 Y 전극 라인들이 제1그룹이 되고, 짝수번째 Y 전극 라인들이 제2그룹이 되도록, 상기 Y 전극 라인들이 그룹으로 나뉘는 디스플레이 패널의 구동방법.
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