KR19990050873A - 다이나믹 랜덤 억세스 메모리회로 - Google Patents

다이나믹 랜덤 억세스 메모리회로 Download PDF

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Abstract

본 발명은 다이나믹 랜덤 억세스 메모리회로에 관한 것으로, 종래의 다이나믹 랜덤 억세스 메모리회로는 기준전압과 출력데이터를 입출력버퍼에서 비교함으로써, 동일한 메모리셀에 서로 다른 전압값의 데이터를 저장한 후, 메모리셀에 누설전류가 발생하여 저장된 메모리셀의 데이터 전압값이 낮아지는 경우 정확한 데이터의 판별을 할 수 없는 문제점이 있었다. 이와 같은 문제점을 감안한 본 발명은 메모리셀부의 워드라인을 선택하는 로우 디코더와; 메모리셀부의 비트라인을 선택하는 컬럼 디코더와; 각기 다른 기준전압을 발생시키는 기준전압발생부와; 상기 기준전압발생부의 기준전압을 각각의 셀에 저장하는 기준전압 메모리셀부와; 전원전압의 절반값과 상기 기준전압 메모리셀부의 출력데이터 값을 차동증폭하는 기준 차동증폭부와; 전원전압의 절반 값과 메모리셀부의 출력데이터 값을 차동증폭하는 차동증폭부와; 상기 기준 차동증폭부의 출력데이터와 차동증폭부의 출력을 비교하여 출력하는 비교부와; 상기 비교부의 출력데이터를 엔코딩하여 출력하는 엔코더와; 입력되는 데이터를 디코딩하여 출력하는 디코더와; 상기 디코더의 출력신호를 아날로그 변환하여 메모리셀부의 메모리셀에 저장하는 디지털 아날로그 변환부로 구성하여 메모리셀에 저장된 데이터의 전압값이 전류의 누설에 의해 낮아지게 되는 경우에도 기준전압또한 낮아지게 되어 정확한 데이터값을 출력할 수 있는 효과가 있다.

Description

다이나믹 랜덤 억세스 메모리회로
본 발명은 다이나믹 랜덤 억세스 메모리회로에 관한 것으로, 특히 하나의 메모리셀에 두 개의 데이터를 저장하여 다이나믹 랜덤 억세스 메모리의 특성을 향상시키는데 적당하도록 한 다이나믹 랜덤 억세스 메모리회로에 관한 것이다.
일반적으로, 반도체 메모리 중, 다이나믹 랜덤 억세스 메모리(이하, 디램)는 각 메모리셀의 워드라인과 비트라인을 선택하는 선택수단과; 상기 선택수단에 의해 선택된 메모리셀의 데이터를 센싱하는 센스앰프를 포함하여 구성되어 하나의 메모리셀에 저장된 하나의 데이터를 출력하도록 구성된다. 즉, 하나의 메모리셀에는 하나의 데이터 밖에는 저장할 수 없으며, 이와 같은 종래 디램회로를 첨부한 도면을 참조하여 상세히 설명하면 다음과 같다.
도1은 종래 디램회로도로서, 이에 도시한 바와 같이 로우 어드레스(RA)를 인가받아 디코딩하여 메모리셀부(1)의 특정 워드라인을 선택하는 로우 디코더(2)와; 컬럼 어드레스(CA)를 인가받아 디코딩하여 메모리셀부(1)의 특정 비트라인을 선택하는 컬럼 디코더(3)와; 입출력 데이터를 래치하여 저장하는 입출력버퍼(6)와; 센스앰프 제어부(4)의 제어에 따라 상기 입출력버퍼(6)에 저장된 데이터를 상기 로우 디코더(2)와 컬럼 디코더(3)에 의해 선택된 메모리셀에 저장하거나, 선택된 메모리셀의 데이터를 센싱하여 상기 입출력버퍼(6)를 통해 출력하는 센스앰프(5)로 구성된다.
이하, 상기와 같은 디램회로의 동작을 설명의 편의상 읽기동작에 한정하여 설명한다.
먼저, 로우 어드레스(RA)가 입력되면 로우 디코더(2)는 그 로우 어드레스(RA)를 디코딩하여 메모리셀부(1)에 구비된 다수의 워드라인 중, 특정 워드라인을 인에이블시킨다. 이에 따라 상기 특정 워드라인을 공유하는 다수의 메모리셀이 인에이블된다.
그 다음, 컬럼 어드레스(CA)를 인가받아 디코딩한 컬럼 디코더(3)의 출력신호에 의해 상기 인에이블된 다수의 메모리셀 중 특정 메모리셀의 데이터가 비트라인을 통해 출력된다.
그 다음, 센스앰프 제어부(4)의 제어를 받은 센스앰프(5)는 상기 비트라인을 통해 출력되는 상기 특정 메모리셀의 데이터를 센싱하여 출력하게 된다.
그 다음, 입출력버퍼(6)는 일차센싱 및 이차센싱을 통해 상기 센스앰프(5)에서 센싱된 데이터를 저장하고, 외부의 버스로 출력한다.
이때, 입출력버퍼(6)는 일차센싱을 통해 상기 센스앰프(5)의 데이터가 전원전압의 반값보다 높은 전압인가를 판단하여 디지털 데이터를 저장하고, 이차센싱을 통해 다시 그 전원전압값의 보다 큰값인 가를 구분하여 고전위 또는 저전위의 데이터를 저장하고 이를 버스를 통해 외부로 출력한다.
상기와 같은 종래 다이나믹 랜덤 억세스 메모리회로는 기준전압과 출력데이터를 입출력버퍼에서 비교함으로써, 동일한 메모리셀에 서로 다른 전압값의 데이터를 저장한 후, 메모리셀에 누설전류가 발생하여 저장된 메모리셀의 데이터 전압값이 낮아지는 경우 정확한 데이터의 판별을 할 수 없는 문제점이 있었다.
이와 같은 문제점을 감안한 본 발명은 다수 레벨의 데이터를 하나의 메모리셀에 저장하고 이를 센싱함이 가능하도록 한 다이나믹 랜덤 억세스 메모리회로를 제공함에 그 목적이 있다.
도1은 종래 다이나믹 랜덤 억세스 메모리회로의 블록도.
도2는 본 발명 다이나믹 랜덤 억세스 메모리회로의 블록도.
도3은 도2의 상세 회로도.
***도면의 주요 부분에 대한 부호의 설명***
1:메모리셀부 2:로우 디코더
3:컬럼 디코더 7:기준전압 발생부
8:기준전압 메모리셀부 9:기준 차동증폭부
10:차동증폭부 11:비교부
12:엔코더 13:디코더
14:디지털 아날로그 변환부
상기와 같은 목적은 로우 어드레스를 디코딩하여 메모리셀부의 워드라인을 선택하는 로우 디코더와; 컬럼 어드레스신호를 디코딩하여 메모리셀부의 비트라인을 선택하는 컬럼 디코더와; 각기 다른 기준전압을 발생시키는 기준전압발생부와; 상기 기준전압발생부의 기준전압을 각각의 셀에 저장하는 기준전압 메모리셀부와; 전원전압의 절반값과 상기 기준전압 메모리셀부의 출력데이터 값을 차동증폭하는 기준 차동증폭부와; 전원전압의 절반 값과 메모리셀부의 출력데이터 값을 차동증폭하는 차동증폭부와; 상기 기준 차동증폭부의 출력데이터와 차동증폭부의 출력을 비교하여 출력하는 비교부와; 상기 비교부의 출력데이터를 엔코딩하여 출력하는 엔코더와; 입력되는 데이터를 디코딩하여 출력하는 디코더와; 상기 디코더의 출력신호를 아날로그 변환하여 메모리셀부의 메모리셀에 저장하는 디지털 아날로그 변환부로 구성함으로써 달성되는 것으로, 이와 같은 본 발명을 첨부한 도면을 참조하여 상세히 설명하면 다음과 같다.
도2는 본 발명 다이나믹 랜덤 억세스 메모리회로의 블록도로서, 이에 도시한 바와 같이 로우 어드레스(RA)를 디코딩하여 메모리셀부(1)의 워드라인을 선택하는 로우 디코더(2)와; 컬럼 어드레스신호(CA)를 디코딩하여 메모리셀부(1)의 비트라인을 선택하는 컬럼 디코더(3)와; 각기 다른 기준전압을 발생시키는 기준전압발생부(7)와; 상기 기준전압발생부(7)의 기준전압을 각각의 셀에 저장하는 기준전압 메모리셀부(8)와; 전원전압의 절반값과 상기 기준전압 메모리셀부(8)의 출력데이터값을 차동증폭하는 기준 차동증폭부(9)와; 전원전압의 절반값과 메모리셀부(1)의 출력데이터값을 차동증폭하는 차동증폭부(10)와; 상기 기준 차동증폭부(9)의 출력데이터와 차동증폭부(10)의 출력을 비교하여 출력하는 비교부(11)와; 상기 비교부(11)의 출력데이터를 엔코딩하여 출력하는 엔코더(12)와; 입력되는 데이터를 디코딩하여 출력하는 디코더(13)와; 상기 비교부(11) 또는 디코더(13)의 출력신호를 아날로그 변환하여 메모리셀부(1)의 메모리셀에 저장하는 디지털 아날로그 변환부(14)로 구성된다.
또한 도3은 상기 도2의 상세회로도로서, 이에 도시한 바와 같이 상기 기준전압 메모리셀부(8)는 기준전압 발생부(7)의 기준전압( VCC, VCC, VCC)을 각각의 비트라인을 통해 인가받는 각각의 워드라인을 공유하는 메모리셀(MC)로 구성된다.
상기 기준 차동증폭부(9)는 각 비트라인을 통해 출력되는 상기 기준전압 메모리셀부(8)의 데이터와 기준전압( VCC)과의 차를 증폭하여 출력하는 다수의 차동증폭기로 구성된다.
상기 차동증폭부(10)는 다수의 비트라인을 통해 출력되는 메모리셀부(1)의 출력 데이터와 기준전압( VCC)과의 차를 증폭하여 출력하는 다수의 차동증폭기와; 쓰기제어신호(WTR)에 따라 도통제어되어 상기 디지털 아날로그 변환부(14)의 출력신호를 메모리셀부(1)의 비트라인에 인가제어하는 엔모스 트랜지스터(NM1)로 구성된다.
상기 비교부(11)는 상기 차동증폭부(10)의 출력값중 하나를 기준으로하고 각각 상기 기준 차동증폭부(9)의 출력신호를 비교하는 다수의 비교기(C1,C2,C3)로 구성된다.
이하, 상기와 같이 구성된 본 발명 다이나믹 랜덤 억세스 메모리회로의 동작을 설명한다.
먼저, 기준전압 발생부(7)는 각기 다른값의 기준전압( VCC, VCC, VCC)을 발생시킨다. 이에 따라 기준전압 메모리셀부(6)의 각 비트라인을 공유하는 다수의 메모리셀에는 기준전압( VCC, VCC, VCC)값이 각각 저장된다. 즉, 하나의 워드라인이 인에이블되면 그 워드라인을 공유하는 메모리셀의 출력전압은 각각 VCC, VCC, VCC로 출력된다.
이와 같이 기준전압 메모리셀부(8)에 기준전압( VCC, VCC, VCC)이 저장된 후, 메모리셀부(1)에 데이터를 저장하는 쓰기동작에서는 로우 어드레스(RA)를 디코딩한 로우디코더(2)에 의해 상기 기준전압 메모리셀부(8)와 메모리셀부(1)의 특정 워드라인이 인에이블되고, 컬럼 어드레스(CA)를 디코딩한 컬럼 디코더(3)의 출력에 의해 메모리셀부(1)의 비트라인이 선택된다. 이와 같이 비트라인이 선택된 후에 외부의 버스로 부터 입력데이터(DIN)가 입력되면, 디코더(13)에서 디코딩하여 그 값을 디지털 아날로그 변환부(14)로 인가하고, 그 디지털 아날로그 변환부(14)의 출력은 상기 워드라인과 비트라인이 선택되어 인에이블된 메모리셀부(1)의 특정 메모리셀에 저장된다.
이때, 저장되는 값은 기준전압( VCC, VCC, VCC)값의 사이 값인 VSS, VCC, VCC, VCC의 값이며, 종래 VCC와 VSS를 저장할 수 있는 것에 비해 하나의 데이터를 더 저장할 수 있게된다.
상기와 같이 데이터를 저장한 후, 읽기동작에서는 다시 로우 디코더(2)에 의해 기준전압 메모리셀부(8)와 메모리셀부(1)의 워드라인이 선택되고, 컬럼 디코더(3)에 의해 메모리셀부(1)의 비트라인이 선택된다.
이와 같은 동작을 통해 메모리셀부(8)에 저장된 기준전압( VCC, VCC, VCC)값을 갖는 데이터와 메모리셀부(1)의 특정 메모리셀에 저장된 데이터는 출력되며, 이는 각각 기준차동증폭부(9)와 차동증폭부(10)에서 기준전압( VCC)값과의 차가 증폭되어 출력된다.
이에 따라 상기 차동증폭된 전압값간의 차는 더욱 커지게 되며, 상기 기준 차동증폭부(9)의 출력은 비교부(11)에 구비된, 상기 차동증폭부(10)의 출력전압을 기준으로 하는 비교기(C1,C2,C3)에 의해 각각 비교 및 디지털화되어 출력되며, 이는 엔코더(12)에서 엔코딩된 후 외부의 버스로 출력된다.
이와 같이 엔코더(12)는 기준 차동증폭부(9)의 각 출력값과 차동증폭부(10)의 출력값을 비교한 것을 판단하여 메모리셀부(1)에서 출력된 데이터의 전압값을 표시하는 정보를 포함하여 출력하게 된다.
상기한 바와 같이 본 발명은 비교의 기준이되는 기준전압과 메모리셀에 저장된 데이터의 전압값을 비교함이 가능하도록 구성하여, 메모리셀에 저장되는 데이터가 그 전압값에 따라 각각 다른 데이터를 표시하도록 하고, 기준전압을 메모리셀에 저장하여 사용함으로써, 메모리셀의 누설전류에 의한 데이터의 전압값에 영향을 받지않아 하나의 메모리셀에 두 개의 데이터를 저장하도록 하여 다이나믹 랜덤 억세스 메모리의 효율을 향상시키는 효과가 있다.

Claims (5)

  1. 로우 어드레스를 디코딩하여 메모리셀부의 워드라인을 선택하는 로우 디코더와; 컬럼 어드레스신호를 디코딩하여 메모리셀부의 비트라인을 선택하는 컬럼 디코더와; 각기 다른 기준전압을 발생시키는 기준전압발생부와; 상기 기준전압발생부의 기준전압을 각각의 셀에 저장하는 기준전압 메모리셀부와; 전원전압의 절반값과 상기 기준전압 메모리셀부의 출력데이터 값을 차동증폭하는 기준 차동증폭부와; 전원전압의 절반 값과 메모리셀부의 출력데이터 값을 차동증폭하는 차동증폭부와; 상기 기준 차동증폭부의 출력데이터와 차동증폭부의 출력을 비교하여 출력하는 비교부와; 상기 비교부의 출력데이터를 엔코딩하여 출력하는 엔코더와; 입력되는 데이터를 디코딩하여 출력하는 디코더와; 상기 디코더의 출력신호를 아날로그 변환하여 메모리셀부의 메모리셀에 저장하는 디지털 아날로그 변환부로 구성하여 된 것을 특징으로 하는 다이나믹 랜덤 억세스 메모리회로.
  2. 제 1항에 있어서, 상기 기준전압 메모리셀부는 기준전압 발생부의 서로다른 기준전압을 각각의 비트라인을 통해 인가받으며, 각각의 워드라인을 공유하는 다수의 메모리셀로 구성하여 된 것을 특징으로 하는 다이나믹 랜덤 억세스 메모리회로.
  3. 제 1항에 있어서, 상기 기준 차동증폭부는 각 비트라인을 통해 출력되는 상기 기준전압 메모리셀부의 데이터와 전원전압 절반값의 기준전압과의 차를 증폭하여 출력하는 다수의 차동증폭기로 구성하여 된 것을 특징으로 하는 다이나믹 랜덤 억세스 메모리회로.
  4. 제 1항에 있어서, 상기 차동증폭부는 다수의 비트라인을 통해 출력되는 메모리셀부의 출력 데이터와 전원전압의 절반값인 기준전압과의 차를 증폭하여 출력하는 다수의 차동증폭기와; 쓰기제어신호에 따라 도통제어되어 상기 디지털 아날로그 변환부의 출력신호를 메모리셀부의 비트라인에 인가제어하는 엔모스 트랜지스터로 구성하여 된 것을 특징으로 하는 다이나믹 랜덤 억세스 메모리회로.
  5. 제 1항에 있어서, 상기 비교부는 상기 차동증폭부의 출력값중 하나를 기준으로하고 각각 상기 기준 차동증폭부의 출력신호를 비교하는 다수의 비교기로 구성하여 된 것을 특징으로 하는 다이나믹 랜덤 억세스 메모리회로.
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