KR102226416B1 - 주파수 변환 없이 고감도 선택적 수신기로서 사용되기 위한 대수 검출 증폭기 시스템 - Google Patents
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Abstract
고감도 수신 부스터 및 통신 장치의 수신 체인 내 저 잡음 증폭기에 대한 대체품으로서 사용되기 위한 대수 검출기 증폭(LDA) 시스템이 제공된다. 상기 LDA 시스템은 제1 주파수를 갖는 입력 신호를 수신하고 입력 신호를 기초로 발진을 생성하도록 구성된 증폭 회로, 상기 증폭 회로에 연결되고 지정 임계치를 기초로 상기 발진을 종료하여 상기 발진을 주기적으로 고정 및 재시작하여 발진 및 입력 신호에 의해 변조되는 일련의 펄스를 생성하도록 구성된 샘플링 회로, 및 증폭 회로와 연결되며 동작의 주파수를 확립하며, 제2 주파수를 갖는 출력 신호를 생성하도록 구성된 하나 이상의 공진 회로를 포함하며, 상기 제2 주파수는 제1 주파수와 실질적으로 동일하다.
Description
관련 출원과의 상호 참조
이 출원은 2013년 09월 12일에 출원되는 미국 가특허출원 61/877,218호의 이익을 주장한다.
기술 분야
본 출원은 대수 증폭기(logarithmic amplifier)의 분야와 관련된다.
여러 전자 적용예, 예컨대, 의료 이미징, 셀룰러 통신 등에서, 잡음 또는 그 밖의 다른 원치 않는 신호 중에서 저전력 레벨의 특정 신호를 검출할 수 있는 것이 바람직할 수 있다. 종래의 해결책은 대수 증폭기("log amp")를 포함한다. 대수 증폭기의 하나의 특성은 출력 신호가 입력 신호의 대수에 비례하는 전압임으로써, 대수 증폭기가 저 레벨 입력 신호를 수신할 수 있고, 이를 증폭하여, 잡음 또는 그 밖의 다른 원치 않는 신호를 증폭하지 않고 출력할 수 있다.
대수 증폭기의 한 가지 분류가 대수 관계를 획득하기 위해 직렬로 캐스케이딩된 복수의 이득 블록, 즉, 증폭기를 가진다. 직렬 구조 때문에, 개별 구성요소의 성능의 차이가 대수 증폭기의 전체 성능에 영향을 미치는 경향이 있다. 예를 들어, 동적 범위가 제한적일 수 있으며, 즉, 매우 높거나 매우 낮은 입력 신호에 대한 전압 출력이 대수 관계에 적응되지 않는다. 이는 이들 극단적인 입력 값에 대한 오류 출력을 도출할 수 있다.
종래 기술의 목록
US 7,911,235 B2 (2011-03-22)
US 7,612,616 B2 (2009-11-03)
US 2011/0037516 A1 (2011-02-17)
US 6,054,900 A (2000-04-25)
US 2010/0279635 A1 (2010-11-04)
US 2009/0079524 A1 (2009-03-26)
US 6,421,535 (2002-07-16)
US 6,389,275 B1 (2002-05-14)
US 4,034,298 A (1977-07-05)
US 4,393,514 A (1983-07-12)
통신 장치의 수신 체인에서 저 잡음 증폭기에 대한 고감도 수신 부스터 또는 저 잡음 증폭기의 대안으로서 사용되기 위한 대수 검출기 증폭(LDA) 시스템이 기재된다. LDA 시스템은 입력 신호를 수신하고 상기 입력 신호를 기초로 발진을 생성하도록 구성된 증폭 회로, 상기 증폭 회로로 연결되고 지정 임계치를 기초로 발진을 종료하여, 발진을 주기적으로 고정(clamp)하고 재시작하여 상기 발진 및 입력 신호에 의해 변조되는 일련의 펄스를 생성하도록 구성된 샘플링 회로, 및 상기 증폭 회로와 연결되고 동작 주파수를 확립하며 RF 주파수를 갖는 신호를 출력하도록 구성된 하나 이상의 공진 회로를 포함한다.
도 1은 대수 검출기의 하나의 실시예를 도시하는 블록도이다.
도 2는 LDA 시스템의 또 다른 실시예를 도시하는 블록도이다.
도 3은 LDA 시스템의 또 다른 실시예를 도시하는 블록도이다.
도 4는 저 잡음 증폭기(LNA)가 LDA 시스템으로 대체되는, RF 신호를 송신 및 수신하기 위한 통신 장치의 제1 실시예를 도시한다.
도 5는 LDA 시스템의 회로 구성의 실시예를 도시한다.
도 6은 LDA 속성에 영향을 미치지 않으면서 RF 신호를 출력하기 위한 공진 회로의 실시예를 도시한다.
도 7a는 LDA 속성에 영향을 미치지 않으면서 RF 신호를 출력하기 위한 공진 회로의 또 다른 실시예를 도시한다.
도 7b는 LDA 속성에 영향을 미치지 않으면서 RF 신호를 출력하기 위한 차동 입력 및 차동 출력을 갖는 공진 회로의 하나의 실시예를 도시한다.
도 8은 LDA 시스템의 회로 구성의 또 다른 실시예를 도시하며, 여기서 공진자 회로가 피드백 회로로서 증폭 회로와 병렬 연결된다.
도 9는 LDA 시스템의 회로 구성의 또 다른 실시예를 도시하며, 여기서 공진자 회로가 증폭 회로의 입력 측부에서 증폭 회로와 분로 연결된다.
도 10은 LDA 시스템이 위상 고정 루프(PLL)에서 구현되는 토폴로지의 실시예를 도시한다.
도 2는 LDA 시스템의 또 다른 실시예를 도시하는 블록도이다.
도 3은 LDA 시스템의 또 다른 실시예를 도시하는 블록도이다.
도 4는 저 잡음 증폭기(LNA)가 LDA 시스템으로 대체되는, RF 신호를 송신 및 수신하기 위한 통신 장치의 제1 실시예를 도시한다.
도 5는 LDA 시스템의 회로 구성의 실시예를 도시한다.
도 6은 LDA 속성에 영향을 미치지 않으면서 RF 신호를 출력하기 위한 공진 회로의 실시예를 도시한다.
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도 7b는 LDA 속성에 영향을 미치지 않으면서 RF 신호를 출력하기 위한 차동 입력 및 차동 출력을 갖는 공진 회로의 하나의 실시예를 도시한다.
도 8은 LDA 시스템의 회로 구성의 또 다른 실시예를 도시하며, 여기서 공진자 회로가 피드백 회로로서 증폭 회로와 병렬 연결된다.
도 9는 LDA 시스템의 회로 구성의 또 다른 실시예를 도시하며, 여기서 공진자 회로가 증폭 회로의 입력 측부에서 증폭 회로와 분로 연결된다.
도 10은 LDA 시스템이 위상 고정 루프(PLL)에서 구현되는 토폴로지의 실시예를 도시한다.
새로운 유형의 대수 검출기가 본 명세서에 기재된다. 기존 대수 검출기의 구조 및 구현의 예시가 본 명세서에 참조로서 포함되는 2011년 03월 22일에 발행된 미국 특허 제7,911,235호에 기재되어 있다. 본 명세서에 개시된 대수 검출기가 도 1에 도시된 실시예를 참조하여 이하에서 더 설명된다.
도 1은 대수 검출기(100)의 실시예에 도시되는 블록도이다. 이 실시예에서, INPUT으로 라벨링되는 입력 단자로부터의 입력 신호가 증폭 회로(104)에 의해 수신될 수 있다. 증폭 회로(104)는 입력 신호를 증폭하도록 구성될 수 있고 임의의 적합한 증폭 요소, 가령, 연산 증폭기, 양극성 접합 트랜지스터(BJT)(bipolar junction transistor), 전계 효과 트랜지스터(FET) 또는 그 밖의 다른 이산 트랜지스터, 진공 튜브, RF 증폭기 등을 포함할 수 있다. 전기적 잡음 및/또는 희망 신호에 응답하여, 증폭 회로(104)에서 발진(oscillation)이 개시될 수 있다. 입력 신호의 크기에 응답하여 발진이 주기적으로 종료될 수 있다. 피드백 회로이도록 구성될 수 있는 공진 회로(108)가 증폭 회로(104)와 병렬로 연결되어 동작의 주파수를 제어할 수 있다. 도 1의 실시예에서, 공진 회로(108)는 직렬 LC 회로를 포함할 수 있고, L 및 C 값은 대수 검출기(100)의 동작의 주파수에 대응하는 공진 주파수를 갖도록 선택될 수 있다. L 및 C 값에 의해 결정된 주파수에서 증폭 회로(104)에서 발진이 설정될 수 있다. 따라서 LC 공진 외부의 잡음이 LC 회로의 동작에 최소한의 영향을 미칠 수 있다. LC 공진의 대역폭 내 입력 신호가 랜덤 잡음만 있을 때보다 발진을 더 빨리 개시할 수 있다. 공진 회로(108)에서 사용되는 구성요소에 의해 회로의 표준 감도 또는 팩터 Q가 대부분 결정될 수 있다. 하이-Q(high-Q) 회로가, 예를 들어, 공진 회로(108) 내 크리스탈 공진자의 사용에 의해 획득될 수 있다. 주파수 선택도, 스커트 비(skirt ratio), 전체 LDA 재생 및 팩터 Q가 또한 그 밖의 다른 파라미터, 예컨대, 순간 이득, 1-사이클 소지 이득, F_rep 주파수, 도 5의 커패시터(C1)의 값, 및 증폭기의 입력 바이어스 레벨(전압 또는 전류), 그 밖의 다른 가능한 파라미터에 따라 달라질 수 있다.
샘플링 회로(112)가 증폭 회로(104)에 연결될 수 있다. 상기 샘플링 회로(112)는 증폭 회로(104)에 전압 공급 라인에서 흐르는 전류를 효과적으로 샘플링하도록 구성될 수 있으며, 지정 임계치에 도달하면, 샘플링 회로(112)가 발진을 중단하도록 동작할 수 있다. 즉, 샘플링 회로(112)는, 임계치에 도달할 때마다, 발전을 주기적으로 인터럽트하도록 사용될 수 있다. 주파수-전압 변환기(116)가 샘플링 회로(112)로 연결될 수 있다. 주파수-전압 변환기(116)로의 입력은 F_rep로 지시되는 일련의 전압 스파이크(voltage spike)를 포함할 수 있으며, 이의 주파수가 실질적으로 입력 신호의 전력의 대수로서 변할 수 있다. 주파수-전압 변환기(116)로부터의 출력(OUTPUT)이 입력 스파이크의 주파수에 비례인 DC 전압일 수 있다.
입력 신호가 변조되는 경우, 주파수-전압 변환기(116)의 출력은 DC 전압 성분 및 AC 전압 성분을 포함할 수 있다. 상기 AC 성분은 입력 변조에 대응할 수 있고 효과적으로 기저대역에서 복조된 입력 신호의 복사본일 수 있다.
앞서 설명된 대수 검출기의 실시예가 다양한 전자 적용예를 위해 구현될 다양한 방식으로 구성될 수 있다. 대수 검출기 증폭기(LDA) 시스템은 특정 기본 속성을 제공받을 수 있고 타깃 적용예에서 적절한 성능 향상을 위해 수정될 수 있다. 도 2는 LDA 시스템의 실시예(200)를 도시하는 블록도이다. 상기 LDA 시스템(200)은 절연 회로(204), 정합 회로망(208), LDA 코어(212), 부스터 회로(216), 및 주파수-전압 변환기(220)를 포함할 수 있다. 출력, 이 예시에서, OUTPUT 1로 라벨링된 것이 주파수-전압 변환기(220)에 연결될 수 있다. 부스터 회로(216) 및/또는 주파수-전압 변환기(220)는 선택적 요소일 수 있으며, 이들 중 하나 또는 둘 모두는 타깃 적용예에 따라 생략될 수 있다. LDA 시스템(200)이 부스터 회로(216) 및 주파수-전압 변환기(220)를 포함하지 않을 때, 도 2의 OUTPUT 2로 나타나는 바와 같이 출력 포트가 LDA 코어(212)로부터 직접 분리되어 위치될 수 있다. LDA 코어(212)는 도 1의 대수 검출기(100)의 증폭 회로(104), 공진 회로(108), 및 샘플링 회로(112)와 유사하게 동작 및 기능하도록 구성될 수 있는 증폭 회로(224), 공진 회로(228), 및 샘플링 회로(232)를 포함할 수 있다.
절연 회로(204)는 전력 누설(power leak), LDA 코어(212)로부터 반사된 신호, 및 주위 회로, 특히, Tx 체인으로부터의 그 밖의 다른 간섭 효과를 필터링 제거하도록 사용되어, Rx 체인을 보호하고 재생을 최적화할 수 있다. 특히, 재생 구축 프로세스가 동기화될 때 입력 신호에 대해 미지의 위상을 갖고 LDA 코어로부터 절연 회로(204)로 반사된 신호가 신호 재생에 악영향을 미칠 수 있다. 입력 신호가 반사된 이위상 신호와 혼합될 때, 재생 프로세스가 원하는 대로 획득되지 않을 수 있으며 열악한 성능이 도출될 수 있다.
누설 전력이 수신기 입력, 가령, 안테나로의 길을 또한 찾을 수 있고, 원치 않는 발산 또는 EMI로서 방사될 수 있다. 절연 회로(204)가 이러한 절연 목적으로 서큘레이터(circulator)를 포함할 수 있다. Rx 체인 내 서큘레이터가 Rx 신호를 통과시키고 원치 않는 누설 및 반사를 접지로 단락시키도록 구성될 수 있다. 일반적인 서큘레이터는 비-선형성을 보정하기 위해 강자성 요소, 예컨대, 페라이트(ferrite)를 포함한다. 그러나 일반적으로 강자성 요소는 부피가 크고 비용이 높다. 그 밖의 다른 유형의 서큘레이터로는 상당한 크기 감소를 가능하게 하는 나노-강자성 구조물 및 메타물질이 있을 수 있다. 서큘레이터 대신, 절연 회로(204)는 저잡음 증폭기(LNA) 또는 임의의 수동 또는 능동 소자를 갖도록 구성될 수 있으며, 이는 (능동 회로에 대한) 개선된 이득, 개선된 절연, 신호대잡음 비, 및 대역폭을 제공할 수 있다. 입력 신호의 감쇄 및/또는 잡음 지수의 감소가 허용되는 경우, 저항성 감쇠기, 저항성 스플리터, 윌킨슨 스플리터(Wilkinson splitter) 또는 커플러가 사용될 수 있다. 상기 정합 회로망(208)이 임피던스 정합 및/또는 위상 보정 목적으로 사용될 수 있다. 도 1을 참조하여 설명된 것과 유사한 메커니즘을 기초로, LDA 코어(212)가 일련의 전압 스파이크, F_rep를 출력할 수 있고, 이의 주파수가 실질적으로 입력 신호의 전력의 대수로서 변한다. 상기 신호 F_rep는 OUTPUT 2로부터 출력되거나 추가로 처리되도록 부스터 회로(booster circuit)(216) 및/또는 주파수-전압 변환기(220)로 전송되고 OUTPUT 1로부터 출력될 수 있다. 상기 부스터 회로(216)는 신호 F_rep를, 예를 들어, 약 100mV에서 수 볼트로 증폭하기 위한 하나 이상의 트랜지스터 또는 그 밖의 다름 임의의 적합한 증폭 구성요소를 포함할 수 있다. 부스터 회로는 증폭된 F_rep를 디지털화하여 더 깨끗하고 더 선명한 스파이크를 획득하기 위해, 슈미트 트리거 회로(Schmidt trigger circuit) 또는 임의의 단순 디지털 회로, 예컨대, 디지털 인버터를 더 포함할 수 있다. 부스터 회로(216)로부터의 출력 신호가 주파수-전압 변환기(220)로 전송될 수 있고, 여기서 신호가 DC 플러스 AC 전압으로 변환되어 예컨대, 오디오 범위에서 OUTPUT 1로부터 출력될 수 있다.
앞서 언급된 바와 같이, LDA 시스템(200)은 도 1에 도시된 바와 같이 대수 검출기의 특정 기본 속성뿐 아니라 타깃 적용예에 대한 적절한 성능 향상까지 포함할 수 있다. 예를 들어, 공진 회로에서 L 및 C 값을 선택함으로써 동작의 주파수가 결정될 수 있고, 따라서 LDA 코어 증폭 회로와 함께, 다양하게 수정된 바와 같이 LDA 시스템(200)을 이용함으로써, 높은 대역외 제거, 높은 스커트 비, 및 높은 신호대잡음 비가 획득될 수 있다. 즉, LDA 시스템(200)은 고도로 주파수-선택적 적용예를 위해 구현될 수 있다. 덧붙여, 임계치에 도달할 때마다, 샘플링 회로가 자기-소멸(self-quenching) 및 시간-종속적 샘플링 함수를 제공하면서, 발진을 주기적으로 인터럽트하도록 사용될 수 있다. 따라서 증폭 회로의 낮은 순간 재생 이득 및 발진의 고정 및 재시작에 의해, 발진의 재생 속성이 향상될 수 있고 높은 Rx 감도를 발생시킬 수 있다. 실시예에서, 증폭 회로의 낮은 순간 재생 이득이 1-5 범위에 속할 수 있다. 그러나 전체 재생 사이클에 걸쳐 LDA 이득이 실질적으로 더 높아질 수 있다. 일반적으로 이는 낮음에서 높아질 수 있고, 예를 들어, -10dB 내지 +50dB일 수 있다. 통상의 LNA에 비교할 때, 신호대잡음 비가 향상될 수 있으며, 출력된 수신 신호 강도 지시자(RSSI) 레벨이 더 높아질 수 있다. 이는 후속하는 수신 스테이지 및 LDA 시스템(200)이 사용되는 통신 장치의 경우, 추가 증폭이 덜 필요하거나 전혀 필요하지 않을 수 있기 때문에, 유리할 수 있다. 공진 회로 내 하이 Q 구성요소, 예컨대, 커패시터, 인덕터, SAW 필터, BAW 필터, 세라믹 공진자, 기계 공진자 등을 이용함으로써 획득될 수 있는 LDA 코어의 주파수 대역폭을 감소시킴으로써, LDA의 Rx 감도가 증가될 수 있다. 실시예에서, 인덕터 및 커패시터에 대한 하이 Q 값이 25-200일 수 있다. 특히, SAW 필터, BAW 필터, 세라믹 필터, 및 기계적 필터에 대한 하이 Q 값이 500 - 20,000일 수 있다.
실시예가 약에서 강으로의 수신 신호를 재생하고, 최소한의 잡음만 추가하여, 대수 증폭기와 일반적으로 연관된 주파수의 임의의 변환 없이 이를 선택적으로 증폭시킬 수 있다.
도 3은 LDA 시스템의 또 다른 실시예(300)를 도시하는 블록도이다. 상기 LDA 시스템(300)은 절연 회로(304), 정합 회로망(308), 및 LDA 코어(312)를 포함할 수 있다. 상기 LDA 코어(312)는 도 1의 대수 검출기(100)의 증폭 회로(104), 공진 회로(108) 및 샘플링 회로(112)와 유사하게 동작 및 기능하도록 구성된 증폭 회로(324), 공진 회로(328), 및 샘플링 회로(332)를 포함할 수 있다. OUTPUT A는 도 2의 OUTPUT 2와 동등하며, 여기서 LDA 코어(312)가 일련의 전압 스파이크, F_rep를 출력할 수 있다. 대안적으로, 여기서 F_rep가 출력되지 않고 미결 상태로 남겨질 수 있다. LDA 시스템의 예시(300)에서, 공진 회로(328)가 OUTPUT B를 통해 RF 신호를 출력하도록 구성될 수 있다. 출력 신호가 퀀칭 주파수(quenching frequency)의 레이트로 시간 영역에서 샘플링될 수 있다는 것을 제외하고, OUTPUT B 상의 신호는 전력 레벨이 더 높지만 주파수가 실질적으로 동일한 입력 신호의 실질적으로 재생된 복사본일 수 있다. 시간 샘플링 때문에, 주파수 스펙트럼이 반복적으로 보일 수 있다. 일부 경우, 시스템이 퀀칭 주파수가 아닌 것처럼 동작하고 OUTPUT B 상의 출력 신호가 시간 영역에서 연속으로 나타날 수 있도록 퀀칭 주파수 펄스는 거의 없을 수 있다.
Rx 체인을 보호하기 위해, 그리고 앞서 설명한 바와 같이, 재생 효율의 감소 또는 EMI로서의 방사되는 전력 누설을 피하기 위해, 절연 회로(304)가 사용되어, 전력 누설, 반사된 신호 및 주위 회로, 특히, Tx 체인으로부터의 그 밖의 다른 간섭 효과를 필터링 제거할 수 있다. 절연 회로(304)는 절연 목적으로 서큘레이터를 포함할 수 있다. Rx 체인 내 이러한 서큘레이터가 Rx 신호를 전달하고 원치 않는 누설 및 반사를 접지로 단락시키도록 구성될 수 있다. 통상적인 서큘레이터는 비선형성을 보정하기 위해 강자성 요소, 예컨대, 페라이트를 포함할 수 있다. 그러나 강자성 요소는 일반적으로 부피가 크고 비용이 높다. 그 밖의 다른 유형의 서큘레이터는 상당한 크기 감소를 허용하는 나노-강자성 구조물 및 메타물질을 포함할 수 있다. 서큘레이터 대신, 절연 회로(304)는 (능동 회로의 경우) 향상된 이득, 절연, 신호대잡음 비, 및 대역폭을 제공할 수 있는 LNA, 또는 임의의 수동 또는 능동 소자를 갖도록 구성될 수 있다.
상기 정합 회로망(308)은 임피던스 정합 및/또는 위상 보정 목적으로 사용될 수 있다. 도 1을 참조하여 설명된 것과 유사한 메커니즘을 기초로, LDA 코어(312)가 일련의 전압 스파이크, F_rep를 출력할 수 있다. F_rep는 OUTPUT A로부터 출력되거나, 단순히 출력되지 않고 미정 상태로 남겨질 수 있다.
OUTPUT B를 통해 RF 신호를 출력하기 위해 공진 회로(328)를 구성함으로써, 도 3에 도시된 LDA 시스템이 다양한 RF 적용예에 대해 구현될 수 있으며, 종래의 RF 통신 장치에 비교할 때 향상된 성능 레벨을 제공할 수 있다. 도 3의 회로와 도 1의 회로 간 실질적 차이는 도 3의 OUTPUT B가 입력 신호에 비교할 때, 중앙 주파수를 중심으로 실질적인 동일한 주파수 스펙트럼(실질적으로 0.05% 내지 20%의 비율 범위)을 지니고, 실질적으로 동일한 중앙 주파수에 있다는 것이다. INPUT과 OUTPUT B 사이에 어떠한 주파수 편이도 없지만, INPUT과 OUTPUT A의 주파수 간에 상당한 차이가 있으며, 이때, 주파수 비는 실질적으로 0.01% 내지 10%의 범위에 있다. 그러나 OUTPUT A는 INPUT가 비교할 때 INPUT의 중앙 주파수를 중심으로 그러나 상이한 주파수, 가령, 더 낮은 중간 주파수(IF)에서, 실질적으로 동일한 주파수 스펙트럼을 지닐 수 있다. 주파수 스펙트럼이 INPUT 에 비해 OUTPUT A 상에서 실질적으로 동일하도록 F_rep는 INPUT 주파수 스펙트럼보다 커야 한다. 예를 들어, INPUT 주파수 신호가 1.5 MHz를 차지하는 1Mbps BPSK 변조를 반송하는 500MHz 사인 파일 수 있다. LDA는 1.5MHz BPSK 변조를 반송하는 OUTPUT B 상에 500MHz의 주파수를 제공하도록 설계될 수 있으며, OUTPUT A는 1.5MHz의 BPSK 변조를 이용하는 5MHz의 반복 주파수 F_rep를 반송한다. 도 4는 RF 신호를 송신 및 수신하기 위한 종래의 통신 장치의 하나의 실시예를 도시한다. 이 예시에서 송신(Tx) 모드와 수신(Rx) 모드 모두에 대해 단일 안테나(404)가 사용될 수 있다. Tx/Rx 스위치(408)가 안테나(404)로 연결되어 시간격 동안의 모드에 따라 Tx 체인 또는 Rx 체인을 선택할 수 있다. 상기 Rx 체인은 일반적으로 Rx 필터(412) 및 LNA(416)를 가질 수 있다. 필터링 레벨 및 주파수 범위에 따라서 추가 Rx 필터는 LNA(416) 앞에 또는 뒤에 또는 둘 모두에 추가될 수 있다. 일반적으로 LNA는 감도를 증가시키기 위해 잡음 및 왜곡을 가능한 거의 추가하지 않으면서, Rx 신호를 증폭하도록 사용될 수 있다. Rx 신호는 증폭되고 LNA(416)에서 트랜시버(420)로 출력되어, 기저대역 프로세서(424), 가령, 모뎀에 결국 도달할 수 있다. Tx 체인은 전력 증폭기(PA)(428) 및 Tx 필터(432)를 가질 수 있다. 추가 Tx 필터가 필터링 레벨 및 주파수 범위에 따라서 PA(428) 앞에 또는 뒤에 또는 두 위치 모두에 추가될 수 있다. 트랜시버(420)로부터 출력된 Tx 신호가 PA(428)로 전송될 수 있고, 여기서 이 실시예에 도시된 바와 같이 Tx 신호는 증폭되고 Tx 필터(432)로 출력되고, 안테나(404)로 전송될 수 있다. 트랜시버(420)는 RF 신호를 처리하기 위한 다양한 회로를 포함할 수 있다. 이들 회로가, Rx 체인에 대한 Rx 신호 프로세싱 회로(436) 및 Tx 체인에 대한 Tx 신호 프로세싱 회로(440)로서, 도 4에 나타난다. 상기 Rx 신호 프로세싱 회로(436)는 주파수를 하향 변환하기 위한 하향 변환기(down converter), 변조된 신호를 복조하기 위한 복조기, 기저대역 프로세서(424)로 입력될 디지털 신호를 생성하기 위한 아날로그-디지털 변환기, 및 원격 송신기로부터의 인커밍 심볼 데이터 스트림을 수신기와 시간 동기화하기 위한 동기화 기능부를 포함할 수 있다.
종래의 RF 통신 장치, 가령, 도 4에 도시된 장치에서, LNA(416)는 일반적으로 잡음 및 왜곡을 가능한 거의 추가하지 않으면서, Rx 신호를 증폭한다. 앞서 설명된 바와 같이, LDA 시스템은 원치 않는 잡음을 최소화하면서 증폭된 신호를 제공할 수 있다. 따라서 도 4에서 점선으로 나타나는 바와 같이, RF 출력, 즉, OUTPUT B을 트랜시버(420)로 연결함으로써 LNA(416)를 LDA 시스템(300)으로 교체함으로써, 향상된 성능 레벨을 갖는 새 유형의 RF 통신 장치가 제공될 수 있다. 대안으로, LDA 시스템은 수신 감도 부스터로서의 제1 증폭 스테이지로서 추가되어, LNA를 보완할 수 있다. Rx 필터(412) 및 그 밖의 다른 구성요소가 또한 LDA 시스템에 포함될 수 있다. 하나의 실시예에서, LDA가 주파수 선택적이고 높은 스커트 비를 갖는 능동 필터링 장치로서 동작하기 때문에, Rx 필터(412)는 제거되거나 상당히 완화(즉, 차수가 더 낮고, 주파수 대역외 제거가 덜하며, 더 입수 가능함)될 수 있다. 통신 장치가 WiFi 시스템인 경우, 약 2.4GHz인 상기 RF 신호가 LDA 시스템(300)에 의해 증폭되고 하향 변환기를 포함하는 트랜시버(420)로 출력될 수 있다. 일반적인 하향 변환기가 중간 주파수를 중심으로 갖는 디지털화된 신호를 매우 낮은 주파수를 중심으로 갖는 기저대역 신호로 변환한다. 따라서 약 2.4 GHz의 RF Rx 신호를 LDA 시스템(300)의 RF 출력, 즉, OUTPUT B로부터 취함으로써, 기존 트랜시버 기술, 가령, 하향 변환기가 수정 없이 사용되어, 신호를 기저대역 프로세서(424)로 전송하기 전에, WiFi에 대해(IEEE 802.11b 내지 802.11n) 20MHz 내지 40MHz 수준의 하향 변환된 신호를 획득할 수 있다.
그 밖의 다른 적용예가 168MHz, 433MHz 또는 868MHz에서 사용되도록 1GHz 미만의 협대역 트랜시버에 대한 것일 수 있으며, 여기서 변조된 신호 대역폭이 수 KHz만큼 낮을 수 있다.
또 다른 적용예가 위성 통신, 예를 들어, 1.5GHz의 GPS과 관련될 수 있고, 여기서, 수신된 라디오 신호가 매우 저전력 레벨을 가진다. LDA는 이러한 매우 낮은 수신 레벨 및 상대적으로 낮은 데이터 레이트 적용예를 위한 수신 부스터의 후보자일 수 있다.
또 다른 적용예가 매우 높은 주파수, 가령, 60GHz 대역과 관련될 수 있고, 여기서 초고속 트랜지스터를 갖는 단순한 전자 토폴로지가 요구된다. 60GHz CMOS 프로세스는 이러한 수신 부스터 또는 LNA 배치를 설계하여 매우 감도가 뛰어난 수신기를 제공할 수 있다.
또 다른 적용예가 WLAN 통신 표준, 예컨대, IEEE 802.11a-c(5-6 GHz에서의 20MHz 내지 160MHz 대역폭), BLUETOOTH, Z-Wave, Zigbee, DECT, DECT 6.0, 2.5GHz에서의 DECT 등과 관련될 수 있다.
또 다른 적용예가 셀룰러 통신 표준, 예컨대, AMPS, PCS, GSM(Global System for Mobile Communications), GPRS(General Packet Radio Service), CDMA, IS-95, cdmaOne, CDMA2000, EV-DO(Evolution-Data Optimized), EDGE(Enhanced Data Rates for GSM Evolution), UMTS(Universal Mobile Telecommunications System), Digital AMPS (IS-136/TDMA) 및 iDEN(Integrated Digital Enhanced Network), 3G, 4G, WIMAX, 수 100MHz에서 수 GHz까지의 다양한 주파수 대역의 LTE와 관련될 수 있다.
또 다른 적용예가 무선 또는 유선 시스템으로부터 케이블, 전원선, 전화선, 광섬유 등을 통해 전송되는 다양한 변조된 통신 신호와 관련될 수 있으며, 이때, 반송파 및/또는 변조된 신호의 파워가, 감도가 높고 잡음이 적게 추가된 채, 증폭되고 수신기 유닛에 의해 추가 프로세싱되는 것이 바람직하다.
도 3의 LDA 시스템은 변조 신호로 CW RF 신호(변조되지 않음) 또는 RF 반송파 신호를 증폭할 수 있다. 변조 신호는 각각 AM, FM, PM으로 약칭되는 아날로그 진폭 변조, 주파수 변조, 또는 위상 변조이거나, 디지털 변조, 가령, ASK, OOK, 직교 m-AM, FSK, MSK, GFSK, GMSK, 4-FSK, 4GMSK, m-FSK, PSK, QPSK, m-QAM일 수 있으며, 이들 모두는 해당 분야에서 여러 다른 유형의 변조에 대해 알려진 약자이다. 더 복잡한 변조, 가령, BPSK, QPSK, m-QAM, 및 OFDM를 이용하는 FH-SS, DS-SS, OFDM, MIMO NxN가 사용될 수 있다. 일반적인 관점에서, LDA 시스템(300)은, 도 3에 도시된 바와 같이, 높은 수신 감도 및 낮은 잡음 지수를 갖고, 주파수 변환 없이(즉, 동일한 주파수, 동일한 스펙트럼을 갖고), OUTPUT B 상에서 이의 재생 주파수 대역폭에서 INPUT으로부터 입력 신호를 재생하고 증폭한다. 이는 반송파와 변조를 포함한다.
앞서 언급된 바와 같이, LNA(416)를 교체하지 않고, 블록(412)과 블록(416) 사이의 수신 경로 내에 보완 방식으로 LDA 시스템(300)을 추가함으로써, 도 4의 통신 장치에서 LDA 시스템(300)은 수신 부스터로서 구현될 수 있다. 이 구성에서, LDA 고 수신 감도, 저 잡음 지수, 및 증폭을 이용해 수신 감도가 증가될 수 있다.
또 다른 실시예에서, LDA 시스템이 펄스형 오실레이터(pulsed oscillator) 및 증가된 스커트 비를 갖는 증폭기로 인한 선택적 주파수 회로일 수 있기 때문에, 필터(412)가 제거될 수 있다. 이는 필터(412)를 교체하고 심지어 대역외 제거 성능을 초과할 수 있다.
도 5는 LDA 시스템(300)의 회로 구성의 하나의 실시예를 도시한다. 절연 회로는 입력 포트로 연결되고 전력 누설, 반사된 신호, 및 주변 회로로부터의 그 밖의 다른 간섭 효과를 필터링 제거하도록 사용되어 Rx 체인을 보호할 수 있고, 앞서 설명된 바와 같이, 재생 효율의 감소 또는 EMI로서 발산되는 전력 누설을 피할 수 있다. 상기 절연 회로는 절연 목적으로 서큘레이터를 포함할 수 있다. 구형 서큘레이터는 부피가 크고 비용이 높은 강자성 요소인 경향이 있다. 신형 서큘레이터는 상당한 크기 감소를 가능하게 하는 나노-강자성 구조물 및 메타물질을 포함할 수 있다. 절연 회로는, 서큘레이터 대신, (능동 회로의 경우) 향상된 이득, 절연, 신호대잡음 비, 및 대역폭을 제공할 수 있는 LNA 또는 임의의 수동 또는 능동 소자를 갖도록 구성될 수 있다. 정합 회로망은 임피던스 정합 및/또는 위성 보정 목적으로 사용될 수 있다. 이 실시예에서, 상기 정합 회로망은 커패시터 C2를 통해 증폭 회로의 입력 섹션으로 임계 결합(critically couple)될 수 있다. LDA에서 충분한 입력 에너지가 주입되지 않기 때문에, 과소-결합된(under-coupled) 연결이 재생 프로세스에 부정적인 영향을 미칠 수 있다. 시스템이 과다-결합된(over-coupled) 반대의 경우, 지나치게 많은 입력 에너지가 LDA로 전달되기 때문에 역시 재생에 영향을 미칠 수 있다. 증폭 회로가 입력 신호를 증폭하고 임의의 적합한 증폭 요소, 예컨대, 연산 증폭기, BJT, FET, RF 증폭기, 또는 그 밖의 다른 이산 트래지스터를 포함할 수 있다.
도 1의 대수 검출기에서, 공진 회로(108)는 증폭 회로(104)와 병렬로 연결되어, 피드백 루프를 형성할 수 있다. 이와 달리, 도 5의 LDA 시스템은 증폭 회로의 외부 측에서 증폭 회로와 직렬로 연결된 공진 회로, 및 증폭 회로와 병렬로 연결된 커패시터 C1를 포함할 수 있다. 대안적으로, 공진 회로는 증폭 회로의 입력 측에서 증폭 회로와 직렬로 연결될 수 있다. 공진 회로에서 L 값 및 C 값을 선택함으로써 동작의 주파수가 설정될 수 있다. 발진이 이렇게 결정된 주파수에서 증폭 회로에서 설정될 수 있다. 이 실시예에서, 샘플링 회로는 다이오드(D1)를 통해 증폭 회로로 연결될 수 있다. 상기 샘플링 회로는 전압 공급 라인에서 증폭 회로로 흐르는 전류를 효과적으로 샘플링하도록 구성될 수 있으며, 지정 임계치에 도달하면, 샘플링 회로가 발진을 중단하도록 동작할 수 있다. 즉, 샘플링 회로는, 임계치에 도달할 때마다, 발진을 주기적으로 인터럽트하도록 사용될 수 있다. 도 1에 도시된 대수 검출기와 유사하게, 따라서 샘플링 회로로부터의 출력이 일련의 전압 스파이크, F_rep일 수 있다. 상기 F_rep는 OUTPUT A로부터 출력되거나 단순히 출력되지 않고 종료될 수 있다.
LDA 시스템의 속성에 영향을 미치지 않으면서, RF 주파수에서 신호를 출력하기 위해, 도 3 또는 도 5의 LDA 시스템의 공진 회로가 도 2의 LDA 시스템(200)의 공진 회로(228)와 상이하게 구성될 수 있다. 이 목표를 획득하기 위해 사용될 수 있는 다양한 기법이 존재할 수 있다. 도 6은 LDA 속성에 영향을 미치지 않으면서 RF 신호를 출력하기 위한 공진 회로의 실시예를 도시한다. 이 공진 회로는 2개의 주요 부분, 즉, 직렬 공진 회로 부분과 병렬 공진 회로 부분을 포함할 수 있다. 본 발명의 도면에서, VCC는 DC 전압 서플라이를 나타내고, 공진 회로의 입력 포트가 상기 증폭 회로로 연결되도록 구성될 수 있으며, 출력 포트가 RF 신호를 출력하도록 OUTPUT B로 연결될 수 있다. 직렬 공진 부분은 커패시터 CS 및 인덕터 LS를 포함하여 직렬 공진(series resonance)을 제공할 수 있다. 병렬 공진 회로 부분은 분할된 커패시터 CP1 및 CP2와 CP1과 CP2의 공통 노드에 연결된 제3 커패시터 CC와 병렬 연결된 인덕터 LP를 포함할 수 있다. CP1, CP2 및 CC의 값을 결정하여, 서로 임계 결합하고 출력 임피던스에 대해 최적화함으로써, RF 신호가 최적으로 탭핑 아웃될 수 있다. 덧붙여, 병렬 공진 회로 부분 내 인덕터 및 커패시터 중 일부가 하이 Q 인덕터 및 하이 Q 커패시터여서, 감도가 개선된 작은 대역폭을 갖도록 구성될 수 있다. 대역폭은 순간 증폭기 이득뿐 아니라 1-사이클 소지 이득에 의해 추가로 결정될 수 있다. 일반적으로 증폭기 이득은 도 5의 커패시터 C1 및 증폭기의 바이어스 레벨(전압 또는 전류)에 의해 설정될 수 있다.
도 7a는 LDA 속성에 영향을 미치지 않으면서 RF 신호를 출력하기 위한 공진 회로의 또 다른 실시예를 도시한다. 이 도면에서, VCC는 DC 전압 서플라이를 나타내고, 공진 회로의 입력 포트는 증폭 회로에 연결되도록 구성될 수 있으며, 출력 포트는 RF 신호를 출력하기 위해 OUTPUT B에 연결될 수 있다. 이 공진 회로는 VCC에 연결된 인덕터 L1, OUTPUT B에 연결된 커패시터 C1, 및 출력 브랜치 상의 공진자를 포함할 수 있다. 공진자는 표면 음향 파(SAW: surface acoustic wave) 필터, 벌크 음향 파(BAW: bulk acoustic wave) 필터, 또는 RF 주파수를 갖는 신호를 전달하기 위한 크리스털 필터뿐 아니라 세라믹 필터, 기계 필터, LC 공진자, 능동 RC, RC 또는 LC의 변형예를 포함할 수 있으며, C는 가변 커패시터 또는 가변 커패시턴스를 갖는 능동 구성요소로 대체된다.
도 7b는 LDA 속성에 영향을 미치지 않고 RF 신호를 출력하기 위한 공진 회로의 또 다른 실시예를 도시하며, 여기서, 차동 입/출력 공진기가 사용될 수 있다. 이 도면에서, VCC는 DC 전압 서플라이를 나타내고, 공진 회로의 입력 포트들 중 하나가 증폭 회로에 연결되도록 구성될 수 있으며, 나머지 입력 포트가 VCC로 연결되도록 구성될 수 있다. 출력 포트들 중 하나가 RF 신호를 출력하기 위해 OUTPUT B에 연결될 수 있고, 제2 출력은 접지될 수 있다. 이 공진 회로가 VCC로 연결된 인덕터 L1, OUTPUT B로 연결된 커패시터 C1, 및 출력 브랜치 상의 차동 입/출력을 갖는 공진자를 포함할 수 있다. 공진자는 표면 음향 파(SAW) 필터, 벌크 음향 파(BAW), 또는 RF 주파수를 갖는 신호를 전달하기 위한 크리스털 필터일 수 있다.
공진 회로 구성의 세 가지 실시예가 도 6, 7a, 및 7b에 기재된다. 각각의 구성에서, 출력 브랜치가 시스템 절연을 향상시키기 위해 아이솔레이터, 가령, 저에서 중 이득을 갖는 LNA를 더 포함할 수 있다. 추가 실시예에서, 출력 브랜치는 50Ω 패드를 포함할 수 있다. 도 6에 도시된 분할된 커패시터(CP1, CP2) 구성의 대안으로서, 인덕터(LP)가 상호 인덕턴스와 함께 연결될 수 있는 LP1 및 LP2로 분할될 수 있다. 이 구성에서, RF 출력 신호가 LP2의 하나의 출력 노드 상으로 탭핑될 수 있고, 단일 단부 구성으로 제2 노드가 접지에 연결될 수 있다. 이들 방법 및 그 밖의 다른 방법 중 일부가 LDA 속성에 영향을 주지 않으면서 RF 신호를 최적으로 출력하기 위한 공진 회로를 구성하도록 조합될 수 있다.
도 5를 다시 참조하면, LDA 시스템은 증폭 회로의 출력 측부에 증폭 회로와 직렬로 연결된 공진 회로를 포함할 수 있다. 상기 공진 회로는 증폭 회로의 입력 측부에서 증폭 회로와 직렬로 연결될 수 있다. 도 8은 LDA 시스템(300)의 회로 구성의 또 다른 실시예를 도시하며, 여기서 공진 회로는 피드백 회로로서 증폭 회로와 병렬로 연결될 수 있다. 상기 공진 회로는 입/출력 단일 단부 또는 차동이도록 구성될 수 있다. 증폭 회로의 출력 측부가 초크 L1을 통해 VCC로 연결될 수 있고, 커패시터 C1은 OUTPUT B에 연결된다. 회로의 나머지 부분이 도 5에 도시된 것과 유사할 수 있다. 공진 회로는 LC 필터, SAW 필터, BAW, 크리스털 필터, RF 주파수의 신호를 통과시키기 위한 기타 필터를 포함할 수 있다. 도 8의 예시에서, VCC, L1 및 C1이 공진 회로의 외부 요소로서 도시된다.
도 9는 LDA 시스템의 회로 구성의 또 다른 실시예를 도시하고, 상기 공진 회로는 증폭 회로의 입력 측부에서 증폭 회로와 분로(shunt)로 연결될 수 있다. 공진 회로는 증폭 회로의 출력 측부에서 증폭 회로와 분로로 연결될 수 있음이 자명할 것이다. 공진 회로의 나머지 단부는 접지로 단락될 수 있다. 상기 공진 회로는 입/출력 단일 단부 또는 차동일 수 있고, 출력들 중 하나가 개방 상태로 남겨져서 회로를 로딩하지 않을 수 있다. 증폭 회로의 출력 측부가 초크 L1를 통해 VCC로 연결될 수 있고 커패시터 C3은 OUTPUT B로 연결될 수 있다. 회로의 나머지 부분은 도 5에 도시된 것과 유사할 수 있다. 도 9의 예시에서, VCC, L1 및 C3이 공진 회로의 외부 요소로서 나타난다.
하나 이상의 공진 회로는 여기서 도시된 LDA 시스템에서 사용될 수 있다. 적어도 하나의 공진 회로가 증폭 회로의 입력 측부 또는 출력 측부에서 증폭 회로와 직렬로 연결될 수 있다. 대안적으로, 적어도 하나의 공진 회로가 증폭 회로와 병렬로 연결될 수 있다. 또 대안적으로, 적어도 하나의 공진 회로가 증폭 회로의 입력 측부 또는 출력 측부에서 증폭 회로와 분로로 연결될 수 있다. 덧붙여, 직렬, 분로, 및 병렬 구성의 조합이 역시 채용될 수 있다. 각각의 공진 회로가 SAW 필터, BAW 필터, 크리스털 필터, 세라믹 필터, 기계적 필터, LC 공진자, 능동 RC, 또는 RC 또는 LC의 변형으로 구성된 군 중에서 선택된 하나 이상의 구성요소를 포함하도록 구성될 수 있으며, 여기서 C는 가변 커패시터, 가령, 배리캡(varicap), 또는 가변 커패시턴스를 갖는 능동 구성요소로 대체된다. 덧붙여, 정합 회로망이 입력, RF 출력, 또는 둘 모두로 연결되도록 구성되거나 생략될 수 있다. 마찬가지로, 절연 회로가 입력, RF 출력, 또는 둘 모두로 연결되도록 구성되거나, 생략될 수 있다.
도 10은 토폴로지의 실시예를 도시하며, LDA 시스템은 위상 고정 루프(PLL)로 구현될 수 있다. 도 10에서, 도 3의 개략도가 추가 특징, 가령, 매우 좁을 수 있는 조절 가능한 캡처 주파수 대역폭, 사용 주파수 대역에서 특정 채널일 수 있는 기준 주파수로의 고정 특징, 또는 기준 주파수가 "반송파 추출 회로"(도시되지 않음)에 의해 입력 반송파 주파수로부터 얻어질 수 있는 특징을 제공하도록 수정된다.
본래의 OUTPUT B가 파워 스플리터에 의해 2개로 분할될 수 있는데, 하나는 도 10의 새 OUTPUT B일 수 있고, 다른 하나는 제2 출력일 수 있으며, 이 출력은 증폭기 또는 감쇠기를 통해 출력 신호를 통과시켜 디지털 프로그램 가능 또는 고정 주파수 N 분주기로 공급되게 할 수 있다. 이 N 분주기는 최대 주파수가 최대 마이크로파 주파수까지 스케일될 수 있는 주파수 프리스케일러를 포함할 수 있다. 최종 신호가 위상/주파수 비교기의 사용에 의해 인수 M으로 나눠지는 기준 주파수, F_reference에 비교될 수 있다. 위상/주파수 비교기가 아날로그 또는 디지털일 수 있다. 스위치가 개방될 때 저역 통과 필터에서 출력 전압이 일정하게 유지되도록, 위상 차이가 3-상태 스위치 및 전하 펌프를 통해 저역-통과 필터로 공급될 수 있다. 스위치가 폐쇄될 때, 전하 펌프가 저역 통과 필터의 출력에서 전압을 감소 또는 증가시키는 양성 또는 음성 전류 펄스를 주입한다. 필터의 출력 전압이 전압 제어기 오실레이터 모드에서 발진 주파수를 변화시킬 수 있는 LDA 코어의 입력, VT를 구동시킬 수 있으며, 여기서 LDA 입력은, 예를 들어, 공진 회로 또는 DC 전압이 발진 주파수를 변화하는 또 다른 LDA 입력 노드에서 가변 커패시턴스 다이오드 또는 배리캡일 수 있다. LDA 코어의 입력이 정합 회로 및 절연 회로를 통해 INPUT으로 연결될 수 있다. 다른 한 측에서, 디지털 성형 회로(digital shaping circuit) 및 선택적 조절 가능 딜레이 기능을 통과하는 OUTPUT A로부터의 신호가 위상 비교기의 3-상태 스위치를 구동시킬 수 있다. 분할 비 N 및 M을 조절함으로써, PLL 및 LDA의 캡처 대역폭이 변경, 조절 또는 프로그램될 수 있다. 루프 대역폭이 최저 데이터 레이트보다 실질적으로 느리도록 조절될 수 있다. 상기 구성에서, PLL은 느린 반응 시간 대 데이터 레이트를 가지며, 상기 데이터 레이트는 위상 및 주파수 차이의 균형을 이루려 시도하는 PLL 루프에 의해 영향 받지 않는다. 변조된 입력 또는 데이터 레이트가 PLL에 영향을 미치지 않으면서 PLL을 통과할 수 있고 PLL 없이 재생될 수 있다. 재생 프로세스가 PLL에 독립적으로 유지되기 때문에 LDA의 높은 수신 감도가 PLL에 의해 영향을 받지 않는다.
LDA와 PLL 조합의 첫 번째 적용예가 캡처 주파수 대역폭을 감소시키고 주파수 대역폭을 특정 사용 대역의 채널, 가령, 10개의 채널 중 채널 3으로 감소시키는 것일 수 있다. 이 토폴로지는 조절 또는 고정 대역폭을 갖는 전자 조절 가능한 대역 통과 필터 기능을 제공한다. 상기 LDA는 이의 높은 스커트 비(좌측 및 우측 주파수 에지 선명도) 때문에, 그리고 수신기의 선택도 및 원치 않는 간섭 제거를 증가시키는 데 도움이 될 수 있다는 사실 때문에, 이러한 적용예에서 유용할 수 있다. PLL에서 LDA를 고정함으로써, LDA 코어의 디폴트 발진 주파수가 (N / M) * F_reference의 관계일 수 있도록 온도에 따른 주파수 표류를 보정할 수 있다.
LDA 및 PLL의 그 밖의 다른 구성이 추가 특징을 제공하도록 고안될 수 있다. PLL 위상 비교기를 구동시키는 기준 주파수, 즉, F_reference가 입력 수신 심볼 레이트와의 동기화를 제공하는 회로로부터 얻어질 수 있다. 이렇게 함으로써, LDA는 심볼당 동기화된 1회 퀀칭을 제공할 수 있다. 이는 F_rep 주파수를 입력 변조 신호와 동일한 값까지로 감소시키는 데 도움이 될 수 있다. 반대의 경우, F-rep가 나이퀴스트 기준(Nyquist criteria)을 충족시키기 위해, 입력 변조의 적어도 두 배여야 한다.
이 문서는 많은 세부사항을 포함하지만, 이들은 본 발명의 범위에 대한 제한로서 해석되지 않아야 하며, 본 발명의 특정 실시예에 특정한 특징부의 기재로서 해석되어야 한다. 개별 실시예의 맥락에서 본 발명에 기재된 특정 특징부가 단일 실시예에서 조합되어 구현될 수 있다. 역으로, 단일 실시예의 맥락에서 기재된 다양한 특징부가 복수의 실시예에서 개별적으로 또는 임의의 적합한 부분조합으로 구현될 수 있다. 덧붙여, 특징부가 앞서 특정 조합으로 동작하는 것처럼 기재될 수 있지만, 일부 경우, 청구되는 조합으로부터의 하나 이상의 특징이 조합으로 실시될 수 있고, 청구되는 조합이 부분조합 또는 부분조합의 변형과 관련될 수 있다.
Claims (17)
- 통신 장치의 수신 체인(receive chain)에서 사용되기 위한 시스템으로서,
시스템의 입력에서 제1 주파수를 갖는 입력 신호를 수신하고 상기 입력 신호를 기초로 발진을 생성하도록 구성된 증폭 회로 - 상기 입력 신호는 제 1 주파수를 가진 입력 캐리어 신호와 입력 변조 신호를 포함하고, 상기 입력 신호는 상기 제 1 주파수 주위의 제 1 주파수 스펙트럼을 가짐 - 와,
상기 증폭 회로에 연결되고, 상기 시스템의 제 1 출력에서 제 1 출력 신호를 제공하도록 구성된 샘플링 회로 - 상기 제 1 출력 신호는 퀀칭 주파수(quenching frequency)의 펄스로 구성됨 - 와,
상기 증폭 회로에 연결되고 시스템의 동작의 주파수를 확립하며 시스템의 제 2 출력에서 제 2 출력 신호를 생성하도록 구성된 하나 이상의 공진 회로 - 상기 제 2 출력 신호는 상기 입력 신호의 재생성된 사본으로서 제 2 주파수를 가진 출력 캐리어 신호와 출력 변조 신호를 포함하고, 상기 제 2 주파수는 제 1 주파수와 동일하며, 상기 제 1 주파수 주위의 제 2 출력 신호의 제 2 주파수 스펙트럼은 상기 제 1 주파수 스펙트럼과 동일하고, 출력 신호는 입력 신호의 주파수 변환없이 생성됨 - 를 포함하는, 시스템. - 제 1 항에 있어서,
상기 하나 이상의 공진 회로 중 적어도 하나는 증폭 회로의 입력측 또는 출력측에서 상기 증폭 회로와 직렬로 연결되는, 시스템. - 제 1 항에 있어서,
상기 하나 이상의 공진 회로 중 적어도 하나는 상기 증폭 회로의 입력측 또는 출력측에서 상기 증폭 회로와 분로(shunt)로 연결되는, 시스템. - 제 1 항에 있어서,
상기 하나 이상의 공진 회로 중 적어도 하나는 증폭 회로의 입력측 또는 출력측에서 상기 증폭 회로와 병렬로 연결되는, 시스템. - 제 1 항에 있어서,
상기 하나 이상의 공진 회로는 병렬로 연결된 인덕터 및 2개의 커패시터를 포함하고, 2개의 커패시터 사이에서 공통 노드에 연결된 제 3 커패시터를 포함하고, 상기 인덕터 및 커패시터들의 값은 RF 주파수를 가진 신호를 출력하도록 구성되는, 시스템. - 제 1 항에 있어서,
상기 하나 이상의 공진 회로는 복수의 구성요소를 포함하고, 상기 복수의 구성요소 중 하나 이상은 하이 Q를 갖도록 구성되는, 시스템. - 제 6 항에 있어서,
상기 하나 이상의 구성요소는 SAW 필터, BAW 필터, 크리스털 필터, 세라믹 필터, 기계식 필터, LC 공진자, 능동 RC, RC 또는 LC의 변형 - C는 가변 커패시터로 대체됨 - , 또는 가변 커패시턴스를 가진 능동 구성요소 중 하나 이상을 포함하는, 시스템. - 제 1 항에 있어서,
증폭 회로의 입력측, 또는 출력측, 또는 입력측 및 출력측에 연결되어, 타 회로로부터의 다른 간섭 효과를 필터링하도록 구성되는 절연 회로(isolation circuit)를 더 포함하는, 시스템. - 제 8 항에 있어서,
상기 절연 회로는 저잡음 증폭기를 포함하는, 시스템. - 제 1 항에 있어서,
임피던스 정합을 위해 상기 증폭 회로의 입력측, 또는 출력측, 또는 입력측 및 출력측에 연결되는 정합 회로망을 더 포함하는, 시스템. - 제 1 항에 있어서,
위상 교정을 위해 상기 증폭 회로의 입력측, 또는 출력측, 또는 입력측 및 출력측에 연결되는 정합 회로망을 더 포함하는, 시스템. - 제 1 항에 있어서,
상기 증폭 회로의 입력측에 연결되는 임계-결합 커플링 회로를 더 포함하는, 시스템. - 제 1 항에 있어서,
상기 하나 이상의 공진 회로는 상기 시스템의 출력에 연결된 임계-결합 커플링 회로를 포함하는, 시스템. - 제 1 항에 있어서,
상기 시스템은 상기 통신 장치의 수신 체인 내 저잡음 증폭기를 대체하도록 구성되는, 시스템. - 제 1 항에 있어서,
상기 시스템은 상기 통신 장치의 수신 체인 내 저잡음 증폭기를 보완하도록, 그리고 상기 저잡음 증폭기 전 또는 후에 위치하도록 구성되는, 시스템. - 통신 장치의 수신 체인 내 저잡음 증폭기의 이전에 또는 이후에 배치되도록 구성되어 저잡음 증폭기를 보완하는데 사용되는 시스템으로서, 상기 시스템은,
시스템의 입력에서 입력 신호를 수신하고 상기 입력 신호를 기초로 발진을 생성하도록 구성된 증폭 회로 - 상기 입력 신호는 제 1 주파수를 가진 입력 캐리어 신호와 입력 변조 신호를 포함하고, 상기 입력 신호는 상기 제 1 주파수 주위의 제 1 주파수 스펙트럼을 가짐 - 와,
상기 증폭 회로에 연결되고, 상기 시스템의 제 1 출력에서 제 1 출력 신호를 제공하도록 구성된 샘플링 회로 - 상기 제 1 출력 신호는 퀀칭 주파수의 펄스들로 구성됨 - 와,
상기 증폭 회로에 연결되고 시스템의 동작의 주파수를 확립하며 시스템의 제 2 출력에서 제 2 출력 신호를 생성하도록 구성된 하나 이상의 공진 회로 - 상기 제 2 출력 신호는 상기 입력 신호의 재생성된 사본이고, 제 2 주파수를 가진 출력 캐리어 신호와 출력 변조 신호를 포함하며, 상기 제 2 주파수는 제 1 주파수와 동일하며, 상기 제 1 주파수 주위의 제 2 출력 신호의 제 2 주파수 스펙트럼은 상기 제 1 주파수 스펙트럼과 동일하고, 출력 신호는 입력 신호의 주파수 변환없이 생성됨 - 를 포함하는, 시스템. - 통신 장치의 수신 체인 내 수신 감도 향상 방법에 있어서,
수신 입력 신호를 증폭하고 입력 신호에 기초하여 발진을 생성하는 단계 - 상기 입력 신호는 제 1 주파수를 가진 입력 캐리어 신호와 입력 변조 신호를 포함하고, 상기 입력 신호는 상기 제 1 주파수 주위의 제 1 주파수 스펙트럼을 가짐 - 와,
시스템의 제 1 출력에서 제 1 출력 신호를 제공하도록 증폭된 신호를 샘플링하는 단계 - 상기 제 1 출력 신호는 퀀칭 주파수의 펄스들을 포함함 - 와,
증폭 회로에 연결되어, 동작의 주파수를 확립하며 제 2 출력에서 제 2 출력 신호를 출력하도록 구성된 하나 이상의 공진 회로를 포함시키는 단계 - 상기 제 2 출력 신호는 상기 입력 신호의 재생성된 사본이고 제 1 주파수와 동일한 RF 주파수를 가지며, 상기 제 1 주파수 주위의 제 2 출력 신호의 제 2 주파수 스펙트럼은 상기 제 1 주파수 스펙트럼과 동일하며, 출력 신호는 입력 신호의 주파수 변환없이 생성됨 - 를 포함하는, 방법.
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