KR100612504B1 - 플라즈마 디스플레이 패널의 구동 장치 - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 더욱 상세하게는 화면에 표시되는 데이터의 노이즈를 저감시킬 수 있고, 제조 단가를 줄일 수 있는 플라즈마 디스플레이 패널의 구동 장치에 관한 것이다.
본 발명에 따른, 플라즈마 디스플레이 패널의 구동 장치는 데이터 정렬부가 구비되는 데이터 구동 보드; 상기 데이터 구동 보드에 어드레스 펄스를 제어하기 위한 데이터를 인가하는 컨트롤 보드; 및 상기 데이터 구동 보드와 컨트롤 보드를 연결하는 소정 개수의 데이터 라인이 구비되는 케이블을 포함하고, 상기 데이터 라인을 통해 상기 데이터가 전체 프레임 기간 중 임의의 기간에 전송되는 것을 특징으로 한다.

Description

플라즈마 디스플레이 패널의 구동 장치{Driving Device for Plasma Display Panel}
도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 나타낸 도이다.
도 2는 종래 플라즈마 디스플레이 패널의 화상 계조를 구현하는 방법을 나타낸 도이다.
도 3은 종래의 플라즈마 디스플레이 패널의 구동 장치를 설명하기 위한 개략도이다.
도 4는 종래의 플라즈마 디스플레이 패널의 컨트롤 보드를 개략적으로 나타낸 도이다.
도 5는 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치를 설명하기 위한 도이다.
도 6a 및 도 6b는 본 발명의 제1 실시예에 따른 컨트롤 보드 및 데이터 구동 보드를 개략적으로 나타낸 도이다.
도 7은 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 데이터 전송 기간을 설명하기 위한 파형도이다.
도 8은 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치를 설명하기 위한 도이다.
도 9a 및 도 9b는 본 발명의 제2 실시예에 따른 컨트롤 보드 및 데이터 구동 보드를 개략적으로 나타낸 도이다.
도 10은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치를 설명하기 위한 도이다.
도 11a 및 도 11b는 본 발명의 제3 실시예에 따른 컨트롤 보드 및 데이터 구동 보드를 개략적으로 나타낸 도이다.
***** 도면의 주요부분에 대한 부호의 설명*****
510 810, 1010; 데이터 구동 보드 520, 810, 1010; 스캔 구동 보드
530, 830, 1030; 서스테인 구동 보드 540, 840, 1030; 컨트롤 보드
610, 910, 1110; 영상신호 수신부 620, 920, 1120; 영상신호 처리부
630, 930, 1130; 데이터 정렬부 640, 940, 1140; 드라이브 IC
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 더욱 상세하게는 화면에 표시되는 데이터의 노이즈를 저감할 수 있고, 제조 단가를 줄일 수 있는 플라즈마 디스플레이 패널의 구동 장치에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널은 전면기판과 후면기판 사이에 형성된 격벽이 하나의 단위 셀을 이루는 것으로, 각 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있다. 고주파 전압에 의해 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultraviolet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다. 이와 같은 플라즈마 디스플레이 패널은 얇고 가벼운 구성이 가능하므로 차세대 표시장치로서 각광받고 있다.
도 1은 일반적인 플라즈마 디스플레이 패널의 구조를 나타낸 도이다.
도 1에 도시된 바와 같이, 플라즈마 디스플레이 패널은 화상이 디스플레이 되는 표시면인 전면 글라스(101)에 스캔 전극(102)과 서스테인 전극(103)이 쌍을 이뤄 형성된 복수의 유지전극쌍이 배열된 전면기판(100) 및 배면을 이루는 후면 글라스(111) 상에 상술한 복수의 유지전극쌍과 교차되도록 복수의 어드레스 전극(113)이 배열된 후면기판(110)이 일정거리를 사이에 두고 평행하게 결합된다.
전면기판(100)은 하나의 방전셀에서 상호 방전시키고 셀의 발광을 유지하기 위한 스캔 전극(102) 및 서스테인 전극(103), 즉 투명한 ITO 물질로 형성된 투명 전극(a)과 금속재질로 제작된 버스 전극(b)으로 구비된 스캔 전극(102) 및 서스테인 전극(103)이 쌍을 이뤄 포함된다. 스캔 전극(102) 및 서스테인 전극(103)은 방전 전류를 제한하며 전극 쌍 간을 절연시켜주는 하나 이상의 상부 유전체층(104)에 의해 덮혀지고, 상부 유전체층(104) 상면에는 방전 조건을 용이하게 하기 위하여 산화마그네슘(MgO)을 증착한 보호층(105)이 형성된다.
후면기판(110)은 복수개의 방전 공간 즉, 방전셀을 형성시키기 위한 스트라이프 타입(또는 웰 타입)의 격벽(112)이 평행을 유지하여 배열된다. 또한, 어드레 스 방전을 수행하여 진공자외선을 발생시키는 다수의 어드레스 전극(113)이 격벽(112)에 대해 평행하게 배치된다. 후면기판(110)의 상측면에는 어드레스 방전시 화상표시를 위한 가시광선을 방출하는 R, G, B 형광체(114)가 도포된다. 어드레스 전극(113)과 형광체(114) 사이에는 어드레스 전극(113)을 보호하기 위한 하부 유전체층(115)이 형성된다.
이러한 구조의 플라즈마 디스플레이 패널은 방전셀이 매트릭스(Matrix) 구조로 복수개가 형성되고, 방전셀에 소정의 펄스를 공급하기 위한 구동회로를 포함하는 구동모듈이 부착되어 구동장치를 이룬다. 이와 같은 플라즈마 디스플레이 패널에서 화상 계조를 구현하는 방법은 다음 도 2과 같다.
도 2는 종래 플라즈마 디스플레이 패널의 화상 계조를 구현하는 방법을 나타낸 도이다.
도 2에 도시된 바와 같이, 종래 플라즈마 디스플레이 패널의 화상 계조(Gray Level) 표현 방법은 한 프레임을 발광횟수가 다른 여러 서브필드로 나누고, 각 서브필드는 다시 모든 셀들을 초기화시키기 위한 리셋 기간(RPD), 방전될 셀을 선택하기 위한 어드레스 기간(APD) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(SPD)으로 나뉘어진다.
예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어지게 된다.
각 서브필드의 리셋 기간 및 어드레스 기간은 각 서브필드마다 동일하다. 방전될 셀을 선택하기 위한 어드레스방전은 어드레스 전극과 스캔 전극인 투명전극 사이의 전압차에 의해 일어난다. 서스테인 기간은 각 서브필드에서 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가된다.
이와 같이 각 서브필드에서 서스테인 기간이 달라지게 되므로 각 서브필드의 서스테인 기간 즉, 서스테인 방전 횟수를 조절하여 화상의 계조를 표현하게 된다.
이와 같은 화상의 계조를 표현하기 위한 플라즈마 디스플레이 패널의 구동 장치를 살펴보면 도 3와 같다.
도 3은 종래의 플라즈마 디스플레이 패널의 구동 장치를 설명하기 위한 개략도이다. 도 3에 도시된 바와 같이, 종래의 플라즈마 디스플레이 패널의 구동 장치는 데이터 구동 보드(310), 스캔 구동 보드(320), 서스테인 구동 보드(330) 및 컨트롤 보드(340)를 구비한다.
데이터 구동 보드(310)는 어드레스 기간 동안 어드레스 전극에 어드레스 펄스를 인가한다.
스캔 구동 보드(320)는 스캔 전극에 리셋 기간 동안 리셋 펄스를 인가하고, 어드레스 기간 동안 스캔 펄스를 인가하며, 서스테인 기간 동안 서스테인 펄스를 인가한다.
서스테인 구동 보드(330)는 서스테인 기간 동안 서스테인 펄스를 인가한다.
컨트롤 보드(340)는 데이터 구동 보드(310), 스캔 구동 보드(320) 및 서스테 인 구동 보드(330)로부터 각각의 전극에 인가되는 펄스를 제어하는 데이터를 각각의 구동 보드에 인가한다. 이와 같은 컨트롤 보드(340)에 대하여 더욱 상세히 살펴보면 다음 도 4와 같다.
도 4는 종래의 플라즈마 디스플레이 패널의 컨트롤 보드를 개략적으로 나타낸 도이다. 도 4에 도시된 바와 같이, 종래의 컨트롤 보드(400)는 영상신호 수신부(410), 영상신호 처리부(420), 데이터 정렬부(430)를 구비한다.
영상신호 수신부(410)는 외부에서 입력되는 영상신호를 수신하여, 영상신호 처리부(430)로 출력한다.
영상신호 수신부(410)는 R(Red), G(Green), B(Blue) 각각의 영상신호 데이터가 8비트로 이루어져 있고, 데이터 구동 보드가 플라즈마 디스플레이 패널의 상부와 하부에 형성되어 구동하는 듀얼 채널(dual channel)으로 이루어져 있으므로, 영상신호 수신부(410)와 영상신호 처리부(420)의 데이터 인터페이스는 48 데이터 핀(pin; 8*3*2=48)을 구비한다.
영상신호 처리부(420)는 역감마 보정부, 이득 제어부, 하프토닝부 및 서브필드 맵핑부(미도시)를 구비함으로써, 외부 영상신호를 플라즈마 디스플레이 패널에 표시하기 적합하도록 처리한 후, 최종적으로 서브필드 맵핑 데이터를 생성한다.
이때, 영상신호 처리부(420)의 인터페이스는 서브필드 개수에 따라 R, G, B 각각 16 비트의 데이터이고, 데이터 구동 방법이 듀얼 채널이기 때문에 96핀(16*3*2=96)을 갖는다.
데이터 정렬부(430)는 영상신호 처리부(420)로부터 입력되는 공간적으로 정 렬된 서브필드 맵핑 데이터를 시간적인 데이터로 변환한다. 데이터 정렬부(430)는 한 라인의 데이터를 32번에 걸쳐 데이터 구동 보드로 전송하기 때문에, XGA의 경우는 132 핀으로, Full HD의 경우는 180 핀으로 인터페이스를 이룬다.
한편, 데이터 정렬부(430)에서 변환된 데이터를 데이터 구동 보드(310)로 전송할 때, 복수개의 라인을 갖는 케이블로 전송한다. 이때, 해상도 변화에 따라 케이블의 라인 개수가 증가하게 되어 제조 단가가 증가하는 문제점이 있다.
또한, 최근들어 플라즈마 디스플레이 패널의 크기가 대형화되는 추세이다. 이와 같이, 플라즈마 디스플레이 패널의 크기가 커짐에 따라 케이블의 길이도 늘어난다. 이에 따라, CMOS/TTL 신호의 데이터를 장거리로 전송해야 되기 때문에 신호 손실 및 크로스 토크(cross talk)와 같은 문제점이 발생한다.
본 발명은 상기와 같은 문제점들을 해결하기 위한 것으로, 플라즈마 디스플레이 패널의 구동 장치를 개선하여, 제조 단가를 줄일 수 있는 플라즈마 디스플레이 패널의 구동 장치를 제공하는데 그 목적이 있다.
또한, 본 발명의 다른 목적은 플라즈마 디스플레이 패널의 구동 장치를 개선하여, 화면에 표시되는 데이터의 노이즈를 저감시킬 수 있는 플라즈마 디스플레이 패널의 구동 장치를 제공하는 것이다.
상기의 목적을 달성하기 위하여, 본 발명의 플라즈마 디스플레이 패널의 구동 장치는 플라즈마 디스플레이 패널의 구동 장치는 데이터 정렬부가 구비되는 데 이터 구동 보드; 상기 데이터 구동 보드에 어드레스 펄스를 제어하기 위한 데이터를 인가하는 컨트롤 보드; 및 상기 데이터 구동 보드와 컨트롤 보드를 연결하는 소정 개수의 데이터 라인이 구비되는 케이블을 포함하고, 상기 데이터 라인을 통해 상기 데이터가 전체 프레임 기간 중 임의의 기간에 전송되는 것을 특징으로 한다.
본 발명의 케이블은 상기 데이터 정렬부와 상기 컨트롤 보드에 구비되는 영상신호 처리부를 연결하는 것을 특징으로 한다.
본 발명의 케이블의 데이터 라인 개수는 한 프레임 동안의 R(Red), G(Green), B(Blue) 각각의 서브필드 개수와 상기 데이터 구동 보드의 채널 개수에 의해 결정되는 것을 특징으로 한다.
본 발명의 데이터 구동 보드는 하나의 판 구조로, 플라즈마 디스플레이 패널의 상부 또는 하부 중 적어도 어느 한 부에 형성되는 것을 특징으로 한다.
본 발명의 데이터 정렬부는 상기 데이터 구동 보드 상에 소정 개수로 형성된 드라이브 IC에 상기 데이터를 인가하는 것을 특징으로 한다.
본 발명의 데이터 정렬부는 상기 m 개의 드라이브 IC에 n 비트의 데이터를 인가하기 위해 m*n 개의 핀이 구비되는 것을 특징으로 한다.
본 발명의 드라이브 IC는 n 비트의 데이터를 인가받기 위해 n 개의 핀이 구비되는 것을 특징으로 한다.
본 발명의 임의의 기간은 프레임 기간에 포함되는 리셋 기간, 어드레스 기간 또는 서스테인 기간 중 적어도 하나 이상의 기간인 것을 특징으로 한다.
본 발명의 플라즈마 디스플레이 패널의 구동 장치는 복수개로 형성되는 데이 터 구동 보드; 상기 복수개의 데이터 구동 보드 중 소정의 데이터 구동 보드 상에 구비되는 데이터 정렬부; 상기 데이터 구동 보드에 어드레스 펄스를 제어하기 위한 데이터를 인가하는 컨트롤 보드; 및 상기 데이터 구동 보드와 컨트롤 보드를 연결하는 소정 개수의 데이터 라인이 구비되는 케이블을 포함하고, 상기 데이터 라인을 통해 상기 데이터가 전체 프레임 기간 중 임의의 기간에 전송되는 것을 특징으로 한다.
본 발명의 복수개의 데이터 구동 보드는 플라즈마 디스플레이 패널의 상부 또는 하부 중 적어도 어느 한 부에 형성되는 것을 특징으로 한다.
본 발명의 소정의 데이터 구동 보드에 형성된 데이터 정렬부를 타 데이터 구동 보드에 형성된 드라이브 IC와 연결하기 위한 케이블을 더 포함하는 것을 특징으로 한다.
본 발명의 플라즈마 디스플레이 패널의 구동 장치는 데이터 정렬부가 구비되는 데이터 구동 보드; 상기 데이터 구동 보드에 어드레스 펄스를 제어하기 위한 데이터를 인가하는 컨트롤 보드; 및 상기 데이터 구동 보드와 컨트롤 보드를 연결하는 소정 개수의 데이터 라인이 구비되는 케이블을 포함하고, 상기 데이터 라인을 통해 상기 데이터가 차등 신호 방식으로 전체 프레임 기간 중 임의의 기간에 전송되는 것을 특징으로 한다.
본 발명의 차등 신호 방식은 LVSD(Low Voltage Differential Signaling) 또는 TMDS(Transition Minimized Differential Signaling) 중 어느 하나의 방식인 것을 특징으로 한다.
본 발명의 특징에 따르면, 데이터 정렬부를 데이터 구동 보드에 형성한다. 이로써, 컨트롤 보드와 데이터 구동 보드를 연결하는 케이블의 라인 개수를 줄일 수 있다. 또한, 컨트롤 보드와 데이터 구동 보드 간의 전송 방식을 고속의 차등 신호로 전송함으로써, 케이블의 라인 개수를 줄일 수 있으며, 장거리 전송시 데이터의 노이즈를 저감시킬 수 있다.
이하에서는 본 발명에 따른 구체적인 실시예를 첨부된 도면을 참조하여 설명한다.
<실시예 1>
도 5는 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치를 설명하기 위한 도이다. 도 5에 도시된 바와 같이, 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치는 데이터 구동 보드(510), 스캔 구동 보드(520), 서스테인 구동 보드(530) 및 컨트롤 보드(540)를 구비한다.
데이터 구동 보드(510)는 어드레스 기간 동안 어드레스 전극에 어드레스 펄스를 인가한다.
스캔 구동 보드(520)는 스캔 전극에 리셋 기간 동안 리셋 펄스를 인가하고, 어드레스 기간 동안 스캔 펄스를 인가하며, 서스테인 기간 동안 서스테인 펄스를 인가한다.
서스테인 구동 보드(530)는 서스테인 기간 동안 서스테인 펄스를 인가한다.
컨트롤 보드(540)는 데이터 구동 보드(510), 스캔 구동 보드(520) 및 서스테 인 구동 보드(530)로부터 각각의 전극에 인가되는 펄스를 제어하는 데이터를 각각의 구동 보드에 인가한다.
이때, 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치는 종래의 플라즈마 디스플레이 패널의 구동 장치와 달리, 데이터 정렬부(미도시)가 데이터 구동 보드에 형성된다. 이로써, 컨트를 보드에 형성된 영상신호 처리부와 데이터 구동 보드에 형성된 데이터 정렬부를 연결하는 케이블의 라인 개수를 줄일 수 있다.
또한, 본 발명의 제1 실시예에 따른 데이터 구동 보드는 하나의 판 구조로, 플라즈마 디스플레이 패널의 상부 또는 하부 중 적어도 어느 한 부에 형성된다. 이는, 데이터 정렬부를 데이터 구동 보드에 형성함에 따른 보다 효율적인 구조를 갖기 위함이다.
이에 관한 보다 상세한 설명은 다음 도 6a 및 도 6b를 통해 기술하기로 한다.
도 6a 및 도 6b는 본 발명의 제1 실시예에 따른 컨트롤 보드 및 데이터 구동 보드를 개략적으로 나타낸 도이다. 도 6a은 본 발명의 제1 실시예에 따른 컨트롤 보드를 나타낸 것이고, 도 6b는 본 발명의 제1 실시예에 따른 데이터 구동 보드를 나타낸 것이다.
도 6a 및 도 6b에 도시된 바와 같이, 컨트롤 보드(600A)는 영상신호 수신부(610)와 영상신호 처리부(620)를 구비하며, 데이터 구동 보드(600B)는 데이터 정렬부(630)와 드라이브 IC(640)를 구비한다.
영상신호 수신부(610)는 영상신호 처리부(620)의 일단에 연결된다.
이때, 영상신호 수신부(610)는 외부에서 입력되는 영상신호를 수신하여, 영상신호 처리부(630)로 출력한다. 도시된 바와 같이, 영상신호 수신부(610)는 R(Red), G(Green), B(Blue) 각각의 영상신호 데이터가 8비트로 이루어져 있고, 데이터 구동 보드가 플라즈마 디스플레이 패널의 상부와 하부에 형성되어 구동하는 듀얼 채널(dual channel)으로 이루어져 있으므로, 영상신호 수신부(610)와 영상신호 처리부(620)의 데이터 인터페이스는 48 데이터 핀(pin; 8*3*2=48)을 구비한다.
영상신호 처리부(620)는 컨트롤 보드(600A) 상에 형성되고, 일단에는 외부에서 입력되는 영상신호를 수신하는 영상신호 수신부(610)가 연결되며, 타단에는 케이블(650)이 연결된다.
이때, 영상신호 처리부(620)는 역감마 보정부, 이득 제어부, 하프토닝부 및 서브필드 맵핑부(미도시)를 구비함으로써, 외부 영상신호를 플라즈마 디스플레이 패널에 표시하기 적합하도록 처리한 후, 최종적으로 서브필드 맵핑 데이터를 생성한다. 도시된 바와 같이, 영상신호 처리부(620)의 인터페이스는 서브필드 개수에 따라 R, G, B 각각 16 비트의 데이터이고, 데이터 구동 방법이 듀얼 채널이기 때문에 96핀(16*3*2=96)을 갖는다.
영상신호 처리부(620)와 데이터 정렬부(630) 간의 인터페이스가 96핀을 갖기 때문에, 이를 연결하기 위한 케이블(650)의 라인 또한 96 라인을 갖는다.
이와 같이, 본 발명의 제1 실시예에 따른 케이블(650)의 데이터 라인 개수는 한 프레임 동안의 R(Red), G(Green), B(Blue) 각각의 서브필드 개수와 데이터 보드 의 채널수에 의해 결정되는 것을 특징으로 한다.
여기서, 도4에 도시된, 종래의 라인 개수와 비교하여, 라인 개수가 절반 정도 줄어듦을 알 수 있다.
데이터 정렬부(630)은 데이터 구동 보드(600B) 상에 형성되고, 일단에는 케이블(650)이 연결되며, 타단에는 데이터 인가를 위한 소정 개수의 데이터 핀이 구비된다.
이때, 데이터 정렬부(630)는 영상신호 처리부(620)로부터 입력되는 공간적으로 정렬된 서브필드 맵핑 데이터를 시간적인 데이터로 변환한다.
본 발명의 제1 실시예에 따른 데이터 정렬부(630)는 m 개의 드라이브 IC에 n 비트의 데이터를 인가하기 위해 m*n 개의 핀이 구비되는 것을 특징으로 한다. 이에 따라, 도 6b에 도시된 바와 같이 데이터 정렬부(630)의 인터페이스는 180 핀을 이룬다.
드라이브 IC(640)는 데이터 구동 보드(600B) 상에 소정 개수로 형성되고, 일단이 상기 데이터 정렬부의 타단에 형성된 소정 개수의 데이터 핀과 대응하는 개수의 핀이 형성되어 연결되며, 타단이 어드레스 전극에 연결된다.
본 발명의 제1 실시예에 따른, 드라이브 IC(640)는 n 비트의 데이터를 인가받기 위해 n 개의 핀이 구비되는 것을 특징으로 한다.
또한, 본 발명의 데이터 보드는 데이터 정렬부(630)와 드라이브 IC(640) 간의 인터페이스가 케이블과 같은 연결부재 없이 직접 연결하기 위해 하나의 판 구조를 이룬다.
본 발명의 제1 실시예에 따라, 종래의 라인 개수와 비교하여, 라인 개수가 절반 정도 줄어듦으로써, 제조 단가를 낮출 수 있다.
또한, 데이터 정렬부(630)와 드라이브 IC(640)간의 간격을 줄임으로써, 화면의 표시되는 데이터의 노이즈를 줄일 수 있다.
도 7은 본 발명의 제1 실시예에 따른 플라즈마 디스플레이 패널의 데이터 전송 기간을 설명하기 위한 파형도이다. 도 7에 도시된 바와 같이, 본 발명의 제1 실시예에서는 컨트롤 보드에서 데이터 구동 보드로 데이터를 전체 프레임 기간(16.67ms) 중 임의의 기간에 전송할 수 있다.
종래에는 영상신호를 변화시키는 데이터 정렬부가 컨트롤 보드에 구비되어 있기 때문에, 데이터 정렬이 끝난 데이터가 어드레스 기간 동안 데이터 구동 보드로 전송된다.
반면, 본 발명의 제1 실시예에서는 데이터 정렬부가 데이터 구동 보드에 구비되어 있기 때문에, 프레임 기간에 포함 되는 리셋 기간, 어드레스 기간 또는 서스테인 기간 중 적어도 하나 이상의 기간에 데이터가 데이터 구동 보드로 전송된 후 데이터 정렬하는 과정을 거친다.
이에 따라, 케이블의 데이터 라인을 통해 데이터가 전체 프레임 기간 중 임의의 기간에 전송되며, 이를 실시간으로 측정할 수 있다.
<실시예 2>
도 8은 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치 를 설명하기 위한 도이다. 도 8에 도시된 바와 같이, 본 발명의 제2 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치는 데이터 구동 보드(810), 스캔 구동 보드(820), 서스테인 구동 보드(830) 및 컨트롤 보드(840)를 구비한다.
본 발명의 제2 실시예에 따른 데이터 구동 보드(810)는 제1 실시예와 달리, 종래의 데이터 구동 보드를 구조를 취하기 위해 복수개로 형성된다. 이에 따라, 데이터 구동 보드에 형성되는 데이터 정렬부와 드라이브 IC의 연결 인터페이스 구조는 제1 실시예와 비교하여, 다음 도 9a 및 도 9b와 같이, 다른 구조를 가지게 된다.
데이터 구동 보드(810), 스캔 구동 보드(820), 서스테인 구동 보드(830) 및 컨트롤 보드(840)에 관한 상세한 설명은 제1 실시예에서 도 5를 통해 충분히 설명하였으므로 생략하기로 한다.
도 9a 및 도 9b는 본 발명의 제2 실시예에 따른 컨트롤 보드 및 데이터 구동 보드를 개략적으로 나타낸 도이다. 도 9a는 본 발명의 제2 실시예에 따른 컨트롤 보드를 나타낸 것이고, 도 8b는 본 발명의 제2 실시예에 따른 데이터 구동 보드를 나타낸 것이다.
도 9a 및 도 9b에 도시된 바와 같이, 컨트롤 보드(900A)는 영상신호 수신부(910)와 영상신호 처리부(920)를 구비하며, 데이터 구동 보드(900B)는 데이터 정렬부(930)와 드라이브 IC(940)를 구비한다.
영상신호 수신부(910)는 영상신호 처리부(920)의 일단에 연결된다.
이때, 영상신호 수신부(910)는 외부에서 입력되는 영상신호를 수신하여, 영 상신호 처리부(930)로 출력한다. 도시된 바와 같이, 영상신호 수신부(910)는 R(Red), G(Green), B(Blue) 각각의 영상신호 데이터가 8비트로 이루어져 있고, 데이터 구동 보드가 플라즈마 디스플레이 패널의 상부와 하부에 형성되어 구동하는 듀얼 채널(dual channel)으로 이루어져 있으므로, 영상신호 수신부(910)와 영상신호 처리부(920)의 데이터 인터페이스는 48 데이터 핀(pin; 8*3*2=48)을 구비한다.
영상신호 처리부(920)는 컨트롤 보드(900A) 상에 형성되고, 일단에는 외부에서 입력되는 영상신호를 수신하는 영상신호 수신부(910)가 연결되며, 타단에는 케이블(950)이 연결된다.
이때, 영상신호 처리부(920)는 역감마 보정부, 이득 제어부, 하프토닝부 및 서브필드 맵핑부(미도시)를 구비함으로써, 외부 영상신호를 플라즈마 디스플레이 패널에 표시하기 적합하도록 처리한 후, 최종적으로 서브필드 맵핑 데이터를 생성한다. 도시된 바와 같이, 영상신호 처리부(920)의 인터페이스는 서브필드 개수에 따라 R, G, B 각각 16 비트의 데이터이고, 데이터 구동 방법이 듀얼 채널이기 때문에 96핀(16*3*2=96)을 갖는다.
영상신호 처리부(920)와 데이터 정렬부(930) 간의 인터페이스가 96핀을 갖기 때문에, 이를 연결하기 위한 케이블의 데이터 라인 또한 96 라인을 갖는다.
이와 같이, 본 발명의 제2 실시예에 따른 케이블(950)의 데이터 라인 개수는 한 프레임 동안의 R(Red), G(Green), B(Blue) 각각의 서브필드 개수와 데이터 보드의 채널수에 의해 결정되는 것을 특징으로 한다.
여기서, 도4에 도시된, 종래의 라인 개수와 비교하여, 라인 개수가 절반 정 도 줄어듦을 알 수 있다.
데이터 정렬부(930)은 복수개의 데이터 구동 보드(900B) 중 소정의 데이터 구동 보드 상에 형성되고, 일단에는 케이블(950)이 연결되며, 타단에는 데이터 인가를 위한 소정 개수의 데이터 핀이 구비된다.
이때, 데이터 정렬부(930)는 영상신호 처리부(920)로부터 입력되는 공간적으로 정렬된 서브필드 맵핑 데이터를 시간적인 데이터로 변환한다.
본 발명의 제2 실시예에 따른 데이터 정렬부(930)는 m 개의 드라이브 IC에 n 비트의 데이터를 인가하기 위해 m*n 개의 핀이 구비되는 것을 특징으로 한다. 이에 따라, 도 9b에 도시된 바와 같이 데이터 정렬부(930)의 인터페이스는 180 핀을 이룬다.
이때, 데이터 구동 보드에 형성된 데이터 정렬부(930)를 타 데이터 구동 보드에 형성된 드라이브 IC(940)와 연결하기 위한 케이블을 더 포함시키도록 한다.
즉, 도 9b와 같이, 48핀은 직접 연결되며, 좌측으로 48핀은 케이블(960)을 이용하여 좌측에 위치한 데이터 구동 보드에 연결되고, 우측으로 84핀은 케이블(970)을 이용하여 우측에 위치한 데이터 구동 보드에 연결된다.
드라이브 IC(940)는 복수개의 데이터 구동 보드(900B) 상에 소정 개수로 형성되고, 일단이 상기 데이터 정렬부의 타단에 형성된 소정 개수의 데이터 핀과 대응하는 개수의 핀이 형성되어 연결되며, 타단이 상기 어드레스 전극에 연결된다.
본 발명의 제2 실시예에 따른, 드라이브 IC(940)는 n 비트의 데이터를 인가받기 위해 n 개의 핀이 구비되는 것을 특징으로 한다.
또한, 복수개의 데이터 구동 보드는 플라즈마 디스플레이 패널의 상부 또는 하부 중 적어도 어느 한 부에 형성되는 것을 특징으로 한다.
본 발명의 제2 실시예에 따라, 종래의 라인 개수와 비교하여, 라인 개수가 절반 정도 줄어듦으로써, 제조 단가를 낮출 수 있다.
또한, 데이터 정렬부(930)와 드라이브 IC(940) 간의 간격을 줄임으로써, 화면에 표시되는 데이터의 노이즈를 줄일 수 있다.
본 발명의 제2 실시예에서도 본 발명의 제1 실시예와 같이, 컨트롤 보드에서 데이터 구동 보드로 데이터를 전체 프레임 기간(16.67ms) 중 임의의 기간에 전송할 수 있다.
데이터 정렬부가 데이터 구동 보드에 구비되어 있기 때문에, 프레임 기간에 포함되는 리셋 기간, 어드레스 기간 또는 서스테인 기간 중 적어도 하나 이상의 기간에 데이터가 데이터 구동 보드로 전송된 후 데이터 정렬하는 과정을 거친다.
이에 따라, 케이블의 데이터 라인을 통해 데이터가 전체 프레임 기간 중 임의의 기간에 전송되며, 이를 실시간으로 측정할 수 있다.
<실시예 3>
도 10은 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치를 설명하기 위한 도이다. 도 10에 도시된 바와 같이, 본 발명의 제3 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치는 데이터 구동 보드(1010), 스캔 구동 보드(1020), 서스테인 구동 보드(1030) 및 컨트롤 보드(1040)를 구비한다.
본 발명의 제3 실시예에 따른 케이블(1050)은 도시된 것과 같이, 16핀으로 구비된다. 이는, 본 발명의 제3 실시예에 따라 케이블을 통해 차등 신호 방식으로 데이터를 전송한다. 이에 따라, 케이블의 라인 개수는 현저하게 줄어들게 된다.
데이터 구동 보드(1010), 스캔 구동 보드(1020), 서스테인 구동 보드(1030) 및 컨트롤 보드(1040)에 관한 상세한 설명은 제1 실시예에서 도 5를 통해 충분히 설명하였으므로 생략하기로 한다.
도 11a 및 도 11b는 본 발명의 제3 실시예에 따른 컨트롤 보드 및 데이터 구동 보드를 개략적으로 나타낸 도이다. 도 11a은 본 발명의 제3 실시예에 따른 컨트롤 보드를 나타낸 것이고, 도 11b는 본 발명의 제3 실시예에 따른 데이터 구동 보드를 나타낸 것이다.
도 11a 및 도 11b에 도시된 바와 같이, 컨트롤 보드(1100A)는 영상신호 수신부(1110)와 영상신호 처리부(1120)를 구비하며, 데이터 구동 보드(1100B)는 데이터 정렬부(1130)와 드라이브 IC(1140)를 구비한다.
영상신호 수신부(1110)는 영상신호 처리부(1120)의 일단에 연결된다.
이때, 영상신호 수신부(1110)는 외부에서 입력되는 영상신호를 수신하여, 영상신호 처리부(1130)로 출력한다. 도시된 바와 같이, 영상신호 수신부(1110)는 R(Red), G(Green), B(Blue) 각각의 영상신호 데이터가 8비트로 이루어져 있고, 데이터 구동 보드가 플라즈마 디스플레이 패널의 상부와 하부에 형성되어 구동하는 듀얼 채널(dual channel)으로 이루어져 있으므로, 영상신호 수신부(1110)와 영상신호 처리부(1120)의 데이터 인터페이스는 48 데이터 핀(pin; 8*3*2=48)을 구비한다.
영상신호 처리부(1120)는 컨트롤 보드(1100A) 상에 형성되고, 일단에는 외부에서 입력되는 영상신호를 수신하는 영상신호 수신부(1110)가 연결되며, 타단에는 케이블(1150)이 연결된다.
이때, 영상신호 처리부(1120)는 역감마 보정부, 이득 제어부, 하프토닝부 및 서브필드 맵핑부(미도시)를 구비함으로써, 외부 영상신호를 플라즈마 디스플레이 패널에 표시하기 적합하도록 처리한 후, 최종적으로 서브필드 맵핑 데이터를 생성한다.
도시된 바와 같이, 케이블(1150)의 데이터 라인을 통해 영상신호 처리부(1120)의 데이터를 차등 신호 방식으로 전송한다.
이때, 영상신호는 74.25MHz이므로 영상신호 처리부에서 96핀 : 74.25MHz 데이터를 48핀 : 148.5MHz 데이터로 전환하여 LVSD(Low Voltage Differential Signaling) 또는 TMDS(Transition Minimized Differential Signaling) 중 어느 하나의 방식으로 전송하게 되면, 8 페어(pair)로 전송이 가능하다.
본 발명의 제3 실시에서는 종래와 비교하여 180핀의 출력이 16핀으로 줄어들게 케이블의 라인 개수가 현저하게 줄어든다. 또한, LVDS나 TMDS와 같은 차등 신호 전송 방식은 노이즈에 강하고, TTL 신호에 비해 장거리 전송에 유리하기 때문에 기존의 방식보다 효과적이다.
여기서, 도4에 도시된, 종래의 라인 개수와 비교하여, 라인 개수가 현저하게 줄어듦을 알 수 있다.
데이터 정렬부(1130)은 데이터 구동 보드(1100B) 상에 형성되고, 일단에는 케이블(1150)이 연결되며, 타단에는 데이터 인가를 위한 소정 개수의 데이터 핀이 구비된다.
이때, 데이터 정렬부(1130)는 영상신호 처리부(1120)로부터 입력되는 공간적으로 정렬된 서브필드 맵핑 데이터를 시간적인 데이터로 변환한다.
본 발명의 제3 실시예에 따른 데이터 정렬부(1130)는 m 개의 드라이브 IC에 n 비트의 데이터를 인가하기 위해 m*n 개의 핀이 구비되는 것을 특징으로 한다. 이에 따라, 도 10b에 도시된 바와 같이 데이터 정렬부(1130)의 인터페이스는 180 핀을 이룬다.
드라이브 IC(1140)는 데이터 구동 보드(1100B) 상에 소정 개수로 형성되고, 일단이 상기 데이터 정렬부의 타단에 형성된 소정 개수의 데이터 핀과 대응하는 개수의 핀이 형성되어 연결되며, 타단이 상기 어드레스 전극에 연결된다.
본 발명의 제3 실시예에 따른, 드라이브 IC(1140)는 n 비트의 데이터를 인가받기 위해 n 개의 핀이 구비되는 것을 특징으로 한다.
또한, 본 발명의 제3 실시예에 따른, 데이터 보드는 데이터 정렬부(1130)와 드라이브 IC(1140) 간의 인터페이스가 케이블과 같은 연결부재 없이 직접 연결하기 위해 하나의 판 구조를 이룬다.
본 발명의 제3 실시예에 따라, 종래의 라인 개수와 비교하여, 라인 개수가 현저하게 줄어듦으로써, 제조 단가를 낮출 수 있다.
또한, 데이터 정렬부(1130)와 드라이브 IC(1140) 간의 간격을 줄임으로써, 화면에 표시되는 데이터의 노이즈를 줄일 수 있다.
본 발명의 제3 실시예에서도 본 발명의 제1 실시예와 같이, 컨트롤 보드에서 데이터 구동 보드로 데이터를 전체 프레임 기간(16.67ms) 중 임의의 기간에 전송할 수 있다.
데이터 정렬부가 데이터 구동 보드에 구비되어 있기 때문에, 프레임 기간에 포함되는 리셋 기간, 어드레스 기간 또는 서스테인 기간 중 적어도 하나 이상의 기간에 데이터가 데이터 구동 보드로 전송된 후 데이터 정렬하는 과정을 거친다.
이에 따라, 케이블의 데이터 라인을 통해 데이터가 전체 프레임 기간 중 임의의 기간에 전송되며, 이를 실시간으로 측정할 수 있다.
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
이상에서와 같이 본 발명은 플라즈마 디스플레이 패널의 구동 장치를 개선함으로써, 제조 단가를 줄일 수 있는 효과가 있다.
또한, 본 발명은 플라즈마 디스플레이 패널의 구동 장치를 개선함으로써, 화 면에 표시되는 데이터의 노이즈를 저감시킬 수 있는 효과가 있다.

Claims (13)

  1. 데이터 정렬부가 구비되는 데이터 구동 보드;
    상기 데이터 구동 보드에 어드레스 펄스를 제어하기 위한 데이터를 인가하는 컨트롤 보드; 및
    상기 데이터 구동 보드와 컨트롤 보드를 연결하는 소정 개수의 데이터 라인이 구비되는 케이블을 포함하고,
    상기 데이터 라인을 통해 상기 데이터가 전체 프레임 기간 중 임의의 기간에 전송되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  2. 복수개로 형성되는 데이터 구동 보드;
    상기 복수개의 데이터 구동 보드 중 소정의 데이터 구동 보드 상에 구비되는 데이터 정렬부;
    상기 데이터 구동 보드에 어드레스 펄스를 제어하기 위한 데이터를 인가하는 컨트롤 보드; 및
    상기 데이터 구동 보드와 컨트롤 보드를 연결하는 소정 개수의 데이터 라인이 구비되는 케이블을 포함하고,
    상기 데이터 라인을 통해 상기 데이터가 전체 프레임 기간 중 임의의 기간에 전송되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  3. 데이터 정렬부가 구비되는 데이터 구동 보드;
    상기 데이터 구동 보드에 어드레스 펄스를 제어하기 위한 데이터를 인가하는 컨트롤 보드; 및
    상기 데이터 구동 보드와 컨트롤 보드를 연결하는 소정 개수의 데이터 라인이 구비되는 케이블을 포함하고,
    상기 데이터 라인을 통해 상기 데이터가 차등 신호 방식으로 전체 프레임 기간 중 임의의 기간에 전송되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  4. 제1항 내지 제3항 중 어느 한 항에 있어서,
    상기 케이블은
    상기 데이터 정렬부와 상기 컨트롤 보드에 구비되는 영상신호 처리부를 연결하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  5. 제1항 또는 제2항 중 어느 한 항에 있어서,
    상기 케이블의 데이터 라인 개수는
    한 프레임 동안의 R(Red), G(Green), B(Blue) 각각의 서브필드 개수와 상기 데이터 구동 보드의 채널 개수에 의해 결정되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  6. 제1항 또는 제3항 중 어느 한 항에 있어서,
    상기 데이터 구동 보드는
    하나의 판 구조로, 플라즈마 디스플레이 패널의 상부 또는 하부 중 적어도 어느 한 부에 형성되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  7. 제1항 내지 제3항 중 어느 한 항에 있어서,
    상기 데이터 정렬부는
    상기 데이터 구동 보드 상에 소정 개수로 형성된 드라이브 IC에 상기 데이터를 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  8. 제7항에 있어서,
    상기 데이터 정렬부는
    상기 m 개의 드라이브 IC에 n 비트의 데이터를 인가하기 위해 m*n 개의 핀이 구비되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  9. 제7항에 있어서,
    상기 드라이브 IC는
    n 비트의 데이터를 인가받기 위해 n 개의 핀이 구비되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  10. 제1항 내지 제3항 중 어느 한 항에 있어서,
    상기 임의의 기간은
    프레임 기간에 포함되는 리셋 기간, 어드레스 기간 또는 서스테인 기간 중 적어도 하나 이상의 기간인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  11. 제2항에 있어서,
    상기 복수개의 데이터 구동 보드는
    플라즈마 디스플레이 패널의 상부 또는 하부 중 적어도 어느 한 부에 형성되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  12. 제2항에 있어서,
    상기 소정의 데이터 구동 보드에 형성된 데이터 정렬부를 타 데이터 구동 보드에 형성된 드라이브 IC와 연결하기 위한 케이블을 더 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  13. 제3항에 있어서,
    상기 차등 신호 방식은
    LVSD(Low Voltage Differential Signaling) 또는 TMDS(Transition Minimized Differential Signaling) 중 어느 하나의 방식인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
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