KR20070111261A - 플라즈마 디스플레이 장치 - Google Patents

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KR20070111261A
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김안수
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엘지전자 주식회사
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Abstract

본 발명은 플라즈마 디스플레이 장치에 관한 것으로, 그 장치는 영상 신호를 디스플레이를 위한 데이터로 변환하여 전송하는 컨트롤러(controller) 및 데이터를 수신하여 어드레스 신호를 생성하는 데이터구동부를 포함하며, 컨트롤러는 데이터를 서로 상이한 데이터 전송 포맷(format)으로 각각 직렬화하는 2 이상의 LVDS(Low Voltage Differential Signaling)트랜스미터; 및 트랜스미터들의 출력 중 어느 하나를 직렬 전송될 데이터로 선택하는 제1 스위칭부를 포함하고, 데이터구동부는 서로 상이한 데이터 수신 포맷(format)을 가지는 2 이상의 LVDS 리시버; LVDS 리시버들 중 어느 하나를 컨트롤러로부터 직렬 전송된 데이터를 수신하도록 선택하는 제2 스위칭부; 및 수신된 데이터를 이용하여 어드레스 신호를 생성하는 드라이버IC를 포함하는 것을 특징으로 한다.
본 발명에 따른 플라즈마 디스플레이 장치에 의하면, 컨트롤러에서 생성된 데이터를 데이터구동부로 전송하는 경우, 데이터를 2 이상의 전송 포맷 중 선택된 포맷의 차등 신호로 직렬 전송할 수 있도록 함으로써, 여러 포맷의 저전압 차등 신호 전송 방식에 호환이 가능함과 동시에, 전자파 방해 및 노이즈를 저감시키고, 데이터 전송을 위한 전송 라인의 개수를 감소시킬 수 있다.

Description

플라즈마 디스플레이 장치{Plasma display apparatus}
도 1은 본 발명에 따른 플라즈마 디스플레이 패널의 구조에 대한 일실시예를 나타내는 사시도이다.
도 2 는 플라즈마 디스플레이 패널의 전극 배치에 대한 일실시예를 도시한 도면이다.
도 3은 하나의 프레임(frame)을 복수의 서브필드(subfield)로 나누어 플라즈마 디스플레이 패널을 시분할 구동시키는 방법에 대한 일실시예를 나타내는 타이밍도이다.
도 4는 플라즈마 디스플레이 패널을 구동시키기 위한 구동 신호들에 대한 일실시예를 나타내는 타이밍도이다.
도 5는 본 발명에 따른 플라즈마 디스플레이 장치의 개략적인 구성에 대한 일실시예를 나타내는 블록도이다.
도 6은 저전압 차등 신호 방식(LVDS, Low Voltage Differential Signaling)을 이용하여 데이터를 송수신하는 데이터정렬부와 데이터구동부의 구성에 대한 제1 실시예를 나타내는 블록도이다.
도 7은 저전압 차등 신호 방식(LVDS, Low Voltage Differential Signaling)을 이용하여 데이터를 송수신하는 데이터정렬부와 데이터구동부의 구성에 대한 제2 실시예를 나타내는 블록도이다.
도 8a와 8b는 LVDS 데이터 포맷(format)에 대한 실시예들을 도시한 도면이다.
본 발명은 플라즈마 디스플레이 장치(Plasma display apparatus)에 관한 것으로서, 보다 상세하게는 영상 신호로부터 생성된 데이터 신호를 이용하여 플라즈마 디스플레이 패널을 구동시키는 장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel: 이하, 'PDP'라 함.)은 일반적으로 전면 글라스와 배면 글라스 사이에 형성된 격벽이 하나의 단위 셀을 이루는 것으로, 각 셀 내에는 네온(Ne), 헬륨(He) 또는 네온 및 헬륨의 혼합기체(Ne+He)와 같은 주 방전 기체와 소량의 크세논을 함유하는 불활성 가스가 충진되어 있으며, 고주파 전압에 의해 방전이 될 때, 불활성 가스는 진공자외선(Vacuum Ultraviolet rays)을 발생하고 격벽 사이에 형성된 형광체를 발광시켜 화상이 구현된다.
이와 같은 PDP는 종래 표시수단의 주종을 이루어왔던 음극선관(CRT)에 비하여 구조가 단순하기 때문에 제작이 용이하고, 박형이며 대형화가 가능한 특징이 있어 차세대 디스플레이 장치로 현재 각광을 받고 있다.
상기 PDP의 구동을 위해서는, 영상 신호를 디스플레이하기 위한 데이터로 변 환시키고, 상기 변환된 데이터의 동기화를 위한 클럭 신호를 생성하며, 상기 생성된 데이터와 클럭 신호를 이용해 어드레스 신호를 생성하여 상기 PDP에 인가하는 구동 동작들이 요구된다.
상기와 같은 종래의 방법에 의해 PDP를 구동하는 경우, 생성된 데이터와 클럭을 고전압, 일반적으로 5V 레벨의 신호로 고속 전송함에 따라 전자파 방해(EMI, Electro Magnetic Interference)가 발생하고, 노이즈에 취약하며, 고해상도일수록 어드레스 구간이 짧아 시간적인 제약이 있는 문제가 있었다. 또한, 데이터와 클럭을 동기화시키기 위한 별도의 동작과 노이즈 제거를 위한 별도의 장치가 필요하며, 상기 데이터 및 클럭을 병렬 전송함에 따라 전송 라인의 개수가 매우 증가하는 문제가 있었다.
본 발명의 기술적 과제는 상기와 같은 문제점들을 개선하기 위하여, 전자파 방해 및 노이즈에 강하며, 데이터 및 클럭 신호 전송을 위한 전송 라인의 개수를 감소시킴으로써 PDP 구동 효율을 향상시킬 수 있도록 하는 플라즈마 디스플레이 패널의 구동 장치를 제공하는 데 있다.
상기한 기술적 과제를 해결하기 위한 본 발명에 의한 플라즈마 디스플레이 장치는, 영상 신호를 디스플레이를 위한 데이터로 변환하여 전송하는 컨트롤러; 및 상기 데이터를 수신하여 어드레스 신호를 생성하는 데이터구동부를 포함한다.
바람직하게는, 상기 컨트롤러는 상기 데이터를 서로 상이한 데이터 전송 포 맷(format)으로 각각 직렬화하는 2 이상의 LVDS(Low Voltage Differential Signaling) 트랜스미터; 및 상기 트랜스미터들의 출력 중 어느 하나를 직렬 전송될 데이터로 선택하는 제1 스위칭부를 포함한다.
상기 데이터구동부는 서로 상이한 데이터 수신 포맷(format)을 가지는 2 이상의 LVDS 리시버; 상기 LVDS 리시버들 중 어느 하나를 상기 컨트롤러로부터 직렬 전송된 데이터를 수신하도록 선택하는 제2 스위칭부; 및 상기 수신된 데이터를 이용하여 어드레스 신호를 생성하는 드라이버IC를 포함하는 것이 바람직하다.
바람직하게는, 상기 데이터는 차등 신호로 전송되며, 0.9V 내지 1.9V의 레벨을 가지는 신호로 전송되는 것이 바람직하다. 또한, 상기 데이터의 전송 주파수는 30MHz 내지 80MHz인 것이 바람직하다.
이하, 첨부된 도면을 참조하여 본 발명에 따른 플라즈마 디스플레이 장치에 관하여 상세히 설명한다. 도 1은 본 발명에 따른 플라즈마 디스플레이 패널에 대한 일실시예를 사시도로 도시한 것이다. 도 1에 도시된 바와 같이, 플라즈마 디스플레이 패널은 상부기판(10) 상에 형성되는 유지 전극 쌍인 스캔 전극(11) 및 서스테인 전극(12), 하부기판(20) 상에 형성되는 어드레스 전극(22)을 포함한다.
상기 유지 전극 쌍(11, 12) 각각은 통상 인듐틴옥사이드(Indium-Tin-Oxide;ITO)로 형성된 투명전극(11a, 12a)과 버스 전극(11b, 12b)을 포함하여 구성되며, 상기 버스 전극(11b, 12b)은 은(Ag), 크롬(Cr) 등의 금속 또는 크롬/구리/크롬(Cr/Cu/Cr)의 적층형이나 크롬/알루미늄/크롬(Cr/Al/Cr)의 적층형으로 형성될 수 있다. 버스 전극(11b, 12b)은 투명전극(11a, 12a) 상에 형성되어, 저항이 높은 투 명전극(11a, 12a)에 의한 전압 강하를 줄이는 역할을 한다.
스캔 전극(11) 및 서스테인 전극(12)의 투명전극(11a, 12a)과 버스전극(11b, 11c)의 사이에는 상부 기판(10)의 외부에서 발생하는 외부광을 흡수하여 반사를 줄여주는 광차단의 기능과 상부 기판(10)의 퓨리티(Purity) 및 콘트라스트를 향상시키는 기능을 하는 블랙 매트릭스(Black Matrix, BM, 15)가 배열된다.
상부 기판(10)에 형성되는 격벽(21)과 중첩되는 위치에 형성되는 제1 블랙 매트릭스(15)와, 투명전극(11a, 12a)과 버스전극(11b, 12b)사이에 형성되는 제2 블랙 매트릭스(11c, 12c)로 구성된다. 이때, 상기 제1 , 제 2 블랙 매트릭스(15, 11c, 12c)로 분리되어 형성되는 블랙 매트릭스를 분리형 BM이라 정의하며, 제2 블랙 매트릭스(11c, 12c)는 전극 사이에 층을 이루어 형성되기 때문에 블랙층 또는 블랙 전극층이라고도 한다.
스캔 전극(11)과 서스테인 전극(12)이 나란하게 형성된 상부기판(10)에는 상부 유전체층(13)과 보호막(14)이 적층된다. 상부 유전체층(13)에는 가스방전 이온화 가스(플라즈마)가 발생된 하전입자들이 축된된다. 보호막(14)은 가스 방전시 발생된 하전입자들의 스피터링으로부터 상부 유전체층(13)을 보호하고, 2차 전자의 방출 효율을 높이게 된다. 또한, 보호막(14)은 통상 산화마그네슘(MgO)이 이용된다.
여기서, 어드레스 전극(22)은 스캔 전극(11) 및 서스테인 전극(12)과 교차되는 방향으로 형성된다. 또한, 어드레스 전극(22)이 형성된 하부기판(20) 상에는 하부 유전체층(23)과 격벽(21)이 형성된다.
또한, 하부 유전체층(23)과 격벽(21)의 표면에는 형광체층이 형성된다. 격벽(21)은 세로 격벽(21a)와 가로 격벽(21b)가 폐쇄형으로 형성되고, 방전셀을 물리적으로 구분하며, 방전에 의해 생성된 자외선과 가시광이 인접한 방전셀에 누설되는 것을 방지한다.
또한, 상기 형광체층은 가스 방전시 발생된 자외선에 의해 발광되어 적색(R), 녹색(G) 또는 청색(B) 중 어느 하나의 가시광을 발생하게 된다. 여기서, 상부/하부 기판(10, 20)과 격벽(21) 사이에 마련된 방전공간에는 방전을 위한 He+Xe, Ne+Xe 및 He+Ne+Xe 등의 불활성 혼합가스가 주입된다.
도 1에 도시된 구조는 본 발명에 따른 플라즈마 패널의 구조에 대한 일실시예에 불과하므로, 본 발명은 도 1에 도시된 플라즈마 디스플레이 패널 구조에 한정되지 아니한다. 예컨대, 본 발명에 따른 플라즈마 디스플레이 패널은 상기 유지 전극 쌍(11, 12) 각각이 ITO로 이루어진 투명 전극(11a, 12a)을 포함하지 않고 버스 전극(11b, 12b)만을 포함하는 ITO-less 구조일 수도 있으며, 상부 기판(10)에 상기 블랙 매트릭스가 일체형으로 형성되어 있는 일체형 BM 구조일 수도 있다. 또한, 상기 유지 전극 쌍(11, 12) 각각이 2 이상의 전극 라인을 포함하여 구성될 수도 있으며, 그 이외의 전극들을 더 포함하는 구조도 가능하다.
도 2는 플라즈마 디스플레이 패널의 전극 배치에 대한 일실시예를 도시한 것으로, 플라즈마 디스플레이 패널을 구성하는 복수의 방전셀들은 도 2 에 도시된 바와 같이 매트릭스 형태로 배치되는 것이 바람직하다. 복수의 방전셀들은 각각 스캔 전극 라인(Y1 내지 Ym), 서스테인 전극 라인(Z1 내지 Zm) 및 어드레스 전극 라인 (X1 내지 Xn)의 교차부에 마련된다. 스캔 전극 라인(Y1 내지 Ym)은 순차적으로 구동되고, 서스테인 전극 라인(Z1 내지 Zm)은 공통적으로 구동된다. 어드레스 전극라인(X1 내지 Xn)은 기수 번째 라인들과 우수 번째 라인들로 분할되어 구동한다.
도 2에 도시된 전극 배치는 본 발명에 따른 플라즈마 패널의 전극 배치에 대한 일실시예에 불과하므로, 본 발명은 도 2에 도시된 플라즈마 디스플레이 패널의 전극 배치 및 구동 방식에 한정되지 아니한다. 예컨데, 상기 스캔 전극 라인(Y1 내지 Ym)들 중 2 개의 스캔 전극 라인이 동시에 구동되는 듀얼 스캔(dual scan) 방식도 가능하다.
도 3은 하나의 프레임(frame)을 복수의 서브필드로 나누어 시분할 구동시키는 방법에 대한 일실시예를 타이밍도로 도시한 것이다. 단위 프레임은 시분할 계조 표시를 실현하기 위하여 소정 개수 예컨대 8개의 서브필드들(SF1, ..., SF8)로 분할될 수 있다. 또한, 각 서브필드(SF1, ...SF8)는 리셋 구간(미도시)과, 어드레스 구간(A1, ..., A8)및, 서스테인 구간(S1, ..., S8)로 분할된다.
각 어드레스 구간(A1, ..., A8)에서는, 어드레스 전극(X)에 표시 데이터 신호가 인가되고, 각 스캔 전극(Y)에 상응하는 스캔 펄스가 순차적으로 인가된다.
각 서스테인 구간(S1, ...,S8)에서는, 스캔 전극(Y)과 서스테인 전극(Z)에 서스테인 펄스가 교호하게 인가되어, 어드레스 구간(A1, ..., A8)에서 벽전하들이 형성된 방전셀들에서 서스테인 방전을 일으킨다.
플라즈마 디스플레이 패널의 휘도는 단위 프레임에서 차지하는 서스테인 방전 구간(S1, ..., S8)내의 서스테인 방전 펄스 개수에 비례한다. 1 화상을 형성하 는 하나의 프레임이, 8개의 서브필드와 256계조로 표현되는 경우에, 각 서브필드에는 차례대로 1, 2, 4, 8, 16, 32, 64, 128의 비율로 서로 다른 서스테인 펄스의 수가 할당될 수 있다. 만일 133계조의 휘도를 얻기 위해서는, 서브필드1 구간, 서브필드3 구간 및 서브필드8 구간 동안 셀들을 어드레싱하여 서스테인 방전하면 된다.
각 서브필드에 할당되는 서스테인 방전 수는, APC(Automatic Power Control)단계에 따른 서브필드들의 가중치에 따라 가변적으로 결정될 수 있다. 즉, 도 8에서는 한 프레임을 8개의 서브필드로 분할하는 경우를 예로 들어 설명하였으나 본 발명은 그에 한정되지 아니하며, 한 프레임을 형성하는 서브필드의 수를 설계사양에 따라 다양하게 변형하는 것이 가능하다. 예를 들어, 한 프레임을 12 또는 16 서브필드 등과 같이, 8 서브필드 이상으로 분할하여 플라즈마 디스플레이 패널을 구동시킬 수 있다.
또한 각 서브필드에 할당되는 서스테인 방전 수는 감마특성이나 패널특성을 고려하여 다양하게 변형하는 것이 가능하다. 예컨대, 서브필드 4에 할당된 계조도를 8에서 6으로 낮추고, 서브필드6에 할당된 계조도를 32에서 34로 높일 수 있다.
도 4는 상기 분할된 하나의 서브필드에 대해, 플라즈마 디스플레이 패널을 구동시키기 위한 구동 신호들에 대한 일실시예를 타이밍도로 도시한 것이다.
상기 서브필드는 스캔 전극들(Y) 상에 정극성 벽전하를 형성하고 서스테인 전극들(Z) 상에 부극성 벽전하를 형성하기 위한 프리 리셋(pre reset) 구간, 프리 리셋 구간에 의해 형성된 벽전하 분포를 이용하여 전 화면의 방전셀들을 초기화하기 위한 리셋(reset) 구간, 방전셀을 선택하기 위한 어드레스(address) 구간 및 선 택된 방전셀들의 방전을 유지시키기 위한 서스테인(sustain) 구간을 포함한다.
리셋 구간은 셋업(setup) 구간 및 셋 다운(setdown) 구간으로 이루어지며, 상기 셋업 구간에서는 모든 스캔 전극으로 상승 램프 파형(Ramp-up)이 동시 인가되어 모든 방전셀에서 미세 방전이 발생되고, 이에 따라 벽전하가 생성된다. 상기 셋다운 구간에는 상기 상승 램프 파형(Ramp-up)의 피크 전압보다 낮은 정극성 전압에서 하강하는 하강 램프파형(Ramp-down)이 모든 스캔 전극(Y)으로 동시에 인가되어 모든 방전셀에서 소거방전이 발생되고, 이에 따라 셋업 방전에 의해 생성된 벽전하 및 공간전하 중 불요 전하를 소거시킨다.
어드레스 구간에는 스캔 전극으로 부극성의 스캔 신호(scan)가 순차적으로 인가되고, 이와 동시에 상기 어드레스 전극(X)으로 정극성의 데이터 신호(data)가 인가된다. 이러한 상기 스캔 신호(scan)와 데이터 신호(data) 간의 전압 차와 상기 리셋 구간 동안 생성된 벽전압에 의해 어드레스 방전이 발생 되어 셀이 선택된다. 한편, 상기 셋다운 구간과 어드레스 구간 동안에 상기 서스테인 전극에는 서스테인 전압(Vs)을 유지하는 신호가 인가된다.
상기 서스테인 구간에는 스캔 전극과 서스테인 전극에 교번적으로 서스테인 펄스가 인가되어 스캔 전극과 서스테인 전극 사이에 면방전 형태로 서스테인 방전이 발생된다.
도 4에 도시된 구동 파형들은 본 발명에 따른 플라즈마 디스플레이 패널을 구동시키기 위한 신호들에 대한 일실시예로서, 상기 도 4에 도시된 파형들에 의해 본 발명은 한정되지 아니한다. 예컨데, 상기 프리 리셋 구간이 생략될 수 있으며, 도 4에 도시된 구동 신호들의 극성 및 전압 레벨은 필요에 따라 변경이 가능하고, 상기 서스테인 방전이 완료된 후에 벽전하 소거를 위한 소거 신호가 서스테인 전극에 인가될 수도 있다. 또한, 상기 서스테인 신호가 스캔 전극(Y)과 서스테인(Z) 전극 중 어느 하나에만 인가되어 서스테인 방전을 일으키는 싱글 서스테인(single sustain) 구동도 가능하다.
도 5는 본 발명에 따른 플라즈마 디스플레이 장치의 개략적인 구성에 대한 일실시예를 블록도로 도시한 것으로, 도시된 플라즈마 디스플레이 장치는 신호처리부(100), 플래시메모리(110), 타이밍제어부(120), 데이터정렬부(130), 데이터구동부(140), 스캔/서스테인구동부(150) 및 플라즈마디스플레이패널(160)을 포함하여 이루어진다.
도 5에 도시된 신호처리부(100), 플래시메모리(110), 타이밍제어부(120) 및 데이터정렬부(130)가 컨트롤러를 구성하며, 데이터구동부(140)와 스캔/서스테인구동부(150)가 플라즈마디스플레이패널(160)을 구동시키기 위해 필요한 제어신호들을 상기 컨트롤러가 공급한다.
신호처리부(100)는 입력되는 영상 신호에 대해 소정의 신호 처리를 수행하여 영상 신호를 디스플레이할 데이터로 변환시킨다. 신호처리부(100)의 상기 신호 처리를 위한 신호 처리 정보들은 플래시메모리(110)에 저장되어 있으며, 상기 플래시메모리(110)는 EEPROM(Electrically Erasable and Programmable Read Only Memory) 인 것이 바람직하다. 신호처리부(100)는 플래시메모리(110)에 저장된 신호 처리 정보를 읽어들여, 상기 영상 신호에 대해 감마보정), 이득조정, 오차확산 및 서브필 드맵핑 등을 수행한다.
상기 감마 보정은 입력되는 영상 신호의 계조값에 따른 휘도값을 선형적으로 변환시키며, 상기 이득 보정은 상기 감마 보정에 의한 휘도 정보에 따라 영상 신호의 계조 범위를 미리 설정된 계조 범위로 변환하여 상기 영상 신호의 이득을 균일하게 보상한다. 상기 오차 확산은 오차 성분을 인접한 셀들에 확산시킴으로써 영상 신호의 휘도값을 미세하게 조정하며, 상기 서브필드 맵핑은 상기 오차 확산된 데이터를 미리 설정된 서브필드들에 맵핑하여 상기 데이터의 최하위 비트(LSB, Least Significant Bit)는 최소 휘도 가중치(weight)가 설정된 서브필드에 할당되고 최상위 비트(MSB, Most Significant Bit)는 최대 휘도 가중치가 설정된 서브필드에 할당되도록 한다.
타이밍제어부(120)는 수직/수평 동기 신호(H,V)를 입력받아 플라즈마디스플레이패널(160)의 구동 구간을 제어하는 타이밍 제어신호를 생성하고, 상기 생성된 타이밍 제어신호를 데이터정렬부(130) 및 스캔/서스테인구동부(150)로 출력하여 플라즈마디스플레이패널(160)에 공급되는 구동 신호들의 타이밍을 제어한다.
타이밍제어부(120)가 상기 타이밍 제어신호를 생성하기 위해 필요한 구동 타이밍 관련 정보들, 예를 들어 플라즈마디스플레이패널(160)이 분할 구동되는 각 구간들의 길이, 상기 각 구간들의 타입(A 또는 B) 등은 플래시메모리(110)에 저장된다. 타이밍제어부(120)는 플래시메모리(110)로부터 상기 저장된 구동 타이밍 정보를 전송받아, 상기 전송된 구동 타이밍 정보와 상기 수직/수평 동기 신호(H,V)를 이용하여 상기 타이밍 제어신호를 생성한다.
데이터정렬부(130)는 신호처리부(100)에서 처리된 데이터와 타이밍제어부(120)에서 생성된 타이밍 제어신호를 입력받아 스캔 순서에 맞추어 데이터를 정렬하여 데이터구동부(140)로 출력한다. 데이터구동부(140)는 상기 정렬된 데이터를 이용해 데이터 전극 구동 신호를 생성하여 플라즈마디스플레이패널(160)의 데이터 전극(미도시)에 인가한다.
스캔/서스테인구동부(150)는 타이밍제어부(120)로부터 입력되는 타이밍 제어신호를 이용해 스캔 전극과 서스테인 전극의 구동 신호를 생성하여 플라즈마디스플레이패널(160)의 스캔 전극(미도시)과 서스테인 전극(미도시)에 인가한다.
데이터정렬부(130)와 데이터구동부(140)는 LVDS 전송 방식을 이용하여 상기 데이터를 송수신하는 것이 바람직하다. 상기 LVDS는 디지털 정보를 구리선을 통해 고속으로 보내기 위한 전송 방법으로서, 여기서 LV, 즉 저전압이라는 것은 LVDS가 표준 전압인 5V 대신에 3.3V나 또는 1.5V를 사용한다는 의미이다. LVDS기술은 보다 적은 수의 전선이 사용될 수 있으며, 데이터를 최고 1000Mbps(megabits per second) 속도로 직렬 전송한다. 이 저전압 신호 스윙과 전류 모드 드라이버 출력은 아주 낮은 노이즈를 유발하며 전력 소비도 적어 어떤 주파수에서나 거의 일정하다. 그리고 LVDS에서 사용되는 차등 데이터 전송은 공통모드(common mode) 노이즈에 영향을 덜 받고, 전자파 장애(Electro Magnetic Interference)가 발생하는 문제를 해결할 수 있다.
도 6은 저전압 차등 신호 방식(LVDS, Low Voltage Differential Signaling)을 이용하여 데이터를 송수신하는 데이터정렬부(130)와 데이터구동부(140)의 구성 에 대한 제1 실시예를 블록도로 도시한 것이다. 도 5에 도시된 바와 같이, 데이터정렬부(130)는 LVDS트랜스미터(600)를 구비한다. LVDS트랜스미터(600)는 TTL 레벨(5V)의 데이터들을 0.9V 내지 1.9V의 레벨을 가지는 신호, 바람직하게는 1.5V로 정도의 전압 레벨을 가지는 저전압 차등 신호로 변환한 후, 변환된 저전압 차등 신호들을 직렬 전송한다. 상기와 같이 TTL 레벨의 데이터를 저전압 신호로 변환하여 전송함으로써 전송시의 전력 소비 및 노이즈를 감소시키며, 차등 신호 전송으로 공통모드 노이즈에 의한 영향 및 전자파 장애를 감소시킬 수 있다.
상기 LVDS를 이용한 데이터의 전송 주파수는 30MHz 내지 80MHz인 것이 바람직하며, 상기와 같은 주파수로 데이터를 고속 직렬 전송함으로써 플라즈마 디스플레이 패널의 구동 마진을 확보할 수 있으며, 종래의 데이터 병렬 전송이 아닌 직렬 전송을 이용함에 따른 시간적 제약을 극복할 수 있다.
도 5에 도시된 바와 같이, 데이터구동부(140)는 LVDS리시버(610)를 구비한다. 상기 LVDS리시버(610)는 상기 데이터정렬부(130)로부터 직렬 전송되는 저전압 차등 신호를 수신하여 다시 TTL 레벨(5V)의 신호로 변환한다.
도 7은 저전압 차등 신호 방식(LVDS, Low Voltage Differential Signaling)을 이용하여 데이터를 송수신하는 데이터정렬부와 데이터구동부의 구성에 대한 제2 실시예를 블록도로 도시한 것이다. 도 7에 도시된 바와 같이, 데이터정렬부(130)는 제1 LVDS트랜스미터(700), 제2 LVDS트랜스미터(710) 및 제1 스위칭부(720)를 포함하여 이루어지며, 데이터구동부(140)는 제1 LVDS리시버(740), 제2 LVDS리시버(750) 및 제2 스위칭부(730)를 포함하여 이루어진다.
제1 LVDS트랜스미터(700)와 제2 LVDS트랜스미터(710)는 서로 LVDS 데이터 전송 포맷이 상이하며, 제1 LVDS리시버(740)와 제2 LVDS트랜스미터(750)는 서로 LVDS 데이터 수신 포맷이 상이하다. 즉, 데이터정렬부(130)는 서로 LVDS 데이터 전송 포맷이 상이한 복수의 LVDS트랜스미터를 포함하여 복수의 포맷들 중 어느 하나로 데이터를 직렬 전송할 수 있으며, 데이터구동부(140)는 서로 LVDS 데이터 수신 포맷이 상이한 복수의 LVDS리시버를 포함하여 여러 포맷의 데이터를 수신할 수 있다.
도 7에서는 데이터정렬부(130)와 데이터구동부(140) 각각이 서로 다른 LVDS 데이터 포맷을 가지는 두개의 LVDS트랜스미터 또는 LVDS리시버를 포함하였으나 본 발명은 그에 한정되지 아니하며, 상기 데이터정렬부(130)와 데이터구동부(140) 각각은 서로 다른 포맷을 가지는 3 이상의 LVDS트랜스미터 또는 LVDS리시버를 포함할 수 있다.
상기 LVDS 데이터 전송 포맷은 복수의 데이터들을 직렬 전송하는 경우, 상기 데이터들의 전송 순서에 의해 결정되며, 상기 LVDS 데이터 수신 포맷은 직렬 전송되는 데이터들의 수신 순서에 의해 결정된다. 즉, 서로 다른 데이터 전송 포맷을 가지는 LVDS트랜스미터는 복수의 데이터를 직렬 전송하는 순서가 상이하며, 서로 다른 데이터 수신 포맷을 가지는 LVDS리시버는 복수의 데이터를 직렬 수신하는 순서가 상이하다.
도 8a와 8b는 서로 다른 2개의 LVDS 데이터 포맷(format)을 도시한 것으로, 도 8a에 도시된 LVDS 데이터 포맷은, LVDS트랜스미터는 24개의 데이터들을 인덱싱된 순서대로 직렬 전송한 후 4개의 제어 신호들 및 클럭 신호를 직렬 전송하고, LVDS리시버는 상기 전송 순서대로 데이터, 제어 신호들 및 클럭 신호를 수신한다.
도 8b에 도시된 LVDS 데이터 포맷은 상기 도 8a에 도시된 포맷과 데이터 전송 및 수신 순서가 상이하다. 즉, 도 8b에 도시된 바와 같이, LVDS트랜스미터는 24개의 데이터들을 인덱싱된 순서와 상이하게 직렬 전송하고 4개의 제어 신호들 및 클럭 신호를 데이터들을 전송하는 중간에 전송하며, LVDS리시버는 일부 데이터의 경우 상기 전송 순서와 수신 순서가 상이하다.
제1 LVDS트랜스미터(700)와 제2 LVDS트랜스미터(710) 각각은 TTL 레벨(5V)의 데이터를 저전압 차등 신호로 직렬화하고, 제1 스위칭부(720)는 제1 LVDS트랜스미터(700)와 제2 LVDS트랜스미터(710)에서 직렬화된 두 데이터 중 어느 하나를 전송할 데이터로 선택한다. 상기 제1 스위칭부(720)의 선택에 따라 전송되는 저전압 ㅊ차등 신호의 LVDS 데이터 전송 포맷이 상이하게 된다.
제2 스위칭부(730)는 데이터정렬부(130)로부터 직렬 전송되는 저전압 차등 신호를 제1 LVDS리시버(740)와 제2 LVDS리시버(750) 중 어느 하나로 출력한다. 제1 LVDS리시버(740)와 제2 LVDS리시버(750) 중 저전압 차등 신호가 입력된 LVDS 리시버는 상기 저전압 차등 신호를 TTL 레벨의 신호로 변환한다. 데이터 전송 포맷과 수신 포맷이 일치하여야 하므로, 상기 제1 스위칭부(720)가 선택하는 LVDS 전송 포맷과 제2 스위칭부(730)가 선택하는 LVDS 데이터 수신 포맷이 일치하여야 한다.
이상 본 발명의 바람직한 실시예에 대해 상세히 기술하였지만, 본 발명이 속하는 기술분야에 있어서 통상의 지식을 가진 사람이라면, 첨부된 청구범위에 정의된 본 발명의 정신 및 범위에 벗어나지 않으면서 본 발명을 여러 가지로 변형 또는 변경하여 실시할 수 있음을 알 수 있을 것이다. 따라서, 본 발명의 앞으로의 실시예들의 변경은 본 발명의 기술을 벗어날 수 없을 것이다.
상기한 바와 같이 구성되는 본 발명에 의한 플라즈마 디스플레이 패널의 구동 장치에 따르면, 컨트롤러에서 생성된 데이터를 데이터구동부로 전송하는 경우, 데이터를 2 이상의 전송 포맷 중 선택된 포맷의 차등 신호로 직렬 전송할 수 있도록 함으로써, 여러 포맷의 저전압 차등 신호 전송 방식에 호환이 가능함과 동시에, 전자파 방해 및 노이즈를 저감시키고, 데이터 전송을 위한 전송 라인의 개수를 감소시킬 수 있다.

Claims (4)

  1. 영상 신호를 디스플레이를 위한 데이터로 변환하여 전송하는 컨트롤러 및 상기 데이터를 수신하여 어드레스 신호를 생성하는 데이터구동부를 포함하는 플라즈마 디스플레이 장치에 있어서,
    상기 컨트롤러는
    상기 데이터를 서로 상이한 데이터 전송 포맷(format)으로 각각 직렬화하는 2 이상의 LVDS(Low Voltage Differential Signaling)트랜스미터; 및
    상기 트랜스미터들의 출력 중 어느 하나를 직렬 전송될 데이터로 선택하는 제1 스위칭부를 포함하고,
    상기 데이터구동부는
    서로 상이한 데이터 수신 포맷(format)을 가지는 2 이상의 LVDS 리시버;
    상기 LVDS 리시버들 중 어느 하나를 상기 컨트롤러로부터 직렬 전송된 데이터를 수신하도록 선택하는 제2 스위칭부; 및
    상기 수신된 데이터를 이용하여 어드레스 신호를 생성하는 드라이버IC를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  2. 제1항에 있어서, 상기 데이터는
    차등 신호로 전송되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  3. 제1항에 있어서, 상기 데이터는
    0.9V 내지 1.9V의 레벨을 가지는 신호로 전송되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  4. 제1항에 있어서,
    상기 데이터의 전송 주파수는 30MHz 내지 80MHz인 것을 특징으로 하는 플라즈마 디스플레이 장치.
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