KR100258150B1 - 무선통신시스템에서중계선로 테스트를 위한 채널할당방법 및 회로 - Google Patents

무선통신시스템에서중계선로 테스트를 위한 채널할당방법 및 회로 Download PDF

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Abstract

본 발명은 무선통신시스템의 중계선로테스트를 위한 채널을 할당하는데 있어 패킷을 전송하므로 채널구분이 없어지고 특정한 전송속도로 데이터송수신을 하도록 정하여 채널사용을 자유로히 하되, 0번의 채널을 프레임 동기채널로 사용하고,1에서 16번의 채널은 패킷 데이터 전송용으로 사용하며, 31번 채널을 BER 테스트 채널로 활당하여 이를 통해 중계선로의 BER 테스트를 하도록 되어있다.

Description

무선통신시스템에서 중계선로 테스트를 위한 채널할당방법 및 회로 {METHOD AND CIRCUIT FOR CHANNEL ASSIGN TRUNK LINE TEST IN RF COMMUNICATION SYSTEM}
본 발명은 무선통신시스템에 있어서 중계 선로 테스트를 위한 채널 할당 방법 및 회로에 관한것이다.
일반적으로 기지국 제어부(BSC;Base Station Controller)와 기지국 전송시스템(BTS;Base Station Tranceiver System)간에 존재하는 중계선로는 패킷 데이터의 송수신이 목적이므로 기지국 제어부와 기지국 전송 시스템간의 중계선로를 시험하여 데이터의 송수신에 있어 이상이 없음을 확인하여야 한다. 상기 기지국 제어부와 기지국 전송시스템간의 중계선로의 인터페이스 보드는 LIEA(Line Interface E1 Assembly)라 칭한다. 상기 LIEA(Line Interface E1 Assembly)는 도 2의 예와같이 최대 8 대의 링크(Link0-Link7)를 수용 할수있으므로 최대 8개의 E1을 접속 할수있다. 그리고 상기 기지국 제어부와 기지국 전송시스템간의 데이터 전송을 위한 연결방식은 E1 또는 T1으로 연결되며, 상기 E1 또는 T1연결 라인을 통해 전송되는 데이터는 일정한 패킷형태로 만들어져 전송된다. 상기 데이타의 송수신에 있어 이상이 없음을 확인하는 방법으로 두가지가 있다. 하나는 중계선의 측정장비를 이용하는 방법으로 상기 기지국 제어부와 기지국 전송시스템의 각 구간에 순서대로 백룹(Back loop)의 케이블을 이용하여 루 백(Loop Back)을 한 다음 측정장비를 이용하여 의사 랜덤 데이터를 송신 한후 그 데이타를 수신하여 정상/비정상을 판정하는 방법이며, 다른 하나의 방법은 라인 인터페이스E1부(LIEA)의 F/W(Firm Ware)를 이용하는 방법이다. 상기 라인 인터페이스E1부(LIEA)의 F/W(Firm Ware)를 이용하는 방법은 상기와 동일한 방법으로 백룹 케이블을 이용하되, 루백을 한다음 라인인터페이스E1부(LIEA)의 F/W(Firm Ware)에서 백룹 테스트를 시행토록 되어 있다. 그러나 이와 같이 종래방법은 오-프 라인 테스트에서만 시험이 가능(LIEA F/W)하며 트렁크를 시험하는 중에 패킷 데이터 전송이 불가능하다. 예를들어, 5회의 백 루프 테스트의 실시하고자 하여도 많은 시간이 소요되는 문제점이 있었다.
따라서 본 발명의 목적은 시간 또는 공간상의 제약을 받지 않고 원하는 시간에 명령어를 키인하여 중계선로의 안전성을 테스트하는 방법 및 회로를 제공함에 있다.
본 발명의 다른 목적은 신뢰성있는 데이터 전송을 위하여 트렁크 상태가 안정적인가를 체크하는 회로를 제공함에 있다.
본 발명의 또다른 목적은 트렁크(E1,T1)의 상태를 온 라인 서비스상태로 유지하면서 비트 에러 레이트를 테스트하는 회로를 제공함에 있다.
상기 목적을 수행하기 위한 본 발명은 무선통신시스템에 있어서 중계 선로 테스트를 위한 채널 할당을 위하여 패킷을 전송함에 있어 채널의 구분이 없어지고 특정 전송속도로 데이터송수신을 하도록 정하여 채널사용을 자유로히 하도록 0번의 채널을 프레임 동기채널로 사용하고, 16번의 채널은 패킷 데이터 전송용으로 사용하며, 31번 채널은 BER 테스트 채널로 할당하여 이를 통해 중계선로의 BER테스트를 수행하여 전송 선로의 품질을 측정하도록 되어 있다.
도 1는 본 발명의 실시예에 따른 BER 패스(Path)를 설명하기 위한 도면
도 2는 본 발명의 실시예에 따른 8개의 중계선 보드에 해당하는 라인 인터페이스 E1 중 하나의 라인 인터페이스 E1부로 부터 8개 링크중 하나의 링크에서 첫 번째채널(CH0)을 프레임 동기용으로 ,마지막 채널(CH31)을 BER테스트용으로 사용토록함을 표시한 예시도
도 3는 도 1의 라인 인터페이스 E1부(116)로 부터 라인 비트 에러레이트 테스트부(113)와 IPC 프로세서 보드부(115)간의 채널중 31번째 채널을 통해 중계선로를 활당하는 구체회로도
도 4는 본 발명의 실시를 위해 커멘드 데이타발생부(311)로부터 라인 인터페이스 E1부(116)로 제공되는 클럭타이밍도
도 5 및 도 6은 본 발명의 실시예에 따른 비트 에러 레이트 테스트 디스에이블 또는 인에이블 예를 나타내는 도면
이하 본 발명의 바람직한 실시예의 상세한 설명이 첨부된 도면들을 참조하여 설명될 것이다. 하기에서 각 도면의 구성요소들에 참조부호를 부가함에 있어, 동일한 구성요소들에 대해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 부호를 가지도록 하고 있음에 유의해야 한다. 또한 본 발명을 설명함에 있어, 관련된 공지 기능 또는 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우에는 그 상세한 설명은 생략할 것이다. 그리고 후술되는 용어들은 본 발명에서의 기능을 고려하여 정의 내려진 용어들로서 이는 사용자 또는 칩 설계자의 의도 또는 관례 등에 따라 달라질 수 있으며, 그 정의는 본 명세서 전반에 걸친 내용을 토대로 내려져야 할 것이다.
도 1는 본 발명의 실시예에 따른 BER 패스(Path)를 설명하기 위한 도면으로서,
호를 제어하는 호 제어부(101)에 IPC노드를 제어하는 IPC노드부(103)을 연결하며, 상기 IPC노드부(103)에 기지국 제어부의 유지 보수용 제어부(105)와 IPC부(107)를 연결한다. 상기 유지 보수용 제어부(105)와 IPC부(107)간은 서브 하이웨이케이블(SHW)로 연결되며, 상기 IPC부(107)로 부터 PCM케이블(PCM)로 하여 기지국 전송시스템(109)이 연결된다. 상기 유지 보수용 제어부(105)의 내부는 알람제어프로세서(112)와 라인비트 에러레이트 테스트부(113)이 내장되어 있으며, 상기 IPC부(107)는 IPC프로세서보드부(115)와 라인 인터페이스 E1부(116)가 내장되어 있다. 상기 기지국 전송시스템(109)의 내부에는 IPC프로세서부(117)와 라인 인터페이스 T1부(118)가 내장되어 있다.
도 2는 본 발명의 실시예에 따른 8개의 기지국에 해당하는 라인 인터페이스 E1(LIEA -A0-LIEA-A7)중 하나의 라인 인터페이스 E1부(LIEA-A0)로 부터 8개 링크(Link0 -Link7)중 하나의 링크(Link0)에서 첫 번째 채널(CH0)을 프레임 동기용으로 사용하고, 마지막 채널(CH31)을 BER테스트용으로 사용함을 표시한 예시도이다.
도 3는 도 1의 라인 인터페이스 E1(116)의 채널중 일반 신호 전송용으로 0채널에서 30채널을 사용하고, 에러 레이트 테스트용 데이터 전송용으로 31번째 채널을 통해 중계선로를 할당하는 예를 구체적으로 설명하기 위한 회로도로서,
무선통신시스템의 송수신용 전송데이타(DIFF DATA 1-8)를 PCM 데이타로 상호변환하여 처리하는 송수신부(301,302)로 구성된 IPC 프로세서 보드부(115)와,
상기 IPC프로세서 보드부(115)의 송수신부(301,302)를 통하여 일반신호의 전송을 위해 설정된 0채널에서 30채널과 비트 에러 테스트용 31채널을 할당하여 전송 프레임을 형성하는 라인 인터페이스 E1부(116)와,
상기 IPC 프로세서 보드부(115)와 연결되고 상기 라인 인터페이스 E1부(116)에 연결되어 비트 에러 테스트용 31채널 및 일반 전송신호의 전송을 위한 0-30의 프레임동기 및 통신채널을 설정토록 스위칭하는 타임스위치(308)와,
상기 타임스위치(308)에서 설정된 31채널을 통해 전송되는 송수신되는 비트 에러 테스트용 데이터를 송수신하는 BER 테스트용 데이터 송수신부(304,305)로 구성된 라인 비트 에러 레이트 테스트부(113)와,
시스템 전체를 제어하거나 상기 각부를 제어하는 제어신호를 발생하는 중앙처리장치(CPU)와,
상기 중앙처리장치(CPU)의 제어에 의해 상기 라인 인터페이스 E1부(116)에 커멘드클럭신호를 제공하는 커멘드데이타발생부(311)로 구성된다.
도 4는 도 3의 본 발명의 실시예에 따른 커멘드 데이터 발생부(311)에서 발생되는 (4a),(4b)의 클럭 타이밍도로서,
(4a)는 프레임 펄스 파형이며, (4b)는 데이터 송수신 패킷 클럭파형이다. (4c-4e)는 상기 (4a)와(4b)로 부터 발생된 라인 인터페이스 E1부(116)의 타이밍도이다.
도 5, 6은 본 발명의 실시예에 따른 BER 테스트 인에이블/디스에이블 동작타이밍도이다.
따라서 본 발명의 구체적 일 실시예를 도 1-도 6를 참조하여 상세히 설명하면,
라인비트 에러레이트 테스트부(113)는 도 1의 개시와 같이 알람 제어 프로세서(112)에서 발생되고 TD-버스(TD-BUS)를 통하여 수신된 측정에 대한 모드 데이터(MODE DATA)와 코멘드 데이타(COMMAND DATA)에 의해 피측정 전송 전로상에 대한 시험을 한다. 상기 시험을 완료한 라인비트 에러레이트 테스트부(113)는 상기 알람 제어 프로세서(112)로 요구한 상태를 테스트하여 전송하되, 상기 라인비트 에러레이트 테스트부(113)는 상기 알람 제어 프로세서(112)로 데이타 전송을 알리는 플랙을 세팅하고, 이의 세팅의 완료 여부에 따라 리드동작에 의해 테스트한 결과 데이터를 읽어 가도록 한다. 즉, 상기 알람 제어 프로세서(112)와 라인 비트에러 레이트 테스트부(113)와의 관계는 할당된 어드레스로 데이터를 송수신하며, 인터럽트를 요구하게 된다. 송수신 데이터의 형태는 아스키 코드 또는 헥사 데시멀로 8비트 1바이트형태로 하며, 데이타 바이트수는 경우에 따라 다르므로 데이터의 마지막임을 알리기 위해 송수신 데이타의 마지막 바이트는 케리지 리턴으로 "0DH"로 한다. 또한 상기 알람 제어 프로세서(112)는 라인 비트 에러 레이트 테스트부(113)의 데이터 수신영역에 데이터를 라이트한후 데이터가 라이트 완료되었음을 라인비트 에러레이트 테스트부(113)로 알려주기 위하여 라인비트 에러레이트 테스트부(113)의 수신 인터럽트영역(7FFH)에 "EEH"를 라이트하면 인터럽트가 발생된다. 상기 인터럽트가 발생된 상기 알람제어프로세서(112)와 라인 비트에러레이트 테스트부(113)와의 관계는 라인비트 에러레이트 테스트부(113)는 수신 데이타를 읽어오고, 인터럽트영역을 리드하여 인터럽트신호를 클리어 한다. 상기 피측정 전송선로상의 테스트란 도 1의 PCM 케이블(PCM)상의 BER 특성을 시험하기 위한 것으로 상기 라인비트 에러레이트 테스트부(113)는 라인 인터페이스 E1부(116)와 같이 연결되어져야 한다. 이를 위해서는 우선 라인비트 에러레이트 테스트부(113)와 라인 인터페이스 E1부(116)의 관계에서 SHW상의 신호의 방식은 차동(Differential)방식이며, 타임슬롯은 소프트웨어적으로 결정되며, 상기 채널 할당예는 상기 기지국 전송시스템(109)의 라인 인터페이스 T1부(118)와 라인 인터페이스 E1부(116)의 관계에서 도 2의 예와 같이 라인 인터페이스 E1부(116)에서 채널 31에서 BER 테스터용 채널이 설정되고, 도 3은 도 1의 라인비트 에러레이트 테스트부(113)및 IPC프로세서보드부(115)와 라인 인터페이스 E1부(116)와의 관계에서 각부를 구체적으로 나타내는 예로서, 라인 인터페이스 E1부(116)에서 타임 스위치(308)에서 채널 31에서 BER 테스트용으로 설정하여 BER 테스트용 데이터 수신부(304), BER 테스트용 데이터 송신부(305)를 통해 BER 테스트 데이타를 송수신한다. 그리고 채널 0에서 채널30을 통해 패킷 전송 데이타를 송수신한다. 도 4는 본 발명에서 커멘드 데이터 발생부(311)로 부터 발생되어 수신되는 클럭 타이밍도로서, 프레임 동기펄스(4a)로 부터 내부 2M(Mhz),4M(Mhz)의 클럭 발생(4b,4d,4e)과 FOi의 신호(4c)의 발생을 나타낸 것이다. 도 5,6은 기지국 제어부(107)와 기지국 전송시스템(109)간의 BER테스트를 위한 인에이블 또는 디스에이블에 대한 라인 인터페이스 E1,T1부(117,118)사이의 세팅은 상기 라인 인터페이스 E1부(117)의 특정포트를 지정에 따라 BER 테스트를 인에이블 할것이인지 또는 디스에이블 할것인지를 설정한다. 이에 대해 도 3를 참조하면, 도 5의 예와같이 BER 테스트를 디스에이블 상태이면 라인 인터페이스E1부(116)에서 타임 스위치(308)에 의해 IPC 프로세서부(115)에서 채널 0는 프레임 동기채널로 사용되고, 채널 16은 멀티 동기 채널로 정하여지나 도 6의 예와 같이 라인 인터페이스 E1부(116)에 의해 BER 테스트 인에이블이면 타임 스위치(308)에 의해 IPC 프로세서 보드부(115)로 채널 16으로 패킷 데이타 전송용으로 전용되고, 라인비트 에러 레이트 테스트부(113)로 채널 31으로 BER 테스트 채널로 할당하여 전체적으로 패킷 데이타의 손실없이 BER 테스트가 가능토록 되어있다. 본 발명은 호제어부(101)의 중앙처리장치(CPU)로부터 BER 시험 또는 라인 인터페이스 E1부(116)에 대한 세팅지정이 있으면 커멘드 데이터 발생부(311)에서 상기 라인 인터페이스 E1부(116)에 도 4의 (4a)예와 같이 프레임 펄스를 인가하고, (4b)의 예와 같이 2MHZ의 클럭을 인가하면 상기 라인 인터페이스 E1부(116)는 도 6의 예와 같이 BER 테스트모드이면 타임스위치(308)에서 31채널을 BER테스트전용 채널로 지정하여 호제어부(101)의 중앙처리장치(CPU)에서 도 3의 라인비트 에러 레이트 테스트부(113)의 BER 테스트용 데이터송신부(305)를 인에이블하여 BER 테스트용 데이터를 송신하고, BER 테스트용 데이터 수신부(304)를 통해 BER테스트용 데이터를 받는다. 다음 도 5의 예와 같이 BER 테스트모드가 아니면 도 3의 IPC프로세서 보드부(115)를 통해 0에서 30채널로 데이터를 통신토록 정하고, 호제어부(101)의 중앙처리장치(CPU)에서 IPC 프로세서 보드부(115)의 수신부(301)를 인에이블하여 일반 데이터를 수신토록 하며, 송신부(302)를 통하여 전송한다.
상술한 바와 같이 무선통신시스템의 기지국에서 BER 테스트 명령의 키인으로부터 중계선로의 안정성을 체크할수 있고, 전송선로가 온 라인 서비스, 즉 시스템이 정상 동작중에도 중계선로를 측정 할수 있어 측정효율을 증대시키며, 특정구간을 체크하기 위해 중계선 측정장비를 사용하지 않아도 되므로 비용이 절감되며, 원하는 시간에 측정이 가능하므로 시간의 제약이 감소되고, 측정을 위한 특정장소에 구애 받지 않고 확인이 가능하므로 공간의 제약성을 없애는 이점이 있다.

Claims (2)

  1. 무선 통신 시스템의 비트에러 레이트 테스트 채널할당방법에 있어서,
    상기 무선통신시스템의 비트에러 레이트 테스트를 위한 데이터는 패킷으로 채널의 구분이 없이 전송하되, 0번의 채널을 프레임 동기채널로 사용하며, 1번에서 16번의 채널은 패킷 데이터 전송전용으로 사용하고, 31번 채널은 BER 테스트 채널로 할당하여 상기 할당된 31번 채널을 통하여 전송 되는 패킷 데이터에 의해 중계선로의 품질을 측정하도록 함을 특징으로 하는 무선통신시스템에서 중계선로 테스트를 위한 채널할당방법.
  2. 무선 통신 시스템의 비트 에러 레이트 테스트 채널할당회로에 있어서,
    상기 무선통신시스템의 송수신용 전송데이타(DIFF DATA 1-8)를 PCM 데이타로 상호 변환하여 처리하는 송수신부(301,302)로 구성된 IPC 프로세서 보드부(115)와,
    상기 IPC프로세서 보드부(115)의 송수신부(301,302)를 통하는 일반신호의 전송을 위해 설정된 0에서 30채널과 비트 에러 테스트용 31채널을 할당하여 전송 프레임을 형성하는 라인 인터페이스 E1부(116)와,
    상기 IPC 프로세서 보드부(115)와 연결되고 상기 라인 인터페이스 E1부(116)에 연결되어 비트에러 테스트용 31채널 및 일반 전송신호의 전송을 위한 0-30채널의 통신채널을 설정토록 스위칭하는 타임스위치(308)와,
    상기 타임스위치(308)에서 설정된 31채널을 통해 전송되는 송수신되는 비트 에러 테스트용 데이터를 송수신하는 BER 테스트용 데이터 송수신부(304,305)로 구성된 라인비트 에러레이트 테스트부(113)와,
    상기 무선통신시스템의 전체를 제어하거나 상기 각부를 제어하는 제어신호를 발생하는 중앙처리장치(CPU)와,
    상기 중앙처리장치(CPU)의 제어에 의해 상기 라인 인터페이스 E1부(116)에 커멘드 클럭신호를 제공하는 커멘드 데이터 발생부(311)로 구성됨을 특징으로 하는 무선통신시스템에서 중계선로 테스트를 위한 채널할당회로.
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