JPWO2004097543A1 - 半導体装置 - Google Patents
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Abstract
Description
OLEDなどの発光素子は自発光型であるため、液晶ディスプレイに比べて画素の視認性が高く、バックライトが不要で応答速度が速い等の利点がある。また発光素子の輝度は電流によって制御可能である。
このような自発光型の発光素子を用いた表示装置では、その駆動方式として単純マトリックス方式とアクティブマトリックス方式とが知られている。前者は構造は簡単であるが、大型かつ高輝度のディスプレイの実現が難しい等の問題があり、近年は発光素子に流れる電流を画素回路内部に設けた薄膜トランジスタ(TFT)によって制御するアクティブマトリックス方式の開発が盛んに行われている。
このようなアクティブマトリックス方式の表示装置の場合、駆動TFTの電流特性のバラツキにより発光素子に流れる電流が変化し輝度がばらついてしまうという問題があった。
つまり、このようなアクティブマトリックス方式の表示装置の場合、画素回路には発光素子に流れる電流を駆動する駆動TFTが用いられており、これらの駆動TFTの特性がばらつくことにより発光素子に流れる電流が変化し、輝度がばらついてしまうという問題があった。そこで画素回路内の駆動TFTの特性がばらついても発光素子に流れる電流は変化せず、輝度のバラツキを抑えるための種々の回路が提案されている。
図6に、特許文献1に開示されている従来のアクティブマトリックス型表示装置の第1の構成例を示す。図6の画素は、ソース信号線601、第1〜第3のゲート信号線602〜604、電流供給線605、TFT606〜609、保持容量610、EL素子611、映像信号入力用電流源612を有する。
TFT606のゲート電極は、第1のゲート信号線602に接続され、第1の電極はソース信号線601に接続され、第2の電極は、TFT607の第1の電極、TFT608の第1の電極、およびTFT609の第1の電極に接続されている。TFT607のゲート電極は、第2のゲート信号線603に接続され、第2の電極はTFT608のゲート電極に接続されている。TFT608の第2の電極は、電流供給線605に接続されている。TFT609のゲート電極は、第3のゲート信号線604に接続され、第2の電極はEL素子611の陽極に接続されている。保持容量610はTFT608のゲート電極と電流供給線との間に接続され、TFT608のゲート・ソース間電圧を保持する。電流供給線605およびEL素子611の陰極には、それぞれ所定の電位が入力され、互いに電位差を有する。
図7を用いて、信号電流の書き込みから発光までの動作について説明する。図中、各部を示す図番は、図6に準ずる。図7(A)〜(C)は、電流の流れを模式的に示している。図7(D)は、信号電流の書き込み時における各経路を流れる電流の関係を示しており、図7(E)は、同じく信号電流の書き込み時に、保持容量610に蓄積される電圧、つまりTFT608のゲート・ソース間電圧について示している。
まず、第1のゲート信号線602および第2のゲート信号線603にパルスが入力され、TFT606、607がONする。このとき、ソース信号線を流れる電流、すなわち信号電流をIdataとする。
ソース信号線には、電流Idataが流れているので、図7(A)に示すように、画素内では、電流の経路はI1とI2とに分かれて流れる。これらの関係を図7(D)に示している。なお、Idata=I1+I2であることは言うまでもない。
TFT606がONした瞬間には、まだ保持容量610には電荷が保持されていないため、TFT608はOFFしている。よって、I2=0となり、Idata=I1となる。すなわちこの間は、保持容量610における電荷の蓄積による電流のみが流れている。
その後、徐々に保持容量610に電荷が蓄積され、両電極間に電位差が生じ始める(図7(E))。両電極の電位差がVthとなると(図7(E)A点)、TFT608がONして、I2が生ずる。前述のように、Idata=I1+I2であるので、I1は次第に減少するが、依然電流は流れており、さらに保持容量には電荷の蓄積が行われる。
保持容量610においては、その両電極の電位差、つまりTFT608のゲート・ソース間電圧が所望の電圧、つまりTFT608がIdataの電流を流すことが出来るだけの電圧(VGS)になるまで電荷の蓄積が続く。やがて電荷の蓄積が終了する(図7(E)B点)と、電流I1は流れなくなり、さらにTFT608はそのときのVGSに見合った電流が流れ、Idata=I2となる(図7(B))。こうして、定常状態に達する。以上で信号の書き込み動作が完了する。最後に第1のゲート信号線602および第2のゲート信号線603の選択が終了し、TFT606、607がOFFする。
続いて、発光動作に移る。第3のゲート信号線604にパルスが入力され、TFT609がONする。保持容量610には、先ほど書き込んだVGSが保持されているため、TFT608はONしており、電流供給線605から、Idataの電流が流れる。これによりEL素子611が発光する。このとき、TFT608が飽和領域において動作するようにしておけば、TFT608のソース・ドレイン間電圧が変化したとしても、Idataは変わりなく流れることが出来る。
このように、設定した電流を出力する動作を、出力動作と呼ぶことにする。以上に一例を示した、電流書き込み型画素のメリットとして、TFT608の特性等にばらつきがあった場合であっても、保持容量610には、電流Idataを流すのに必要なゲート・ソース間電圧が保持されるため、所望の電流を正確にEL素子に供給することが出来、よってTFTの特性ばらつきに起因した輝度ばらつきを抑えることが可能になる点がある。
以上の例は、画素回路内での駆動TFTのバラツキによる電流の変化を補正するための技術に関するものであるが、ソースドライバ回路内においても同一の問題が発生する。特許文献4には、ソースドライバ回路内でのTFTの製造上のバラツキによる信号電流の変化を防止するための回路構成が開示されている。
しかしながら、信号電流を駆動TFTや発光素子に供給するために用いられる配線の寄生容量は極めて大きいため、信号電流が小さい場合には配線の寄生容量を充電する時定数が大きくなり、信号書き込み速度が遅くなってしまうという問題点がある。すなわち、トランジスタに信号電流を供給しても、それを流すのに必要な電圧をゲート端子に生じさせるまでの時間が長くなってしまい、信号の書き込み速度が遅くなってしまうことが問題となっている。
本発明はこのような問題点に鑑み、トランジスタの特性バラツキの影響を低減し、信号電流が小さな場合であっても信号の書き込み速度を十分に向上させることのできる半導体装置を提供することを目的とする。
本発明は、負荷に供給する電流をトランジスタで制御する回路を具備し、該トランジスタのソースまたはドレインが電流源回路と接続され、該トランジスタのソース電位、ドレイン電位及びゲート電位から選ばれた少なくとも一つの電位を制御する増幅回路を備えていること特徴とするものである。
本発明は、負荷に供給する電流をトランジスタで制御する回路を具備し、該トランジスタのソースまたはドレインが電流源回路と接続され、該電流源回路からトランジスタに電流が供給されたとき、トランジスタが飽和領域で動作するように制御する増幅回路を備えていることを特徴とするものである。
本発明は、負荷に供給する電流をトランジスタで制御する回路を具備し、該トランジスタのソースまたはドレインが電流源回路と接続され、該トランジスタのドレインとゲート間の電位を安定化させる増幅回路を備えていることを特徴とするものである。
本発明は、負荷に供給する電流をトランジスタで制御する回路を具備し、該トランジスタのソースまたはドレインが電流源回路と接続され、該トランジスタのドレインとゲート間の電位を安定化させる帰還回路を備えていることを特徴とするものである。
本発明は、負荷に供給する電流を制御するトランジスタとオペアンプとを具備し、電流源回路に接続する前記トランジスタのドレイン端子側にオペアンプの非反転入力端子が接続され、オペアンプの反転入力端子は、トランジスタのゲート端子と接続され、オペアンプの出力端子は、ゲート端子と反転入力端子と接続されていることを特徴とするものである。
本発明は、負荷に供給する電流を制御するトランジスタと電圧フォロワ回路とを具備する半導体装置であって、電流源回路に接続する前記トランジスタのドレイン端子側に電圧フォロワ回路入力端子が接続され、電圧フォロワ回路の出力端子は、トランジスタのゲート端子と接続されていることを特徴とするものである。この発明の構成において、電圧フォロワ回路がソースフォロワ回路で構成されていても良い。
本発明において、適用可能なトランジスタの種類に限定はなく、非晶質シリコンや多結晶シリコンに代表される非単結晶半導体膜を用いた薄膜トランジスタ(TFT)、半導体基板やSOI基板を用いて形成されるMOS型トランジスタ、接合型トランジスタ、有機半導体やカーボンナノチューブを用いたトランジスタ、その他のトランジスタを適用することができる。また、トランジスタが配置されている基板の種類に限定はなく、単結晶基板、SOI基板、ガラス基板などに配置することが出来る。
なお、本発明において、接続されているとは、電気的に接続されていることと同義である。したがって、間に、別の素子やスイッチなどが配置されていてもよい。
図2は、本発明の半導体装置の構成を説明する図である。
図3は、本発明の半導体装置の構成を説明する図である。
図4は、本発明の半導体装置の構成を説明する図である。
図5は、本発明の半導体装置の構成を説明する図である。
図6は、従来の画素の構成を説明する図である。
図7は、従来の画素の動作を説明する図である。
図8は、本発明の半導体装置の構成を説明する図である。
図9は、本発明の半導体装置の構成を説明する図である。
図10は、本発明の半導体装置の構成を説明する図である。
図11は、本発明の半導体装置の構成を説明する図である。
図12は、本発明の半導体装置の構成を説明する図である。
図13は、本発明の半導体装置の動作を説明する図である。
図14は、本発明の半導体装置の動作を説明する図である。
図15は、本発明の半導体装置の動作を説明する図である。
図16は、本発明の半導体装置の動作を説明する図である。
図17は、本発明の半導体装置の構成を説明する図である。
図18は本発明の半導体装置の構成を説明する図である。
図19は。本発明の半導体装置の構成を説明する図である。
図20は、本発明の半導体装置の構成を説明する図である。
図21は、本発明の半導体装置の構成を説明する図である。
図22は、本発明の半導体装置の動作を説明する図である。
図23は、本発明の半導体装置の動作を説明する図である。
図24は、本発明の半導体装置の動作を説明する図である。
図25は、本発明の半導体装置の動作を説明する図である。
図26は、本発明の半導体装置の構成を説明する図である。
図27は、本発明の半導体装置の構成を説明する図である。
図28は、本発明の半導体装置の構成を説明する図である。
図29は、本発明の半導体装置の構成を説明する図である。
図30は、本発明の半導体装置の構成を説明する図である。
図31は、本発明の半導体装置の構成を説明する図である。
図32は、本発明の半導体装置の構成を説明する図である。
図33は、本発明の半導体装置の構成を説明する図である。
図34は、本発明の表示装置の構成を示す図である。
図35は、本発明の表示装置の構成を示す図である。
図36は、本発明の表示装置の動作を示す図である。
図37は、本発明の表示装置の動作を示す図である。
図38は、本発明の表示装置の動作を示す図である。
図39は、本発明が適用される電子機器の図である。
(実施の形態1)
本発明は、EL素子などのような発光素子を有する画素だけでなく、電流源を有する様々なアナログ回路に適用することが出来る。そこでまず、本実施の形態では、本発明の原理について述べる。
まず、図1に、本発明の基本原理に基づく構成について示す。配線104と配線105の間に、電流源回路101と電流源トランジスタ102が接続されている。図1では、電流源回路101から電流源トランジスタ102の方へ電流が流れる場合について示している。そして、増幅回路107の第1入力端子108が電流源トランジスタ102のドレイン端子に接続されている。また、増幅回路107の第2入力端子110が電流源トランジスタ102のゲート端子に接続されている。増幅回路107の出力端子109は、電流源トランジスタ102のゲート端子に接続されている。
保持容量103が、電流源トランジスタ102のゲート電圧を保持するために、電流源トランジスタ102のゲート端子と配線106に接続されている。なお、保持容量103は、電流源トランジスタ102のゲート容量などで代用することにより、省略することが出来る。
このような構成において、電流源回路101から電流Idataを供給し、入力する。電流Idataは、電流源トランジスタ102に流れる。増幅回路107は、電流源回路101から供給する電流Idataが電流源トランジスタ102に流れ、かつ、電流源トランジスタ102が飽和領域で動作するような状態で、定常状態になるように状態に制御する。すると、電流源トランジスタ102のゲート電位は、電流源トランジスタ102が電流Idataを流すのに必要な値に制御される。このとき、電流源トランジスタ102のゲート電位は、電流源トランジスタ102の電流特性(移動度やしきい値電圧など)やサイズ(ゲート幅Wやゲート長L)に依存せずに、適切な大きさになる。したがって、電流源トランジスタ102の電流特性やサイズがばらついても、電流源トランジスタ102は、電流Idataを流すことが出来るようになる。その結果、その電流源トランジスタ102は、電流特性やサイズのばらつきの影響を受けることなく、電流源として動作させることができ、さまざまな負荷(別の電流源トランジスタや画素や信号線駆動回路など)に電流を供給することが可能となる。
そして、増幅回路107は、出力インピーダンスが高くない。したがって、出力端子109から大きな電流を出力することが出来る。よって、電流源トランジスタ102のゲート端子を素早く充電することが出来る。つまり、電流Idataの書き込み速度が速くなり、素早く書き込みを完了させることができ、定常状態に達するまでの時間が短くてすむようになる。
次に、増幅回路107の動作について述べる。増幅回路107は、第1入力端子108と第2入力端子110の電圧を検知して、その入力電圧の差を増幅させて、出力端子109に出力する機能を有している。そして、図1では、第2入力端子110と出力端子109とが接続されている。つまり、帰還回路が形成されている。帰還回路になっているため、出力端子109の電圧によって、第2入力端子110の電圧も変わる。第2入力端子110の電圧が変われば、出力端子109の電圧も変わる。そのような帰還動作を経て、各入力端子の状態が安定するような電圧が、出力端子109から出力されるようになる。
図1では、電流源トランジスタ102のドレイン端子は、第1入力端子108に接続され、電流源トランジスタ102のゲート端子は、第2入力端子110と出力端子109に接続されている。よって、電流源トランジスタ102のドレイン端子とゲート端子の電圧が安定するような電圧が、増幅回路107によって電流源トランジスタ102のゲート端子に出力されるようになる。このとき、電流源トランジスタ102には、電流源回路101から電流Idataが供給されている。したがって、電流源トランジスタ102が電流Idataを流すのに必要な電圧が、電流源回路101から電流源トランジスタ102のゲート端子へ出力されるようになる。
なお、一般に、トランジスタ(ここでは簡単のため、NMOS型トランジスタであるとする)の動作領域は、線形領域と飽和領域とに分けることが出来る。その境目は、ドレイン・ソース間電圧をVds、ゲート・ソース間電圧をVgs、しきい値電圧をVthとすると、(Vgs−Vth)=Vdsの時になる。(Vgs−Vth)>Vdsの場合は、線形領域であり、Vds、Vgsの大きさによって電流値が決まる。一方、(Vgs−Vth)<Vdsの場合は飽和領域になり、Vdsが変化しても、電流値はほとんど変わらない。つまり、Vgsの大きさだけによって電流値が決まる。
以上のことから、電流源トランジスタ102が飽和領域で動作するように、増幅回路107が電流源トランジスタ102を制御すればよい。そうすると、電流源トランジスタ102のゲート電位は、電流Idataを流すのに必要な電圧に設定されるようになる。電流源トランジスタ102が飽和領域で動作するためには、(Vgs−Vth)<Vdsを満たせばよい。通常、Nチャネル型トランジスタでは、Vth>0であるため、少なくとも、電流源トランジスタ102のドレイン端子の電位は、ゲート端子の電位と等しいか、それ以上になっていればよい。このような動作を実現するように、増幅回路107が電流源トランジスタ102を制御することになる。
以上のように、増幅回路107を有する帰還回路を用いることにより、電流源トランジスタ102が、電流源回路101から供給される電流と同じ大きさの電流を流すことが出来るように、ゲート電位を設定することが出来る。この時、増幅回路107を用いているため、設定をすばやく完了させることが出来、短い時間で書き込みが終了する。そして、設定された電流源トランジスタ102は、電流源回路として動作させることが出来、さまざまな負荷に電流を供給できる。
なお、図1では、電流源回路101から電流源トランジスタ102の方へ電流が流れる場合について示しているが、これに限定されない。図2では、電流源トランジスタ202から電流源回路201の方へ電流が流れる場合について示している。このように、電流源トランジスタ202の極性を変更することによって、回路の接続関係を変更せずに、電流の向きを変えることが出来る。
なお、図1では、電流源回路101はNチャネル型トランジスタを用いているが、これに限定されない。Pチャネル型トランジスタを用いてもよい。ただし、電流の流れる向きを変更せずにトランジスタの極性を変更すると、ソース端子とドレイン端子とが入れ替わる。そのため、回路の接続関係を変更する必要がある。その場合の構成を図3に示す。配線104と配線105の間に、電流源回路101と電流源トランジスタ302が接続されている。図3では、電流源回路101から電流源トランジスタ302の方へ電流が流れる場合について示しているが、図2の場合と同様に、電流の向きを変更することは可能である。そして、増幅回路107の第1入力端子108が電流源トランジスタ302のドレイン端子に接続されている。また、増幅回路107の第2入力端子110が電流源トランジスタ302のゲート端子に接続されている。増幅回路107の出力端子109は、電流源トランジスタ302のゲート端子に接続されている。
よって、電流源トランジスタ302のドレイン端子とゲート端子の電圧が安定するような電圧が、増幅回路107によって電流源トランジスタ302のゲート端子に出力されるようになる。このとき、電流源トランジスタ302には、電流源回路101から電流Idataが供給されている。したがって、電流源トランジスタ302が電流Idataを流すのに必要な電圧が、電流源回路101から電流源トランジスタ302のゲート端子へ出力されるようになる。
なお、図1において、容量素子103は、電流源トランジスタ102のゲート電位を保持できればよいため、配線106の電位は、任意でよい。よって、配線105と配線106の電位は、同じであってもよいし、異なっていても良い。ただし、電流源トランジスタ102の電流値はそのゲート・ソース間電圧によって決定される。したがって、容量素子103は、電流源トランジスタ102のゲート・ソース間電圧を保持することが、より望ましい。したがって、配線106は、電流源トランジスタ102のソース端子(配線105)に接続されていることが望ましい。その結果、配線抵抗の影響などを少なくすることが出来る。
同様に、図2において、配線206は、電流源トランジスタ202のソース端子(配線205)に接続されていることが望ましい。また、図3において、配線106は、電流源トランジスタ302のソース端子に接続されていることが望ましい。
なお、負荷は、何でもよい。抵抗などのような素子でも、トランジスタでも、EL素子でも、そのほかの発光素子でも、トランジスタと容量とスイッチなどで構成された電流源回路でも、何かの回路が接続された配線でもよい。信号線でも、信号線とそれに接続された画素でもよい。その画素には、EL素子やFEDで用いる素子など、どのような表示素子を含んでいてもよい。
(実施の形態2)
実施の形態2では、図1〜図3において用いた増幅回路の例を示す。
まず、増幅回路の例として、オペアンプがあげられる。そこで、増幅回路として、オペアンプを用いた場合について、図1に対応した構成図を図4に示す。増幅回路107の第1入力端子108がオペアンプ407の非反転(正相)入力端子、第2入力端子110が反転入力端子に相当している。
オペアンプでは、通常、非反転(正相)入力端子の電位と反転入力端子の電位とは、等しくなるように動作する。したがって、図4の場合は、電流源トランジスタ102のゲート電位とドレイン電位とが等しくなるように、電流源トランジスタ102のゲート電位が制御される。したがって、Vgs=Vdsであるので、Vth>0の場合は、電流源トランジスタ102は飽和領域で動作することになる。
図4と同様に、図2に対応した構成図を図5に、図3に対応した構成図を図8に示す。
なお、図4〜8で用いたオペアンプとしては、どのようなタイプのオペアンプでもよい。電圧帰還型オペアンプでもよいし、電流帰還型オペアンプでもよい。位相補償回路やばらつき補正回路やオフセット電圧補正回路のようなさまざまな補正回路を付加したオペアンプでもよい。
なお、オペアンプは、通常、非反転(正相)入力端子の電位と反転入力端子の電位とは、等しくなるように動作するが、特性バラツキなどにより、非反転(正相)入力端子の電位と反転入力端子の電位とは、等しくならない場合がある。つまり、オフセット電圧が生じる場合がある。その場合は、通常のオペアンプと同様に、非反転(正相)入力端子の電位と反転入力端子の電位が等しくなるように調節して動作させてもよい。しかし、本発明の場合、電流源トランジスタ102が飽和領域で動作するように制御すればよい。したがって、電流源トランジスタ102が飽和領域で動作する範囲内であれば、オペアンプにオフセット電圧が生じても良いし、オフセット電圧がばらついても、影響は与えない。そのため、電流特性のバラツキが大きいようなトランジスタを用いてオペアンプを構成しても、正常に動作することになる。
したがって、単結晶で形成されたトランジスタではなく、薄膜トランジスタ(アモルファス、多結晶を含む)や有機トランジスタのようなものであっても、有効に動作させることが出来る。
ここで、図4の回路の接続関係に着目すると、オペアンプの反転入力端子が出力端子に接続されていることが分かる。これは通常、電圧フォロワ回路と呼ばれる回路構成である。つまり、非反転(正相)入力端子の電圧を出力端子に出力する動作を行い、入出力インピーダンスを変換している。したがって、図4のように接続されたオペアンプだけでなく、電圧フォロワ回路と同様な機能を有する回路であれば、図1〜図3において用いた増幅回路として利用できることが分かる。
入出力インピーダンスを変換している回路としては、ソースフォロワ回路があげられる。ただし、通常のソースフォロワ回路は、入力電位と出力電位とは、等しくない。しかし、図1〜図3において用いた増幅回路では、入力電位と出力電位とは、等しくなくてもよい。つまり、電流源トランジスタ102が飽和領域で動作するように制御できる回路であればよい、そこで、増幅回路としてソースフォロワ回路を用いた場合の構成を図9に示す。入力端子(増幅用トランジスタ901のゲート端子)、つまり、電流源トランジスタ102のドレイン端子の電位が変化すれば、出力端子(増幅用トランジスタ901のソース端子)、つまり、電流源トランジスタ102のゲート端子の電位が変化する。電流源トランジスタ102のゲート端子の電位が変化すると、電流源トランジスタ102のドレイン端子の電位が変化する。このようにして、帰還回路を形成している。
図9の場合は、増幅用トランジスタ901として、電流源トランジスタ102と同じ極性であるNチャネル型トランジスタを用いている。したがって、入力端子(増幅用トランジスタ901のゲート端子)の電位よりも、出力端子(増幅用トランジスタ901のソース端子)の電位の方が、増幅用トランジスタ901のゲート・ソース間電圧の分だけ低い。したがって、電流源トランジスタ102は飽和領域で動作することになる。以上のことから、ソースフォロワ回路を増幅回路として利用する場合は、電流源トランジスタ102が飽和領域で動作しやすいような構成(図9の場合は、増幅用トランジスタ901がNチャネル型トランジスタ)にすることが望ましい。ただし、これに限定されず、Pチャネル型トランジスタを用いてもよい。図2に対応した構成図を図10に、図3に対応した構成図を図11に示す。図10では電流源トランジスタと同じ極性の増幅用トランジスタ1001を用いており、図11も同様である。ただし、これに限定されない。
なお、図9〜図11では、バイアス用トランジスタ902、1002、1102を用いて、そのゲート端子にバイアス電圧を加えて動作させているが、これに限定されない。バイアス用トランジスタの代わりに抵抗素子などを用いても良い。あるいは、増幅用トランジスタとは逆の極性のトランジスタを用いて、プッシュプル回路を構成してもよい。
なお、ソースフォロワ回路の場合も、オペアンプの場合と同様、電流源トランジスタが飽和領域で動作する範囲内であれば、出力電圧がばらついても、影響は与えない。そのため、電流特性のバラツキが大きいようなトランジスタを用いてソースフォロワ回路を構成しても、正常に動作することになる。
このように、電流源トランジスタが飽和領域で動作する範囲内であれば、増幅回路の出力電圧がばらついても、影響は与えない。したがって、電圧フォロワ回路やソースフォロワ回路などにおいても、入力電圧と出力電圧とが、比例関係になっていなくてもよい。つまり、電流源トランジスタが飽和領域で動作するように制御できれば、どのような回路であってもよい。
このように、図1〜図3において用いた増幅回路は、電流源トランジスタが飽和領域で動作する範囲内であれば、特性がばらついても、影響は与えない。そのため、電流特性のバラツキが大きいようなトランジスタを用いて増幅回路を構成しても、正常に動作させることができる。
したがって、単結晶で形成されたトランジスタではなく、薄膜トランジスタ(アモルファス、多結晶を含む)や有機トランジスタのようなものであっても、有効に動作させることが出来る。
なお、増幅回路の例として、オペアンプやソースフォロワ回路を用いた例を示したが、これに限定されない。これ以外にも、差動回路やドレイン接地増幅回路やソース接地増幅回路など、さまざまな回路を用いて、増幅回路を構成することが出来る。
なお、本実施の形態で説明した内容は、実施の形態1で説明した構成における、ある部分を詳細に述べたものに相当するが、これに限定されず、その要旨を変更しない範囲であれば様々な変形が可能である。したがって、実施の形態1で説明した内容は、本実施の形態にも適用できる。
(実施の形態3)
電流源回路から電流Idataを流じて、電流源トランジスタが電流Idataを流すことが出来るように設定する。そして、設定された電流源トランジスタは電流源回路として動作し、様々な負荷に電流を供給する。そこで、本実施例では、負荷と電流源トランジスタとの接続構成や、負荷に電流を供給する時のトランジスタの構成などについて述べる。
なお、本実施の形態では、簡単のため、図1の構成や、さらに特に、増幅回路としてオペアンプを用いた構成(図4)などを用いて説明するが、これに限定されない。容易に、図2〜図11などで説明したような別の構成に適用することが可能である。
また、電流源回路から電流源トランジスタの方に電流が流れて、かつ、電流源トランジスタがNチャネル型の場合について説明するが、これに限定されない。容易に、図2〜図11などで説明したような別の構成に適用することが可能である。
まず、電流源回路から供給された電流源トランジスタのみを用いて、負荷に電流を供給する場合の構成を図12に示す。図13では、増幅回路としてオペアンプを用いた場合を示している。
そこで、図12の動作方法について、増幅回路としてオペアンプを用いた場合を例にして、述べる。まず、図13に示すように、スイッチ1203とスイッチ1204をオンにする。すると、オペアンプ407が電流源トランジスタ102のゲート電位を制御して、電流源回路から供給される電流Idataを、飽和領域で動作させながら流すのに必要な状態に設定する。このとき、オペアンプ407を用いているので、急速に書き込みを行うことが出来る。そして、図14に示すように、スイッチ1204をオフにすると、電流源トランジスタ102のゲート電位が容量素子103に保持される。そして、図15に示すように、スイッチ1203をオフにすると、電流の供給が止まる。そして、図16に示すように、スイッチ1202をオンにすると、負荷1201に電流が供給される。この電流の大きさは、電流源トランジスタ102が飽和領域で動作していれば、Idataと同じ大きさになる。つまり、電流源トランジスタ102の電流特性やサイズなどがばらついても、その影響を除去することが出来る。
次に、電流源トランジスタとは別のトランジスタを用いて、負荷に電流を供給する場合の構成図を図17に示す。カレントトランジスタ1702のゲート端子が電流源トランジスタ102のゲート端子と接続されている。したがって、電流源トランジスタ102とカレントトランジスタ1702のW/Lの値を調節することにより、負荷に供給する電流量を変えることが出来る。なお、ここでWはチャネル幅、Lはチャネル長である。たとえば、カレントトランジスタ1702のW/Lの値を小さくしておくと、負荷に供給する電流量が小さくなるので、逆にIdataの大きさを大きくすることが出来る。その結果、電流の書き込みを素早くすることが可能となる。ただし、電流源トランジスタ102とカレントトランジスタ1702の電流特性がばらつくと、その影響を受けてしまう。
次に、電流源トランジスタだけでなく、別のトランジスタも用いて、負荷に電流を供給する場合の構成図を図18に示す。電流源回路101の電流Idataを供給する時に、その電流が負荷1201に漏れたり、負荷1201から電流が漏れてきたりすると、正しい大きさの電流で設定することが出来ない。図12の場合は、スイッチ1202を用いて制御するが、図18の場合は、マルチトランジスタ1802を用いて制御する。マルチトランジスタ1802のゲート端子は電流源トランジスタ102のゲート端子と接続されている。したがって、スイッチ1203、1204がオンになっていて、電流源トランジスタ102が飽和領域で動作している場合は、マルチトランジスタ1802はオフしている。したがって、電流源回路101の電流Idataを供給する時には、悪影響を及ぼさない。一方、負荷に電流を供給するときは、電流源トランジスタ102とマルチトランジスタ1802とは、ゲート端子が接続されているので、マルチゲートのトランジスタとして動作する。そのため、負荷1201には、Idataよりも小さい電流が流れることになる。よって、負荷に供給する電流量が小さくなるので、逆にIdataの大きさを大きくすることが出来る。その結果、電流の書き込みを素早くすることが可能となる。ただし、電流源トランジスタ102とマルチトランジスタ1802の電流特性がばらつくと、その影響を受けてしまうが、負荷1201に電流を供給するとき、電流源トランジスタ102も用いるため、バラツキの影響は小さい。
次に、図17や図18とは別のやり方で、電流源回路101から供給される電流Idataを大きくするための構成を図19に示す。図19では、電流源トランジスタ102と並列に並列トランジスタ1902が接続されている。したがって、電流源回路101から電流が供給される間は、スイッチ1901をオンにする。そして、負荷1201に電流を供給する場合は、スイッチ1901をオフにする。すると、負荷1201に流れる電流が小さくなるので、電流源回路101から供給される電流Idataを大きくすることが出来る。
ただしこの場合、電流源トランジスタ102と並列に並列トランジスタ1902のバラツキの影響を受けてしまう。そこで、図19の場合、電流源回路101から電流を供給する場合、その大きさを変化させてもよい。つまり、最初は電流を大きくしておく。そのとき、それに合わせて、1901をオンにしておく。すると、並列トランジスタ1902にも電流が流れ、急速に電流を書き込むことが出来る。つまり、プリチャージ動作に相当する。その後、電流源回路101から供給する電流を小さくして、1901をオフにする。そして、電流源トランジスタ102にのみ電流を供給して、書き込むようにする。その結果、ばらつきの影響を除去できる。その後、スイッチ1202をオンにして、負荷1201に電流を供給する。
図19では、電流源トランジスタと並列にトランジスタを追加していたが、直列にトランジスタを追加した場合の構成図を図20に示す。図20では、電流源トランジスタ102と直列に直列トランジスタ2002が接続されている。したがって、電流源回路101から電流が供給される間は、スイッチ2001をオンにする。すると、直列トランジスタ2002のソース・ドレイン間が短絡される。そして、負荷1201に電流を供給する場合は、スイッチ2001をオフにする。すると、電流源トランジスタ102と直列トランジスタ2002は、ゲート端子が接続されているので、マルチゲートのトランジスタとして動作する。そのため、ゲート長Lが大きくなったことになり、負荷1201に流れる電流が小さくなるので、電流源回路101から供給される電流Idataを大きくすることが出来る。
ただしこの場合、電流源トランジスタ102と直列に直列トランジスタ2002のバラツキの影響を受けてしまう。そこで、図20の場合、電流源回路101から電流を供給する場合、その大きさを変化させてもよい。つまり、最初は電流を大きくしておく。そのとき、それに合わせて、2001をオンにしておく。すると、電流源トランジスタ102に電流が流れ、急速に電流を書き込むことが出来る。つまり、プリチャージ動作に相当する。その後、電流源回路101から供給する電流を小さくして、2001をオフにする。そして、電流源トランジスタ102と直列トランジスタ2002に電流を供給して、書き込むようにする。その結果、ばらつきの影響を除去できる。その後、スイッチ1202をオンにして、電流源トランジスタ102と直列トランジスタ2002のマルチゲートのトランジスタとして、負荷1201に電流を供給する。
なお、図12から図20まで、さまざまな構成を示したが、それらを組み合わせて構成させることも可能である。
なお、図12から図20まで、電流源回路101と負荷1201とを切り替えるような形で構成しているが、これに限定されない。例えば、電流源回路101と配線とを切り替えて構成してもよい。そこで、図12に対して、電流源回路101と配線とを切り替える構成にしたものを図21に示す。次に、図21の動作について示す。まず、電流源回路101から電流Idataを電流源トランジスタ102に供給して、電流を設定する場合は、スイッチ1203、1204、2103をオンにする。そして、電流源トランジスタ102を電流源回路として動作させ、負荷に電流を供給する場合は、スイッチ2102、1202をオンにする。このように、スイッチ1203とスイッチ2102のオンオフを切り替えることにより、電流源回路101と配線2105とを切り替えていることになる。
なお、電流源回路101から電流Idataを電流源トランジスタ102に供給する場合、スイッチ2103をオンにして配線105に電流を流し、スイッチ1202をオフにしているが、これに限定されない。電流源回路101から電流Idataを電流源トランジスタ102に供給する場合、負荷1201の方に電流が流れても良い。
なお、容量素子103は、電流源トランジスタ102のゲート電位を保持しているが、ゲート・ソース間電圧を保持するために、配線106を電流源トランジスタのソース端子に接続することがより望ましい。
なお、図12に対して、電流源回路101と負荷1201とを切り替えるような形で構成した図を図21に示したが、これに限定されない。図12から図20までのさまざまな構成においても、電流源回路101と負荷1201とを切り替えるような形で構成することが可能である。
なお、これまで述べてきた構成において、スイッチが各部分に配置されているが、その配置場所は、すでに述べた場所に限定されない。正常に動作する場所であれば、任意の場所にスイッチを配置することが可能である。
例えば、図12の構成の場合、電流源回路101から電流Idataを電流源トランジスタ102に供給している時には、図24のように接続され、電流源トランジスタ102を電流源回路として動作させ、負荷1201に電流を供給する時には、図25のように接続されていればよい。したがって、図12は、図26のように接続されていてもよい。図26では、スイッチ1202、1203、1204の位置が変更されているが、正常に動作する。
なお、図12などに示すスイッチは、電気的スイッチでも機械的なスイッチでも何でも良い。電流の流れを制御できるものなら、何でも良い。トランジスタでもよいし、ダイオードでもよいし、それらを組み合わせた論理回路でもよい。よって、スイッチとしてトランジスタを用いる場合、そのトランジスタは、単なるスイッチとして動作するため、トランジスタの極性(導電型)は特に限定されない。ただし、オフ電流が少ない方が望ましい場合、オフ電流が少ない方の極性のトランジスタを用いることが望ましい。オフ電流が少ないトランジスタとしては、LDD領域を設けているもの等がある。また、スイッチとして動作させるトランジスタのソース端子の電位が、低電位側電源(Vss、Vgnd、OVなど)に近い状態で動作する場合はnチャネル型を、反対に、ソース端子の電位が、高電位側電源(Vddなど)に近い状態で動作する場合はpチャネル型を用いることが望ましい。なぜなら、ゲート・ソース間電圧の絶対値を大きくできるため、スイッチとして、動作しやすいからである。なお、nチャネル型とpチャネル型の両方を用いて、CMOS型のスイッチにしてもよい。
このように様々な例を示したが、これに限定されない。電流源トランジスタや、電流源として動作するような様々なトランジスタを、いろいろな構成で配置することが出来る。よって、同様な動作をする構成であれば、本願を適用することが可能である。
なお、本実施の形態で説明した内容は、実施の形態1、2で説明した構成を利用したもの相当するが、これに限定されず、その要旨を変更しない範囲であれば様々な変形が可能である。したがって、実施の形態1、2で説明した内容は、本実施の形態にも適用できる。
(実施の形態4)
これまでは、電流源回路と電流源トランジスタとが1対1で配置されている場合について述べてきた。本実施の形態では、電流源トランジスタなどが複数ある場合の構成について述べる。
図27に、図13の構成で、電流源トランジスタが複数ある場合の構成を示す。図27では、複数の電流源トランジスタに対して、電流源回路101とオペアンプ407を1つづつにした場合について示す。ただし、複数の電流源トランジスタに対して、複数の電流源回路があってもよいし、複数のオペアンプがあってもよい。しかし、回路規模が大きくなるので、電流源回路101とオペアンプ407を1つにすることが望ましい。
次に、図27の構成について述べる。まず、電流源回路101とオペアンプ407が配置されている。これをまとめて、リソース回路2701と呼ぶことにする。リソース回路2701には、電流源回路101と接続された電流線2702と、オペアンプ407の出力端子と接続された電圧線2703とが接続されている。電流線2702や電圧線2703には、複数のユニット回路が接続されている。ユニット回路2704aは、電流源トランジスタ102a、容量素子103a、スイッチ1202a、1203a、1204aなどで構成されている。ユニット回路2704aは、負荷1201aと接続されている。ユニット回路2704bも、ユニット回路2704aと同様に構成されている。ここでは、簡単のため、ユニット回路が2つ接続されている場合を示しているが、これに限定されない。任意の数だけユニット回路が接続されていてもよい。
動作としては、1本の電流線2702や電圧線2703に、複数のユニット回路が接続されているため、各々のユニット回路を選択して、順次、リソース回路2701から電流線2702や電圧線2703を通って、電流や電圧を供給していくことになる。例えば、まず、スイッチ1203a、1204aをオンにして、ユニット回路2704aに電流や電圧を入力して、次に、スイッチ1203b、1204bをオンにして、ユニット回路2704bに電流や電圧を入力して、というような動作を繰り返すことにより、動作させる。
このようなスイッチの制御は、シフトレジスタ、デコーダ回路、カウンタ回路、ラッチ回路、などのようなデジタル回路を用いて、制御することが出来る。
ここで、もし、負荷1201a、1201bなどがEL素子などの表示素子である場合、ユニット回路と負荷が1つの画素を構成することになる。そして、リソース回路2701が、信号線(電流線や電圧線)に接続された画素に信号を供給する信号線駆動回路(の一部)であることになる。つまり、図27は、1列分の画素や信号線駆動回路(の一部)を示していることになる。その場合、電流源回路101が出力する電流は、画像信号に相当することになる。この画像信号電流をアナログ的に、もしくは、デジタル的に変化させることによって、各々適切な大きさの電流を負荷(EL素子などの表示素子)に流すことが出来る。この場合は、スイッチ1203a、1204a、スイッチ1203b、1204bなどは、ゲート線駆動回路を用いて制御することになる。
また、図27における電流源回路101が、信号線駆動回路(の一部)であるとした場合、その電流源回路101も、トランジスタの電流特性バラツキやサイズのバラツキなどの影響を受けずに、正確な電流を出力する必要がある。よって、信号線駆動回路(の一部)の中の電流源回路101が電流源トランジスタで構成されていて、別の電流源回路から電流源トランジスタに電流を供給することが出来る。つまり、図27における負荷1201a、1201bなどが信号線や画素などである場合、ユニット回路が信号線駆動回路(の一部)を構成することになる。そして、リソース回路2701が、電流線に接続された信号線駆動回路の中の電流源トランジスタ(電流源回路)に信号を供給する電流源回路(の一部)であることになる。つまり、図27は、複数の信号線や信号線駆動回路(の一部)や信号線駆動回路に電流を供給する電流源回路(の一部)を示していることになる。
その場合、電流源回路101が出力する電流は、信号線や画素に供給する電流に相当することになる。よって、例えば、電流源回路101が出力する電流に応じた大きさの電流を信号線や画素に供給する場合は、電流源回路101が出力する電流は、画像信号に相当することになる。この画像信号電流をアナログ的に、もしくは、デジタル的に変化させることによって、各々適切な大きさの電流を負荷(信号線や画素)に流すことが出来る。この場合は、スイッチ1203a、1204a、スイッチ1203b、1204bなどは、信号線駆動回路の中の一部の回路(シフトレジスタやラッチ回路など)を用いて制御することになる。
なお、スイッチ1203a、1204a、スイッチ1203b、1204bを制御するための回路(シフトレジスタやラッチ回路など)などについては、国際公開第03/038796号パンフレット、国際公開第03/038791号パンフレット、などに記載されているため、その内容を本願と組み合わせることが出来る。
あるいは、電流源回路101が出力する電流は、ある決まった大きさの電流を供給するようになっており、それを供給するかどうかをスイッチなどを用いて制御して、それに応じた大きさの電流を信号線や画素に供給する場合は、電流源回路101が出力する電流は、ある決まった大きさの電流を供給するための信号電流に相当することになる。そして、信号線や画素に電流を供給するかどうかを決めるスイッチをデジタル的に制御させ、信号線や画素に供給される電流量を制御することによって、各々適切な大きさの電流を負荷(信号線や画素)に流すことが出来る。この場合は、スイッチ1203a、1204a、スイッチ1203b、1204bなどは、信号線駆動回路の中の一部の回路(シフトレジスタやラッチ回路など)を用いて制御することになる。ただし、この場合は、信号線や画素に電流を供給するかどうかを決めるスイッチを制御するために駆動回路(シフトレジスタやラッチ回路など)が必要になる。そのため、そのスイッチを制御するために駆動回路(シフトレジスタやラッチ回路など)と、スイッチ1203a、1204a、スイッチ1203b、1204bなど制御するための駆動回路(シフトレジスタやラッチ回路など)が必要になる。それらの駆動回路は、別々に設けても良い。例えば、スイッチ1203a、1204a、スイッチ1203b、1204bを制御するためのシフトレジスタを別に設けても良い。あるいは、スイッチを制御するために駆動回路(シフトレジスタやラッチ回路など)と、スイッチ1203a、1204a、スイッチ1203b、1204bなど制御するための駆動回路(シフトレジスタやラッチ回路など)を、一部もしくは全部で、共用してもよい。例えば、1つのシフトレジスタで両方のスイッチを制御してもよいし、信号線や画素に電流を供給するかどうかを決めるスイッチを制御するために駆動回路(シフトレジスタやラッチ回路など)において、ラッチ回路の出力(画像信号)などを用いて制御してもよい。
なお、信号線や画素に電流を供給するかどうかを決めるスイッチを制御するために駆動回路(シフトレジスタやラッチ回路など)と、スイッチ1203a、1204a、スイッチ1203b、1204bなど制御するための駆動回路(シフトレジスタやラッチ回路など)とに関しては、国際公開第03/038793号パンフレット、国際公開第03/038794号パンフレット、国際公開第03/038795号パンフレット、などに記載されているため、その内容を本願と組み合わせることが出来る。
図27では、電流源トランジスタと負荷が1対1で配置されている場合を示した。次に、1つの負荷に、複数の電流源トランジスタが配置されている場合を図28に示す。ここでは簡単のため、1つの負荷に対して2個のユニット回路が接続されている場合を示すが、これに限定されない。さらに多くのユニット回路が接続されていてもよいし、1個だけでもよい。スイッチ2801aa、スイッチ2801baのオンオフにより、負荷1201aaに流れる電流量を制御できる。例えば、ユニット回路2704aaが出力する電流値(Iaa)とユニット回路2704baが出力する電流値(Iba)の大きさが異なる場合、スイッチ2801aaとスイッチ2801baの各々のオンオフにより、負荷1201aaに流れる電流の大きさを4種類で制御できることになる。例えば、Iba=2*Iaaの場合、2ビットの大きさを制御できることになる。したがって、スイッチ2801aa、スイッチ2801baのオンオフを各ビットに対応したデジタルデータによって制御する場合、図28の構成を用いて、デジタル・アナログ変換機能を実現できる。したがって、負荷1201aa、1201bbが信号線の場合、図28の構成を用いて、信号線駆動回路(の一部)を構成させることが出来る。そのとき、デジタル画像信号をアナログ画像信号電流に変換することが出来る。また、スイッチ2801aaやスイッチ2801baなどのオンオフは、画像信号を用いて制御することが出来る。したがって、画像信号を出力する回路(ラッチ回路)などを用いて、スイッチ2801aaやスイッチ2801baなどを制御することが出来る。
また、スイッチ2801aa、スイッチ2801baのオンオフを時間によって切り替えてもよい。例えば、ある期間は、スイッチ2801aaをオン、スイッチ2801baのオフにして、その時は、リソース回路2701bからユニット回路2704baに電流を入力して、正確な電流を出力できるように設定を行い、ユニット回路2704aaから負荷1201aaに電流を供給する。そして別の期間では、スイッチ2801aaをオフ、スイッチ2801baのオンにして、その時は、リソース回路2701aからユニット回路2704aaに電流を入力して、正確な電流を出力できるように設定を行い、ユニット回路2704baから負荷1201aaに電流を供給する。このように、時間的に切り替えて動作させてもよい。
次に、図28では、2つのリソース回路を用いて、ユニット回路に電流を供給していたが、図29では、1つのリソース回路を用いて、ユニット回路に電流を供給する場合について述べる。
例えば、配線2904cがH信号の時、スイッチ2901ca、2902ca、2903cbがオンになり、スイッチ2903ca、2901cb、292cbがオフになるとする。すると、ユニット回路2704caはリソース回路2701から電流を供給されることが可能な状況になり、ユニット回路2704cbは、負荷1201caに電流を供給することが可能な状況になる。逆に、配線2904cがL信号の時、ユニット回路2704cbはリソース回路2701から電流を供給されることが可能な状況になり、ユニット回路2704caは、負荷1201caに電流を供給することが可能な状況になる。また、配線2904cや配線2904dなどは、順次選択するような信号を入力していけばよい。このように、時間的にユニット回路の動作を切り替えてもよい。
また、負荷1201ca、1201daが信号線の場合、図29の構成を用いて、信号線駆動回路(の一部)を構成させることが出来る。また、配線2904cや配線2904dなどは、シフトレジスタなどを用いて制御すればよい。
なお、本実施の形態では、図13の構成で、電流源トランジスタが複数ある場合の構成を示したが、これに限定されない。図13以外の構成でも実現できる。
例えば、図9の構成を用いても実現できる。その場合、複数の電流源トランジスタに対して、電流源回路101と増幅回路(ソースフォロワ回路)を1つづつにしてもよい。または、複数の電流源トランジスタに対して、複数の電流源回路があってもよいし、複数の増幅回路(ソースフォロワ回路)があってもよい。しかし、回路規模が大きくなるので、電流源回路101と増幅回路(ソースフォロワ回路)を1つにすることが望ましい。ただし、図9の増幅回路(ソースフォロワ回路)は、トランジスタ2個で構成されている場合が多いので、複数の電流源トランジスタに対して、複数の増幅回路(ソースフォロワ回路)を配置してもよい。
なお、本実施の形態で説明した内容は、実施の形態1、2、3で説明した構成を利用したもの相当するが、これに限定されず、その要旨を変更しない範囲であれば様々な変形が可能である。したがって、実施の形態1、2、3で説明した内容は、本実施の形態にも適用できる。
(実施の形態5)
本実施の形態では、表示素子を有する画素に適用した場合の例を示す。
本実施の形態では、図1(図12、図2、図5)や図3(図8)を用いた場合について述べるが、これに限定されない。実施の形態1〜4で説明した様々な構成に適用することが出来る。
まず、電流源回路201が画像信号として信号電流を供給するような構成の場合について、図30、31に示す。図30と図31とでは、電流の流れる向きは同じであるが、電流源トランジスタの極性が異なる。そのため、接続構造が異なっている。なお、負荷としては、例として、EL素子の場合を示している。
また、電流源回路201が画像信号として供給する信号電流が、アナログ値の場合は、アナログ階調で画像を表示することが出来る。信号電流が、デジタル値の場合は、デジタル階調で画像を表示することが出来る。多階調化を図る場合は、時間階調方式や面積階調方式を組み合わせればよい。
なお、ここでは特に時間階調方式について詳細な説明は省略するが、特願2001−5426号出願、特願2000−86968号出願等に記載されている方法によれば良い。
また、各スイッチを制御するゲート線は、トランジスタの極性を調整することにより、1本に共用している。これにより、開口率を向上させることが出来る。ただし、別々のゲート線を配置しても良い。特に、時間階調方式を用いる場合は、ある特定の期間において、負荷(EL素子)に電流を供給しないような動作をしたい場合がある。その場合は、負荷(EL素子)に電流を供給しないように出来るスイッチを制御するゲート線を別の配線とすればよい。
次に、画素に電流源回路を有し、電流源回路が供給する電流を流すかどうかによって画像を表現するような場合の構成の画素について、図32に構成を示す。選択ゲート線3206が選択されたときに、信号線3205から、デジタルの画像信号(通常は電圧値)を容量素子3203に入力する。なお、容量素子3203は、トランジスタのゲート容量などを用いることにより、省略可能である。そして、保存されたデジタルの画像信号を用いて、スイッチ3202をオンオフする。電流源回路3201が供給する電流が、負荷1201に流れるかどうかを、スイッチ3202が制御する。これにより、画像を表現することが出来る。
なお、多階調化を図る場合は、時間階調方式や面積階調方式を組み合わせればよい。
また、図32では、電流源回路3201やスイッチ3202は、1つづつしか配置されていないが、これに限定されない。複数組配置して、各々の電流源回路から電流が流れるかどうかを制御して、その電流の総和が負荷1201に流れるようにしてもよい。
次に、図32の具体的な構成例を図33に示す。ここでは、電流源トランジスタの構成として、図1(図12、図2、図5)に示した構成を適用している。電流源回路201から電流を電流源トランジスタ202に供給して、電流源トランジスタ202のゲート端子に適切な電圧を設定する。そして、信号線3205から入力される画像信号に応じて、スイッチ3202をオンオフして、負荷1201に電流を供給し、画像を表示する。
なお、本実施の形態で説明した内容は、実施の形態1〜4で説明した構成を利用したもの相当するが、これに限定されず、その要旨を変更しない範囲であれば様々な変形が可能である。したがって、実施の形態1〜4で説明した内容は、本実施の形態にも適用できる。
(実施の形態6)
本実施の形態では、表示装置、および、信号線駆動回路などの構成とその動作について、説明する。信号線駆動回路の一部や画素に、本発明の回路を適用することができる。
表示装置は、図34に示すように、画素配列3401、ゲート線駆動回路3402、信号線駆動回路3410を有している。ゲート線駆動回路3402は、画素配列3401に選択信号を順次出力する。信号線駆動回路3410は、画素配列3401にビデオ信号を順次出力する。画素配列3401では、ビデオ信号に従って、光の状態を制御することにより、画像を表示する。信号線駆動回路3410から画素配列3401へ入力するビデオ信号は、電流である場合が多い。つまり、各画素に配置された表示素子や表示素子を制御する素子は、信号線駆動回路3410から入力されるビデオ信号(電流)によって、状態を変化させる。画素に配置する表示素子の例としては、EL素子やFED(フィールドエミッションディスプレイ)で用いる素子などがあげられる。
なお、ゲート線駆動回路3402や信号線駆動回路3410は、複数配置されていてもよい。
信号線駆動回路3410は、構成を複数の部分に分けられる。大まかには、一例として、シフトレジスタ3403、第1ラッチ回路(LAT1)3404、第2ラッチ回路(LAT2)3405、デジタル・アナログ変換回路3406に分けられる。デジタル・アナログ変換回路3406には、電圧を電流に変換する機能も有しており、ガンマ補正を行う機能も有していてもよい。つまり、デジタル・アナログ変換回路3406には、画素に電流(ビデオ信号)を出力する回路、すなわち、電流源回路を有しており、そこに本発明を適用することが出来る。
なお、図32に示したように、画素の構成によっては、ビデオ信号用のデジタル電圧信号と、画素の中の電流源回路のための制御用の電流とを、画素に入力する場合がある。その場合は、デジタル・アナログ変換回路3406は、デジタル・アナログ変換機能ではなく、電圧を電流に変換する機能を有しており、その電流を制御用の電流として画素に出力する回路、すなわち、電流源回路を有しており、そこに本発明を適用することが出来る。
また、画素は、EL素子などの表示素子を有している。その表示素子に電流(ビデオ信号)を出力する回路、すなわち、電流源回路を有しており、そこにも、本発明を適用することが出来る。
そこで、信号線駆動回路3410の動作を簡単に説明する。シフトレジスタ3403は、フリップフロップ回路(FF)等を複数列用いて構成され、クロック信号(S−CLK)、スタートパルス(SP)、クロック反転信号(S−CLKb)が入力される、これらの信号のタイミングに従って、順次サンプリングパルスが出力される。
シフトレジスタ3403より出力されたサンプリングパルスは、第1ラッチ回路(LAT1)3404に入力される。第1ラッチ回路(LAT1)3404には、ビデオ信号線3408より、ビデオ信号が入力されており、サンプリングパルスが入力されるタイミングに従って、各列でビデオ信号を保持していく。なお、デジタル・アナログ変換回路3406を配置している場合は、ビデオ信号はデジタル値である。また、この段階でのビデオ信号は、電圧であることが多い。
ただし、第1ラッチ回路3404や第2ラッチ回路3405が、アナログ値を保存できる回路である場合は、デジタル・アナログ変換回路3406は省略できる場合が多い。その場合、ビデオ信号は、電流であることも多い。また、画素配列3401に出力するデータが2値、つまり、デジタル値である場合は、デジタル・アナログ変換回路3406は省略できる場合が多い。
第1ラッチ回路(LAT1)3404において、最終列までビデオ信号の保持が完了すると、水平帰線期間中に、ラッチ制御線3409よりラッチパルス(Latch Pulse)が入力され、第1ラッチ回路(LAT1)3404に保持されていたビデオ信号は、一斉に第2ラッチ回路(LAT2)3405に転送される。その後、第2ラッチ回路(LAT2)3405に保持されたビデオ信号は、1行分が同時に、デジタル・アナログ変換回路3406へと入力される。そして、デジタル・アナログ変換回路3406から出力される信号は、画素配列3401へ入力される。
第2ラッチ回路(LAT2)3405に保持されたビデオ信号がデジタル・アナログ変換回路3406に入力され、そして、画素3401に入力されている間、シフトレジスタ3403においては再びサンプリングパルスが出力される。つまり、同時に2つの動作が行われる。これにより、線順次駆動が可能となる。以後、この動作を繰り返す。
なお、デジタル・アナログ変換回路3406が有している電流源回路が、設定動作と出力動作とを行うような回路である場合、つまり、別の電流源回路から電流を入力して、トランジスタの特性バラツキの影響を受けない電流を出力できるような回路である場合、その電流源回路に、電流を流す回路が必要となる。そのような場合、リファレンス用電流源回路3414が配置されている。
なお、すでに述べたように、本発明におけるトランジスタは、どのようなタイプのトランジスタでもよいし、どのような基板上に形成されていてもよい。したがって、図34、図35などで示したような回路が、全てガラス基板上に形成されていてもよいし、プラスチック基板に形成されていてもよいし、単結晶基板に形成されていてもよいし、SOI基板上に形成されていてもよいし、どのような基板上に形成されていてもよい。あるいは、図34、図35などにおける回路の一部が、ある基板に形成されており、図34、図35などにおける回路の別の一部が、別の基板に形成されていてもよい。つまり、図34、図35などにおける回路の全てが同じ基板上に形成されていなくてもよい。例えば、図34、図35などにおいて、画素3401とゲート線駆動回路3402とは、ガラス基板上にTFTを用いて形成し、信号線駆動回路3410(もしくはその一部)は、単結晶基板上に形成し、そのICチップをCOG(Chip On Glass)で接続してガラス基板上に配置してもよい。あるいは、そのICチップをTAB(Tape Auto Bonding)やプリント基板を用いてガラス基板と接続してもよい。
なお、信号線駆動回路などの構成は、図34に限定されない。
例えば、第1ラッチ回路3404や第2ラッチ回路3405が、アナログ値を保存できる回路である場合、図35に示すように、リファレンス用電流源回路3414から第1ラッチ回路(LAT1)3404に、ビデオ信号(アナログ電流)が入力されることもある。また、図35において、第2ラッチ回路3405が存在しない場合もある。そのような場合は、第1ラッチ回路3404に、より多くの電流源回路が配置されている場合が多い。
このような場合、図34における、デジタル・アナログ変換回路3406の中の電流源回路に、本発明を適用することが出来る。デジタル・アナログ変換回路3406の中に、沢山のユニット回路があり、リファレンス用電流源回路3414に、電流源回路101や増幅回路107が配置されている。
あるいは、図35における、第1ラッチ回路(LAT1)3404の中の電流源回路に、本発明を適用することが出来る。第1ラッチ回路(LAT1)3404の中に、沢山のユニット回路があり、リファレンス用電流源回路3414に、基本電流源101や追加電流源103が配置されている。
あるいは、図34、図35における画素配列3401の中の画素(その中の電流源回路)に、本発明を適用することが出来る。画素配列3401の中に、沢山のユニット回路があり、信号線駆動回路3410に、電流源回路101や増幅回路107が配置されている。
つまり、回路の様々な部分に、電流を供給するような回路が存在する。そのような電流源回路は、正確な電流を出力する必要がある。そのため、別の電流源回路を用いて、トランジスタが正確な電流が出力できるように設定を行う。別の電流源回路も、正確な電流を出力する必要がある。したがって、図36〜図38に示すように、ある場所に、基本となる電流源回路があり、そこから電流源トランジスタを次々に設定していく。それにより、電流源回路は、正確な電流を出力することが可能となる。よって、そのような部分に、本発明を適用することが出来る。
なお、電流源回路に対して設定動作を行う場合、そのタイミングを制御する必要がある。その場合、設定動作を制御するために、専用の駆動回路(シフトレジスタなど)を配置してもよい。あるいは、LAT1回路を制御するためのシフトレジスタから出力される信号を用いて、電流源回路への設定動作を制御してもよい。つまり、一つのシフトレジスタで、LAT1回路と電流源回路とを両方制御するようにしてもよい。その場合は、LAT1回路を制御するためのシフトレジスタから出力される信号を直接、電流源回路に入力してもよいし、LAT1回路への制御と電流源回路への制御を切り分けるため、その切り分けを制御する回路を介して、電流源回路を制御してもよい。あるいは、LAT2回路から出力される信号を用いて、電流源回路への設定動作を制御してもよい。LAT2回路から出力される信号は、通常、ビデオ信号であるため、ビデオ信号として使用する場合と電流源回路を制御する場合とを切り分けるため、その切り替えを制御する回路を介して、電流源回路を制御すればよい。このように、設定動作や出力動作を制御するための回路構成や、回路の動作等については、国際公開第03/038793号パンフレット、国際公開第03/038794号パンフレット、国際公開第03/038795号パンフレット、に記載されており、その内容を本発明に適用することが出来る。
なお、本実施の形態で説明した内容は、実施の形態1〜5で説明した内容を利用したものに相当する。したがって、実施の形態1〜5で説明した内容は、本実施の形態にも適用できる。
(実施の形態3)
本発明は電子機器の表示部を構成する回路に用いることができる。そのような電子機器として、ビデオカメラ、デジタルカメラ、ゴーグル型ディスプレイ(ヘッドマウントディスプレイ)、ナビゲーションシステム、音響再生装置(カーオーディオ、オーディオコンポ等)、ノート型パーソナルコンピュータ、ゲーム機器、携帯情報端末(モバイルコンピュータ、携帯電話、携帯型ゲーム機または電子書籍等)、記録媒体を備えた画像再生装置(具体的にはDigital Versatile Disc(DVD)等の記録媒体を再生し、その画像を表示しうるディスプレイを備えた装置)などが挙げられる。つまり、これらの表示部を構成する画素や、画素を駆動する信号線駆動回路等に本発明を適用することができる。それらの電子機器の具体例を図39に示す。
図39(A)は発光装置(ここで、発光装置とは自発光型の発光素子を表示部に用いた表示装置をいう。)であり、筐体13001、支持台13002、表示部13003、スピーカー部13004、ビデオ入力端子13005等を含む。本発明は表示部13003を構成する画素や信号線駆動回路等に用いることができる。また本発明により、図39(A)に示す発光装置が完成される。発光装置は自発光型であるためバックライトが必要なく、液晶ディスプレイよりも薄い表示部とすることができる。なお、発光装置は、パソコン用、TV放送受信用、広告表示用などの全ての情報表示用表示装置が含まれる。
図39(B)はデジタルスチルカメラであり、本体13101、表示部13102、受像部13103、操作キー13104、外部接続ポート13105、シャッター13106等を含む。本発明は、表示部13102を構成する画素や信号線駆動回路等に用いることができる。また本発明により、図39(B)に示すデジタルスチルカメラが完成される。
図39(C)はノート型パーソナルコンピュータであり、本体13201、筐体13202、表示部13203、キーボード13204、外部接続ポート13205、ポインティングマウス13206等を含む。本発明は、表示部13203を構成する画素や信号線駆動回路等に用いることができる。また本発明により、図39(C)に示す発光装置が完成される。
図39(D)はモバイルコンピュータであり、本体13301、表示部13302、スイッチ13303、操作キー13304、赤外線ポート13305等を含む。本発明は、表示部13302を構成する画素や信号線駆動回路等に用いることができる。また本発明により、図39(D)に示すモバイルコンピュータが完成される。
図39(E)は記録媒体を備えた携帯型の画像再生装置(具体的にはDVD再生装置)であり、本体13401、筐体13402、表示部A13403、表示部B13404、記録媒体(DVD等)読み込み部13405、操作キー13406、スピーカー部13407等を含む。表示部A13403は主として画像情報を表示し、表示部B13404は主として文字情報を表示するが、本発明は、表示部A、B13403、13404を構成する画素や信号線駆動回路等に用いることができる。なお、記録媒体を備えた画像再生装置には家庭用ゲーム機器なども含まれる。また本発明により、図39(E)に示すDVD再生装置が完成される。
図39(F)はゴーグル型ディスプレイ(ヘッドマウントディスプレイ)であり、本体13501、表示部13502、アーム部13503を含む。本発明は、表示部13502を構成する画素や信号線駆動回路等に用いることができる。また本発明により、図39(F)に示すゴーグル型ディスプレイが完成される。
図39(G)はビデオカメラであり、本体13601、表示部13602、筐体13603、外部接続ポート13604、リモコン受信部13605、受像部13606、バッテリー13607、音声入力部13608、操作キー13609等を含む。本発明は、表示部13602を構成する画素や信号線駆動回路等に用いることができる。また本発明により、図39(G)に示すビデオカメラが完成される。
図39(H)は携帯電話であり、本体13701、筐体13702、表示部13703、音声入力部13704、音声出力部13705、操作キー13706、外部接続ポート13707、アンテナ13708等を含む。本発明は、表示部13703を構成する画素や信号線駆動回路等に用いることができる。なお、表示部13703は黒色の背景に白色の文字を表示することで携帯電話の消費電流を抑えることができる。また本発明により、図39(H)に示す携帯電話が完成される。
なお、将来的に発光材料の発光輝度が高くなれば、出力した画像情報を含む光をレンズ等で拡大投影してフロント型若しくはリア型のプロジェクターに用いることも可能となる。
また、上記電子機器はインターネットやCATV(ケーブルテレビ)などの電子通信回線を通じて配信された情報を表示することが多くなり、特に動画情報を表示する機会が増してきている。発光材料の応答速度は非常に高いため、発光装置は動画表示に好ましい。
また、発光装置は発光している部分が電力を消費するため、発光部分が極力少なくなるように情報を表示することが望ましい。従って、携帯情報端末、特に携帯電話や音響再生装置のような文字情報を主とする表示部に発光装置を用いる場合には、非発光部分を背景として文字情報を発光部分で形成するように駆動することが望ましい。
以上の様に、本発明の適用範囲は極めて広く、あらゆる分野の電子機器に用いることが可能である。また本実施の形態の電子機器は、実施の形態1〜4に示したいずれの構成の半導体装置を用いても良い。
Claims (15)
- 負荷に供給する電流をトランジスタで制御する回路を具備する半導体装置であって、前記トランジスタのソースまたはドレインが電流源回路と接続され、前記トランジスタのソース電位、ドレイン電位及びゲート電位から選ばれた少なくとも一つの電位を制御する増幅回路が備えられていることを特徴とする半導体装置。
- 負荷に供給する電流をトランジスタで制御する回路を具備する半導体装置であって、前記トランジスタのソースまたはドレインが電流源回路と接続され、前記電流源回路から前記トランジスタに電流が供給されたとき、前記トランジスタが飽和領域で動作するように制御する増幅回路が備えられていることを特徴とする半導体装置。
- 負荷に供給する電流をトランジスタで制御する回路を具備する半導体装置であって、前記トランジスタのソースまたはドレインが電流源回路と接続され、前記トランジスタのドレインとゲート間の電位を安定化させる増幅回路が備えられていることを特徴とする半導体装置。
- 負荷に供給する電流をトランジスタで制御する回路を具備する半導体装置であって、前記トランジスタのソースまたはドレインが電流源回路と接続され、前記トランジスタのドレインとゲート間の電位を安定化させる帰還回路が備えられていることを特徴とする半導体装置。
- 負荷に供給する電流を制御するトランジスタと、オペアンプを具備する半導体装置であって、電流源回路に接続する前記トランジスタのドレイン端子側に前記オペアンプの非反転入力端子が接続され、前記オペアンプの反転入力端子は、前記トランジスタのゲート端子と接続され、前記オペアンプの出力端子は、前記ゲート端子と前記反転入力端子と接続されていることを特徴とする半導体装置。
- 負荷に供給する電流を制御するトランジスタと、電圧フォロワ回路を具備する半導体装置であって、電流源回路に接続する前記トランジスタのドレイン端子側に前記電圧フォロワ回路入力端子が接続され、前記電圧フォロワ回路の出力端子は、前記トランジスタのゲート端子と接続されていることを特徴とする半導体装置。
- 請求項6において、前記電圧フォロワ回路がソースフォロワ回路で構成されていることを特徴とする半導体装置。
- 請求項1乃至7のいずれか一項に記載の半導体装置を表示部に有することを特徴とする発光装置。
- 請求項1乃至7のいずれか一項に記載の半導体装置を表示部に有することを特徴とするデジタルスチルカメラ。
- 請求項1乃至7のいずれか一項に記載の半導体装置を表示部に有することを特徴とするノート型パーソナルコンピュータ。
- 請求項1乃至7のいずれか一項に記載の半導体装置を表示部に有することを特徴とするモバイルコンピュータ。
- 請求項1乃至7のいずれか一項に記載の半導体装置を表示部に有することを特徴とする画像再生装置。
- 請求項1乃至7のいずれか一項に記載の半導体装置を表示部に有することを特徴とするゴーグル型ディスプレイ。
- 請求項1乃至7のいずれか一項に記載の半導体装置を表示部に有することを特徴とするビデオカメラ。
- 請求項1乃至7のいずれか一項に記載の半導体装置を表示部に有することを特徴とする携帯電話。
Applications Claiming Priority (3)
Application Number | Priority Date | Filing Date | Title |
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