JPWO2004077561A1 - 電極層および誘電体層を含む積層体ユニット - Google Patents

電極層および誘電体層を含む積層体ユニット Download PDF

Info

Publication number
JPWO2004077561A1
JPWO2004077561A1 JP2005502840A JP2005502840A JPWO2004077561A1 JP WO2004077561 A1 JPWO2004077561 A1 JP WO2004077561A1 JP 2005502840 A JP2005502840 A JP 2005502840A JP 2005502840 A JP2005502840 A JP 2005502840A JP WO2004077561 A1 JPWO2004077561 A1 JP WO2004077561A1
Authority
JP
Japan
Prior art keywords
group
bismuth
dielectric layer
unit according
laminate unit
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Withdrawn
Application number
JP2005502840A
Other languages
English (en)
Inventor
坂下 幸雄
幸雄 坂下
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
TDK Corp
Original Assignee
TDK Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by TDK Corp filed Critical TDK Corp
Publication of JPWO2004077561A1 publication Critical patent/JPWO2004077561A1/ja
Withdrawn legal-status Critical Current

Links

Images

Classifications

    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01GCAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
    • H01G4/00Fixed capacitors; Processes of their manufacture
    • H01G4/002Details
    • H01G4/018Dielectrics
    • H01G4/06Solid dielectrics
    • H01G4/08Inorganic dielectrics
    • H01G4/12Ceramic dielectrics
    • H01G4/1209Ceramic dielectrics characterised by the ceramic dielectric material
    • H01G4/1218Ceramic dielectrics characterised by the ceramic dielectric material based on titanium oxides or titanates
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01GCAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
    • H01G4/00Fixed capacitors; Processes of their manufacture
    • H01G4/002Details
    • H01G4/005Electrodes
    • H01G4/008Selection of materials
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01GCAPACITORS; CAPACITORS, RECTIFIERS, DETECTORS, SWITCHING DEVICES, LIGHT-SENSITIVE OR TEMPERATURE-SENSITIVE DEVICES OF THE ELECTROLYTIC TYPE
    • H01G4/00Fixed capacitors; Processes of their manufacture
    • H01G4/33Thin- or thick-film capacitors 
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L23/00Details of semiconductor or other solid state devices
    • H01L23/52Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames
    • H01L23/522Arrangements for conducting electric current within the device in operation from one component to another, i.e. interconnections, e.g. wires, lead frames including external interconnections consisting of a multilayer structure of conductive and insulating layers inseparably formed on the semiconductor body
    • H01L23/5222Capacitive arrangements or effects of, or between wiring layers
    • H01L23/5223Capacitor integral with wiring layers
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/01Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate comprising only passive thin-film or thick-film elements formed on a common insulating substrate
    • H01L27/016Thin-film circuits
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L27/00Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate
    • H01L27/02Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers
    • H01L27/04Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body
    • H01L27/06Devices consisting of a plurality of semiconductor or other solid-state components formed in or on a common substrate including semiconductor components specially adapted for rectifying, oscillating, amplifying or switching and having potential barriers; including integrated passive circuit elements having potential barriers the substrate being a semiconductor body including a plurality of individual components in a non-repetitive configuration
    • H01L27/0688Integrated circuits having a three-dimensional layout
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L28/00Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
    • H01L28/40Capacitors
    • H01L28/55Capacitors with a dielectric comprising a perovskite structure material
    • H01L28/57Capacitors with a dielectric comprising a perovskite structure material comprising a barrier layer to prevent diffusion of hydrogen or oxygen
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L28/00Passive two-terminal components without a potential-jump or surface barrier for integrated circuits; Details thereof; Multistep manufacturing processes therefor
    • H01L28/40Capacitors
    • H01L28/60Electrodes
    • HELECTRICITY
    • H01ELECTRIC ELEMENTS
    • H01LSEMICONDUCTOR DEVICES NOT COVERED BY CLASS H10
    • H01L2924/00Indexing scheme for arrangements or methods for connecting or disconnecting semiconductor or solid-state bodies as covered by H01L24/00
    • H01L2924/0001Technical content checked by a classifier
    • H01L2924/0002Not covered by any one of groups H01L24/00, H01L24/00 and H01L2224/00

Landscapes

  • Engineering & Computer Science (AREA)
  • Power Engineering (AREA)
  • Microelectronics & Electronic Packaging (AREA)
  • Computer Hardware Design (AREA)
  • Chemical & Material Sciences (AREA)
  • Condensed Matter Physics & Semiconductors (AREA)
  • General Physics & Mathematics (AREA)
  • Physics & Mathematics (AREA)
  • Manufacturing & Machinery (AREA)
  • Materials Engineering (AREA)
  • Ceramic Engineering (AREA)
  • Inorganic Chemistry (AREA)
  • Semiconductor Integrated Circuits (AREA)
  • Formation Of Insulating Films (AREA)
  • Semiconductor Memories (AREA)

Abstract

本発明にかかる積層体ユニットは、シリコン単結晶によって形成された支持基板と、支持基板上に、酸化シリコンによって形成されたバリア層と、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができるBi2Sr2CaCu2O8で表わされる化学量論組成を有するBSCCOによって形成され、c軸方向に配向された電極層と、電極層上で、SrBi4Ti4O15で表わされる組成を有するビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて形成され、c軸方向に配向された誘電体層を備えている。

Description

本発明は、電極層および誘電体層を含む積層体ユニットに関するものであり、さらに詳細には、電界効果型トランジスタ(FET)やCPU(Central Processing Unit)などの他のデバイスとともに、半導体ウェハに組み込むのに適した小型で、かつ、大容量の誘電特性に優れた薄膜コンデンサを構成することができる電極層および誘電体層を含む積層体ユニットに関するものである。
電界効果型トランジスタ(FET)やCPU(Central Processing Unit)などの他のデバイスとともに、コンデンサを、半導体ウェハに組み込んで、形成された半導体デバイスが知られている。
このような半導体デバイスにあっては、コンデンサを、他のデバイスとともに、半導体プロセスを用いて、形成することが、工程上、有利であるため、従来は、半導体プロセスによって形成することができるシリコン系材料などよりなるコンデンサが、半導体デバイスに形成されていた。
しかしながら、半導体プロセスによって形成することができるシリコン系材料などは、誘電率が低いため、容量の大きいコンデンサを形成しようとすると、その面積が必然的に大きくなり、半導体デバイスが大型化するという問題があった。
かかる問題を解決するために、小型で、容量の大きい薄膜コンデンサを半導体ウエハに組み込んで、半導体デバイスを作製することが考えられる。
日本国公開特許公報第2001−15382号は、誘電体の材料として、PZT、PLZT、(Ba,Sr)TiO(BST)、Taなどを用いた小型で、容量の大きい薄膜コンデンサを開示している。
しかしながら、これらの材料によって、形成された誘電体薄膜は、その厚みが薄くなると、誘電率が低下するだけでなく、たとえば、100kV/cmの電界を加えた場合に、静電容量が大きく低下するという問題があり、これらの材料を、薄膜コンデンサの誘電体材料として、用いた場合には、小型で、かつ、大容量の薄膜コンデンサを得ることは困難である。さらに、これらの材料によって、形成された誘電体薄膜は、表面平滑性が低いため、その厚みを薄くすると、絶縁不良などが生じやすくなるという問題もある。
このような問題を解決するためには、薄膜コンデンサの誘電体として、ビスマス層状化合物を用いることが考えられる。ビスマス層状化合物については、竹中正著「ビスマス層状構造強誘電体セラミックスの粒子配向とその圧電・焦電材料への応用」、京都大学工学博士論文(1984)の第3章の第23〜36頁に記載されている。
ビスマス層状化合物は結晶構造に異方性を有しており、基本的に、強誘電体としての性質を示すが、ある配向軸方向については、強誘電体としての性質が小さく、常誘電体としての性質を示すことが知られている。
ビスマス層状化合物が持つ強誘電体としての性質は、ビスマス層状化合物を、薄膜コンデンサの誘電体として利用する場合には、誘電率の変動をもたらすため、好ましくなく、ビスマス層状化合物の常誘電体としての性質が十分に発揮されることが好ましい。
よって、ビスマス層状化合物の強誘電体としての性質が小さく、常誘電体としての性質を示す配向軸方向に、ビスマス層状化合物が配向された誘電体層を備え、電界効果型トランジスタ(FET)やCPU(Central Processing Unit)などの他のデバイスとともに、半導体ウェハに組み込むのに適した大容量の誘電特性に優れた薄膜コンデンサの開発が望まれている。
したがって、本発明は、電界効果型トランジスタ(FET)やCPU(Central Processing Unit)などの他のデバイスとともに、半導体ウェハに組み込むのに適した小型で、かつ、大容量の誘電特性に優れた薄膜コンデンサを構成することができる電極層および誘電体層を含む積層体ユニットを提供することを目的とするものである。
本発明のかかる目的およびその他の目的は、半導体ウェハ上に、バリア層と、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料により、形成され、[001]方位に配向された電極層と、前記電極層上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて、形成され、[001]方位に配向されたビスマス層状化合物を含む誘電体材料よりなる誘電体層とが、この順に、積層された積層体ユニットによって達成される。
ここに、[001]方位とは、立方晶、正方晶、単斜晶および斜方晶における[001]方位のことをいう。
本発明によれば、半導体ウェハ上に、バリア層が形成されているから、電極層の成分が、半導体ウェハ中に拡散するなど、半導体ウェハが、電極層の影響を受けることが防止され、したがって、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料により、所望のように、電極層を形成し、[001]方位に配向させることができる。
また、本発明によれば、電極層は、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料によって形成され、[001]方位に配向されているから、バッファ層としても機能し、したがって、電極層上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて、確実に、[001]方位に配向したビスマス層状化合物を含む誘電体層を形成することが可能になる。
したがって、本発明によれば、誘電体層に含まれるビスマス層状化合物のc軸を、電極層に対して、垂直に配向させることが可能になるから、たとえば、誘電体層上に、上部電極を設け、電極層と上部電極との間に電圧を印加した場合に、電界の方向が、誘電体層に含まれるビスマス層状化合物のc軸とほぼ一致し、したがって、誘電体層に含まれるビスマス層状化合物の強誘電体としての性質を抑制して、常誘電体としての性質を十分に発揮させることが可能になるから、小型で、かつ、大容量の薄膜コンデンサを、他のデバイスとともに、半導体ウェハに組み込んで、半導体との一体化デバイスを作製することが可能になる。
さらに、c軸配向性が向上されたビスマス層状化合物を含む誘電体材料よりなる誘電体層は高い絶縁性を有しているから、誘電体層を薄膜化することができ、したがって、本発明によれば、薄膜コンデンサを、より一層小型化することが可能になり、薄膜コンデンサが組み込まれた半導体との一体化デバイスを、より一層小型化することが可能になる。
また、本発明によれば、誘電体層上に、上部電極を形成して、作製された薄膜コンデンサ上に、CPU(Central Processing Unit)などの他の半導体デバイスを実装する場合に、他の半導体デバイスは、半導体ウェハ上に形成されているのが一般であるから、他の半導体デバイスの半導体ウェハが、積層体ユニットの半導体ウェハと同じ材料を形成されていれば、薄膜コンデンサの熱膨張率と、その上に実装された他の半導体デバイスの熱膨張率とが合致し、実装されたデバイス間の熱膨張率の相違に起因して、両デバイスの接合部が破損されることを効果的に防止することが可能になる。
本発明において、ビスマス層状化合物を含む誘電体材料は、不可避的な不純物を含んでいてもよい。
本発明において、半導体ウェハを形成するための材料としては、種々のデバイスを組み込んだ半導体デバイスを作製するのに用いられる材料であれば、とくに限定されるものではなく、たとえば、シリコン単結晶、砒化ガリウム結晶などを用いることができる。
本発明において、積層体ユニットは、半導体ウェハ上に、バリア層を備えている。バリア層は、バリア層上に形成される電極層の構成成分が、半導体ウェハ中に拡散するなど、半導体ウェハが、電極層の影響を受けることを防止する機能を有している。
本発明において、バリア層を形成するための材料は、半導体ウェハが、電極層の影響を受けることを防止することができる材料であれば、とくに限定されるものではない。半導体ウェハとして、シリコン単結晶が用いられる場合には、コスト面から、バリア層を形成するために、酸化シリコンが好ましく用いられ、半導体ウェハとして、砒化ガリウム結晶が用いられる場合には、安定性の観点から、バリア層を形成するために、酸化アルミニウム(Al)や、酸化マグネシウム(MgO)が好ましく用いられる。
また、バリア層は、その上に形成された電極層が、半導体ウェハに影響を与えない程度の厚さあるいはそれ以上の厚さに形成される。
本発明において、積層体ユニットは、バリア層上に、[001]方位に、すなわち、c軸方向に配向された電極層を備えている。
本発明において、電極層は、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料によって形成され、[001]方位に配向されている。したがって、電極層は、電極としての機能と、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて、[001]方位に、すなわち、c軸方向に配向されたビスマス層状化合物を含む誘電体層を確実に形成できるように保証するバッファ層としての機能を有している。
酸化シリコンなどによって形成されたバリア層上に、白金などからなる電極層を直接形成する場合には、電極層が、[111]方位に配向しやすいため、電極層上に、ビスマス層状化合物を含む誘電体材料よりなる誘電体層をエピタキシャル成長させて、ビスマス層状化合物を[001]方位に、すなわち、c軸方向に配向させることが困難になる。しかしながら、本発明においては、電極層は、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料によって形成されているから、電極層を[001]方位に配向することができ、したがって、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて、誘電体層を形成し、誘電体層に含まれたビスマス層状化合物を、確実に、[001]方位に、すなわち、c軸方向に配向させることが可能になる。
本発明において、電極層を形成するための材料は、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料であれば、とくに限定されるものではないが、酸化物超伝導体が、電極層を形成するために、好ましく使用される。
酸化物超伝導体の中でも、CuO面を有する銅酸化物超伝導体が、電極層を形成するために、とくに好ましく使用される。
本発明において、電極層を形成するために、とくに好ましく使用されるCuO面を有する銅酸化物超伝導体の例としては、化学量論的組成式:BiSrCan−1Cu2n+4で示されるBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)、化学量論的組成式:YBaCu−δで示されるYBCO(イットリウム・ビスマス・カッパー・オキサイド)が挙げられる。
本発明において、電極層に含まれている異方性および導電性を有する材料の[001]方位の配向度、すなわち、c軸配向度Fが100%であることは必ずしも必要でなく、c軸配向度Fが80%以上であればよい。c軸配向度Fが90%であることが好ましく、c軸配向度Fが95%以上であると、より好ましい。
ここに、異方性および導電性を有する材料のc軸配向度Fは、次式(1)によって定義される。
F(%)=(P−P)/(1−P)×100 …(1)
式(1)において、Pは、完全にランダムな配向をしている異方性および導電性を有する材料のc軸配向比、すなわち、完全にランダムな配向をしている異方性および導電性を有する材料の(001)面からの反射強度I(001)の合計ΣI(001)と、その異方性および導電性を有する材料の各結晶面(hkl)からの反射強度I(hkl)の合計ΣI(hkl)との比({ΣI(001)/ΣI(hkl)})であり、Pは、X線回折強度を用いて算出された異方性および導電性を有する材料のc軸配向比、すなわち、ビスマス層状化合物の(001)面からの反射強度I(001)の合計ΣI(001)と、異方性および導電性を有する材料の各結晶面(hkl)からの反射強度I(hkl)の合計ΣI(hkl)との比({ΣI(001)/ΣI(hkl)})である。ここに、h、k、lは、それぞれ、0以上の任意の整数値を取ることができる。
ここに、Pは既知の定数であるから、(001)面からの反射強度I(001)の合計ΣI(001)と、各結晶面(hkl)からの反射強度I(hkl)の合計ΣI(hkl)が等しいとき、すなわち、P=1のときに、異方性および導電性を有する材料のc軸配向度Fは100%となる。
本発明において、電極層は、真空蒸着法、スパッタリング法、パルスレーザー蒸着法(PLD)、有機金属化学気相成長法(metal−organic chemical vapor deposition:MOCVD)、有機金属分解法(metal−organic decomposition:MOD)やゾル・ゲル法などの液相法(CSD法)などの各種薄膜形成法を用いて、形成することができる。
本発明において、積層体ユニットは、電極層上に、[001]方位に、すなわち、c軸方向に配向されたビスマス層状化合物を含む誘電体材料よりなる誘電体層を備えている。
本発明において、誘電体層は、ビスマス層状化合物を含む誘電体材料を、電極層上で、エピタキシャル成長させることによって形成される。
誘電体層は、[001]方位に配向されている電極層上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて、形成されるから、誘電体層に含まれているビスマス層状化合物を、確実に、[001]方位に、すなわち、c軸方向に配向させることができ、したがって、本発明にかかる積層体ユニットを用いて、薄膜コンデンサを構成したときに、誘電体層に含まれるビスマス層状化合物は、強誘電体としてではなく、常誘電体として機能するから、小型で、かつ、大容量の誘電特性に優れた薄膜コンデンサを、他のデバイスとともに、半導体ウェハに組み込むことが可能になる。
誘電体層を形成するビスマス層状化合物としては、コンデンサ材料としての特性に優れたビスマス層状化合物が選ばれる。
ビスマス層状化合物は、化学量論的組成式:(Bi2+(Am− 3m+12−、あるいは、Bim−13m+3で表わされる組成を有している。ここに、化学量論的組成式中の記号mは正の整数であり、記号Aは、ナトリウム(Na)、カリウム(K)、鉛(Pb)、バリウム(Ba)、ストロンチウム(Sr)、カルシウム(Ca)およびビスマス(Bi)からなる群より選ばれる少なくとも1つの元素であり、記号Bは、鉄(Fe)、コバルト(Co)、クロム(Cr)、ガリウム(Ga)、チタン(Ti)、ニオブ(Nb)、タンタル(Ta)、アンチモン(Sb)、マンガン(Mn)、バナジウム(V)、モリブデン(Mo)およびタングステン(W)からなる群より選ばれる少なくとも1つの元素である。記号Aおよび/またはBを2つ以上の元素で構成する場合、それらの比率は任意である。
第1図に示されるように、ビスマス層状化合物は、それぞれがABO1aで構成される(m−1)個のペロブスカイト格子が連なった層状ペロブスカイト層1と、(Bi2+層2とが、交互に積層された層状構造を有している。
層状ペロブスカイト層1と(Bi2+層2の積層数は、とくに限定されるものではなく、少なくとも一対の(Bi2+層2と、これらに挟まれた一つの層状ペロブスカイト層1を備えていれば十分である。
ビスマス層状化合物のc軸とは、一対の(Bi2+層2同士を結ぶ方向、すなわち、[001]方位を意味する。
これらのビスマス層状化合物のうち、コンデンサ材料としての特性に優れたビスマス層状化合物が、誘電体層を形成するために用いられる。
本発明において、誘電体層を形成するために用いられるビスマス層状化合物は、コンデンサ材料としての特性に優れたビスマス層状化合物であれば、とくに限定されるものではないが、化学量論組成式において、m=4の化学量論的組成式:(Bi2+(A13 、あるいは、Bi15で表わされるビスマス層状化合物がコンデンサ材料としての特性に優れ、好ましく使用される。
本発明において、バッファ層に含まれているビスマス層状化合物の[001]方位の配向度、すなわち、c軸配向度Fが100%であることは必ずしも必要でなく、c軸配向度Fが80%以上であればよい。c軸配向度Fが90%であることが好ましく、c軸配向度Fが95%以上であると、より好ましい。
ビスマス層状化合物のc軸配向度Fは、式(1)によって定義される。
このように、ビスマス層状化合物を、[001]方位に、すなわち、c軸方向に配向させることによって、誘電体層の誘電特性を大幅に向上させることが可能になる。
すなわち、本発明にかかる積層体ユニットの誘電体層上に、たとえば、上部電極を形成して、薄膜コンデンサを作製した場合、誘電体層の膜厚をたとえば100nm以下にしても、比較的高い誘電率と低い損失(tanδ)を有する薄膜コンデンサを得ることができ、リーク特性に優れ、耐圧が向上し、誘電率の温度特性に優れ、表面平滑性にも優れた薄膜コンデンサを得ることが可能になる。
本発明において、とくに好ましくは、誘電体層に含まれるビスマス層状化合物が、化学量論的組成式:CaSr(1−x)BiTi15で表わされる組成を有している。ここに、0≦x≦1である。このような組成を有するビスマス層状化合物を用いると、比較的大きな誘電率を有する誘電体層が得られるとともに、その温度特性がさらに向上する。
本発明において、誘電体層に含まれるビスマス層状化合物の化学量論的組成式中の記号AまたはBで表わされる元素の一部が、スカンジウム(Sc)、イットリウム(Y)、ランタン(La)、セリウム(Ce)、プラセオジム(Pr)、ネオジム(Nd)、プロメチウム(Pm)、サマリウム(Sm)、ユウロピウム(Eu)、ガドリニウム(Gd)、テルビウム(Tb)、ジスプロシウム(Dy)、ホルミウム(Ho)、エルビウム(Er)、ツリウム(Tm)、イッテルビウム(Yb)およびルテチウム(Lu)からなる群より選ばれる少なくとも1つの元素Re(イットリウム(Y)または希土類元素)によって置換されていることが好ましい。
元素Reによって、置換する場合には、好ましい置換量は、mの値により異なるが、たとえば、m=3のときは、化学量論的組成式:Bi2−xRe12において、好ましくは、0.4≦x≦1.8であり、より好ましくは、1.0≦x≦1.4である。元素Reによる置換量をこの範囲に設定すれば、誘電体層のキュリー温度(強誘電体から常誘電体への相転移温度)を、好ましくは、−100℃以上、100℃以下、より好ましくは、−50℃以上、50℃以下に収めることが可能となる。キュリー点が−100℃ないし+100℃であると、誘電体層の誘電率が向上する。キュリー温度は、DSC(示差走査熱量測定)などによって測定することができる。なお、キュリー点が室温(25℃)未満になると、tanδがさらに減少し、その結果、損失Q値がさらに上昇する。
また、m=4の場合には、化学量論的組成式:Bi3−xRe15において、好ましくは、0.01≦x≦2.0であり、より好ましくは、0.1≦x≦1.0である。
本発明にかかる積層体ユニットの誘電体層は、優れたリーク特性を有しているが、ビスマス層状化合物の化学量論的組成式中の記号AまたはBで表わされる元素の一部が、元素Reによって、置換されている場合には、誘電体層のリーク特性を一層向上させることができ、好ましい。
たとえば、ビスマス層状化合物の化学量論的組成式中の記号AまたはBで表わされる元素の一部が、元素Reによって、置換されていない場合においても、本発明にかかる積層体ユニットの誘電体層は、電界強度50kV/cmで測定したときのリーク電流を、好ましくは、1×10−7A/cm以下、より好ましくは、5×10−8A/cm以下に抑制することができ、しかも、ショート率を、好ましくは、10%以下、より好ましくは、5%以下にすることができるが、ビスマス層状化合物の化学量論的組成式中の記号AまたはBで表わされる元素の一部が、元素Reによって、置換されている場合には、同条件で測定したときのリーク電流を、好ましくは、5×10−8A/cm以下、より好ましくは、1×10−8A/cm以下にすることができ、ショート率を、好ましくは、5%以下、より好ましくは、3%以下にすることができる。
本発明において、誘電体層は、真空蒸着法、スパッタリング法、パルスレーザー蒸着法(PLD)、有機金属化学気相成長法(metal−organic chemical vapor deposition:MOCVD)、有機金属分解法(metal−organic decomposition:MOD)やゾル・ゲル法などの液相法(CSD法)などの各種薄膜形成法を用いて、形成することができる。とくに低温で、誘電体層を形成する必要がある場合には、プラズマCVD、光CVD、レーザーCVD、光CSD、レーザーCSD法を用いることが好ましい。
本発明にかかる電極層および誘電体層を含む積層体ユニットは、薄膜コンデンサの構成部品としてだけでなく、無機EL素子を発光させるための積層体ユニットとして用いることもできる。すなわち、無機EL素子を発光させるためには、電極層と、無機EL素子との間に、絶縁層が必要であるが、c軸配向性が向上されたビスマス層状化合物を含む誘電体材料よりなる誘電体層は高い絶縁性を有しており、したがって、誘電体層上に、無機EL素子を配置するとともに、無機EL素子上に、別の電極を配置し、電極層と別の電極との間に電圧を加えることによって、無機EL素子を、所望のように、発光させることが可能になる。
本発明の前記およびその他の目的や特徴は、添付図面に基づいた以下の説明から明らかになるであろう。
第1図は、ビスマス層状化合物の構造を模式的に示す図である。
第2図は、本発明の好ましい実施態様にかかる積層体ユニットの略一部断面図である。
発明の好ましい実施態様の説明
以下、添付図面に基づき、本発明の好ましい実施態様につき、詳細に説明を加える。
第2図は、本発明の好ましい実施態様にかかる積層体ユニットの略一部断面図である。
第2図に示されるように、本実施態様にかかる積層体ユニット1は、支持基板2上に、バリア層3、電極層4および誘電体層5が、この順に、積層されて、形成されている。
本実施態様において、積層体ユニット1の支持基板2は、シリコン単結晶によって形成されている。
本実施態様にかかる積層体ユニット1は、支持基板2上に、酸化シリコンによって形成されたバリア層3を備えている。
酸化シリコンよりなるバリア層3は、たとえば、シリコンの熱酸化によって形成される。
第2図に示されるように、バリア層3上には、電極層4が形成されており、本実施態様においては、電極層4は、化学量論的組成式:BiSrCaCuによって表わされる組成を有するBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)によって、形成され、[001]方位に配向されている。
シリコン単結晶によって形成された支持基板2上に、BSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)よりなる電極層4を直接形成する場合には、BSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)の構成成分が、支持基板2を構成するシリコン単結晶中に拡散し、[001]方位に、すなわち、c軸方向に配向された電極層4を形成することはできないが、本実施態様においては、電極層4は、シリコン単結晶によって形成された支持基板2上に形成されているバリア層3上に形成されるから、BSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)の構成成分が、支持基板2を構成するシリコン単結晶中に拡散することを効果的に防止し、[001]方位に、すなわち、c軸方向に配向されたBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)よりなる電極層4を、所望のように、形成することが可能になる。
したがって、バリア層3は、BSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)の構成成分が、支持基板2を構成するシリコン単結晶中に拡散することを防止するのに十分な厚さ、たとえば、10μm以上の厚さを有している。
第2図に示されるように、本実施態様にかかる積層体ユニット1は、バリア層3上に、化学量論的組成式:BiSrCaCuによって表わされる組成を有するBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)によって、形成され、[001]方位に配向された電極層4を備えている。
化学量論的組成式:BiSrCaCuによって表わされる組成を有するBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)は、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる性質を有している。
したがって、電極層4は、電極としての機能と、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて、[001]方位に、すなわち、c軸方向に配向されたビスマス層状化合物を含む誘電体層5を確実に形成できるように保証するバッファ層としての機能を有している。
酸化シリコンなどによって形成されたバリア層3上に、白金などからなる電極層を直接形成する場合には、電極層が、[111]方位に配向しやすいため、電極層上で、ビスマス層状化合物を含む誘電体材料よりなる誘電体層をエピタキシャル成長させて、ビスマス層状化合物を[001]方位に、すなわち、c軸方向に配向させることは困難になる。しかしながら、本実施態様においては、電極層4は、化学量論的組成式:BiSrCaCuによって表わされる組成を有するBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)によって形成され、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料によって形成されているから、電極層4を[001]方位に配向することができ、したがって、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて、誘電体層5を形成し、誘電体層5に含まれたビスマス層状化合物を、確実に、[001]方位に、すなわち、c軸方向に配向させることが可能になる。
本実施態様において、化学量論的組成式:BiSrCaCuによって表わされる組成を有するBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)よりなる電極層4は、たとえば、パルスレーザー蒸着法(PLD)によって形成される。
パルスレーザー蒸着法(PLD)を用いて、化学量論的組成式:BiSrCaCuによって表わされる組成を有するBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)よりなる電極層4を形成する場合には、たとえば、原料として、BiSrCaCuによって表わされる組成を有するBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)をターゲットとして用い、酸化シリコンよりなるバリア層3の温度を650℃に保持して、100nmの厚さを有し、[001]方位に配向された電極層4が形成される。
第2図に示されるように、本実施態様にかかる積層体ユニット1は、電極層4上に形成された誘電体層5を備えている。
本実施態様において、誘電体層5は、ビスマス層状化合物の化学量論的組成式において、m=4、A=Bi+Srとした化学量論的組成式:SrBiTi15で表わされ、コンデンサ材料としての特性に優れたビスマス層状化合物を含む誘電体材料によって形成されている。
本実施態様においては、誘電体層5は、有機金属分解法(metal−organic decomposition:MOD)によって、電極層4上に形成される。
具体的には、2−エチルヘキサン酸Srのトルエン溶液と、2−エチルヘキサン酸Biの2−エチルヘキサン酸溶液と、2−エチルヘキサン酸Tiのトルエン溶液を、2−エチルヘキサン酸Srが1モル、2−エチルヘキサン酸Biが4モル、2−エチルヘキサン酸Tiが4モルとなるように、化学量論比で混合し、トルエンで希釈して、得た原料溶液を、スピンコーティング法によって、電極層4上に塗布し、乾燥後、得られた誘電体層5を結晶化させない温度条件で、仮焼成する。
次いで、仮焼成した誘電体層5上に、スピンコーティング法によって、同じ原料溶液を塗布して、乾燥し、仮焼成し、この操作を繰り返す。
仮焼成が完了すると、誘電体層5が本焼成され、必要な厚さの誘電体層5、たとえば、100nmの厚さの誘電体層5が得られるまで、塗布、乾燥、仮焼成、塗布、乾燥、仮焼成および本焼成よりなる一連の操作が繰り返される。
この過程で、ビスマス層状化合物を含む誘電体材料はエピタキシャル成長し、[001]方位に、すなわち、c軸方向に配向された誘電体層5が形成される。
本実施態様によれば、積層体ユニット1は、シリコン単結晶よりなる支持基板2上に、バリア層3、電極層4および誘電体層5が積層された構造を有しているから、たとえば、誘電体層5上に、上部電極を設けることによって、シリコン単結晶よりなる支持基板2に、電界効果型トランジスタやCPUなどの他のデバイスとともに、薄膜コンデンサを容易に組み込んで、半導体との一体化デバイスを作製することが可能になる。
また、本実施態様によれば、シリコン単結晶によって形成された支持基板2上に、酸化シリコンによって、バリア層3が形成されるから、電極層4の構成成分が、支持基板2を構成するシリコン単結晶中に拡散するなど、その上に形成される電極層4が、シリコン単結晶に影響を与えることを防止することができ、したがって、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料によって、所望のように、電極層4を形成し、[001]方位に、すなわち、c軸方向に配向させることが可能になる。
さらに、本実施態様によれば、ビスマス層状化合物を含む誘電体材料よりなる誘電体層5は、[001]方位に、すなわち、c軸方向に配向された電極層4上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて、形成されるから、誘電体層5を、確実に、[001]方位に配向させ、c軸配向性を向上させることが可能になる。
したがって、本実施態様によれば、積層体ユニット1は、[001]方位に、すなわち、c軸方向に配向されたビスマス層状化合物を含む誘電体材料によって形成された誘電体層5を有しているから、たとえば、本実施態様にかかる積層体ユニット1の誘電体層5上に、上部電極を設けて、薄膜コンデンサを作製し、電極層5と上部電極との間に電圧を印加したときに、電界の方向が誘電体層5に含まれているビスマス層状化合物のc軸とほぼ一致し、したがって、誘電体層5に含まれているビスマス層状化合物の強誘電体としての性質を抑制して、常誘電体としての性質を十分に発揮させることが可能になるから、小型で、かつ、大容量の薄膜コンデンサを、電界効果型トランジスタやCPUなどの他のデバイスとともに、シリコン単結晶よりなる支持基板2に組み込んで、半導体との一体化デバイスを作製することが可能になる。
さらに、本実施態様によれば、積層体ユニット1は、[001]方位に、すなわち、c軸方向に配向されたビスマス層状化合物を含む誘電体材料によって形成された誘電体層5を有し、c軸配向性が向上されたビスマス層状化合物を含む誘電体層5は高い絶縁性を有しているから、誘電体層5を薄膜化することができ、したがって、薄膜コンデンサを、より一層小型化することが可能になり、薄膜コンデンサが組み込まれた半導体との一体化デバイスを、より一層小型化することが可能になる。
本発明は、以上の実施の形態に限定されることなく、特許請求の範囲に記載された発明の範囲内で種々の変更が可能であり、それらも本発明の範囲内に包含されるものであることはいうまでもない。
たとえば、前記実施態様においては、積層体ユニット1は、支持基板2上に、バリア層3、化学量論的組成式:BiSrCaCuによって表わされる組成を有するBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)によって形成された電極層4および化学量論的組成式:SrBiTi15で表わされ、コンデンサ材料としての特性に優れたビスマス層状化合物を含む誘電体材料によって形成された誘電体層5が、この順に、積層されて、形成されているが、積層体ユニット1は、誘電体層5上に、さらに、それぞれが、少なくとも、電極層4および誘電体層5を含む複数の単位積層体が、積層されて形成されていてもよく、最上の単位積層体の誘電体層5上に、上部電極を形成することによって、薄膜コンデンサを形成するようにしてもよい。ただし、積層体ユニット1が、誘電体層5上に、さらに、複数の単位積層体が積層されて形成されている場合に、単位積層体に含まれる電極層が、誘電体層5上で、導電性材料の結晶をエピタキシャル成長させて、形成されていないときは、電極層上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させても、ビスマス層状化合物を[001]方位に配向させることが困難で、[001]方位に配向されたビスマス層状化合物を含む誘電体材料よりなる誘電体層5を形成することが困難であるから、単位積層体を、電極層、電極層上に形成され、[001]方位に配向されたバッファ層およびビスマス層状化合物を含む誘電体材料によって形成され、バッファ層上に形成された誘電体層5によって構成することが要求される。さらに、電極層4および誘電体層5によって構成された1または2以上の単位積層体と、電極層、電極層上に形成され、[001]方位に配向されたバッファ層およびビスマス層状化合物を含む誘電体材料によって形成され、バッファ層上に形成された誘電体層5によって構成された1または2以上の単位積層体を、誘電体層5上に、任意の順序で、積層し、最上の単位積層体の誘電体層5上に、上部電極を形成することによって、薄膜コンデンサを形成するようにしてもよい。
また、前記実施態様においては、積層体ユニット1の支持基板2は、シリコン単結晶によって形成されているが、シリコン単結晶によって形成された支持基板2を用いることは必ずしも必要でなく、支持基板2を形成するための材料としては、種々のデバイスを組み込んだ半導体デバイスを作製するのに用いられる材料であれば、とくに限定されるものではなく、たとえば、シリコン単結晶に代えて、砒化ガリウム結晶などによって、支持基板2を形成することもできる。
さらに、前記実施態様においては、積層体ユニット1は、支持基板2上に、酸化シリコンによって形成されたバリア層3を備えているが、支持基板2上に形成されるバリア層3を、酸化シリコンによって形成することは必ずしも必要でなく、その上に形成される電極層4の構成成分が、支持基板2中に拡散するなど、支持基板2が電極層4の影響を受けることを防止することができる材料であれば、いかなる材料で、バリア層3を形成してもよい。たとえば、支持基板2として、砒化ガリウム結晶が用いられる場合には、安定性の観点から、バリア層を形成するために、酸化アルミニウム(Al)や、酸化マグネシウム(MgO)が好ましく用いられる。
また、前記実施態様においては、積層体ユニット1は、バリア層3上に、化学量論的組成式:BiSrCaCuで表わされるBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)によって形成され、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させるためのバッファ層としても機能する電極層4を備えているが、電極層4を、化学量論的組成式:BiSrCaCuで表わされるBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)によって形成することは必ずしも必要でなく、電極層4を形成する材料は、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料であれば、とくに限定されるものではない。異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料としては、酸化物超伝導体が好ましく用いられ、CuO面を有する銅酸化物超伝導体がとくに好ましく用いられる。CuO面を有する銅酸化物超伝導体の例としては、化学量論的組成式:BiSrCan−1Cu2n+4で示されるBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)の他に、化学量論的組成式:YBaCu−δで表わされるYBCO(イットリウム・ビスマス・カッパー・オキサイド)が挙げられる。
さらに、前記実施態様においては、積層体ユニット1の電極層4は、パルスレーザー蒸着法(PLD)によって形成されているが、電極層4を、パルスレーザー蒸着法(PLD)によって形成することは必ずしも必要でなく、電極層4を、真空蒸着法、スパッタリング法、有機金属化学気相成長法(metal−organic chemical vapor deposition:MOCVD)、有機金属分解法(metal−organic decomposition:MOD)やゾル・ゲル法などの液相法(CSD法)などの他の薄膜形成法を用いて、形成することもできる。
また、前記実施態様においては、積層体ユニット1は、電極層4上に、ビスマス層状化合物の化学量論的組成式において、m=4、A=Bi+Srとした化学量論的組成式:SrBiTi15で表わされる組成を有するビスマス層状化合物を含む誘電体材料によって形成された誘電体層5を備えているが、電極層4上に、ビスマス層状化合物の化学量論的組成式において、m=4、A=Bi+Srとした化学量論的組成式:SrBiTi15で表わされる組成を有するビスマス層状化合物を含む誘電体材料によって、誘電体層5を形成することは必ずしも必要でなく、mが4以外のビスマス層状化合物を含む誘電体材料によって、誘電体層5を形成することもでき、さらに、構成元素を異にする他のビスマス層状化合物を含む誘電体材料によって、誘電体層5を形成することもできる。
さらに、前記実施態様においては、積層体ユニット1の誘電体層5は、有機金属分解法(metal−organic decomposition:MOD)によって形成されているが、誘電体層5を、有機金属分解法によって形成することは必ずしも必要でなく、真空蒸着法、スパッタリング法、パルスレーザー蒸着法(PLD)、有機金属化学気相成長法(metal−organic chemical vapor deposition:MOCVD)、ゾル・ゲル法などの他の液相法(CSD法)などの他の薄膜形成法によって、誘電体層5を形成することもできる。
また、前記実施態様においては、積層体ユニット1は、薄膜コンデンサの構成部品として、用いられているが、積層体ユニット1は、薄膜コンデンサの構成部品としてだけでなく、無機EL素子を発光させるための積層体ユニットとして用いることもできる。すなわち、無機EL素子を発光させるためには、電極層4と、無機EL素子との間に、絶縁層が必要であるが、c軸配向性が向上されたビスマス層状化合物を含む誘電体材料よりなる誘電体層5は高い絶縁性を有しており、したがって、誘電体層5上に、無機EL素子を配置するとともに、無機EL素子上に、別の電極を配置し、無機EL素子に電圧を加えることによって、無機EL素子を、所望のように、発光させることが可能になる。
本発明によれば、電界効果型トランジスタ(FET)やCPU(Central Processing Unit)などの他のデバイスとともに、半導体ウェハに組み込むのに適した小型で、かつ、大容量の誘電特性に優れた薄膜コンデンサを構成することができる電極層および誘電体層を含む積層体ユニットを提供することが可能になる。

Claims (24)

  1. 半導体ウェハ上に、バリア層と、異方性および導電性を有し、かつ、その上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させることができる材料により、形成され、[001]方位に配向された電極層と、前記電極層上で、ビスマス層状化合物を含む誘電体材料をエピタキシャル成長させて、形成され、[001]方位に配向されたビスマス層状化合物を含む誘電体材料よりなる誘電体層とが、この順に、積層されたことを特徴とする積層体ユニット。
  2. 前記支持基板が、シリコン単結晶によって形成され、前記バリア層が、酸化シリコンによって形成されたことを特徴とする請求の範囲第1項に記載の積層体ユニット。
  3. 前記電極層が、酸化物超伝導体によって形成されていることを特徴とする請求の範囲第1項に記載の積層体ユニット。
  4. 前記電極層が、酸化物超伝導体によって形成されていることを特徴とする請求の範囲第2項に記載の積層体ユニット。
  5. 前記電極層が、CuO面を有する銅酸化物超伝導体によって形成されていることを特徴とする請求の範囲第3項に記載の積層体ユニット。
  6. 前記電極層が、CuO面を有する銅酸化物超伝導体によって形成されていることを特徴とする請求の範囲第4項に記載の積層体ユニット。
  7. 前記電極層が、化学量論的組成式:BiSrCan−1Cu n+4で表わされるBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)および化学量論的組成式:YBaCu−δで表わされるYBCO(イットリウム・ビスマス・カッパー・オキサイド)よりなる群から選ばれたCuO面を有する銅酸化物超伝導体によって形成されていることを特徴とする請求の範囲第5項に記載の積層体ユニット。
  8. 前記電極層が、化学量論的組成式:BiSrCan−1Cu n+4で表わされるBSCCO(ビスマス・ストロンチウム・カルシウム・カッパー・オキサイド)および化学量論的組成式:YBaCu−δで表わされるYBCO(イットリウム・ビスマス・カッパー・オキサイド)よりなる群から選ばれたCuO面を有する銅酸化物超伝導体によって形成されていることを特徴とする請求の範囲第6項に記載の積層体ユニット。
  9. 前記誘電体層が、化学量論的組成式:(Bi2+(Am−13m+12−、あるいは、Bim−13m+3で表わされる組成を有するビスマス層状化合物(記号mは正の整数であり、記号Aは、ナトリウム(Na)、カリウム(K)、鉛(Pb)、バリウム(Ba)、ストロンチウム(Sr)、カルシウム(Ca)およびビスマス(Bi)からなる群より選ばれる少なくとも1つの元素であり、記号Bは、鉄(Fe)、コバルト(Co)、クロム(Cr)、ガリウム(Ga)、チタン(Ti)、ニオブ(Nb)、タンタル(Ta)、アンチモン(Sb)、マンガン(Mn)、バナジウム(V)、モリブデン(Mo)およびタングステン(W)からなる群より選ばれる少なくとも1つの元素である。記号Aおよび/またはBを2つ以上の元素で構成する場合、それらの比率は任意である。)を含んでいることを特徴とする請求の範囲第1項に記載の積層体ユニット。
  10. 前記誘電体層が、化学量論的組成式:(Bi2+(Am−13m+12−、あるいは、Bim−13m+3で表わされる組成を有するビスマス層状化合物(記号mは正の整数であり、記号Aは、ナトリウム(Na)、カリウム(K)、鉛(Pb)、バリウム(Ba)、ストロンチウム(Sr)、カルシウム(Ca)およびビスマス(Bi)からなる群より選ばれる少なくとも1つの元素であり、記号Bは、鉄(Fe)、コバルト(Co)、クロム(Cr)、ガリウム(Ga)、チタン(Ti)、ニオブ(Nb)、タンタル(Ta)、アンチモン(Sb)、マンガン(Mn)、バナジウム(V)、モリブデン(Mo)およびタングステン(W)からなる群より選ばれる少なくとも1つの元素である。記号Aおよび/またはBを2つ以上の元素で構成する場合、それらの比率は任意である。)を含んでいることを特徴とする請求の範囲第2項に記載の積層体ユニット。
  11. 前記誘電体層が、化学量論的組成式:(Bi2+(Am−13m+12−、あるいは、Bim−13m+3で表わされる組成を有するビスマス層状化合物(記号mは正の整数であり、記号Aは、ナトリウム(Na)、カリウム(K)、鉛(Pb)、バリウム(Ba)、ストロンチウム(Sr)、カルシウム(Ca)およびビスマス(Bi)からなる群より選ばれる少なくとも1つの元素であり、記号Bは、鉄(Fe)、コバルト(Co)、クロム(Cr)、ガリウム(Ga)、チタン(Ti)、ニオブ(Nb)、タンタル(Ta)、アンチモン(Sb)、マンガン(Mn)、バナジウム(V)、モリブデン(Mo)およびタングステン(W)からなる群より選ばれる少なくとも1つの元素である。記号Aおよび/またはBを2つ以上の元素で構成する場合、それらの比率は任意である。)を含んでいることを特徴とする請求の範囲第3項に記載の積層体ユニット。
  12. 前記誘電体層が、化学量論的組成式:(Bi2+(Am−13m+12−、あるいは、Bim−13m+3で表わされる組成を有するビスマス層状化合物(記号mは正の整数であり、記号Aは、ナトリウム(Na)、カリウム(K)、鉛(Pb)、バリウム(Ba)、ストロンチウム(Sr)、カルシウム(Ca)およびビスマス(Bi)からなる群より選ばれる少なくとも1つの元素であり、記号Bは、鉄(Fe)、コバルト(Co)、クロム(Cr)、ガリウム(Ga)、チタン(Ti)、ニオブ(Nb)、タンタル(Ta)、アンチモン(Sb)、マンガン(Mn)、バナジウム(V)、モリブデン(Mo)およびタングステン(W)からなる群より選ばれる少なくとも1つの元素である。記号Aおよび/またはBを2つ以上の元素で構成する場合、それらの比率は任意である。)を含んでいることを特徴とする請求の範囲第4項に記載の積層体ユニット。
  13. 前記誘電体層が、化学量論的組成式:(Bi2+(Am−13m+12−、あるいは、Bim−13m+3で表わされる組成を有するビスマス層状化合物(記号mは正の整数であり、記号Aは、ナトリウム(Na)、カリウム(K)、鉛(Pb)、バリウム(Ba)、ストロンチウム(Sr)、カルシウム(Ca)およびビスマス(Bi)からなる群より選ばれる少なくとも1つの元素であり、記号Bは、鉄(Fe)、コバルト(Co)、クロム(Cr)、ガリウム(Ga)、チタン(Ti)、ニオブ(Nb)、タンタル(Ta)、アンチモン(Sb)、マンガン(Mn)、バナジウム(V)、モリブデン(Mo)およびタングステン(W)からなる群より選ばれる少なくとも1つの元素である。記号Aおよび/またはBを2つ以上の元素で構成する場合、それらの比率は任意である。)を含んでいることを特徴とする請求の範囲第5項に記載の積層体ユニット。
  14. 前記誘電体層が、化学量論的組成式:(Bi2+(Am−13m+12−、あるいは、Bim−13m+3で表わされる組成を有するビスマス層状化合物(記号mは正の整数であり、記号Aは、ナトリウム(Na)、カリウム(K)、鉛(Pb)、バリウム(Ba)、ストロンチウム(Sr)、カルシウム(Ca)およびビスマス(Bi)からなる群より選ばれる少なくとも1つの元素であり、記号Bは、鉄(Fe)、コバルト(Co)、クロム(Cr)、ガリウム(Ga)、チタン(Ti)、ニオブ(Nb)、タンタル(Ta)、アンチモン(Sb)、マンガン(Mn)、バナジウム(V)、モリブデン(Mo)およびタングステン(W)からなる群より選ばれる少なくとも1つの元素である。記号Aおよび/またはBを2つ以上の元素で構成する場合、それらの比率は任意である。)を含んでいることを特徴とする請求の範囲第6項に記載の積層体ユニット。
  15. 前記誘電体層が、化学量論的組成式:(Bi2+(Am−13m+12−、あるいは、Bim−13m+3で表わされる組成を有するビスマス層状化合物(記号mは正の整数であり、記号Aは、ナトリウム(Na)、カリウム(K)、鉛(Pb)、バリウム(Ba)、ストロンチウム(Sr)、カルシウム(Ca)およびビスマス(Bi)からなる群より選ばれる少なくとも1つの元素であり、記号Bは、鉄(Fe)、コバルト(Co)、クロム(Cr)、ガリウム(Ga)、チタン(Ti)、ニオブ(Nb)、タンタル(Ta)、アンチモン(Sb)、マンガン(Mn)、バナジウム(V)、モリブデン(Mo)およびタングステン(W)からなる群より選ばれる少なくとも1つの元素である。記号Aおよび/またはBを2つ以上の元素で構成する場合、それらの比率は任意である。)を含んでいることを特徴とする請求の範囲第7項に記載の積層体ユニット。
  16. 前記誘電体層が、化学量論的組成式:(Bi2+(Am−13m+12−、あるいは、Bim−13m+3で表わされる組成を有するビスマス層状化合物(記号mは正の整数であり、記号Aは、ナトリウム(Na)、カリウム(K)、鉛(Pb)、バリウム(Ba)、ストロンチウム(Sr)、カルシウム(Ca)およびビスマス(Bi)からなる群より選ばれる少なくとも1つの元素であり、記号Bは、鉄(Fe)、コバルト(Co)、クロム(Cr)、ガリウム(Ga)、チタン(Ti)、ニオブ(Nb)、タンタル(Ta)、アンチモン(Sb)、マンガン(Mn)、バナジウム(V)、モリブデン(Mo)およびタングステン(W)からなる群より選ばれる少なくとも1つの元素である。記号Aおよび/またはBを2つ以上の元素で構成する場合、それらの比率は任意である。)を含んでいることを特徴とする請求の範囲第8項に記載の積層体ユニット。
  17. 前記誘電体層が、真空蒸着法、スパッタリング法、パルスレーザー蒸着法、有機金属化学気相成長法および有機金属分解法を含む液相法よりなる群から選ばれた薄膜形成法によって形成されたことを特徴とする請求の範囲第9項に記載の積層体ユニット。
  18. 前記誘電体層が、真空蒸着法、スパッタリング法、パルスレーザー蒸着法、有機金属化学気相成長法および有機金属分解法を含む液相法よりなる群から選ばれた薄膜形成法によって形成されたことを特徴とする請求の範囲第10項に記載の積層体ユニット。
  19. 前記誘電体層が、真空蒸着法、スパッタリング法、パルスレーザー蒸着法、有機金属化学気相成長法および有機金属分解法を含む液相法よりなる群から選ばれた薄膜形成法によって形成されたことを特徴とする請求の範囲第11に記載の積層体ユニット。
  20. 前記誘電体層が、真空蒸着法、スパッタリング法、パルスレーザー蒸着法、有機金属化学気相成長法および有機金属分解法を含む液相法よりなる群から選ばれた薄膜形成法によって形成されたことを特徴とする請求の範囲第12項に記載の積層体ユニット。
  21. 前記誘電体層が、真空蒸着法、スパッタリング法、パルスレーザー蒸着法、有機金属化学気相成長法および有機金属分解法を含む液相法よりなる群から選ばれた薄膜形成法によって形成されたことを特徴とする請求の範囲第13項に記載の積層体ユニット。
  22. 前記誘電体層が、真空蒸着法、スパッタリング法、パルスレーザー蒸着法、有機金属化学気相成長法および有機金属分解法を含む液相法よりなる群から選ばれた薄膜形成法によって形成されたことを特徴とする請求の範囲第14項に記載の積層体ユニット。
  23. 前記誘電体層が、真空蒸着法、スパッタリング法、パルスレーザー蒸着法、有機金属化学気相成長法および有機金属分解法を含む液相法よりなる群から選ばれた薄膜形成法によって形成されたことを特徴とする請求の範囲第15項に記載の積層体ユニット。
  24. 前記誘電体層が、真空蒸着法、スパッタリング法、パルスレーザー蒸着法、有機金属化学気相成長法および有機金属分解法を含む液相法よりなる群から選ばれた薄膜形成法によって形成されたことを特徴とする請求の範囲第16項に記載の積層体ユニット。
JP2005502840A 2003-02-26 2004-02-18 電極層および誘電体層を含む積層体ユニット Withdrawn JPWO2004077561A1 (ja)

Applications Claiming Priority (3)

Application Number Priority Date Filing Date Title
US10/375,897 US6885540B2 (en) 2003-02-26 2003-02-26 Multi-layered unit including electrode and dielectric layer
US10/375,897 2003-02-26
PCT/JP2004/001829 WO2004077561A1 (ja) 2003-02-26 2004-02-18 電極層および誘電体層を含む積層体ユニット

Publications (1)

Publication Number Publication Date
JPWO2004077561A1 true JPWO2004077561A1 (ja) 2006-06-08

Family

ID=32869060

Family Applications (1)

Application Number Title Priority Date Filing Date
JP2005502840A Withdrawn JPWO2004077561A1 (ja) 2003-02-26 2004-02-18 電極層および誘電体層を含む積層体ユニット

Country Status (3)

Country Link
US (1) US6885540B2 (ja)
JP (1) JPWO2004077561A1 (ja)
WO (1) WO2004077561A1 (ja)

Families Citing this family (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US20060237760A1 (en) * 2003-02-27 2006-10-26 Tdk Corporation Thin-film capacitative element and electronic circuit and electronic equipment including the same
KR20060114533A (ko) * 2005-05-02 2006-11-07 삼성에스디아이 주식회사 평판 디스플레이 모듈의 장착 구조 및 이를 구비한 평판디스플레이 모듈
JP2007095750A (ja) * 2005-09-27 2007-04-12 Canon Anelva Corp 磁気抵抗効果素子
JP2007287745A (ja) * 2006-04-12 2007-11-01 Seiko Epson Corp 圧電材料および圧電素子
CN110109293A (zh) * 2019-04-04 2019-08-09 深圳市华星光电技术有限公司 液晶无机配向薄膜的制造方法

Family Cites Families (16)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5206788A (en) * 1991-12-12 1993-04-27 Ramtron Corporation Series ferroelectric capacitor structure for monolithic integrated circuits and method
US5248564A (en) 1992-12-09 1993-09-28 Bell Communications Research, Inc. C-axis perovskite thin films grown on silicon dioxide
US5426075A (en) * 1994-06-15 1995-06-20 Ramtron International Corporation Method of manufacturing ferroelectric bismuth layered oxides
JPH08335672A (ja) * 1995-06-05 1996-12-17 Sony Corp 強誘電体不揮発性メモリ
KR100199095B1 (ko) 1995-12-27 1999-06-15 구본준 반도체 메모리 셀의 캐패시터 구조 및 그 제조방법
JP3193302B2 (ja) 1996-06-26 2001-07-30 ティーディーケイ株式会社 膜構造体、電子デバイス、記録媒体および強誘電体薄膜の製造方法
JP3195265B2 (ja) * 1997-01-18 2001-08-06 東京応化工業株式会社 Bi系強誘電体薄膜形成用塗布液およびこれを用いて形成した強誘電体薄膜、強誘電体メモリ
JP3472087B2 (ja) 1997-06-30 2003-12-02 Tdk株式会社 膜構造体、電子デバイス、記録媒体および酸化物導電性薄膜の製造方法
US5994276A (en) 1997-09-08 1999-11-30 Mcmaster University Composite high Tc superconductor film
JP3549715B2 (ja) * 1997-10-15 2004-08-04 日本電気株式会社 Bi層状強誘電体薄膜の製造方法
US6096343A (en) 1997-10-27 2000-08-01 Gerhard Gergely Instant calcium/soybean granules, their use and process for their preparation
JP2001015382A (ja) 1999-06-29 2001-01-19 Kyocera Corp 薄膜コンデンサ
JP2001077323A (ja) * 1999-07-02 2001-03-23 Toshiba Corp 半導体装置の製造方法
US6566698B2 (en) * 2000-05-26 2003-05-20 Sony Corporation Ferroelectric-type nonvolatile semiconductor memory and operation method thereof
JP2003209179A (ja) 2002-01-15 2003-07-25 Fujitsu Ltd 容量素子及びその製造方法
JP4036707B2 (ja) * 2002-08-12 2008-01-23 三洋電機株式会社 誘電体素子および誘電体素子の製造方法

Also Published As

Publication number Publication date
US6885540B2 (en) 2005-04-26
WO2004077561A1 (ja) 2004-09-10
US20040165334A1 (en) 2004-08-26

Similar Documents

Publication Publication Date Title
US6876536B2 (en) Thin film capacitor and method for fabricating the same
JP6859805B2 (ja) 積層体、熱電変換素子
US6891714B2 (en) Multi-layered unit including electrode and dielectric layer
US6930875B2 (en) Multi-layered unit
JPWO2003021615A1 (ja) 薄膜容量素子用組成物、高誘電率絶縁膜、薄膜容量素子および薄膜積層コンデンサ
JPWO2004077561A1 (ja) 電極層および誘電体層を含む積層体ユニット
JP3732631B2 (ja) 強誘電体素子および半導体装置
JPH10270653A (ja) 酸化物積層構造およびその製造方法ならびに強誘電体不揮発性メモリ
US6977806B1 (en) Multi-layered unit including electrode and dielectric layer
US6958900B2 (en) Multi-layered unit including electrode and dielectric layer
JP4142127B2 (ja) 積層薄膜およびその製造方法
US20060237760A1 (en) Thin-film capacitative element and electronic circuit and electronic equipment including the same
JPWO2004077563A1 (ja) 電極層および誘電体層を含む積層体ユニット
US6788522B1 (en) Multi-layered unit including electrode and dielectric layer
JP4230179B2 (ja) ペロブスカイト型酸化膜を含む酸化物積層膜
US7067458B2 (en) Multi-layered unit including electrode and dielectric layer
WO2004077564A1 (ja) 薄膜容量素子ならびにそれを含んだ電子回路および電子機器

Legal Events

Date Code Title Description
A300 Application deemed to be withdrawn because no request for examination was validly filed

Free format text: JAPANESE INTERMEDIATE CODE: A300

Effective date: 20070501