JPS6327941U - - Google Patents

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JPS6327941U
JPS6327941U JP11920786U JP11920786U JPS6327941U JP S6327941 U JPS6327941 U JP S6327941U JP 11920786 U JP11920786 U JP 11920786U JP 11920786 U JP11920786 U JP 11920786U JP S6327941 U JPS6327941 U JP S6327941U
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data bit
pixel
bit configurations
bus
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JP11920786U
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【図面の簡単な説明】
第1図は本考案の一実施例を示すブロツク図、
第2図はLSIデータバスとメモリブロツクの関
係を説明する図、第3図はデータマルチプレクサ
の説明図、第4図は本実施例の動作を示すフロー
チヤート、第5図、第6図は2種類のデータビツ
ト構成を示す図である。 1:ビデオメモリ、2:アドレス・マルチプレ
クサ、3:データ・マルチプレクサ、4:読出し
データ変換回路、5:タイミング・コントローラ
、6:パラレル→シリアル変換回路。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 異なるデータビツト構成を持つ複数の制御
    手段を有するCRT制御用コントローラにおいて
    、前記異なるデータビツト構成間の変換を行う手
    段を設けたことを特徴とするバス変換装置。 (2) 前記異なるデータビツト構成の一方が1ビ
    ツト/1画素でプレーン数nのプレーン方式、他
    方がnビツト/1画素の非プレーン方式であり、
    前記変換手段が前記二方式のバス間に接続された
    マルチプレクサであることを特徴とする、実用新
    案登録請求の範囲第1項記載のバス変換装置。
JP11920786U 1986-08-01 1986-08-01 Pending JPS6327941U (ja)

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JP11920786U JPS6327941U (ja) 1986-08-01 1986-08-01

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JP11920786U JPS6327941U (ja) 1986-08-01 1986-08-01

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JPS6327941U true JPS6327941U (ja) 1988-02-24

Family

ID=31006357

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JP11920786U Pending JPS6327941U (ja) 1986-08-01 1986-08-01

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