JPS5876277U - ビデオ信号発生回路 - Google Patents

ビデオ信号発生回路

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Publication number
JPS5876277U
JPS5876277U JP17135781U JP17135781U JPS5876277U JP S5876277 U JPS5876277 U JP S5876277U JP 17135781 U JP17135781 U JP 17135781U JP 17135781 U JP17135781 U JP 17135781U JP S5876277 U JPS5876277 U JP S5876277U
Authority
JP
Japan
Prior art keywords
address
synchronization signal
character
video signal
generation circuit
Prior art date
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Pending
Application number
JP17135781U
Other languages
English (en)
Inventor
「肉」倉　博久
Original Assignee
沖電気工業株式会社
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Publication date
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Pending legal-status Critical Current

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  • Television Signal Processing For Recording (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のキャラクタパターン図、第２図は本考案
の一実施例を示す回路構成図、第３図および第４図なら
びに第５図は一実施例の動作を説明するための図である
。 １・・・キャラクタの種類指定信号入力端子、２・・・
アドレス制御回路、３・・・垂直同期信号入力端子、４
・・・水平同期信号入力端子、５・・・キャラクタＲＯ
Ｍ、　８・・・シリアルデータ転送回路。

Claims (1)

    【実用新案登録請求の範囲】
  1. 垂直同期信号と水平同期信号に同期した所定のタイミン
    グでキャラクタのアドレスと行のアドレスとを出力する
    アドレス制御回路と、このアドレス制御回路によってア
    ドレス指定され、指定されたアドレスのメモリ内容を出
    力データとして出力するキャラクタＲＯＭと、このキャ
    ラクタＲＯＭの出力データを並列に受は取り、所定のク
    ロックパルスタイミングに従ってシリアルに送出するた
    めのシリアルデータ転送回路とからなり、前記キャラク
    タＲＯＭは、３ビツト×５ビツト、つごう１５ビツトで
    １キヤラクタを形成するごとく構成されたビデオ信号発
    生回路。
JP17135781U 1981-11-19 1981-11-19 ビデオ信号発生回路 Pending JPS5876277U (ja)

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JPS5876277U true JPS5876277U (ja) 1983-05-23

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5099439A (ja) * 1973-12-28 1975-08-07

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5099439A (ja) * 1973-12-28 1975-08-07

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