JPS60116549U - 主・従計算機同期装置 - Google Patents

主・従計算機同期装置

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JPS60116549U
JPS60116549U JP264284U JP264284U JPS60116549U JP S60116549 U JPS60116549 U JP S60116549U JP 264284 U JP264284 U JP 264284U JP 264284 U JP264284 U JP 264284U JP S60116549 U JPS60116549 U JP S60116549U
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JP
Japan
Prior art keywords
reference time
main
slave computer
synchronization device
interrupt processing
Prior art date
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Pending
Application number
JP264284U
Other languages
English (en)
Inventor
能智　政光
Original Assignee
三菱電機株式会社
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Publication date
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Publication of JPS60116549U publication Critical patent/JPS60116549U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は、従来の主・従計算機同期装置を示す図、第２
図はこの考案の一実施例を示す図、第３図は従来の装置
のタイミング図、第４図はこの考案のタイミング図であ
る。 図において１は受信回路、２は基準時間発生回路、３は
基準時間カウンタ、４は割込処理制御回路、５は論理和
回路、１１は同期信号、１２は主計算機同期割込要求信
号、１３は基準時間データ、１４はキャリー出力、１５
は基準時間割込要求信号、１６はリセット信号、１７は
割込処理要求信号、１８は基準時間リセット信号、ａは
主計算機同期割込要求信号１２のタイミング、ｂは基準
時間カウンタ３の値、Ｃはキャリー出力１４のタイミン
グ、ｄは割込処理タイミング、ｅは信号処理タイミング
、ｆは割込受付禁止タイミングである。なお、図中同一
あるいは相当部分には同一符号を付して示しである。

Claims (1)

  1. 【実用新案登録請求の範囲】 主計算機からの同期信号を受信する受信回路と、プログ
    ラムにより任意に時間間隔を設定できる基準時間発生回
    路と、上記受信回路及び上記基準時間発生回路から出力
    される割込要求信号を受けて割込処理の優先順位を決定
    し、その優先順位に従って割込処理要求信号を発生する
    割込処理制御回路とを従計算機に設け、上記受信回路か
    ら上記基準時間発生回路に基準時間リセット信号を与え
    るようにしたことを特徴とする主・従計算機同期装置。 　　　　　−
JP264284U 1984-01-12 1984-01-12 主・従計算機同期装置 Pending JPS60116549U (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006350435A (ja) * 2005-06-13 2006-12-28 Fujitsu Ltd 再同期可能な割込発生回路

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2006350435A (ja) * 2005-06-13 2006-12-28 Fujitsu Ltd 再同期可能な割込発生回路
JP4490337B2 (ja) * 2005-06-13 2010-06-23 富士通マイクロエレクトロニクス株式会社 再同期可能な割込発生回路

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