JPS5948137U - フリツプフロツプ回路 - Google Patents
フリツプフロツプ回路Info
- Publication number
- JPS5948137U JPS5948137U JP10930582U JP10930582U JPS5948137U JP S5948137 U JPS5948137 U JP S5948137U JP 10930582 U JP10930582 U JP 10930582U JP 10930582 U JP10930582 U JP 10930582U JP S5948137 U JPS5948137 U JP S5948137U
- Authority
- JP
- Japan
- Prior art keywords
- flip
- flop circuit
- flop
- reset
- rising edge
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
図は、本考案の一実施例の回路図である。
101〜103・・・フリップフロップ、104〜10
5・・・アンドゲート、106.112・・・セット(
リセット)入力線、107,110・・・セット(リセ
ット)データ入力線、108.111・・・セット(リ
セット)クロック入力線、109・・・初期設定用入力
線、113,114・・・セット(リセット)出力線。
5・・・アンドゲート、106.112・・・セット(
リセット)入力線、107,110・・・セット(リセ
ット)データ入力線、108.111・・・セット(リ
セット)クロック入力線、109・・・初期設定用入力
線、113,114・・・セット(リセット)出力線。
Claims (1)
- フリップフロップ回路において、第1図に示すように、
エツジトリガー型ディレーフリップフロップとアンドゲ
ートとを結線し、フリップフロップのセットをセット信
号の立ち上がりで、リセットをリセット信号の立ち上が
りでそれぞれ行なうことを特徴とするフリップフロップ
回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10930582U JPS5948137U (ja) | 1982-07-21 | 1982-07-21 | フリツプフロツプ回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP10930582U JPS5948137U (ja) | 1982-07-21 | 1982-07-21 | フリツプフロツプ回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS5948137U true JPS5948137U (ja) | 1984-03-30 |
Family
ID=30254673
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP10930582U Pending JPS5948137U (ja) | 1982-07-21 | 1982-07-21 | フリツプフロツプ回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS5948137U (ja) |
-
1982
- 1982-07-21 JP JP10930582U patent/JPS5948137U/ja active Pending
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