JPS5948137U - フリツプフロツプ回路 - Google Patents

フリツプフロツプ回路

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Publication number
JPS5948137U
JPS5948137U JP10930582U JP10930582U JPS5948137U JP S5948137 U JPS5948137 U JP S5948137U JP 10930582 U JP10930582 U JP 10930582U JP 10930582 U JP10930582 U JP 10930582U JP S5948137 U JPS5948137 U JP S5948137U
Authority
JP
Japan
Prior art keywords
flip
flop circuit
flop
reset
rising edge
Prior art date
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Pending
Application number
JP10930582U
Other languages
English (en)
Inventor
明久 深見
Original Assignee
株式会社日立製作所
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Filing date
Publication date
Application filed by 株式会社日立製作所 filed Critical 株式会社日立製作所
Priority to JP10930582U priority Critical patent/JPS5948137U/ja
Publication of JPS5948137U publication Critical patent/JPS5948137U/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図は、本考案の一実施例の回路図である。 １０１〜１０３・・・フリップフロップ、１０４〜１０
５・・・アンドゲート、１０６．１１２・・・セット（
リセット）入力線、１０７，１１０・・・セット（リセ
ット）データ入力線、１０８．１１１・・・セット（リ
セット）クロック入力線、１０９・・・初期設定用入力
線、１１３，１１４・・・セット（リセット）出力線。

Claims (1)

    【実用新案登録請求の範囲】
  1. フリップフロップ回路において、第１図に示すように、
    エツジトリガー型ディレーフリップフロップとアンドゲ
    ートとを結線し、フリップフロップのセットをセット信
    号の立ち上がりで、リセットをリセット信号の立ち上が
    りでそれぞれ行なうことを特徴とするフリップフロップ
    回路。
JP10930582U 1982-07-21 1982-07-21 フリツプフロツプ回路 Pending JPS5948137U (ja)

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JP10930582U JPS5948137U (ja) 1982-07-21 1982-07-21 フリツプフロツプ回路

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Application Number Priority Date Filing Date Title
JP10930582U JPS5948137U (ja) 1982-07-21 1982-07-21 フリツプフロツプ回路

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JPS5948137U true JPS5948137U (ja) 1984-03-30

Family

ID=30254673

Family Applications (1)

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JP10930582U Pending JPS5948137U (ja) 1982-07-21 1982-07-21 フリツプフロツプ回路

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