JPS58158540U - パルス選択回路 - Google Patents

パルス選択回路

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JPS58158540U
JPS58158540U JP5299382U JP5299382U JPS58158540U JP S58158540 U JPS58158540 U JP S58158540U JP 5299382 U JP5299382 U JP 5299382U JP 5299382 U JP5299382 U JP 5299382U JP S58158540 U JPS58158540 U JP S58158540U
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JP
Japan
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pulse
input signal
gate
selection circuit
pulse selection
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Application number
JP5299382U
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English (en)
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JPH026682Y2 (ja
Inventor
勲 大橋
河添　秋雄
江波　健
和田　金三
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沖電気工業株式会社
日本ビクター株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のパルス信号選択回路を示す回路図であり
、第２図は第１図各部の動作波形を示す波形図、第３図
は本考案の第１実施例を示す回路図、第４図は第３図各
部の動作を示す波形図、第５図は本考案の第２実施例と
１７で、第１実施例の第４図とは異った動作波形を第３
図各部に得た場合の波形図である。 １・・・・・・第１パルス信号入力端子、２・・・・・
・第２パルス信号入力端子、３・・・・・・パルス選択
信号入力端子、４・・・・・・インバータ、５・・・・
・・第１ＡＮＤゲート、６・・・・・・第２ＡＮＤゲー
ト、７・・・・・・ＯＲゲート、８・・・・・・パルス
信号出力端子、９・・・・・・バイナリアップカウンタ
、９Ｃ・・・・・・前記バイナリアップカウンタ９のカ
ウント出力端子、９■・・・・・・同カウンタ９のクロ
ックパルス信号入力端子、９Ｒ・・・・・・同カウンタ
９のリセット信号入力端子。 （ａ） ］１′１

Claims (1)

    【実用新案登録請求の範囲】
  1. クロックパルス信号入力端子と第２パルス入力信号が入
    力されるリセット信号入力端子とを備えたバイナリカウ
    ンタと、第１パルス入力信号及び、前記バイナリカウン
    タの反転出力が印加される第１ＡＮＤゲートと、前記第
    １パルス入力信号及び前記バイナリカウンタの出力が印
    加される第２ＡＮＤゲートと、該第２ＡＮＤゲートの出
    力及び前記第２パルス入力信号が印加されるＯＲゲート
    とから成り、該ＯＲゲートの出力は前記第１パルス入力
    信号と前記第２パルス入力信号を選択出力することを特
    徴とするパルス選択回路。
JP5299382U 1982-04-14 1982-04-14 パルス選択回路 Granted JPS58158540U (ja)

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JP5299382U JPS58158540U (ja) 1982-04-14 1982-04-14 パルス選択回路

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JP5299382U JPS58158540U (ja) 1982-04-14 1982-04-14 パルス選択回路

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Publication Number Publication Date
JPS58158540U true JPS58158540U (ja) 1983-10-22
JPH026682Y2 JPH026682Y2 (ja) 1990-02-19

Family

ID=30063675

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS48109844U (ja) * 1972-03-22 1973-12-18

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS48109844U (ja) * 1972-03-22 1973-12-18

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Publication number Publication date
JPH026682Y2 (ja) 1990-02-19

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