JPS60127034U - 波形処理回路 - Google Patents

波形処理回路

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JPS60127034U
JPS60127034U JP1456784U JP1456784U JPS60127034U JP S60127034 U JPS60127034 U JP S60127034U JP 1456784 U JP1456784 U JP 1456784U JP 1456784 U JP1456784 U JP 1456784U JP S60127034 U JPS60127034 U JP S60127034U
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JP
Japan
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output
latch circuit
processing circuit
waveform processing
flop
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JP1456784U
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JPH0543544Y2 (ja
Inventor
新川　和明
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ロ−ム株式会社
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来の波形処理回路を示すブロック図、第２図
は同波形処理回路の動作を説明するための波形図、第３
図はこの考案の１実施例を示す波形処理回路のブーツク
図、第４図は同波形処理回路の動作を説明するための波
形図、第５図は実施例回路を鋸歯状波発生回路に応用し
た場合の従来との比較を示す波形図である。 １１：Ｔ型フリップフロップ、１２：Ｄラッチ回路（第
１）、１３：Ｄラッチ回路（第２）。 （ 爵 第４図　　　− 星 ０Ｓ、　　　　　　　−１ ： ：　　　ｉ　− １Ｅ注Ｊ二一−一−−−−−−−−−−−」１−一一一
一上−−ｊ　　−Ｈ １ｔ２

Claims (1)

    【実用新案登録請求の範囲】
  1. 入力パルスを受ける毎に、第１の論理状態と第２の論理
    状態を交互に出力し、リセット入力端に信号を受けると
    、第２の論理状態に出力が強制されるフリップフロップ
    と、リセット信号を受ケると、このリセット信号を記憶
    する第１のラッチ回−路と、この第１のラッチ回路の記
    憶出力を受け、前記フリップフロップの出力の状態変化
    に応答して前記第１のラッチ回路の出力を記憶し、この
    記憶出力を前記フリップフロップのリセット入力端に入
    力する第２のラッチ回路とからなる波形処理回路。
JP1456784U 1984-02-02 1984-02-02 波形処理回路 Granted JPS60127034U (ja)

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JP1456784U JPS60127034U (ja) 1984-02-02 1984-02-02 波形処理回路

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JP1456784U JPS60127034U (ja) 1984-02-02 1984-02-02 波形処理回路

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Publication Number Publication Date
JPS60127034U true JPS60127034U (ja) 1985-08-27
JPH0543544Y2 JPH0543544Y2 (ja) 1993-11-02

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ID=30499610

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JP1456784U Granted JPS60127034U (ja) 1984-02-02 1984-02-02 波形処理回路

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JPH0543544Y2 (ja) 1993-11-02

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