JPS6030498U - エコ−回路 - Google Patents
エコ−回路Info
- Publication number
- JPS6030498U JPS6030498U JP12345983U JP12345983U JPS6030498U JP S6030498 U JPS6030498 U JP S6030498U JP 12345983 U JP12345983 U JP 12345983U JP 12345983 U JP12345983 U JP 12345983U JP S6030498 U JPS6030498 U JP S6030498U
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- delay
- echo circuit
- parallel
- echo
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図は従来例を示す回路構成図、第2図はその出力波
形を示すグラフ、第3図は本考案の一実施例を示す回路
構成図、第4・図はその出力波形を示すグラフである。 1a・・・入力端子、2a、3a・・・出力端子、4a
、4b・・・反転回路、5a、5b・・・遅延回路、6
a、6b・・・加算器、?a、7b・・・クロック。
形を示すグラフ、第3図は本考案の一実施例を示す回路
構成図、第4・図はその出力波形を示すグラフである。 1a・・・入力端子、2a、3a・・・出力端子、4a
、4b・・・反転回路、5a、5b・・・遅延回路、6
a、6b・・・加算器、?a、7b・・・クロック。
Claims (1)
- 複数の遅延回路を並列配置すると共に、各遅延向路に設
けたクロックによる遅延時間を異ならせ、各遅延回路に
並列配置した反転回路に所定のゲインを与えるように構
成したことを特徴とするエコー回路。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12345983U JPS6030498U (ja) | 1983-08-09 | 1983-08-09 | エコ−回路 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP12345983U JPS6030498U (ja) | 1983-08-09 | 1983-08-09 | エコ−回路 |
Publications (1)
Publication Number | Publication Date |
---|---|
JPS6030498U true JPS6030498U (ja) | 1985-03-01 |
Family
ID=30281810
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP12345983U Pending JPS6030498U (ja) | 1983-08-09 | 1983-08-09 | エコ−回路 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JPS6030498U (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0219942U (ja) * | 1988-07-14 | 1990-02-09 |
-
1983
- 1983-08-09 JP JP12345983U patent/JPS6030498U/ja active Pending
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH0219942U (ja) * | 1988-07-14 | 1990-02-09 |
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